JPS60109102U - デジタル制御回路 - Google Patents

デジタル制御回路

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Publication number
JPS60109102U
JPS60109102U JP20129683U JP20129683U JPS60109102U JP S60109102 U JPS60109102 U JP S60109102U JP 20129683 U JP20129683 U JP 20129683U JP 20129683 U JP20129683 U JP 20129683U JP S60109102 U JPS60109102 U JP S60109102U
Authority
JP
Japan
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flip
circuit
flop
output end
digital control
Prior art date
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Pending
Application number
JP20129683U
Other languages
English (en)
Inventor
菅 敏喜
Original Assignee
株式会社ノーリツ
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Filing date
Publication date
Application filed by 株式会社ノーリツ filed Critical 株式会社ノーリツ
Priority to JP20129683U priority Critical patent/JPS60109102U/ja
Publication of JPS60109102U publication Critical patent/JPS60109102U/ja
Pending legal-status Critical Current

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  • Feedback Control In General (AREA)
  • Safety Devices In Control Systems (AREA)
  • Manipulation Of Pulses (AREA)
  • Logic Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は本考案の一実施例を示すブロック回路図、第2
図はそのタイミングチャートである。 2・・・入力端、3・・・前段フリップフロップ、4・
・・ノア回路、5・・・インバータ、6・・・第1ナン
ド回路、7・・・第2ナンド回路、8・・・後段フリッ
プフロップ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力信号の入力端に、D端子を接続した前段フリップフ
    ロップと、ノア回路と、第1ナンド回路と、当該フリッ
    プフロップの反転出力端と第1ナンド回路の出力端とを
    入力端に接続した第2ナンド回路と、当該第2ナンド回
    路の出力端をD端子に接続した後段フリップフロップと
    を有し、後段フリップフロップの出力端を上記第1ナン
    ド回路、゛ノア回路の入力端と接続し、ノア回路の出力
    端をインバータを介して前段フリップフロップのCL端
    子と、両フリップフロップのCK端子をクロック発生回
    路と接続したデジタル制御回路。
JP20129683U 1983-12-28 1983-12-28 デジタル制御回路 Pending JPS60109102U (ja)

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JP20129683U JPS60109102U (ja) 1983-12-28 1983-12-28 デジタル制御回路

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JPS60109102U true JPS60109102U (ja) 1985-07-24

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017127948A (ja) * 2015-12-29 2017-07-27 上銀科技股▲分▼有限公司 電動グリッパの駆動装置および駆動方法

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5742891B2 (ja) * 1975-04-25 1982-09-11

Patent Citations (1)

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JPS5742891B2 (ja) * 1975-04-25 1982-09-11

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