JPS5952753U - 信号伝達回路 - Google Patents

信号伝達回路

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Publication number
JPS5952753U
JPS5952753U JP14776782U JP14776782U JPS5952753U JP S5952753 U JPS5952753 U JP S5952753U JP 14776782 U JP14776782 U JP 14776782U JP 14776782 U JP14776782 U JP 14776782U JP S5952753 U JPS5952753 U JP S5952753U
Authority
JP
Japan
Prior art keywords
terminal
output terminal
open collector
state inverter
input terminal
Prior art date
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Pending
Application number
JP14776782U
Other languages
English (en)
Inventor
秀一 遠藤
Original Assignee
富士通株式会社
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Filing date
Publication date
Application filed by 富士通株式会社 filed Critical 富士通株式会社
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Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は信号伝達回路の第一の従来例、第２図は同第二
の従来例、また第３図は本考案−実施例を示し、これら
の図において、１は第一のオープンコレクタ論理回路、
３は第二のオープンコレクタ論理回路、１０は第一のＮ
ＡＮＤオープンコレクタ論理素子、１１は第一の３ステ
ートインバータ、１３は第二のＮＡＮＤオープンコレク
タ論理素子、１４は第二の３ステートインバータである
。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第一のオープンコレクタ論理回路と第二のオープンコレ
    クタ論理回路との間に設けられ、第一の入力端子と第二
    の入力端子と出力端子がそれぞれ後記第一の３ステート
    インバータの出力端子と制御端子と入力端子に接続され
    る第一のＮＡＮＤオーブンコレクタ素子と、入力端子が
    前記第一のオープンコレクタ論理回路の出力端子に接続
    される第一の３ステートインバータと、第一の入力端子
    が前記第一の３ステートインバータの出力端子に接続さ
    れ第二の入力端子が後記第二の３ステートインバータの
    制御端子に接続され出力端子が前記第二のオープンコレ
    クタ論理回路の出力端子に接続される第二のＮＡＮＤオ
    ープンコレクタ素子と、入力端子と出力端子がそれぞれ
    前記第二のＮＡＮＤオープンコレクタ素子の出力端子と
    第一の入力端子に接続される第二の３ステートインバー
    タとを備えることを特徴とする信号伝達回路。
JP14776782U 1982-09-29 1982-09-29 信号伝達回路 Pending JPS5952753U (ja)

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JP14776782U JPS5952753U (ja) 1982-09-29 1982-09-29 信号伝達回路

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JPS5952753U true JPS5952753U (ja) 1984-04-06

Family

ID=30328508

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