JPS60192199U - プログラマブル選択回路 - Google Patents
プログラマブル選択回路Info
- Publication number
- JPS60192199U JPS60192199U JP7964284U JP7964284U JPS60192199U JP S60192199 U JPS60192199 U JP S60192199U JP 7964284 U JP7964284 U JP 7964284U JP 7964284 U JP7964284 U JP 7964284U JP S60192199 U JPS60192199 U JP S60192199U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- terminal
- selection circuit
- programmable selection
- outputs
- Prior art date
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- Pending
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- Static Random-Access Memory (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図、第2図は本考案の実施例の回路図、第3図は従
来のものの回路図を示す。 2.3・・・・・・アンド回路、4・・・・・・ノア回
路、5・・・・・・インバータ回路、6・・・・・・ラ
ッチ回路、7・・・・・・アドレスデコーダ、8・・・
・・・インバータ回路、9・・・・・・初期設定を決め
るプル・アップ用抵抗。
来のものの回路図を示す。 2.3・・・・・・アンド回路、4・・・・・・ノア回
路、5・・・・・・インバータ回路、6・・・・・・ラ
ッチ回路、7・・・・・・アドレスデコーダ、8・・・
・・・インバータ回路、9・・・・・・初期設定を決め
るプル・アップ用抵抗。
Claims (1)
- アドレスデコーダ出力の入力するラッチ回路の2つの出
力の一方を第1のアンド回路の一端子に、他方の出力を
第2のアンド回路の一端子に、外部入力を前記第1のア
ンド回路の第2の端子およびインバータを通して前記第
2のアンド回路の第2の端子に、また前記第1および第
2のアンド回路の出力をノア回路に入力することを特徴
とするプログラマブル選択回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP7964284U JPS60192199U (ja) | 1984-05-30 | 1984-05-30 | プログラマブル選択回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP7964284U JPS60192199U (ja) | 1984-05-30 | 1984-05-30 | プログラマブル選択回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60192199U true JPS60192199U (ja) | 1985-12-20 |
Family
ID=30624746
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP7964284U Pending JPS60192199U (ja) | 1984-05-30 | 1984-05-30 | プログラマブル選択回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60192199U (ja) |
-
1984
- 1984-05-30 JP JP7964284U patent/JPS60192199U/ja active Pending
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