JPS5948124U - デジタル可変抵抗出力回路 - Google Patents

デジタル可変抵抗出力回路

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Publication number
JPS5948124U
JPS5948124U JP14412682U JP14412682U JPS5948124U JP S5948124 U JPS5948124 U JP S5948124U JP 14412682 U JP14412682 U JP 14412682U JP 14412682 U JP14412682 U JP 14412682U JP S5948124 U JPS5948124 U JP S5948124U
Authority
JP
Japan
Prior art keywords
output terminal
variable resistance
output
digital variable
output circuit
Prior art date
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Pending
Application number
JP14412682U
Other languages
English (en)
Inventor
塩野　雄
石垣　聰
Original Assignee
日新電機株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の可変抵抗回路の一例の回路図、第２図は
この考案のデジタル可変抵抗回路の一実、施例の回路図
である。 １・・・第１出力端子、２・・・第２出力端子、３・・
・第３出力端子、７・・・レジスタ回路、７ａ〜７ｆ・
・・レジスタ回路の各段、８・・・リレーコイル回路、
８ａ〜８ｆ・・・リレーコイル、ａ〜ｆ・・・ブレーク
接点、ａ′・・・ｆ′・・・メーク接点、Ｒ１〜Ｒ，、
Ｒ□′〜Ｒ６′　・・・抵抗器、１０・・・デジタル可
変抵抗出力回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 デジタル入力値をストレージする２段以上のレジスタ回
    路、そのレジスタ回路の各段の出力に各々ドライブ部が
    接続されかつ各々がブレーク接点部およびメーク接点部
    を有するリレー回路、それらリレー回路の各ブレーク接
    点および各メーク接点にそれぞれ並列接続された抵抗手
    段、および。 第１、第２、第３出力端子を具備し、前記リレ一手段の
    ブレーク接点部またはメーク接点部のいずれか一方は前
    記第１出力端子と第２出力端子間に直列接続されかつ他
    方は第２出力端子と第３出力端子間に直列接続されてな
    るデジタル可変抵抗出力回路。
JP14412682U 1982-09-22 1982-09-22 デジタル可変抵抗出力回路 Pending JPS5948124U (ja)

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JPS5948124U true JPS5948124U (ja) 1984-03-30

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ID=30321493

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JP14412682U Pending JPS5948124U (ja) 1982-09-22 1982-09-22 デジタル可変抵抗出力回路

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006303524A (ja) * 2006-06-08 2006-11-02 Oki Comtec Ltd アバランシェフォトダイオード用バイアス電圧制御回路およびその調整方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006303524A (ja) * 2006-06-08 2006-11-02 Oki Comtec Ltd アバランシェフォトダイオード用バイアス電圧制御回路およびその調整方法

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