JPS6116687U - 表示回路 - Google Patents

表示回路

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JPS6116687U
JPS6116687U JP10190484U JP10190484U JPS6116687U JP S6116687 U JPS6116687 U JP S6116687U JP 10190484 U JP10190484 U JP 10190484U JP 10190484 U JP10190484 U JP 10190484U JP S6116687 U JPS6116687 U JP S6116687U
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JP
Japan
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display circuit
display
terminals
control element
load
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Pending
Application number
JP10190484U
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English (en)
Inventor
敬 岡上
宏之 小出
宏 宮川
Original Assignee
株式会社日立ホームテック
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Publication date
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Priority to JP10190484U priority Critical patent/JPS6116687U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例による表示回路の回路図、第
２図、第３図は従来の表示回路の回路図である。 １・・・制御素子、３， ４． ５・・・表示素子、
９・・・抵抗。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数個の表示素子３， ４． ５に１個の抵抗９を共通
    負荷として接続し、表示素子３， ４． ５の他端子
    をそれぞれ制御素子１の内蔵負荷のない形式の端子に接
    続したことを特徴とする表示回路。
JP10190484U 1984-07-05 1984-07-05 表示回路 Pending JPS6116687U (ja)

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JP10190484U JPS6116687U (ja) 1984-07-05 1984-07-05 表示回路

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JP10190484U JPS6116687U (ja) 1984-07-05 1984-07-05 表示回路

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JPS6116687U true JPS6116687U (ja) 1986-01-30

Family

ID=30661315

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JP10190484U Pending JPS6116687U (ja) 1984-07-05 1984-07-05 表示回路

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