JPS5999299U - 混成集積回路 - Google Patents

混成集積回路

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Publication number
JPS5999299U
JPS5999299U JP19437382U JP19437382U JPS5999299U JP S5999299 U JPS5999299 U JP S5999299U JP 19437382 U JP19437382 U JP 19437382U JP 19437382 U JP19437382 U JP 19437382U JP S5999299 U JPS5999299 U JP S5999299U
Authority
JP
Japan
Prior art keywords
integrated circuit
hybrid integrated
eprom
substrate
utility
Prior art date
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Pending
Application number
JP19437382U
Other languages
English (en)
Inventor
昭雄 斎藤
Original Assignee
日本電気株式会社
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Filing date
Publication date
Application filed by 日本電気株式会社 filed Critical 日本電気株式会社
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Publication of JPS5999299U publication Critical patent/JPS5999299U/ja
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  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図ａは従来の混成集積回路の上面図、同図すはその
正面図、第２図ａは本考案の一実施例の上面図１、同図
すはその正面図、第３図はこの実施例にＥＰＲＯＭライ
タのコンタクトプローブを接触した状態を示す正面図で
ある。 １・・・・・・ＥＰＲＯＭ、２．３・・・・・・制御素
子、４・・・・・・ピン、５・・・・・・セラミック基
板、６・・・・・・再書込みデ　　　　　−−少入力端
子、７・・・・・・コンタクトプローブ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 基板上にＥＰＲＯＭを備える混成集積回路において、前
    記ＥＰＲＯＭの複数のデータ書込み用端子にそれぞれ接
    続されている複数の再書込みデータ入力端子が前記基板
    上に設けであることを特徴とする混成集積回路。
JP19437382U 1982-12-22 1982-12-22 混成集積回路 Pending JPS5999299U (ja)

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JP19437382U JPS5999299U (ja) 1982-12-22 1982-12-22 混成集積回路

Applications Claiming Priority (1)

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JP19437382U JPS5999299U (ja) 1982-12-22 1982-12-22 混成集積回路

Publications (1)

Publication Number Publication Date
JPS5999299U true JPS5999299U (ja) 1984-07-05

Family

ID=30417807

Family Applications (1)

Application Number Title Priority Date Filing Date
JP19437382U Pending JPS5999299U (ja) 1982-12-22 1982-12-22 混成集積回路

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Country Link
JP (1) JPS5999299U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01177698U (ja) * 1988-05-10 1989-12-19

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01177698U (ja) * 1988-05-10 1989-12-19

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