JPS6133149U - 誤り情報除去装置 - Google Patents

誤り情報除去装置

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Publication number
JPS6133149U
JPS6133149U JP11634384U JP11634384U JPS6133149U JP S6133149 U JPS6133149 U JP S6133149U JP 11634384 U JP11634384 U JP 11634384U JP 11634384 U JP11634384 U JP 11634384U JP S6133149 U JPS6133149 U JP S6133149U
Authority
JP
Japan
Prior art keywords
circuit
input terminal
signal
output signal
receives
Prior art date
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Pending
Application number
JP11634384U
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English (en)
Inventor
満 大沼
Original Assignee
株式会社東芝
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図面は本考案の一実施例を示す構成図である。 １２・・・前値記憶回路、１４・・・誤り判定回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電子計算機又はデジタル機器に接続された第１の入力端
    子と、前記電子計算機又はヂジタル機器と並列に運転さ
    れて同一の信号を出力する他の電子計算機又はデジタル
    機器に接続された第２の入力端子と、前記第１の入力端
    子及び前馳第２の入力端子に接続された第１の論理回路
    と、前記第１゜ の入力端子に信号反転回路を介して接
    続され、また前記第２の入力端子にも接続された第２の
    論理回路と、前記第１の入力端子に接続され、また前記
    第２の入力端子にも信号反転回路を介して接続きれた第
    ３の論理積回路と、この第３の論理積回路の出力信号及
    び前記第２の論理積回路の出力信号を入力する第１の論
    理和回路と、この第１の論理和回路の出力信号を入力す
    る第４の論理積回路と、前記第１の論理積回路の出力を
    遅延させる限時回路と、この限時回路の出力信号を入力
    し、また前記第１の論理和回路の出力信号を信号反転回
    路を介して入力する第５の論理積回路と、この第，５の
    論理積回路の出力信号及び前記第４の論理積回路の出力
    信号を入力する第２の論理和回路と、リセット入力端子
    から入力されたリセット信号によってもとの運転状態に
    復帰され、また前記第４の論理積回路にもとの信号を出
    力する前値記憶回路と、この前値記憶回路及び前記第２
    の論理和回路に接続された出力端子とを具備してなる誤
    り情報除去装置。
JP11634384U 1984-07-31 1984-07-31 誤り情報除去装置 Pending JPS6133149U (ja)

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JP11634384U JPS6133149U (ja) 1984-07-31 1984-07-31 誤り情報除去装置

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JPS6133149U true JPS6133149U (ja) 1986-02-28

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