JPS63207178A - プレ−ナ型高耐圧サイリスタ - Google Patents

プレ−ナ型高耐圧サイリスタ

Info

Publication number
JPS63207178A
JPS63207178A JP4070687A JP4070687A JPS63207178A JP S63207178 A JPS63207178 A JP S63207178A JP 4070687 A JP4070687 A JP 4070687A JP 4070687 A JP4070687 A JP 4070687A JP S63207178 A JPS63207178 A JP S63207178A
Authority
JP
Japan
Prior art keywords
type
layer
channel stopper
conductivity type
film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP4070687A
Other languages
English (en)
Inventor
Katsuharu Kitajima
北嶋 勝春
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP4070687A priority Critical patent/JPS63207178A/ja
Publication of JPS63207178A publication Critical patent/JPS63207178A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/70Bipolar devices
    • H01L29/74Thyristor-type devices, e.g. having four-zone regenerative action

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Ceramic Engineering (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Thyristors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、サイリスタの耐圧構造に関し、特に樹脂封止
にて組立てられるサイリスタにおいて、高耐圧を有する
プレーナ形サイリスタ構造を提供することにある。
〔従来の技術〕
従来のプレーナ形サイリスタを第3図に示す。
半導体基板(N型)1の一生面にP型エミッタ層3が全
面に形成され、他主面にP型ベース層2が選択的に形成
され、外周にこれらと同じ導電型の半導体基板深さ方向
に貫通する拡散層8を有する。
又、ベース層2と外周部の拡散層8との間にチャンネル
ストッパ層(N”)4を設け、かつ頭側および逆側の電
圧印加において酸化膜7中の可動イオンが順方向耐圧、
逆方向耐圧へ影@Iをおよぼさないようにチャンネルス
トッパ層4上の酸化膜7が窓明けされた構造となってい
た。さらに層側においてはP型代−ス層2の曲率を緩和
する形でP型フローティングリング5を設けてお夛、P
型代−ス層2内にN型エミツタ層6を有していた。
〔発明が解決し上うとする問題点〕
上述した従来量のプレーナ形サイリスタは層側において
〜900V、逆側において〜5oov程度の耐圧を有す
ることができる。しかし本構造においては、缶ケースに
組立てた場合は耐圧が安定であるが、樹脂封止形に組立
てると耐圧が劣化するなどの不安定な欠点がある。
すなわち、上述した従来のプレーナ形サイリスタの場合
、樹脂封止形に組立てられると電圧を印加した時樹脂中
の等電位線がパシベーション酸化膜7中の可動イオンが
耐圧劣化に働くような電界ベクトル作用となってしまう
為、耐圧の安定性が得られない構造となっていた。
〔問題点を解決するための手段〕
本発明はかかる従来の欠点を解決するために、前述の従
来のブレーナ形サイリスタ構造の半導体基板−主面のN
+チャンネルストッパ上のパシベーション酸化膜窓明は
部チャンネルストッパー幅をオーバーラツプさせた形で
金属薄膜を設けている。
すなわち、本発明によるサイリスタでは、その耐圧構造
は樹脂封止形に組立てられても、樹脂中の等電位線によ
る電界ベクトル方向を制御することによυ、パシベーシ
ョン酸化膜中の可動イオンの横方向への動きを阻止出来
るようにしている。
〔実施例〕
次に、図面を参照して本発明をよシ詳細に説明する。
第1図は本発明の一実施例の縦断面図である。
PNPHの4層よシ成るサイリスタであシ、N型高抵抗
層1の不純物濃度は〜I X 1014cm−” 、 
Pベース層2およびP型フローティング層50表面濃度
は〜lXl0  cm  であシ、拡散深さは40〜4
7μmである。又、P型エミッタ層8はPベース層2と
同一面側ではPベース2の濃度以下の表面濃度を有し、
逆止面側ではPベース層2と同等の表面濃度である。P
型エミッタ層8はN型高抵抗層1を突き抜ける形で設け
られている。更に、P型エミッタ層8とP型代−ス層2
にはさまれる一主面側のN型ベース層1中にP型のフロ
ーティングリング5とP型フローティングリング5とP
型エミッタ層8間のN型高抵抗層1中にN+型チャンネ
ルストッパ一層4が設けられておりN型チャンネルスト
ッパー4上のパシベーション酸化膜7は窓明けの状態と
なっている。
本実施例においては、上述したN+型型中ヤンネルスト
ッパー4上パシベーション酸化膜7の窓明は部分に接し
、その周囲のパッシベーション酸化膜7上に延在してチ
ャネルストッパー4よりも広くN型高抵抗層1上に延び
る形でアルミニウム薄膜9を設けたことによシ第2図(
a) 、 (b)に示した樹脂封止状態での樹脂中の等
電位線10 、10’と電界ベクトルモデル11.11
’となり、アルミニウム薄膜を設けることによシ樹脂中
の等電位線を第2図(b)の等電位線10′のように変
えて、電界ベクトル11′がパシベーション酸化膜7中
の可動イオンの移動に影響しないようにしたことにある
。つtp第2図から上述の内容上のべると、まず第2図
(a)は従来のプレーナ形サイリスタを樹脂封止したも
ので例えば、順方向側に電圧を印加した場合Pベース層
2とN型高抵抗層1の中で空乏層12が広が9樹脂中の
中の等電位線10は第2図(a)に示した状態となり、
この際電界ベクトル11が矢印(太線で示した)の様に
な9、この電界ベクトル11の影響でパシベーション酸
化膜7中の可動イオン12がN+チャンネルストッパ4
近傍によせ集められる為、逆方向側の耐圧が表面の影響
を受けてN型高抵抗層1に広がった空乏層13が表面で
アキュミレション状態を起こし耐圧は劣化する。
これに対し第2図(b)は本発明のVチャンネルストッ
パ上のパシベーション酸化膜7の窓明は部分にアルミニ
ウム薄膜9を形成したものを樹脂封止したもので第2図
(a)と同様に順方向側に電圧を印加した場合樹脂中の
等電位線10′が図に示した様になり、この際の電界ベ
クトル11′は矢印(太線で示した)の様になるためパ
シベーション酸化膜7中の可動イオン移動に寄与しなく
なる為、逆方向側の耐圧は劣化しないことになる。
〔発明の効果〕
以上説明したように、本発明はN+チャンネルストッパ
ー上のパシベーション酸化膜の窓明は部分にアルミニウ
ム薄膜をN+チャンネルストッパー幅よりも広く形成す
ることにより、樹脂封止した場合の樹脂中の等電位線を
制御し、等電位線による電界ベクトルをパシベーション
酸化膜中の可動イオンを電圧印加時に移動させる働きを
阻止することが出来、樹脂封止型高耐圧プレーナサイリ
スタを製造する事が可能となる。
【図面の簡単な説明】
第1図は本発明の一実施例の縦断面図、第2図(a)は
従来のプレーナ型サイリスタの耐圧劣化のモデルを示し
た図、第2図(b)は本発明の一実施例の耐圧劣化のモ
デルを示した図、第3図は従来構造のプレーナ型サイリ
スタの縦断面図である。 1・・・・・・N型高抵抗基板、2・・・・・・P型ベ
ース層、3・・・・・・P型エミッタ一層、4・・・・
・・N+チャンネルストッパ層、5・・・・・・P型フ
ローティングリング、6・・・・・・Nfiエミッタ一
層、7・・・・・・パシベーション酸化膜、8・・・・
・・P−突き抜け層、9・・・・・・アルミニウム薄膜
、10.10’・・・・・・樹脂中の等電位線、11・
11’・・・・・・電界ベクトル、12.13・・・・
・・究乏層。 代理人 弁理士  内 原   晋″″τパ−ミー、。 第1図 第3図 第2図

Claims (1)

    【特許請求の範囲】
  1. 一導電型エミッタ層と他導電型ベース層と前記一導電型
    ベース層と前記他導電型エミツタ層のPNPN4層を有
    し、前記他導電型ベース層には貫通する前記一導電型の
    突き抜け領域を有し、かつ前記一導電型エミッタ層と前
    記一導電型ベース層にはさまれる一主面側の前記他導電
    型ベース層中に前記一導電型のフローティングリングを
    有し、更に前記−導電型フローティングリングと、前記
    一導電型エミッタ層間の前記他導電型ベース領域中に前
    記他導電型のチャンネルストッパ層が設けられかつ該チ
    ャンネルストッパー層上に窓明けされた絶縁膜を有する
    プレーナ型サイリスタにおいて、前記酸化膜の前記チャ
    ンネルストッパー上の窓明けされた部分に該チャンネル
    ストッパーに接して前記酸化膜上に前記チャンネルスト
    ッパーよりも広く延在する導電体膜を有することを特徴
    とするプレーナ型高耐圧サイリスタ。
JP4070687A 1987-02-23 1987-02-23 プレ−ナ型高耐圧サイリスタ Pending JPS63207178A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP4070687A JPS63207178A (ja) 1987-02-23 1987-02-23 プレ−ナ型高耐圧サイリスタ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP4070687A JPS63207178A (ja) 1987-02-23 1987-02-23 プレ−ナ型高耐圧サイリスタ

Publications (1)

Publication Number Publication Date
JPS63207178A true JPS63207178A (ja) 1988-08-26

Family

ID=12588018

Family Applications (1)

Application Number Title Priority Date Filing Date
JP4070687A Pending JPS63207178A (ja) 1987-02-23 1987-02-23 プレ−ナ型高耐圧サイリスタ

Country Status (1)

Country Link
JP (1) JPS63207178A (ja)

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5122379A (ja) * 1974-08-19 1976-02-23 Sony Corp
JPS5152788A (ja) * 1974-11-01 1976-05-10 Mitsubishi Electric Corp Pureenagatahandotaisochi
JPS5778171A (en) * 1980-11-04 1982-05-15 Hitachi Ltd Thyristor
JPS583301U (ja) * 1981-06-30 1983-01-10 セントラル硝子株式会社 複輪タイヤにおける泥付着防止具

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5122379A (ja) * 1974-08-19 1976-02-23 Sony Corp
JPS5152788A (ja) * 1974-11-01 1976-05-10 Mitsubishi Electric Corp Pureenagatahandotaisochi
JPS5778171A (en) * 1980-11-04 1982-05-15 Hitachi Ltd Thyristor
JPS583301U (ja) * 1981-06-30 1983-01-10 セントラル硝子株式会社 複輪タイヤにおける泥付着防止具

Similar Documents

Publication Publication Date Title
US4414560A (en) Floating guard region and process of manufacture for semiconductor reverse conducting switching device using spaced MOS transistors having a common drain region
US4298881A (en) Semiconductor device with double moat and double channel stoppers
JP2007157799A (ja) 半導体装置
JPS6011815B2 (ja) サイリスタ
US3996601A (en) Shorting structure for multilayer semiconductor switching devices
US3994011A (en) High withstand voltage-semiconductor device with shallow grooves between semiconductor region and field limiting rings
JP4532536B2 (ja) 半導体装置
JP6854598B2 (ja) 半導体装置
US4021837A (en) Symmetrical semiconductor switch having carrier lifetime degrading structure
JPS63207178A (ja) プレ−ナ型高耐圧サイリスタ
JP3297087B2 (ja) 高耐圧半導体装置
JP2001237437A (ja) 半導体装置
JP7517206B2 (ja) 電界効果トランジスタ
JP3198757B2 (ja) 静電誘導サイリスタ
JP2839595B2 (ja) 絶縁ゲート付きgtoサイリスタ
JP3106844B2 (ja) 横型絶縁ゲート型バイポーラトランジスタ
JP2021093556A (ja) Rc−igbt半導体装置
JPH0680817B2 (ja) 半導体装置
JP3149483B2 (ja) プレーナ型半導体整流素子
JP2825303B2 (ja) 絶縁ゲート付きgtoサイリスタの製造方法
JPS63174369A (ja) 半導体装置
JP2686125B2 (ja) 静電誘導型スイッチング素子及びその製造方法
JP3007504B2 (ja) 埋込構造を有する半導体素子用ガードリング構造
JPS63292675A (ja) プレ−ナ型サイリスタ
JPH05267649A (ja) 電力用半導体素子