JPS63165766A - A/d変換装置 - Google Patents
A/d変換装置Info
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- JPS63165766A JPS63165766A JP30909986A JP30909986A JPS63165766A JP S63165766 A JPS63165766 A JP S63165766A JP 30909986 A JP30909986 A JP 30909986A JP 30909986 A JP30909986 A JP 30909986A JP S63165766 A JPS63165766 A JP S63165766A
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- 238000000034 method Methods 0.000 claims description 6
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- 238000010586 diagram Methods 0.000 description 3
- GNFTZDOKVXKIBK-UHFFFAOYSA-N 3-(2-methoxyethoxy)benzohydrazide Chemical compound COCCOC1=CC=CC(C(=O)NN)=C1 GNFTZDOKVXKIBK-UHFFFAOYSA-N 0.000 description 1
- FGUUSXIOTUKUDN-IBGZPJMESA-N C1(=CC=CC=C1)N1C2=C(NC([C@H](C1)NC=1OC(=NN=1)C1=CC=CC=C1)=O)C=CC=C2 Chemical compound C1(=CC=CC=C1)N1C2=C(NC([C@H](C1)NC=1OC(=NN=1)C1=CC=CC=C1)=O)C=CC=C2 FGUUSXIOTUKUDN-IBGZPJMESA-N 0.000 description 1
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- 230000033764 rhythmic process Effects 0.000 description 1
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明はデイジタルストレーノオツシロスコープ等に用
いられるA/D変換装置に関する。
いられるA/D変換装置に関する。
(従来技術および問題点)
たとえばデイジタルストレーゾオッシロスコープにおい
て、入力信号の周波数が高くなるにともなって、入力信
号をA / D変換するA/D変換器には変換速度の高
いものを必要とする。
て、入力信号の周波数が高くなるにともなって、入力信
号をA / D変換するA/D変換器には変換速度の高
いものを必要とする。
しかし高速用のサンプルホールド回路の実現が困難であ
ったシする問題点があった。
ったシする問題点があった。
本考案は上記の問題点を解決して高速の変換にも、低速
の変換にも対応することができるA/D変換装置を提供
することを目的とする。
の変換にも対応することができるA/D変換装置を提供
することを目的とする。
(問題点を解決するための手段)
サンプルホールド回路と、 D/A変換器と−D/A変
換器による変換アナログ信号を一方の入力とする比較器
と、入力信号をサンプルホールド回路に導くと共にサン
プルホールド回路の出力を比較器の他方の入力とする第
1位置かまたは入力信号を直接比較器の他方の入力とす
る第2位置かの何nか一方を選択する信号切替手段と、
入力信号の一周期毎に変換時期指定信号を出力する変換
時期指定手段と、変換時期指定手段からの変換時期指定
信号をストローブ信号として比較器の出力を取り込み保
持する保持手段と、D/Ai換器に逐次比較方式にとも
なってディジタルデータを与え、低速変換が指示されて
いるときは信号切替手段に第1位置を選択せしめると共
に比較器の出力にともなってディジタル変換を行ない、
かつ高速変換が指示さ几ているときは信号切替手段に第
2位置を選択せしめると共に保持手段の保持出力にとも
なって変換時期指定信号毎に1ビットのディジタルデー
タに変換を行ない、全ピットの変換終了后変換時期指定
手段からの変換時期指定信号発生時を変更させる変換制
御手段とを備えて、低速変時と高速変換時とのホールド
の方式を異ならしめるようにした。
換器による変換アナログ信号を一方の入力とする比較器
と、入力信号をサンプルホールド回路に導くと共にサン
プルホールド回路の出力を比較器の他方の入力とする第
1位置かまたは入力信号を直接比較器の他方の入力とす
る第2位置かの何nか一方を選択する信号切替手段と、
入力信号の一周期毎に変換時期指定信号を出力する変換
時期指定手段と、変換時期指定手段からの変換時期指定
信号をストローブ信号として比較器の出力を取り込み保
持する保持手段と、D/Ai換器に逐次比較方式にとも
なってディジタルデータを与え、低速変換が指示されて
いるときは信号切替手段に第1位置を選択せしめると共
に比較器の出力にともなってディジタル変換を行ない、
かつ高速変換が指示さ几ているときは信号切替手段に第
2位置を選択せしめると共に保持手段の保持出力にとも
なって変換時期指定信号毎に1ビットのディジタルデー
タに変換を行ない、全ピットの変換終了后変換時期指定
手段からの変換時期指定信号発生時を変更させる変換制
御手段とを備えて、低速変時と高速変換時とのホールド
の方式を異ならしめるようにした。
(作用)
そこで低速変換が指示なさnているときは信号切替手段
は第1位置が選択さn、入力信号はサンプルホールド回
路に導かれ、サンプルホールド回路の出力は比較器の一
方の入力として供給される。
は第1位置が選択さn、入力信号はサンプルホールド回
路に導かれ、サンプルホールド回路の出力は比較器の一
方の入力として供給される。
一方、D/A変換器の入力として逐次比較方式にともな
ってディジタルデータが与えられて、このディジタルデ
ータをアナログ信号に変換した変換アナログ信号レベル
とサンプルホールド回路からの出力信号レベルとが比較
器で比較され、比較器からの比較出力にと本なって、変
換制御手段によシ入力信号がディジタルデータに変換さ
れる。
ってディジタルデータが与えられて、このディジタルデ
ータをアナログ信号に変換した変換アナログ信号レベル
とサンプルホールド回路からの出力信号レベルとが比較
器で比較され、比較器からの比較出力にと本なって、変
換制御手段によシ入力信号がディジタルデータに変換さ
れる。
また一方、高速変換が指示されているときは信号切替手
段は第2位置が選択され、入力信号が直接比較器の一方
の入力として供給される。一方、D/A変換器の入力と
して逐次比較方式にともなってディジタルデータが与え
られて、このディジタルデータをアナログ信号に変換し
た変換アナログ信号レベルと入力信号レベルとが比較器
で比較される。また一方、入力信号の周期毎に変換時期
指定手段から出力される変換時期指定信号をストローブ
信号として比較器の比較出力が保持手段によシ取り込ま
れ、保持される。保持手段からの保持出力にともなって
変換時期指定信号毎に1ビットのディジタルデータに変
換制御手段により変換され、全ビットの変換終了後、変
換時期指定手段からの変換時期指定信号発生時が変換制
御手段によシ変更させられる。
段は第2位置が選択され、入力信号が直接比較器の一方
の入力として供給される。一方、D/A変換器の入力と
して逐次比較方式にともなってディジタルデータが与え
られて、このディジタルデータをアナログ信号に変換し
た変換アナログ信号レベルと入力信号レベルとが比較器
で比較される。また一方、入力信号の周期毎に変換時期
指定手段から出力される変換時期指定信号をストローブ
信号として比較器の比較出力が保持手段によシ取り込ま
れ、保持される。保持手段からの保持出力にともなって
変換時期指定信号毎に1ビットのディジタルデータに変
換制御手段により変換され、全ビットの変換終了後、変
換時期指定手段からの変換時期指定信号発生時が変換制
御手段によシ変更させられる。
したがって、高速変換指定時は入力信号はその1周期毎
に1ビットづつディジタルデータに変換され、たとえば
8ピツトのディジタルデータに変換する場合は8周期間
で入力信号の所定レベルがディジタルデータに変換され
ることになシ、変換速度の高速のものを必要とせず、鍋
速の′に洟にも低速の変換にも対応できる。
に1ビットづつディジタルデータに変換され、たとえば
8ピツトのディジタルデータに変換する場合は8周期間
で入力信号の所定レベルがディジタルデータに変換され
ることになシ、変換速度の高速のものを必要とせず、鍋
速の′に洟にも低速の変換にも対応できる。
また、高速変換が指示されているとき、D/A変換器へ
与えるディジタルデータを順次変化させ、保持回路の出
力が反転したときにD / A変換器へ与えているディ
ジタルデータを変換ディジタルデータとして変換制御手
段から出力するようにしてもよい。この場合は入力信号
の一周期毎に入力信号レベルとD/A変換器で変換され
たアナログレベルと比較されることになり、保持回路の
出力が反転した後、次の変換時期が指定されることにな
る。
与えるディジタルデータを順次変化させ、保持回路の出
力が反転したときにD / A変換器へ与えているディ
ジタルデータを変換ディジタルデータとして変換制御手
段から出力するようにしてもよい。この場合は入力信号
の一周期毎に入力信号レベルとD/A変換器で変換され
たアナログレベルと比較されることになり、保持回路の
出力が反転した後、次の変換時期が指定されることにな
る。
(発明の実施列)
以下、本発明を実施列によシ説明する。
第1図は本発明の一実施例の構成を示すブロック図であ
り、オツシロスコープに適用した場合の例である。
り、オツシロスコープに適用した場合の例である。
人力信号は信号切替スイッチ1に供給し、信号切替スイ
ッチ1と連動して動作する信号切替スイッチ3との切替
えにより、入力信号をサンプルホールド回路2に供給す
るか、ノ々イ/母スするかを選択する。信号切替スイッ
チ3を介して出力される入力信号レベルまたはサンプル
ホールド回路2からの出力信号レベルは比較器4に供給
し、D/A変換器5からの出力アナログ信号レベルと比
較する。
ッチ1と連動して動作する信号切替スイッチ3との切替
えにより、入力信号をサンプルホールド回路2に供給す
るか、ノ々イ/母スするかを選択する。信号切替スイッ
チ3を介して出力される入力信号レベルまたはサンプル
ホールド回路2からの出力信号レベルは比較器4に供給
し、D/A変換器5からの出力アナログ信号レベルと比
較する。
比較器4の比較出力はDフリラグフロップ6にデータと
して供給し、比較器4の出力の反転を検出する。
して供給し、比較器4の出力の反転を検出する。
入力信号はトリだ回路7に供給し、トリ力レベル設定器
7人の設定レベルと入力信号レベルとを比較し、掃引開
始、本実施列におけるA/D変換の開始を指定するトリ
が信号を出力する。トリガ回路7から出力された掃引開
始のトリガ信号は掃引回路8に供給して、掃引回路8に
おいて高速変換時の等価サンプリング行なう場合の基準
となる鋸歯状波を発生する。掃引回w68から出力され
た鋸歯状波は比較器10に供給し、比較器10において
この鋸歯状波レベルとD/A変換器9から出力されるア
ナログ信号レベルとを比較する。比較器10の比較出力
はDフリップフロップ6のクロック信号として供給する
。ここでD/A変換器9には、トリガ位置より所定時間
間隔で後述する制御回路11より測定範囲内にわたって
順次増加するディジタルデータが供給され、等価サンプ
リングを行なうためのトリガ位置より一定間隔のストロ
ーブ信号をD/A変換器9エリ出力させる。
7人の設定レベルと入力信号レベルとを比較し、掃引開
始、本実施列におけるA/D変換の開始を指定するトリ
が信号を出力する。トリガ回路7から出力された掃引開
始のトリガ信号は掃引回路8に供給して、掃引回路8に
おいて高速変換時の等価サンプリング行なう場合の基準
となる鋸歯状波を発生する。掃引回w68から出力され
た鋸歯状波は比較器10に供給し、比較器10において
この鋸歯状波レベルとD/A変換器9から出力されるア
ナログ信号レベルとを比較する。比較器10の比較出力
はDフリップフロップ6のクロック信号として供給する
。ここでD/A変換器9には、トリガ位置より所定時間
間隔で後述する制御回路11より測定範囲内にわたって
順次増加するディジタルデータが供給され、等価サンプ
リングを行なうためのトリガ位置より一定間隔のストロ
ーブ信号をD/A変換器9エリ出力させる。
変換制御回路(以下、制御回路と記す)11は逐次比較
レジスタを備えた制御回路であり、破線で示す如く外部
からのスイッチ12の出力により起動、またはトリガ信
号により起動し、スイッチ12による変換速度指定が低
速変換指示のときは信号切替スイッチ1および3を第1
図に示す接点位置に切替えて、入力信号をサンプルホー
ルド回路2に導くと共に、サンプリングパルをサンプル
ホールド回路2に供給し、比較器4の出力を受けて逐次
比較アルゴリズムに従ってD/A変換器5にディジタル
データを出力する。また、スイッチ12による変換指示
が高速変換指示のときは、制御回路11は信号切替スイ
ッチ1および3を第1図に示す状態から切替えて、サン
プルホールド回路2を切り離し、比較器lOの出力をス
トローブ信号として比較器4の出力をDフリップフロッ
プ6に取り込み、取り込んだ比較器4の出力が反転し念
ときにデータを変化させる逐次比較アルゴリズムに従う
変換を行なうように構成しである。なお、掃引回路8の
1掃引について1回サンプルするtめのタイミングを知
らせるために、掃引回路8からスイープゲート信号を制
御回路11に供給する。
レジスタを備えた制御回路であり、破線で示す如く外部
からのスイッチ12の出力により起動、またはトリガ信
号により起動し、スイッチ12による変換速度指定が低
速変換指示のときは信号切替スイッチ1および3を第1
図に示す接点位置に切替えて、入力信号をサンプルホー
ルド回路2に導くと共に、サンプリングパルをサンプル
ホールド回路2に供給し、比較器4の出力を受けて逐次
比較アルゴリズムに従ってD/A変換器5にディジタル
データを出力する。また、スイッチ12による変換指示
が高速変換指示のときは、制御回路11は信号切替スイ
ッチ1および3を第1図に示す状態から切替えて、サン
プルホールド回路2を切り離し、比較器lOの出力をス
トローブ信号として比較器4の出力をDフリップフロッ
プ6に取り込み、取り込んだ比較器4の出力が反転し念
ときにデータを変化させる逐次比較アルゴリズムに従う
変換を行なうように構成しである。なお、掃引回路8の
1掃引について1回サンプルするtめのタイミングを知
らせるために、掃引回路8からスイープゲート信号を制
御回路11に供給する。
上記の如く構成した本実施例において第2図および第3
図に示すフローチャートにしたがってその作用を説明す
る。
図に示すフローチャートにしたがってその作用を説明す
る。
まず、低速変換が指示されているときは、第2図に示す
フローチャートの如く作用する。
フローチャートの如く作用する。
外部スイッチ12により変換指示がなされ、その変換指
示が低速指示のときは、信号切替スイッチ1および3が
第1図に示す状態に切替えられ、指定され九周期のサン
プリングパルスが制御回路11から出力されて、サンプ
ルホールド回路2が選択され、動作する(ステップa)
。サンプルホールド回路2においてサンプリングされ、
ホールドされ定入力信号は比較器4に供給される。一方
制御回路11からはD/A変換器5にディジタルデータ
が供給されており、D/A変換器5で変換されたアナロ
グ信号レベルと信号切替スイッチ3を介して出力された
サンプルホールド出力レベルとが比較器4で比較され、
比較器4の出力は制御回路11に取り込まれて、比較器
4の出力の状態にともなって次にD/A変換器5に異な
るディジタルデータが与えられる逐次比較アルがリズム
にしたがって入力信号がディジタルデータに変換され(
ステップb)、変換されたディジタルデータは制御回路
11から出力される(ステップC)。
示が低速指示のときは、信号切替スイッチ1および3が
第1図に示す状態に切替えられ、指定され九周期のサン
プリングパルスが制御回路11から出力されて、サンプ
ルホールド回路2が選択され、動作する(ステップa)
。サンプルホールド回路2においてサンプリングされ、
ホールドされ定入力信号は比較器4に供給される。一方
制御回路11からはD/A変換器5にディジタルデータ
が供給されており、D/A変換器5で変換されたアナロ
グ信号レベルと信号切替スイッチ3を介して出力された
サンプルホールド出力レベルとが比較器4で比較され、
比較器4の出力は制御回路11に取り込まれて、比較器
4の出力の状態にともなって次にD/A変換器5に異な
るディジタルデータが与えられる逐次比較アルがリズム
にしたがって入力信号がディジタルデータに変換され(
ステップb)、変換されたディジタルデータは制御回路
11から出力される(ステップC)。
上記の動作が全データにわたって終るまで行なわれる(
ステラ7’d)。
ステラ7’d)。
つぎに高速変換が指定されている場合においては、トリ
ガレベルが設定されると制御回路11が動作し、信号切
替スイッチ1および3は第1図の状態から切替えられて
、サンプルホールド回路2は切り離された状態となる(
ステラ7’e)。つぎに制御回路11からD/A変換器
9にディジタルデータが供給される(ステラff)。一
方、トリガ回路7からのトリガ信号によシ掃引回路8か
ら第4図に示す如き鋸回状波が出力される。この鉱山状
波出力のレベルとD / A変換器9からの出力とは比
較器10にて比較される。したがって、第4図に示す如
(D/A変換器9からのアナログ信号出力は、その縦軸
に対応し、D/A変換器9に与えられるディジタルデー
タ)’1(1=L・・・、n)はyiや1−3’1=Δ
yに設定して、等間隔としである。
ガレベルが設定されると制御回路11が動作し、信号切
替スイッチ1および3は第1図の状態から切替えられて
、サンプルホールド回路2は切り離された状態となる(
ステラ7’e)。つぎに制御回路11からD/A変換器
9にディジタルデータが供給される(ステラff)。一
方、トリガ回路7からのトリガ信号によシ掃引回路8か
ら第4図に示す如き鋸回状波が出力される。この鉱山状
波出力のレベルとD / A変換器9からの出力とは比
較器10にて比較される。したがって、第4図に示す如
(D/A変換器9からのアナログ信号出力は、その縦軸
に対応し、D/A変換器9に与えられるディジタルデー
タ)’1(1=L・・・、n)はyiや1−3’1=Δ
yに設定して、等間隔としである。
ここで鋸歯状波は直線性がよく設定しである。したがっ
て比較器10の出力はトリガ点[0]からyiに対する
時間軸上の位置X−でのパルスとなる。
て比較器10の出力はトリガ点[0]からyiに対する
時間軸上の位置X−でのパルスとなる。
ステップfのこの状態に続いて制御回路11から逐次比
較アルコ9リズムにしたがってでイジタルデータがD/
A変換器5に供給される(ステップg)。
較アルコ9リズムにしたがってでイジタルデータがD/
A変換器5に供給される(ステップg)。
続いてスイープゲート信号により制御回路11は一掃引
が終了したことを判別し、−掃引が終了したと判別され
たときは(ステップh)、D/A変換器5に供給された
ディジタルデータはD / A変換器5にてアナログ信
号に変換されて、そのレベルが入力信号レベルと比較さ
れ、その比較出力は比較器10の出力の立下りにおいて
D7リツプフロツプ6に読み取られ、その読み取った出
力すなわちDフリップフロップ6のQ出力は制御回路1
1に読み込まれて(ステップl)、ついでD/A変換器
5に次のディジタルデータが供給される。
が終了したことを判別し、−掃引が終了したと判別され
たときは(ステップh)、D/A変換器5に供給された
ディジタルデータはD / A変換器5にてアナログ信
号に変換されて、そのレベルが入力信号レベルと比較さ
れ、その比較出力は比較器10の出力の立下りにおいて
D7リツプフロツプ6に読み取られ、その読み取った出
力すなわちDフリップフロップ6のQ出力は制御回路1
1に読み込まれて(ステップl)、ついでD/A変換器
5に次のディジタルデータが供給される。
たとえば8ピツトのディジタルデータに変換する場合は
入力信号の8回のトリガが行なわれる毎に実行され、8
ピツトのディジタルデータに変換される(ステップj@
k)。この状態は第5図に示す如くである。第5図にお
いて、tl・・・t、・・・がトリガ点であり、値pi
がtl・・・t、にて8ピツトのデータへの変換が終る
と、次に制御回路11から新たにトリガ点[0]から7
1+1に対する時間軸上の位置xiや、iでのノタルス
となシ次の値Pi+1が同様に8ピツトのディジタルデ
ータに変換され、全データの変換が終了するまで実行さ
れる(ステップt)。
入力信号の8回のトリガが行なわれる毎に実行され、8
ピツトのディジタルデータに変換される(ステップj@
k)。この状態は第5図に示す如くである。第5図にお
いて、tl・・・t、・・・がトリガ点であり、値pi
がtl・・・t、にて8ピツトのデータへの変換が終る
と、次に制御回路11から新たにトリガ点[0]から7
1+1に対する時間軸上の位置xiや、iでのノタルス
となシ次の値Pi+1が同様に8ピツトのディジタルデ
ータに変換され、全データの変換が終了するまで実行さ
れる(ステップt)。
なお、以上説明した本発明の一実施例においては制御回
路11に逐次比較レジスタを備えて、逐次比較のアルゴ
リズムにしたがって変換を行なう場合を例示したが、高
速変換指示がされているときは、制御回路11によ、9
D/A変換器5に順次増加するディジタルデータを与え
、Dフリップフロップ6のQ出力が反転したときにおけ
るD/A変換器5へ供給しているディジタルデータをデ
ィジタルデータとして出力し、次いでD/A変換器9へ
供給するディジタルデータを増加するようにしてもよい
。
路11に逐次比較レジスタを備えて、逐次比較のアルゴ
リズムにしたがって変換を行なう場合を例示したが、高
速変換指示がされているときは、制御回路11によ、9
D/A変換器5に順次増加するディジタルデータを与え
、Dフリップフロップ6のQ出力が反転したときにおけ
るD/A変換器5へ供給しているディジタルデータをデ
ィジタルデータとして出力し、次いでD/A変換器9へ
供給するディジタルデータを増加するようにしてもよい
。
(発明の効果)
以上説明した如く本発明によれば、A/D変換において
、低速変換のときは通常の場合と同じくサンプルホール
ド9回路で入力信号をサンプルホールドし、その出力を
A / D変換することによりディジタルデータを得、
高速変換のときはサンプルホールド回路を通さずに入力
信号を制御回路から出力されたディジタルデータと比較
し、比較出力をディジタル的にサンプルホールドするよ
うにしたため、広い範囲の周波数の信号をA/D変換す
ることができ、特別に高速で動作會することが必要な構
成要素を必要としない。
、低速変換のときは通常の場合と同じくサンプルホール
ド9回路で入力信号をサンプルホールドし、その出力を
A / D変換することによりディジタルデータを得、
高速変換のときはサンプルホールド回路を通さずに入力
信号を制御回路から出力されたディジタルデータと比較
し、比較出力をディジタル的にサンプルホールドするよ
うにしたため、広い範囲の周波数の信号をA/D変換す
ることができ、特別に高速で動作會することが必要な構
成要素を必要としない。
第1図は本発明の一実施例の構成を示すブロック図。
第2図は本発明の一実施例における低速変換のときの作
用を説明するフローチャート。 第3図は本発明の一実施例における高速変換のときの作
用を説明するフローチャート。 第4図および第5図は本発明の一実施例における高速変
換のときの作用説明に供する線図。 1および3・・・信号切替スイッチ、2・・・サンプル
ホールド回路、4および10・・・比較器、5お工び9
・・・D/A変換器、6・・・Dフリップフロップ、7
・・・トリガ回路、8・・・掃引回路、11・・・制御
回路。 特許出願人 株式会社 ケンウッド 代理人 弁理士 砂 子 信 夫 (ほか1名) 第2図 第3図 トリガ点 第5図
用を説明するフローチャート。 第3図は本発明の一実施例における高速変換のときの作
用を説明するフローチャート。 第4図および第5図は本発明の一実施例における高速変
換のときの作用説明に供する線図。 1および3・・・信号切替スイッチ、2・・・サンプル
ホールド回路、4および10・・・比較器、5お工び9
・・・D/A変換器、6・・・Dフリップフロップ、7
・・・トリガ回路、8・・・掃引回路、11・・・制御
回路。 特許出願人 株式会社 ケンウッド 代理人 弁理士 砂 子 信 夫 (ほか1名) 第2図 第3図 トリガ点 第5図
Claims (2)
- (1)サンプルホールド回路と、D/A変換器と、D/
A変換器による変換アナログ信号を一方の入力とする比
較器と、入力信号をサンプルホールド回路に導くと共に
サンプルホールド回路の出力を比較器の他方の入力とす
る第1位置かまたは入力信号を直接比較器の他方の入力
とする第2位置かの何れか一方を選択する信号切替手段
と、入力信号の一周期毎に変換時期指定信号を出力する
変換時期指定手段と、変換時期指定手段からの変換時期
指定信号をストローブ信号として比較器の出力を取り込
み保持する保持手段と、D/A変換器に逐次比較方式に
ともなってディジタルデータを与え、低速変換が指示さ
れているときは信号切替手段に第1位置を選択せしめる
と共に比較器の出力にともなってディジタル変換を行な
い、かつ高速変換が指示されているときは信号切替手段
に第2装置を選択せしめると共に保持手段の保持出力に
ともなって変換時期指定信号毎に1ビットのディジタル
データに変換を行ない、全ビットの変換終了后変換時期
指定手段からの変換時期指定信号発生時を変更させる変
換制御手段とを備えたA/D変換装置。 - (2)サンプルホールド回路と、D/A変換器と、D/
A変換器による変換アナログ信号を一方の入力とする比
較器と、入力信号をサンプルホールド回路に導くと共に
サンプルホールド回路の出力を比較器の他方の入力とす
る第1位置または入力信号を直接比較器の他方の入力と
する第2位置かの何れか一方を選択する信号切替手段と
、入力信号の一周期毎に変換時期指定信号を出力する変
換時期指定手段と、変換時期指定手段からの変換時期指
定信号をストローブ信号として比較器の出力を取り込み
保持する保持手段と、低速変換が指示されているときは
信号切替手段に第1位置を選択せしめると共にD/A変
換器に逐次比較方式にともなってディジタルデータを与
え、比較器の出力にともなってディジタルデータ変換を
行ない、かつ高速変換が指示されているときは信号切替
手段に第2位置を選択せしめると共にD/A変換器に順
次変化するディジタルデータを与え、保持手段の保持出
力が反転したときにD/A変換器に与えていたディジタ
ルデータを変換データ出力とし、次いで変換時期指定手
段からの変換時期指定信号発生時を変更させる変換制御
手段とを備えたことを特徴とするA/D変換装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30909986A JPH0656392B2 (ja) | 1986-12-27 | 1986-12-27 | A/d変換装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30909986A JPH0656392B2 (ja) | 1986-12-27 | 1986-12-27 | A/d変換装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63165766A true JPS63165766A (ja) | 1988-07-09 |
JPH0656392B2 JPH0656392B2 (ja) | 1994-07-27 |
Family
ID=17988875
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP30909986A Expired - Lifetime JPH0656392B2 (ja) | 1986-12-27 | 1986-12-27 | A/d変換装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0656392B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63191071A (ja) * | 1987-02-03 | 1988-08-08 | Nippon Telegr & Teleph Corp <Ntt> | 繰り返しパルスのレベル測定回路 |
-
1986
- 1986-12-27 JP JP30909986A patent/JPH0656392B2/ja not_active Expired - Lifetime
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63191071A (ja) * | 1987-02-03 | 1988-08-08 | Nippon Telegr & Teleph Corp <Ntt> | 繰り返しパルスのレベル測定回路 |
Also Published As
Publication number | Publication date |
---|---|
JPH0656392B2 (ja) | 1994-07-27 |
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