JPS63138776A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPS63138776A JPS63138776A JP28434886A JP28434886A JPS63138776A JP S63138776 A JPS63138776 A JP S63138776A JP 28434886 A JP28434886 A JP 28434886A JP 28434886 A JP28434886 A JP 28434886A JP S63138776 A JPS63138776 A JP S63138776A
- Authority
- JP
- Japan
- Prior art keywords
- cathode
- electrode
- surface passivation
- passivation film
- chipping
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000004065 semiconductor Substances 0.000 title claims description 3
- 238000002161 passivation Methods 0.000 claims abstract description 19
- 238000009966 trimming Methods 0.000 claims abstract description 9
- 238000000034 method Methods 0.000 abstract 2
- 238000005516 engineering process Methods 0.000 description 3
- 230000015556 catabolic process Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000005336 cracking Methods 0.000 description 1
- 230000002950 deficient Effects 0.000 description 1
Landscapes
- Thyristors (AREA)
- Mechanical Treatment Of Semiconductor (AREA)
- Design And Manufacture Of Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はGTO(ゲートターンオフサイリスタ)の構造
に係り、特に特性不具合のカソードAll!極除去時に
発生するSiカケの防止に好適な半導体装置に関する。
に係り、特に特性不具合のカソードAll!極除去時に
発生するSiカケの防止に好適な半導体装置に関する。
従来のGTO構造は第2rRに示すようにカソードAl
電極2が表面パッシベーション膜3の一部をカソードパ
ターン形状に添って覆っており、特性不具合のカソード
Al電極1を第3図に示すようにトリミングバイト5に
より切削・除去するが。
電極2が表面パッシベーション膜3の一部をカソードパ
ターン形状に添って覆っており、特性不具合のカソード
Al電極1を第3図に示すようにトリミングバイト5に
より切削・除去するが。
このときカソードAl電極1と表面パラパッシベーショ
ン膜との密着した重なり部へ応力が加わり、表面パッシ
ベーション膜及びSiのカケが発生する。しかし、これ
を防止するという点については構造的に配慮されていな
かった。
ン膜との密着した重なり部へ応力が加わり、表面パッシ
ベーション膜及びSiのカケが発生する。しかし、これ
を防止するという点については構造的に配慮されていな
かった。
なお関連する技術としては1例えば、宮入編:サイリス
タ応用ハンドブック、第598頁、日刊工業新聞社発行
、などがある。
タ応用ハンドブック、第598頁、日刊工業新聞社発行
、などがある。
(発明が解決しようとする問題点〕
上記従来技術は表面パッシベーション膜及びSiのカケ
を防止するという点について配慮がされておらず、表面
パッシベーション膜及びSiのカケによりゲート・カソ
ード間耐圧劣化がらアノード・カソード間耐圧劣化に至
るという問題があった。
を防止するという点について配慮がされておらず、表面
パッシベーション膜及びSiのカケによりゲート・カソ
ード間耐圧劣化がらアノード・カソード間耐圧劣化に至
るという問題があった。
本発明の目的は表面パッシベーション膜はもとよりその
下のSiカケを防止する構造を提供することにある。
下のSiカケを防止する構造を提供することにある。
上記目的は従来構造のカソードAΩ電極と表面パッシベ
ーション膜との重なり部をなくし、その間に隙き間を設
け、バイトトリミングにより切削されたAMが逃げるた
めの隙き間として切削時の応力により発生するSiカケ
を防止する構造とすることにより達成される。
ーション膜との重なり部をなくし、その間に隙き間を設
け、バイトトリミングにより切削されたAMが逃げるた
めの隙き間として切削時の応力により発生するSiカケ
を防止する構造とすることにより達成される。
カソードAl電極と表面パッシベーション膜との間の隙
き間はバイトトリミングにより切削されたAfiが逃げ
るための隙き間となり、従来構造のようにカソードAl
電極と表面パッシベーション膜との密着した重なり部に
応力が集中するということがなくなりSiカケが発生し
ない。
き間はバイトトリミングにより切削されたAfiが逃げ
るための隙き間となり、従来構造のようにカソードAl
電極と表面パッシベーション膜との密着した重なり部に
応力が集中するということがなくなりSiカケが発生し
ない。
以下1本発明の一実施例を第1図により説明する6図は
カソードAl電極1と表面パッシベーション膜3との間
にカソードパターン形状に添って隙き間4を設け、この
隙き間4にバイトトリミングにより切削されたカソード
Alが逃げ、表面パッシベーション3はもとよりカソー
ド部のSiカケが防止できる構造になっている。
カソードAl電極1と表面パッシベーション膜3との間
にカソードパターン形状に添って隙き間4を設け、この
隙き間4にバイトトリミングにより切削されたカソード
Alが逃げ、表面パッシベーション3はもとよりカソー
ド部のSiカケが防止できる構造になっている。
本実施例によればバイトトリミング時に発生するSiカ
ケの防止に効果がある。
ケの防止に効果がある。
本発明によれば、バイトトリミング時に発生するSiカ
ケを防止することができる。
ケを防止することができる。
第1図は本発明の一実施例のカソードAl電極と表面、
パッシベーション膜との間に隙き間を設けた構造を示す
縦断面図、第2図は従来の構造を示す縦断面図、第3図
は従来の構造においてバイトトリミングの際にSiが欠
けた状態を示す断面図である。 1・・・カソードAΩ電極、2・・・ゲートAfi電極
、3・・・表面パッシベーション膜、4・・・カソード
Al電極と表面パッシベーション膜との隙き間、5・・
・ト第1図 第2図
パッシベーション膜との間に隙き間を設けた構造を示す
縦断面図、第2図は従来の構造を示す縦断面図、第3図
は従来の構造においてバイトトリミングの際にSiが欠
けた状態を示す断面図である。 1・・・カソードAΩ電極、2・・・ゲートAfi電極
、3・・・表面パッシベーション膜、4・・・カソード
Al電極と表面パッシベーション膜との隙き間、5・・
・ト第1図 第2図
Claims (1)
- 1、平型ゲートターンオフサイリスタにおいてゲート・
カソード間特性不具合のカソードAl電極をバイトトリ
ミングにより切削する際に、カソードAl電極と表面パ
ッシベーション膜の密着した重なり部に切削の応力が加
わり発生する表面パッシベーション膜並びにSiのカケ
を防止するために、カソードAl電極と表面パッシベー
ション膜との重なりをなくし、切削されたカソードAl
が逃げるための隙き間をこのカソードAl電極と表面パ
ッシベーション膜との間に設け、Siカケが発生しない
構造とすることを特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61284348A JPH084135B2 (ja) | 1986-12-01 | 1986-12-01 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61284348A JPH084135B2 (ja) | 1986-12-01 | 1986-12-01 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63138776A true JPS63138776A (ja) | 1988-06-10 |
JPH084135B2 JPH084135B2 (ja) | 1996-01-17 |
Family
ID=17677416
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61284348A Expired - Lifetime JPH084135B2 (ja) | 1986-12-01 | 1986-12-01 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH084135B2 (ja) |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5730376A (en) * | 1980-07-30 | 1982-02-18 | Fujitsu Ltd | Manufacture of schottky barrier fet |
JPS5913372A (ja) * | 1982-07-15 | 1984-01-24 | Hitachi Ltd | 半導体装置 |
JPS5998555A (ja) * | 1982-11-27 | 1984-06-06 | Fuji Electric Corp Res & Dev Ltd | 半導体装置の製造方法 |
JPS62179153A (ja) * | 1986-01-31 | 1987-08-06 | Internatl Rectifier Corp Japan Ltd | サイリスタの製造方法 |
-
1986
- 1986-12-01 JP JP61284348A patent/JPH084135B2/ja not_active Expired - Lifetime
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5730376A (en) * | 1980-07-30 | 1982-02-18 | Fujitsu Ltd | Manufacture of schottky barrier fet |
JPS5913372A (ja) * | 1982-07-15 | 1984-01-24 | Hitachi Ltd | 半導体装置 |
JPS5998555A (ja) * | 1982-11-27 | 1984-06-06 | Fuji Electric Corp Res & Dev Ltd | 半導体装置の製造方法 |
JPS62179153A (ja) * | 1986-01-31 | 1987-08-06 | Internatl Rectifier Corp Japan Ltd | サイリスタの製造方法 |
Also Published As
Publication number | Publication date |
---|---|
JPH084135B2 (ja) | 1996-01-17 |
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