JPS63132434A - 半導体装置の製法 - Google Patents
半導体装置の製法Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
この発明は、絶縁ゲート電界効果トランジスタを有する
集積回路装置(以下MOS型ICと称する)のような半
導体装置及びその製法に関し、特にゲート絶縁膜・〜の
ホットキャリア注入に基づく特性劣化を低減するための
技術に関するものである。
集積回路装置(以下MOS型ICと称する)のような半
導体装置及びその製法に関し、特にゲート絶縁膜・〜の
ホットキャリア注入に基づく特性劣化を低減するための
技術に関するものである。
[発明の概要コ
この発明は、MO3型ICの表面をおおう絶縁膜として
、例えばECR(電子サイクロトロン共鳴)プラズマC
VD (化学気相堆積)法により形成されたシリコン結
合水素(S 1−H)含有量の少ない(5X1021[
個/cm3]以下)のシリコンナイトライド膜を用いた
ことによりゲート絶縁膜へのホットキャリア注入による
トランジスタ特性の劣化を低減するようにしたものであ
る。
、例えばECR(電子サイクロトロン共鳴)プラズマC
VD (化学気相堆積)法により形成されたシリコン結
合水素(S 1−H)含有量の少ない(5X1021[
個/cm3]以下)のシリコンナイトライド膜を用いた
ことによりゲート絶縁膜へのホットキャリア注入による
トランジスタ特性の劣化を低減するようにしたものであ
る。
[従来の技術]
従来、微細化されたMO3型IC(MO3型LS I)
にあっては、ドレイン近傍での電界集中によりゲート絶
縁膜中にホットキャリアが注入されるため素子特性が劣
化することが知られている。
にあっては、ドレイン近傍での電界集中によりゲート絶
縁膜中にホットキャリアが注入されるため素子特性が劣
化することが知られている。
また、この種のMO3型ICにおいて、高岡波プラズマ
CVD法で形成したシリコンナイトライド膜を表面の保
護膜として用いることも知られている。
CVD法で形成したシリコンナイトライド膜を表面の保
護膜として用いることも知られている。
[発明が解決しようとする問題点]
上記のように高周波プラズマCVD法で形成したシリコ
ンナイトライド膜を表面の保護膜として用いた場合、熱
CVD法で形成したPSG (リンケイ酸ガラス)膜を
用いた場合と比較すると、耐湿性が向上する利点はある
が、ホットキャリア注入に基づく特性劣化が顕著になる
という問題点があった。
ンナイトライド膜を表面の保護膜として用いた場合、熱
CVD法で形成したPSG (リンケイ酸ガラス)膜を
用いた場合と比較すると、耐湿性が向上する利点はある
が、ホットキャリア注入に基づく特性劣化が顕著になる
という問題点があった。
通常、高周波プラズマCVD法でシリコンナイトライド
膜を形成する際には、原料ガスとして5iHa及びN)
(3が用いられる。このため、形成されたシリコンナイ
トライド膜中には、多く(20〜30 [atom%J
)の水素が含まれている。そこで、このようなシリコン
ナイトライド膜中の水素がゲート絶縁膜中に拡散してホ
ットキャリアと反応することにより固定電荷や界面準位
が形成されるため特性劣化が顕著になるものと考えられ
ている。
膜を形成する際には、原料ガスとして5iHa及びN)
(3が用いられる。このため、形成されたシリコンナイ
トライド膜中には、多く(20〜30 [atom%J
)の水素が含まれている。そこで、このようなシリコン
ナイトライド膜中の水素がゲート絶縁膜中に拡散してホ
ットキャリアと反応することにより固定電荷や界面準位
が形成されるため特性劣化が顕著になるものと考えられ
ている。
シリコンナイトライド膜中の水素含有量を減らすための
方法として、(1)シリコンナイトライド膜を高温で形
成するか又は形成後高温で熱処理する、(2)NH3ガ
スの代りにN2ガスを用いる、(3)NH3ガスの代り
にN2ガスを用い且っ5iHa ガスの代りに5iFa
、Si0文4のような水素を含まないガスを用いる等の
方法が考えられる。
方法として、(1)シリコンナイトライド膜を高温で形
成するか又は形成後高温で熱処理する、(2)NH3ガ
スの代りにN2ガスを用いる、(3)NH3ガスの代り
にN2ガスを用い且っ5iHa ガスの代りに5iFa
、Si0文4のような水素を含まないガスを用いる等の
方法が考えられる。
しかしながら、(1)の方法によると、AI又はA文合
金からなる配線層を損わないように約450℃以下に温
度条件を設定する必要があるため、水素含有量は15
[atom%]程度までしか低減できず、十分でない。
金からなる配線層を損わないように約450℃以下に温
度条件を設定する必要があるため、水素含有量は15
[atom%]程度までしか低減できず、十分でない。
また、(2)の方法でも、15 [atom%]程度ま
でしか低減できず、不十分である。さらに、(3)の方
法によると、原料ガス中に水素が含まれていないので、
殆ど水素を含まないシリコンナイトライド膜が得られる
が、このシリコンナイトライド膜にはフッ素又は塩素が
含まれており、これがAP等からなる配線層を腐食する
という問題がある。
でしか低減できず、不十分である。さらに、(3)の方
法によると、原料ガス中に水素が含まれていないので、
殆ど水素を含まないシリコンナイトライド膜が得られる
が、このシリコンナイトライド膜にはフッ素又は塩素が
含まれており、これがAP等からなる配線層を腐食する
という問題がある。
[問題点を解決するための手段]
この発明の目的は、配線層を損うことなくホットキャリ
ア注入に基づく特性劣化を低減することにある。
ア注入に基づく特性劣化を低減することにある。
この発明による半導体装置は、表面をおおうシリコンナ
イトライド膜中のシリコン結合水素含有量を5X102
1[個/cm3]以下に設定したことを特徴とするもの
である。
イトライド膜中のシリコン結合水素含有量を5X102
1[個/cm3]以下に設定したことを特徴とするもの
である。
また、この発明による半導体装置の製法は、表面をおお
って上記のようなシリコン結合水素含有量のシリコンナ
イトライド膜を形成するにあたり、ECRプラズマCV
D法を使用することを特徴とするものである。
って上記のようなシリコン結合水素含有量のシリコンナ
イトライド膜を形成するにあたり、ECRプラズマCV
D法を使用することを特徴とするものである。
[作 用]
発明者の研究によれば、ホットキャリア注入に基づく特
性劣化にとって問題となるのは、シリコンナイトライド
膜中の水素のうち、窒素と結合した水素(N −H)で
はなく、シリコンと結合した水素(St−H)であるこ
とが判明した。これは、N−H結合に比べて5i−H結
合の方が結合力が弱く、トランジスタの動作条件下で容
易に水素がシリコンから解離することによるものと推測
される。そこで、シリコンナイトライド膜中の5i−H
含有量を低減すれば、ホットキャリア注入に基づく特性
劣化を低減できることになり、実際上、5i−H含有量
を5X1021[個/c113]以下に設定すれば十分
な特性劣化低減効果が得られることがわかった。
性劣化にとって問題となるのは、シリコンナイトライド
膜中の水素のうち、窒素と結合した水素(N −H)で
はなく、シリコンと結合した水素(St−H)であるこ
とが判明した。これは、N−H結合に比べて5i−H結
合の方が結合力が弱く、トランジスタの動作条件下で容
易に水素がシリコンから解離することによるものと推測
される。そこで、シリコンナイトライド膜中の5i−H
含有量を低減すれば、ホットキャリア注入に基づく特性
劣化を低減できることになり、実際上、5i−H含有量
を5X1021[個/c113]以下に設定すれば十分
な特性劣化低減効果が得られることがわかった。
このような5t−H含有量のシリコンナイトライド膜は
、ECRプラズマCVD法によって簡単に得ることがで
きる。
、ECRプラズマCVD法によって簡単に得ることがで
きる。
[実施例]
第1図は、この発明の一実施例によるMOS型ICのト
ランジスタ部の断面構造を示すものであり、この例では
、トランジスタ部がNチャンネル絶縁ゲート電界効果ト
ランジスタがらなっている。
ランジスタ部の断面構造を示すものであり、この例では
、トランジスタ部がNチャンネル絶縁ゲート電界効果ト
ランジスタがらなっている。
例えばシリコンからなるP型半導体基板の表面には、周
知の選択酸化法によりシリコンオキサイドからなるフィ
ールド絶縁膜12が形成される。このフィールド絶縁膜
12は、トランジスタ配置用の開口部を有し、この開口
部内の基板表面部分には、薄いシリコンオキサイド膜を
熱酸化法で形成した後その上にポリシリコン層を堆積し
てから所望のゲートパターンに従ってポリシリコン層及
びシリコンオキサイド膜をパターニングすることにより
、シリコンオキサイドからなるゲー(・絶縁11々14
及びポリシリコンからなるゲート電極層16が形成され
る。
知の選択酸化法によりシリコンオキサイドからなるフィ
ールド絶縁膜12が形成される。このフィールド絶縁膜
12は、トランジスタ配置用の開口部を有し、この開口
部内の基板表面部分には、薄いシリコンオキサイド膜を
熱酸化法で形成した後その上にポリシリコン層を堆積し
てから所望のゲートパターンに従ってポリシリコン層及
びシリコンオキサイド膜をパターニングすることにより
、シリコンオキサイドからなるゲー(・絶縁11々14
及びポリシリコンからなるゲート電極層16が形成され
る。
ゲート電極層16の両側には、この電極層16及びゲー
ト絶縁膜14の積層とフィールド絶縁膜12とをマスク
としてリン(又はヒ素)を選択的にイオン注入すること
によりゲート電極層16にセルファラインされたN゛゛
ソース領域18及びN゛型トドレイン領域20形成され
る。
ト絶縁膜14の積層とフィールド絶縁膜12とをマスク
としてリン(又はヒ素)を選択的にイオン注入すること
によりゲート電極層16にセルファラインされたN゛゛
ソース領域18及びN゛型トドレイン領域20形成され
る。
基板上面には、例えばCVD法によりPSGからなる層
間絶縁膜22が形成され、この層間絶縁膜22には、ソ
ース用及びドレイン用のコンタクト孔が設けられる。そ
して、スパッタ法等によりAJI又はAM−3i合金を
基板上面に被着した後所望の配線パターンに従って被着
金属をパターニングすることによりソース配線層24及
びドレイン配線層26が形成される。
間絶縁膜22が形成され、この層間絶縁膜22には、ソ
ース用及びドレイン用のコンタクト孔が設けられる。そ
して、スパッタ法等によりAJI又はAM−3i合金を
基板上面に被着した後所望の配線パターンに従って被着
金属をパターニングすることによりソース配線層24及
びドレイン配線層26が形成される。
層間絶縁I々22上には、配線層24及び26をおおう
ようにしてシリコンナイトライドからなる保護膜28が
形成される。保護膜28としてのシリコンナイトライド
膜は、その中の5t−H含有量が5×1Q21 [個/
cm3]以下となるように例えばECRプラズマCVD
法によって形成される。
ようにしてシリコンナイトライドからなる保護膜28が
形成される。保護膜28としてのシリコンナイトライド
膜は、その中の5t−H含有量が5×1Q21 [個/
cm3]以下となるように例えばECRプラズマCVD
法によって形成される。
上記した構成において、トランジスタの動作時には、ド
レイン領域20のゲート近傍部分に電界が集中すること
によりチャンネル領域からゲート絶縁膜14にホットキ
ャリアが注入されることがある。注入されたホットキャ
リアは、しきい値電圧の変動等の特性劣化を生じさせる
ものであるが、これと保護膜28から拡散してきた水素
とが反応すると特性劣化が顕著となる。しかしながら、
この発明によれば、保護膜28中の5t−H含有量を低
く抑えたので、ゲート絶縁膜14に達する水素の量が少
なく、この結果として特性劣化低減効果が得られるもの
である。
レイン領域20のゲート近傍部分に電界が集中すること
によりチャンネル領域からゲート絶縁膜14にホットキ
ャリアが注入されることがある。注入されたホットキャ
リアは、しきい値電圧の変動等の特性劣化を生じさせる
ものであるが、これと保護膜28から拡散してきた水素
とが反応すると特性劣化が顕著となる。しかしながら、
この発明によれば、保護膜28中の5t−H含有量を低
く抑えたので、ゲート絶縁膜14に達する水素の量が少
なく、この結果として特性劣化低減効果が得られるもの
である。
第2図は、特性劣化の5i−H含有は依存性を示すもの
で、横軸は保:JJ膜28としてのシリコンナイトライ
ド膜中の5i−H含有量を示し、縦軸はドレイン電流I
dが10[%]減少するまでのストレス時間を示す。ス
トレス印加は、チャンネル幅W=50[終!l]、チャ
ンネル長I、 = 1.4[鉢mlのトランジスタにお
いて、ドレイン電圧VD=7[Vl 、ゲート電圧VG
=3.2[Vlの条件で行なった。
で、横軸は保:JJ膜28としてのシリコンナイトライ
ド膜中の5i−H含有量を示し、縦軸はドレイン電流I
dが10[%]減少するまでのストレス時間を示す。ス
トレス印加は、チャンネル幅W=50[終!l]、チャ
ンネル長I、 = 1.4[鉢mlのトランジスタにお
いて、ドレイン電圧VD=7[Vl 、ゲート電圧VG
=3.2[Vlの条件で行なった。
第2図によれば、5t−H含有量が多いほどI d (
Vo = 0.1 [Vl、Ve=3[Vlで測定)の
10[%]減少までの時間が短いのに対し、5i−H含
有量が5X1021[個/cm3]以下になると、Id
の10[%]減少までの時間が一定の高い値(約3 X
105[sec])を示すことがわかる。
Vo = 0.1 [Vl、Ve=3[Vlで測定)の
10[%]減少までの時間が短いのに対し、5i−H含
有量が5X1021[個/cm3]以下になると、Id
の10[%]減少までの時間が一定の高い値(約3 X
105[sec])を示すことがわかる。
第3図は、種々の保護膜による特性劣化を示すもので、
横軸はストレス時間を示し、縦軸はIdの減少率を示す
。同図において、破線Aは、高周波プラズマCVD法で
形成したシリコンナイトライド膜を保護膜28として用
いた場合であり、従来例に相当する。また、実線Bは、
ECRプラズマCVD法により5i−H含有量が5×I
CI+[個/cm3]となるように形成したシリコンナ
イトライド膜を保護膜28として用いた場合であり、こ
の発明の実施例に相当する。さらに、一点鎖線Cは、熱
CVD法で形成したPSG膜を保護膜28として用いた
場合であり、いわば目標値に相当する。この線Cの場合
は、耐湿性は劣るが、線Aの場合よりホットキャリア注
入に基づく特性劣化は少ない。
横軸はストレス時間を示し、縦軸はIdの減少率を示す
。同図において、破線Aは、高周波プラズマCVD法で
形成したシリコンナイトライド膜を保護膜28として用
いた場合であり、従来例に相当する。また、実線Bは、
ECRプラズマCVD法により5i−H含有量が5×I
CI+[個/cm3]となるように形成したシリコンナ
イトライド膜を保護膜28として用いた場合であり、こ
の発明の実施例に相当する。さらに、一点鎖線Cは、熱
CVD法で形成したPSG膜を保護膜28として用いた
場合であり、いわば目標値に相当する。この線Cの場合
は、耐湿性は劣るが、線Aの場合よりホットキャリア注
入に基づく特性劣化は少ない。
第3図によれば、この発明による線Bの場合には、はぼ
線Cの場合に匹敵する特性劣化低減効果が得られること
がわかる。
線Cの場合に匹敵する特性劣化低減効果が得られること
がわかる。
第4図は、ECRプラズマCVDにおける5i−H含有
量の圧力依存性を示すもので、横軸がCVD処理時の反
応室の圧力を示し、縦軸がシリコンナイトライド膜中の
5i−H含有量を示す。この場合、原料ガスとして5i
Ha及びN2を用いたものであるが、圧力を約8 X
10−3[Torr]以下に設定すれば、5X1021
[個/Cff13]以下の5t−H含有量が得られるこ
とがわかる。このように低圧下でECRプラズマCVD
処理を行なうと5i−H含有量の少ないシリコンナイ)
・ライド膜が得られるのは、低圧にすることでイオン衝
撃効果が増し、結合力の弱い5i−Hが安定に存在でき
ないためであると推測される。
量の圧力依存性を示すもので、横軸がCVD処理時の反
応室の圧力を示し、縦軸がシリコンナイトライド膜中の
5i−H含有量を示す。この場合、原料ガスとして5i
Ha及びN2を用いたものであるが、圧力を約8 X
10−3[Torr]以下に設定すれば、5X1021
[個/Cff13]以下の5t−H含有量が得られるこ
とがわかる。このように低圧下でECRプラズマCVD
処理を行なうと5i−H含有量の少ないシリコンナイ)
・ライド膜が得られるのは、低圧にすることでイオン衝
撃効果が増し、結合力の弱い5i−Hが安定に存在でき
ないためであると推測される。
このようにしてECRプラズマCVD法により得られた
シリコンナイトライド膜には、水素が存在するとしても
殆どがN−Hの形で存在する。このN−H結合は安定で
あり、トランジスタの動作条件下では水素が容易に解離
しない。従って、このようなシリコンナイトライド膜は
、ホットキャリア注入に基づく特性劣化を効果的に低減
しうるものである。
シリコンナイトライド膜には、水素が存在するとしても
殆どがN−Hの形で存在する。このN−H結合は安定で
あり、トランジスタの動作条件下では水素が容易に解離
しない。従って、このようなシリコンナイトライド膜は
、ホットキャリア注入に基づく特性劣化を効果的に低減
しうるものである。
[発明の効果コ
以上のように、この発明によれば、ゲート部をおおうシ
リコンナイトライド膜中の5t−H含有量を低減するこ
とによりホットキャリア注入に基づく特性劣化を低減し
たので、配線層を害するようなM1成のシリコンナイト
ライド膜を用いたり。
リコンナイトライド膜中の5t−H含有量を低減するこ
とによりホットキャリア注入に基づく特性劣化を低減し
たので、配線層を害するようなM1成のシリコンナイト
ライド膜を用いたり。
シリコンナイトライド膜とゲート絶縁膜との間に木実拡
散阻止用の絶縁膜を介在させたりする必要がなく、低コ
ストで高信頼なMO3型ICを実現できる効果がある。
散阻止用の絶縁膜を介在させたりする必要がなく、低コ
ストで高信頼なMO3型ICを実現できる効果がある。
その上、5t−H含有量の少ないシリコンナイトライド
膜をECRプラズマCVD法によって形成すれば、圧力
その他の条件を適宜設定するだけで熱処理等の追加工程
を要せず簡単に特性劣化低減効果が得られる利点もある
。
膜をECRプラズマCVD法によって形成すれば、圧力
その他の条件を適宜設定するだけで熱処理等の追加工程
を要せず簡単に特性劣化低減効果が得られる利点もある
。
第1図は、この発明の一実施例によるMO3型ICのト
ランジスタ部を示す断面図、 第2図は、特性劣化の5t−H含有量依存性を示すグラ
フ、 第3図は種々の保護膜による特性劣化を示すグラフ、 第4図は、ECRプラズマCVDにおける5i−H含有
量の圧力依存性を示すグラフである。 10・・・半導体基板、12・・・フィールド絶縁膜、
14・・・ゲート絶縁膜、16・・・ゲート電極層、1
8・・・ソース領域、20・・・ドレイン領域、22・
・・層間絶縁膜、24・・・ソース配線層、26・・・
ドレイン配線層、28・・・保護膜。 出願人 日木楽器製造株式会社 代理人 弁理士 伊 沢 敏 昭 =10c%〕 1
ランジスタ部を示す断面図、 第2図は、特性劣化の5t−H含有量依存性を示すグラ
フ、 第3図は種々の保護膜による特性劣化を示すグラフ、 第4図は、ECRプラズマCVDにおける5i−H含有
量の圧力依存性を示すグラフである。 10・・・半導体基板、12・・・フィールド絶縁膜、
14・・・ゲート絶縁膜、16・・・ゲート電極層、1
8・・・ソース領域、20・・・ドレイン領域、22・
・・層間絶縁膜、24・・・ソース配線層、26・・・
ドレイン配線層、28・・・保護膜。 出願人 日木楽器製造株式会社 代理人 弁理士 伊 沢 敏 昭 =10c%〕 1
Claims (1)
- 【特許請求の範囲】 1、半導体基板の表面に絶縁ゲート電界効果トランジス
タを形成し、このトランジスタの表面をシリコンナイト
ライド膜で被覆して成る半導体装置において、 前記シリコンナイトライド膜中のシリコン結合水素含有
量を5×10^2^1[個/cm^3]以下に設定した
ことを特徴とする半導体装置。 2、半導体基板の表面に絶縁ゲート電界効果トランジス
タを形成し、このトランジスタの表面をシリコンナイト
ライド膜で被覆することを含む半導体装置の製法におい
て、 前記シリコンナイトライド膜を、シリコン結合水素含有
量が5×10^2^1[個/cm^3]以下となるよう
に電子サイクロトロン共鳴プラズマ化学気相堆積法によ
り形成することを特徴とする半導体装置の製法。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61279378A JPH0752772B2 (ja) | 1986-11-22 | 1986-11-22 | 半導体装置の製法 |
EP19870117110 EP0269008A3 (en) | 1986-11-22 | 1987-11-19 | Semiconductor device with improved passivation film and process of fabrication thereof |
US07/123,566 US4866003A (en) | 1986-11-22 | 1987-11-20 | Plasma vapor deposition of an improved passivation film using electron cyclotron resonance |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61279378A JPH0752772B2 (ja) | 1986-11-22 | 1986-11-22 | 半導体装置の製法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63132434A true JPS63132434A (ja) | 1988-06-04 |
JPH0752772B2 JPH0752772B2 (ja) | 1995-06-05 |
Family
ID=17610308
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61279378A Expired - Fee Related JPH0752772B2 (ja) | 1986-11-22 | 1986-11-22 | 半導体装置の製法 |
Country Status (3)
Country | Link |
---|---|
US (1) | US4866003A (ja) |
EP (1) | EP0269008A3 (ja) |
JP (1) | JPH0752772B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02234430A (ja) * | 1989-03-08 | 1990-09-17 | Mitsubishi Electric Corp | 半導体装置 |
US6905982B2 (en) | 2001-05-15 | 2005-06-14 | Renesas Technology Corp. | Method of manufacturing a semiconductor integrated circuit device |
WO2006080153A1 (ja) * | 2005-01-28 | 2006-08-03 | Nec Corporation | 半導体受光素子及びその製造方法 |
Families Citing this family (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5264724A (en) * | 1989-02-13 | 1993-11-23 | The University Of Arkansas | Silicon nitride for application as the gate dielectric in MOS devices |
EP0569470B1 (en) * | 1991-01-30 | 1999-04-07 | Minnesota Mining And Manufacturing Company | Process for making a polysilicon thin film transistor |
US5254480A (en) * | 1992-02-20 | 1993-10-19 | Minnesota Mining And Manufacturing Company | Process for producing a large area solid state radiation detector |
US5332689A (en) * | 1993-02-17 | 1994-07-26 | Micron Technology, Inc. | Method for depositing low bulk resistivity doped films |
EP0739037B1 (en) * | 1993-08-05 | 2000-10-25 | Matsushita Electronics Corporation | Semiconductor device having capacitor and manufacturing method thereof |
US5633202A (en) * | 1994-09-30 | 1997-05-27 | Intel Corporation | High tensile nitride layer |
JPH0982588A (ja) * | 1995-09-12 | 1997-03-28 | Denso Corp | 窒化物の直接接合方法及びその直接接合物 |
JP3432997B2 (ja) * | 1996-04-23 | 2003-08-04 | 株式会社東芝 | 半導体装置に使用する絶縁膜 |
JP2000311992A (ja) * | 1999-04-26 | 2000-11-07 | Toshiba Corp | 不揮発性半導体記憶装置およびその製造方法 |
US6228777B1 (en) | 1999-06-08 | 2001-05-08 | Intel Corporation | Integrated circuit with borderless contacts |
RU2216818C1 (ru) * | 2003-01-28 | 2003-11-20 | Общество с ограниченной ответственностью "ЭпиЛаб" | Эцр-плазменный источник для обработки полупроводниковых структур, способ обработки полупроводниковых структур, способ изготовления полупроводниковых приборов и интегральных схем (варианты), полупроводниковый прибор или интегральная схема (варианты) |
US7382421B2 (en) * | 2004-10-12 | 2008-06-03 | Hewlett-Packard Development Company, L.P. | Thin film transistor with a passivation layer |
AU2006318589A1 (en) * | 2005-11-25 | 2007-05-31 | Vesta Research Ltd. | Process for producing a silicon nitride compound |
CA2740244A1 (en) * | 2010-01-27 | 2011-07-27 | Sumitomo Electric Industries, Ltd. | Silicon carbide semiconductor device and method of manufacturing thereof |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61154171A (ja) * | 1984-12-27 | 1986-07-12 | Toshiba Corp | 絶縁ゲ−ト型電界効果半導体装置 |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5519850A (en) * | 1978-07-31 | 1980-02-12 | Hitachi Ltd | Semiconductor |
CA1159012A (en) * | 1980-05-02 | 1983-12-20 | Seitaro Matsuo | Plasma deposition apparatus |
JPS57176746A (en) * | 1981-04-21 | 1982-10-30 | Nippon Telegr & Teleph Corp <Ntt> | Semiconductor integrated circuit and manufacture thereof |
US4564997A (en) * | 1981-04-21 | 1986-01-21 | Nippon-Telegraph And Telephone Public Corporation | Semiconductor device and manufacturing process thereof |
JPH0635323B2 (ja) * | 1982-06-25 | 1994-05-11 | 株式会社日立製作所 | 表面処理方法 |
JPS5946648A (ja) * | 1982-09-10 | 1984-03-16 | Nippon Telegr & Teleph Corp <Ntt> | メンブレンの製造方法 |
JPS60107841A (ja) * | 1983-11-16 | 1985-06-13 | Hitachi Ltd | 窒化シリコン膜の形成方法 |
JPS60214532A (ja) * | 1984-04-11 | 1985-10-26 | Nippon Telegr & Teleph Corp <Ntt> | パタ−ン形成方法 |
-
1986
- 1986-11-22 JP JP61279378A patent/JPH0752772B2/ja not_active Expired - Fee Related
-
1987
- 1987-11-19 EP EP19870117110 patent/EP0269008A3/en not_active Ceased
- 1987-11-20 US US07/123,566 patent/US4866003A/en not_active Expired - Lifetime
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61154171A (ja) * | 1984-12-27 | 1986-07-12 | Toshiba Corp | 絶縁ゲ−ト型電界効果半導体装置 |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02234430A (ja) * | 1989-03-08 | 1990-09-17 | Mitsubishi Electric Corp | 半導体装置 |
US6905982B2 (en) | 2001-05-15 | 2005-06-14 | Renesas Technology Corp. | Method of manufacturing a semiconductor integrated circuit device |
WO2006080153A1 (ja) * | 2005-01-28 | 2006-08-03 | Nec Corporation | 半導体受光素子及びその製造方法 |
JP4894752B2 (ja) * | 2005-01-28 | 2012-03-14 | 日本電気株式会社 | 半導体受光素子及びその製造方法 |
US8148229B2 (en) | 2005-01-28 | 2012-04-03 | Nec Corporation | Method for manufacturing a semiconductor light-receiving device |
Also Published As
Publication number | Publication date |
---|---|
EP0269008A2 (en) | 1988-06-01 |
US4866003A (en) | 1989-09-12 |
JPH0752772B2 (ja) | 1995-06-05 |
EP0269008A3 (en) | 1991-01-02 |
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LAPS | Cancellation because of no payment of annual fees |