JPS6288335A - 半導体装置における素子間分離方法 - Google Patents
半導体装置における素子間分離方法Info
- Publication number
- JPS6288335A JPS6288335A JP23061385A JP23061385A JPS6288335A JP S6288335 A JPS6288335 A JP S6288335A JP 23061385 A JP23061385 A JP 23061385A JP 23061385 A JP23061385 A JP 23061385A JP S6288335 A JPS6288335 A JP S6288335A
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- Japan
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- side wall
- region
- silicon substrate
- photoresist layer
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は半導体装置の製造方法、特に例えばMO8型半
導体装置において、各能動素子間を絶縁する素子間分離
方法の改良に関するものである。
導体装置において、各能動素子間を絶縁する素子間分離
方法の改良に関するものである。
〈従来の技術〉
例えば、シリコンを半導体として用いた半導体装置、特
にMO8型半導体装置において、各能動素子を分離する
だめの素子分離方法としては、従来、第2図(a)〜(
j)に示す方法が用いられている。
にMO8型半導体装置において、各能動素子を分離する
だめの素子分離方法としては、従来、第2図(a)〜(
j)に示す方法が用いられている。
即ち、まず第2図(a)に示すシリコン基板21の表面
22上に、熱酸化法によって酸化シリコン層23を形成
させ、この酸化シリコン71J23(D上に化学的気相
成長法(CVD法)によって窒化シリコン層24を形成
し第2図(b) K示す構造が得られる。次に写真蝕刻
法により窒化シリコン層24上に所望のパターンのフォ
[・レジスト層25を形成させ、第2図(c)に示す構
造が得られる。次にこのフォトレジスト層25をマスク
と1〜で窒化シリコン層24をリアクチブ・イオン壷エ
ツチング法(RIE法)によってエツチング処理し、第
2図(d)に示すような構造とする。次いで第2図(e
)に示すように、素子分離領域にフィールド反転防止の
ためにシリコン基板21と同一導電型の不純物、例えば
p形基板の場合は硼素イオンB+をイオン注入して硼素
イオン注入層26を形成させる。その後フォトレジスト
層25を溶解し第2図rf)に示す構造を得る。次に得
られた基板を高温で長時間熱酸化処理することにより厚
い酸化膜27を形成させて第2図(g)に示す構造を得
る。この場合酸化膜27は窒化シリコン層24の下方1
で形成される。次に窒化シリコン層24をRIE法によ
って除去し第2図(h)に示す構造が得られる。次に弗
酸系の緩衝液に浸漬して厚い酸化膜27の一部と薄い酸
化膜23を除いて第2図(j)に示す構造とする。
22上に、熱酸化法によって酸化シリコン層23を形成
させ、この酸化シリコン71J23(D上に化学的気相
成長法(CVD法)によって窒化シリコン層24を形成
し第2図(b) K示す構造が得られる。次に写真蝕刻
法により窒化シリコン層24上に所望のパターンのフォ
[・レジスト層25を形成させ、第2図(c)に示す構
造が得られる。次にこのフォトレジスト層25をマスク
と1〜で窒化シリコン層24をリアクチブ・イオン壷エ
ツチング法(RIE法)によってエツチング処理し、第
2図(d)に示すような構造とする。次いで第2図(e
)に示すように、素子分離領域にフィールド反転防止の
ためにシリコン基板21と同一導電型の不純物、例えば
p形基板の場合は硼素イオンB+をイオン注入して硼素
イオン注入層26を形成させる。その後フォトレジスト
層25を溶解し第2図rf)に示す構造を得る。次に得
られた基板を高温で長時間熱酸化処理することにより厚
い酸化膜27を形成させて第2図(g)に示す構造を得
る。この場合酸化膜27は窒化シリコン層24の下方1
で形成される。次に窒化シリコン層24をRIE法によ
って除去し第2図(h)に示す構造が得られる。次に弗
酸系の緩衝液に浸漬して厚い酸化膜27の一部と薄い酸
化膜23を除いて第2図(j)に示す構造とする。
次弓で再度熱酸化処理して全面に酸化膜を形成させて第
2図(j)に示すように厚い酸化膜27で分離された素
子形成領域28が形成される。次いでこのようにして得
られた素子形成領域28上に所望の素子を形成させて半
導体装置が製造される。
2図(j)に示すように厚い酸化膜27で分離された素
子形成領域28が形成される。次いでこのようにして得
られた素子形成領域28上に所望の素子を形成させて半
導体装置が製造される。
〈発明が解決しようとする問題点〉
しかし上記の従来法では、第2図(g)〜(j)に示さ
れているように、素子形成領域28はフォトレジスト層
25でマスクされた面積よりも狭くなっているので、素
子を高密度化できなめ。丑だ、第2図(j)に示すよう
に基板21上に大きな段差が生じるため、素子形成領域
28 にに配置する配線の断線や写真蝕刻法によるパタ
ーンの加工精度が低下しゃすい○更には、フィールド反
転防止のためにイオン注入さハた不純物が、その後の高
温熱酸化処理により素子形成領域28に寸で拡散し、そ
の結果能動素子のしきい値電圧の制御が不可能になり、
半導体装置の動作不良を発生させるなどの欠点がある。
れているように、素子形成領域28はフォトレジスト層
25でマスクされた面積よりも狭くなっているので、素
子を高密度化できなめ。丑だ、第2図(j)に示すよう
に基板21上に大きな段差が生じるため、素子形成領域
28 にに配置する配線の断線や写真蝕刻法によるパタ
ーンの加工精度が低下しゃすい○更には、フィールド反
転防止のためにイオン注入さハた不純物が、その後の高
温熱酸化処理により素子形成領域28に寸で拡散し、そ
の結果能動素子のしきい値電圧の制御が不可能になり、
半導体装置の動作不良を発生させるなどの欠点がある。
この発明は上記のような問題点を改善するためになされ
たもので、絶縁性に優れ、平坦な構造を有する高密度の
半導体装置の素子分離方法を提供することを目的とする
ものである。
たもので、絶縁性に優れ、平坦な構造を有する高密度の
半導体装置の素子分離方法を提供することを目的とする
ものである。
〈問題点を解決するための手段〉
上記の目的を達成するため、本発明の半導体装置におけ
る素子間分離方法は、半導体基板の素子形成領域上に、
(II!I壁部を有するマスク材を形成する工程と、上
記のマスク材を用いて上記の半導体基板の素子分離領域
をエツチングして、この半導体基板に傾斜を有する溝部
を形成する工程と、次いで上記のマスク材の側壁部のみ
を選択的に除去し、上記の溝部で四重れた上記の半導体
表面の素子形成領域表面の周辺部を露呈せしめる工程と
、次いで上記の側壁部を除去したマスク材を用いて上記
の半導体基板の素子分離領域及び素子形成領域表面の周
辺部にこの半導体基板と同一導電型の不純物をイオン注
入する工程と、次いで上記の側壁部を除去したマスク材
をエツチングした後、絶縁膜を形成し、平坦化法により
上記の素子分離領域と素子形成領域を平坦にする工程と
、しかる後に上記の素子形成領域に所望の素子を形成す
る工程とを備える」=うに構成している。
る素子間分離方法は、半導体基板の素子形成領域上に、
(II!I壁部を有するマスク材を形成する工程と、上
記のマスク材を用いて上記の半導体基板の素子分離領域
をエツチングして、この半導体基板に傾斜を有する溝部
を形成する工程と、次いで上記のマスク材の側壁部のみ
を選択的に除去し、上記の溝部で四重れた上記の半導体
表面の素子形成領域表面の周辺部を露呈せしめる工程と
、次いで上記の側壁部を除去したマスク材を用いて上記
の半導体基板の素子分離領域及び素子形成領域表面の周
辺部にこの半導体基板と同一導電型の不純物をイオン注
入する工程と、次いで上記の側壁部を除去したマスク材
をエツチングした後、絶縁膜を形成し、平坦化法により
上記の素子分離領域と素子形成領域を平坦にする工程と
、しかる後に上記の素子形成領域に所望の素子を形成す
る工程とを備える」=うに構成している。
なおこの発明を適用できる半導体基板としては、シリコ
ン、ガリウム砒素、ガリウムアルミニウム砒素などの半
導体基板が挙げられる。
ン、ガリウム砒素、ガリウムアルミニウム砒素などの半
導体基板が挙げられる。
〈実施例〉
次に本発明を図面を参照して実施例によって説明するが
、本発明を限定するものではない。
、本発明を限定するものではない。
第1図(a)〜(h)はそれぞれ、本発明の一実施例の
各工程を示したものである。
各工程を示したものである。
まず第1図(a)に示すように比抵抗20Ω”QMのP
形(100)シリコン基板1の表面2−]−に通常の写
真蝕刻工程を行うことにより、所要のフォトレジスト層
3を形成し、次いで、波長が250nm以下の遠紫外光
照射を同図(b)に示すように施す。
形(100)シリコン基板1の表面2−]−に通常の写
真蝕刻工程を行うことにより、所要のフォトレジスト層
3を形成し、次いで、波長が250nm以下の遠紫外光
照射を同図(b)に示すように施す。
次いで同図(c)に示すように、フォトレジスト層4を
全面塗布し、次いで、反応性イオンエツチングを行うこ
とにより、同図(d)に示すようVc11111W部5
を例えば03μm幅形成する。
全面塗布し、次いで、反応性イオンエツチングを行うこ
とにより、同図(d)に示すようVc11111W部5
を例えば03μm幅形成する。
続いて、上記側壁部5を有するフォトレジスト3をマス
クとしてシリコン基板1を深さ06μm横1JL7i)
lで021ノ+n fil 、tff−反1.ト7、
すノ1イ副ンエノチ/ダ法によって」ノヂング1−2、
素子−分離領域6((n、’+1旧を有する溝部を同図
(e)のように形成する1、次い−rギンレン等の有機
溶剤に浸漬f /′、〕(二、l−(・(下より、上記
側壁部5を選択的に除去し1.71J:Iン屋板1の素
子1(e M):fr(i域表面の周il)部7を・露
Vさせ、同図(f)に示−J−ようにり(台するフォ1
N・′)スト層3をマスクとしてシリコン基&Iと同ス
、q電jl;1.1の4く紳物である硼素16を例えば
I X ] O”twr ”稈IJI (−dン注入す
る1、この特上d[シ素子形成領域表面の周辺部7およ
び傾斜をイJする溝部6には11771人層8が同時に
形成さノする5゜ 次にプラズマエツチングをMIIずことにより、1記フ
ォトl/シスト層3を・除去し2、次い−(゛同図(g
) VC示すようにCV■)/IX、によりシリ:1ン
酸化膜9を例λ−ば07ノ7m堆積する。
クとしてシリコン基板1を深さ06μm横1JL7i)
lで021ノ+n fil 、tff−反1.ト7、
すノ1イ副ンエノチ/ダ法によって」ノヂング1−2、
素子−分離領域6((n、’+1旧を有する溝部を同図
(e)のように形成する1、次い−rギンレン等の有機
溶剤に浸漬f /′、〕(二、l−(・(下より、上記
側壁部5を選択的に除去し1.71J:Iン屋板1の素
子1(e M):fr(i域表面の周il)部7を・露
Vさせ、同図(f)に示−J−ようにり(台するフォ1
N・′)スト層3をマスクとしてシリコン基&Iと同ス
、q電jl;1.1の4く紳物である硼素16を例えば
I X ] O”twr ”稈IJI (−dン注入す
る1、この特上d[シ素子形成領域表面の周辺部7およ
び傾斜をイJする溝部6には11771人層8が同時に
形成さノする5゜ 次にプラズマエツチングをMIIずことにより、1記フ
ォトl/シスト層3を・除去し2、次い−(゛同図(g
) VC示すようにCV■)/IX、によりシリ:1ン
酸化膜9を例λ−ば07ノ7m堆積する。
続いてエッチバック法などの−qz坦化処理を行い同図
(h)のJ:’5な構jGを得る。
(h)のJ:’5な構jGを得る。
次いで通常の工程により素子形成領域IOに素子を形成
1゛ることにより半導体装置が完成するこc”、、
i(−:l る4゜ 尚、ff1liシ1(f)で素−J’l杉成領域周辺部
を露星して・イー4ン1′1人を行うi″jijjij
山d部(・ζお(する寄生チャネルを防庄することにあ
る。
1゛ることにより半導体装置が完成するこc”、、
i(−:l る4゜ 尚、ff1liシ1(f)で素−J’l杉成領域周辺部
を露星して・イー4ン1′1人を行うi″jijjij
山d部(・ζお(する寄生チャネルを防庄することにあ
る。
上記の方法によhは素子Jfり成領域が狭くならないた
め、素子の高密度化か17丁能J−4、る。さらに、マ
スク?4の側壁を利用すること(・rよ1つ、素子形成
領域表面の周辺部1に素イ分離領域に同時に1」ン汀入
が可能であり、素子分離領域の溝部の反転時11および
溝側壁部の寄l−1−チャネ19を防1ヒすることか■
1能である。さらに、平、1Hな構造を実現できるため
、配線の断線防子−や写真蝕刻法による高精度IJt+
、、Iがril能であるC、さらには、素子分離領域
の形成に高温で長時間の熱酸化処理11’、!がt要な
/′rcめ、工程の簡略化とともに、フィールド反転時
[1,のための不純物の拡散を防止でき、能動素子のし
きい値電圧の制御が可?tf’(となり良好な半導体装
置を実現できる等多くの利点を有する。さらにNチャネ
ルMO8)ランジスタに限らず各種の半導体装置に適用
できるのは勿論のことである。、〈発明の効果5 以上のように本発明の方lノζは次のような利点を、イ
jする。
め、素子の高密度化か17丁能J−4、る。さらに、マ
スク?4の側壁を利用すること(・rよ1つ、素子形成
領域表面の周辺部1に素イ分離領域に同時に1」ン汀入
が可能であり、素子分離領域の溝部の反転時11および
溝側壁部の寄l−1−チャネ19を防1ヒすることか■
1能である。さらに、平、1Hな構造を実現できるため
、配線の断線防子−や写真蝕刻法による高精度IJt+
、、Iがril能であるC、さらには、素子分離領域
の形成に高温で長時間の熱酸化処理11’、!がt要な
/′rcめ、工程の簡略化とともに、フィールド反転時
[1,のための不純物の拡散を防止でき、能動素子のし
きい値電圧の制御が可?tf’(となり良好な半導体装
置を実現できる等多くの利点を有する。さらにNチャネ
ルMO8)ランジスタに限らず各種の半導体装置に適用
できるのは勿論のことである。、〈発明の効果5 以上のように本発明の方lノζは次のような利点を、イ
jする。
(i) 素子形成領域が従来のように狭くならないの
で素子を高密度化できる。
で素子を高密度化できる。
(ji) マスク材の側壁を利Illすることに」:
す、素子形成領域表面の周辺部と素子分離領域に同時に
イオン注入が可能であり、その結呆素子分HL領域の溝
部の反転時IF及び溝側壁部の寄生チャネルの防止台−
行うことができる。
す、素子形成領域表面の周辺部と素子分離領域に同時に
イオン注入が可能であり、その結呆素子分HL領域の溝
部の反転時IF及び溝側壁部の寄生チャネルの防止台−
行うことができる。
(iii) ”17−坦な構造を実現できるので、配
線の断線防止や写真蝕刻法による高梢勇゛加「ができる
、。
線の断線防止や写真蝕刻法による高梢勇゛加「ができる
、。
(iv)素r分離領域の形成eζ高温で長時間の熱酸化
処理7[程がf要なため、]゛桿の簡略化とともに、フ
ィールド反転防止のだ、117)の不純物の拡散を防止
できて能動素子のしきい価電圧の制御が可能となり良好
な半導体層を装置を製造″J′ることかできる。
処理7[程がf要なため、]゛桿の簡略化とともに、フ
ィールド反転防止のだ、117)の不純物の拡散を防止
できて能動素子のしきい価電圧の制御が可能となり良好
な半導体層を装置を製造″J′ることかできる。
第1図(a、)乃至(h) ?;支子れぞh本発明の方
法の一実施例り示すT稈5(P、同図、第2図(a)乃
至(j)は+hぞit従来ノ)法を21−1す丁稈説明
図である。 1 シリコン基板、2・・7リコン基板表+rii、3
・・フォトレジスト層、5 ・側壁部、6・・4f分離
領域、7・・素子1F成領域表面周辺部、8・・−f
Aン注入層、10・・素子形成領域3、 代理人 弁J′l1IIτ 福 −L 愛 彦(他2名
)・−ん
起「
↑第2図
法の一実施例り示すT稈5(P、同図、第2図(a)乃
至(j)は+hぞit従来ノ)法を21−1す丁稈説明
図である。 1 シリコン基板、2・・7リコン基板表+rii、3
・・フォトレジスト層、5 ・側壁部、6・・4f分離
領域、7・・素子1F成領域表面周辺部、8・・−f
Aン注入層、10・・素子形成領域3、 代理人 弁J′l1IIτ 福 −L 愛 彦(他2名
)・−ん
起「
↑第2図
Claims (1)
- 【特許請求の範囲】 1、半導体基板の素子形成領域上に側壁部を有するマス
ク材を形成する工程と、 上記マスク材を用い上記半導体基板の素子分離領域をエ
ッチングして該半導体基板に傾斜を有する溝部を形成す
る工程と、 次いで上記マスク材の側壁部のみを選択的に除去し上記
溝部で囲まれた上記半導体表面の素子形成領域表面の周
辺部を露呈せしめる工程と、次いで上記側壁部を除去し
たマスク材を用い上記半導体基板の素子分離領域及び素
子形成領域表面の周辺部に該半導体基板と同一導電型の
不純物をイオン注入する工程と、 次いで上記側壁部を除去したマスク材をエッチングした
後、絶縁膜を形成し、平坦化法により上記素子分離領域
と素子形成領域を平坦にする工程と、 しかるのち上記素子形成領域に所望の素子を形成する工
程と を具備したことを特徴とする半導体装置における素子間
分離方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23061385A JPS6288335A (ja) | 1985-10-14 | 1985-10-14 | 半導体装置における素子間分離方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23061385A JPS6288335A (ja) | 1985-10-14 | 1985-10-14 | 半導体装置における素子間分離方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6288335A true JPS6288335A (ja) | 1987-04-22 |
Family
ID=16910505
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP23061385A Pending JPS6288335A (ja) | 1985-10-14 | 1985-10-14 | 半導体装置における素子間分離方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6288335A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0529881U (ja) * | 1991-09-30 | 1993-04-20 | マツダ株式会社 | 自動車の前部車体構造 |
-
1985
- 1985-10-14 JP JP23061385A patent/JPS6288335A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0529881U (ja) * | 1991-09-30 | 1993-04-20 | マツダ株式会社 | 自動車の前部車体構造 |
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