JPS6257258B2 - - Google Patents
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- JPS6257258B2 JPS6257258B2 JP56111947A JP11194781A JPS6257258B2 JP S6257258 B2 JPS6257258 B2 JP S6257258B2 JP 56111947 A JP56111947 A JP 56111947A JP 11194781 A JP11194781 A JP 11194781A JP S6257258 B2 JPS6257258 B2 JP S6257258B2
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Description
【発明の詳細な説明】
本発明はモノリシツク集積回路を搭載する容器
の構造に関するものであり、特に容器のメタライ
ズ構造に関するものである。
の構造に関するものであり、特に容器のメタライ
ズ構造に関するものである。
近年、IC,LSIの発展は目覚ましいものがあ
り、高密度、高速化が急速に進められている。集
積度をさらに上げる為、素子は微細化され、より
高速化の為、種々の工夫が施こされている。しか
しながら、これらの素子はチツプ内部の電源ノイ
ズや配線間のクロストーク等に敏感に反応する様
になり、誤動作や発振しやすくなつている。特に
多数本の出力を有する場合が多いデバイス、例え
ば、1チツプCPU(Central Processer Unit)
や、スタテイツクRAM及びROM等は出力が同時
にスイツチングする際、負荷電流及び回路的に発
生するラツシユ電流の大電流スイツチが行なわ
れ、これにより、誘起される電源ノイズが入力回
路に伝達され、誤動作や発振を生ずる場合があ
る。
り、高密度、高速化が急速に進められている。集
積度をさらに上げる為、素子は微細化され、より
高速化の為、種々の工夫が施こされている。しか
しながら、これらの素子はチツプ内部の電源ノイ
ズや配線間のクロストーク等に敏感に反応する様
になり、誤動作や発振しやすくなつている。特に
多数本の出力を有する場合が多いデバイス、例え
ば、1チツプCPU(Central Processer Unit)
や、スタテイツクRAM及びROM等は出力が同時
にスイツチングする際、負荷電流及び回路的に発
生するラツシユ電流の大電流スイツチが行なわ
れ、これにより、誘起される電源ノイズが入力回
路に伝達され、誤動作や発振を生ずる場合があ
る。
これらの高速回路の場合、一般に、配線にのる
ノイズは配線系のインダクタンス成分によつて誘
起されるもので、この寄生的インダクタンスは、
チツプと容器を含めたICの場合様々な要素から
成り基板実装状態においては、基板上配線とソケ
ツトのリード線があり、IC側からはチツプ搭載
用の容器の外部端子と内部リード線及び内部リー
ド線とチツプとを結ぶボンデイング線がある。
ノイズは配線系のインダクタンス成分によつて誘
起されるもので、この寄生的インダクタンスは、
チツプと容器を含めたICの場合様々な要素から
成り基板実装状態においては、基板上配線とソケ
ツトのリード線があり、IC側からはチツプ搭載
用の容器の外部端子と内部リード線及び内部リー
ド線とチツプとを結ぶボンデイング線がある。
これらの寄生的なインダクタンスによつて誘起
されるノイズがICに及ぼす悪影響を最小限に抑
えるのに、これまでにユーザー側及びメーカー側
両面から多くの努力が払われてきた。例えば、ユ
ーザー側からは、ICの実装において多層配線構
造の基板を導入する事で電源線を面状に出来、従
つて電源配線のインダクタンスを小さく抑える事
が可能となつた。一方、メーカー側からは、設計
段階で色々の工夫をしているが、従来から行なわ
れている有効な対策手段として、入力回路と出力
回路のGND分離法も一方策として実用されてい
る。
されるノイズがICに及ぼす悪影響を最小限に抑
えるのに、これまでにユーザー側及びメーカー側
両面から多くの努力が払われてきた。例えば、ユ
ーザー側からは、ICの実装において多層配線構
造の基板を導入する事で電源線を面状に出来、従
つて電源配線のインダクタンスを小さく抑える事
が可能となつた。一方、メーカー側からは、設計
段階で色々の工夫をしているが、従来から行なわ
れている有効な対策手段として、入力回路と出力
回路のGND分離法も一方策として実用されてい
る。
第1図は入力回路と出力回路のGND分離法を
説明するための集積回路の容器およびそれに搭載
した集積回路チツプの斜視図である。第1図にお
いて、集積回路容器1には、ピン番号1から16
までの16本の外部端子1p〜16pが両側に8本
づつ分かれて一列に設けられ、各外部端子は容器
内のメタライズ配線で形成された内部リード3
3,……にそれぞれつながれ、内部リードの他端
はワイヤ5により集積回路チツプ2のボンデイン
グパツド4,4,……に接続されている。外部端
子のうち、ピン番号8の外部端子8pはGND端
子で、これにつながつている内部リード3の他端
は2本のワイヤ5aと5bでもつて、集積回路チ
ツプの入力回路GNDパツドと出力回路GNDパツ
ドにそれぞれ分かれて接続されている。
説明するための集積回路の容器およびそれに搭載
した集積回路チツプの斜視図である。第1図にお
いて、集積回路容器1には、ピン番号1から16
までの16本の外部端子1p〜16pが両側に8本
づつ分かれて一列に設けられ、各外部端子は容器
内のメタライズ配線で形成された内部リード3
3,……にそれぞれつながれ、内部リードの他端
はワイヤ5により集積回路チツプ2のボンデイン
グパツド4,4,……に接続されている。外部端
子のうち、ピン番号8の外部端子8pはGND端
子で、これにつながつている内部リード3の他端
は2本のワイヤ5aと5bでもつて、集積回路チ
ツプの入力回路GNDパツドと出力回路GNDパツ
ドにそれぞれ分かれて接続されている。
このように、2本のワイヤでチツプ上の入力回
路と出力回路用のGNDを分離し、それぞれのパ
ツトからボンデイングをし、内部リードのボンデ
イング台において接続を行うと、出力回路スイツ
チングの際の大電流スイツチと外部端子、内部リ
ード、ボンデイングワイヤ、そして出力回路用
GND線が有する寄生インダクタンスによつて誘
起されたノイズが、チツプ上で入力回路と出力回
路のGNDを同一にした場合より入力回路に伝わ
りにくく、誤動作や発振が抑制される。すなわ
ち、チツプ上で入力回路と出力回路のGNDを分
離する方法は、寄生インダクタンスによつて誘起
されるノイズ悪影響を抑える方法として有効な手
段である。
路と出力回路用のGNDを分離し、それぞれのパ
ツトからボンデイングをし、内部リードのボンデ
イング台において接続を行うと、出力回路スイツ
チングの際の大電流スイツチと外部端子、内部リ
ード、ボンデイングワイヤ、そして出力回路用
GND線が有する寄生インダクタンスによつて誘
起されたノイズが、チツプ上で入力回路と出力回
路のGNDを同一にした場合より入力回路に伝わ
りにくく、誤動作や発振が抑制される。すなわ
ち、チツプ上で入力回路と出力回路のGNDを分
離する方法は、寄生インダクタンスによつて誘起
されるノイズ悪影響を抑える方法として有効な手
段である。
しかしながら、これまで説明した従来からの手
段では、ボンデイング台よりチツプ側への寄生イ
ンダクタンスによつて誘起されるノイズの悪影響
を抑えただけで、内部リード及び外部端子の有す
る寄生インダクタンスによつて誘起されるノイズ
は依然として残り、これらにより誤動作や発振が
起こる恐れがある。
段では、ボンデイング台よりチツプ側への寄生イ
ンダクタンスによつて誘起されるノイズの悪影響
を抑えただけで、内部リード及び外部端子の有す
る寄生インダクタンスによつて誘起されるノイズ
は依然として残り、これらにより誤動作や発振が
起こる恐れがある。
本発明の目的は、少なくとも内部リードの有す
る寄生インダクタンスによつて誘起されるノイズ
を抑え、誤動作や発振の起こりにくいモノリシツ
ク集積回路のための容器を提供するものである。
る寄生インダクタンスによつて誘起されるノイズ
を抑え、誤動作や発振の起こりにくいモノリシツ
ク集積回路のための容器を提供するものである。
本発明では、接地電位のような電源電位が与え
られる内部リードの表面積を他の内部リードより
も大きくしている。さらに本発明では、電源用内
部リードにつながる電源用外部端子の幅を他の外
部端子よりも大きくすることを好ましい実施態様
としている。
られる内部リードの表面積を他の内部リードより
も大きくしている。さらに本発明では、電源用内
部リードにつながる電源用外部端子の幅を他の外
部端子よりも大きくすることを好ましい実施態様
としている。
つぎに本発明を実施例により説明する。
第2図は本発明の一実施例の集積回路容器に集
積回路チツプを搭載した斜視図である。第2図に
おいて、本発明の集積回路容器11では、ピン番
号8の外部端子8p′につながる内部リード3aの
平均線幅を拡げて面積を大きくとり、そして隣接
外部端子7p′を実装上問題のならないように小さ
くしている。
積回路チツプを搭載した斜視図である。第2図に
おいて、本発明の集積回路容器11では、ピン番
号8の外部端子8p′につながる内部リード3aの
平均線幅を拡げて面積を大きくとり、そして隣接
外部端子7p′を実装上問題のならないように小さ
くしている。
このようにGND用内部リード3aの表面積を
他の内部リードより大きくしているので、GND
用内部リードが有する寄生インダンスによつて誘
起されるノイズが大巾に抑えられる。しかも、
GND用外部端子8p′の幅も大きくしているの
で、誘起されるノイズはさらに小さくなる。すな
わち、出力回路スイツチングの際の大電流スイツ
チと外部端子、内部リード、ボンデイング線そし
てGND線が有する寄生インダクタンスによつて
誘起されたノイズの内、外部端子と内部リードが
有する寄生インダクタンスによつて誘起されるノ
イズを大巾に抑えることができる。もちろん、前
記説明した従来からの手段、すなわち、チツプ上
で入力回路と出力回路用のGNDを分離し、各々
のパツドからボンデイングし、内部リードのボン
デイング台に接続するという手段を加えると、外
部端子と内部リードばかりでなく、ボンデイング
線と出力回路のGND線の有する寄生インダクタ
ンスによつて誘起されるノイズ迄も抑えることが
できる。又、この様な配線構造を用いることによ
り、外部端子から内部リードへのDC的な電圧降
下までも抑えることができ、誤動作や発振等の起
こりにくいモノリシツク集積回路を提供すること
ができる。
他の内部リードより大きくしているので、GND
用内部リードが有する寄生インダンスによつて誘
起されるノイズが大巾に抑えられる。しかも、
GND用外部端子8p′の幅も大きくしているの
で、誘起されるノイズはさらに小さくなる。すな
わち、出力回路スイツチングの際の大電流スイツ
チと外部端子、内部リード、ボンデイング線そし
てGND線が有する寄生インダクタンスによつて
誘起されたノイズの内、外部端子と内部リードが
有する寄生インダクタンスによつて誘起されるノ
イズを大巾に抑えることができる。もちろん、前
記説明した従来からの手段、すなわち、チツプ上
で入力回路と出力回路用のGNDを分離し、各々
のパツドからボンデイングし、内部リードのボン
デイング台に接続するという手段を加えると、外
部端子と内部リードばかりでなく、ボンデイング
線と出力回路のGND線の有する寄生インダクタ
ンスによつて誘起されるノイズ迄も抑えることが
できる。又、この様な配線構造を用いることによ
り、外部端子から内部リードへのDC的な電圧降
下までも抑えることができ、誤動作や発振等の起
こりにくいモノリシツク集積回路を提供すること
ができる。
なお、本実施例では便宜上16ピンのデユアルイ
ンライン容器を例にとり説明したきたが任意の端
子数について適用でき、又、フラツト型容器につ
いても同様に適用できるものである。また、本例
では8ピンにGNDを割り当てて説明している
が、任意の端子位置についても同様なことが言え
るのは明白である。
ンライン容器を例にとり説明したきたが任意の端
子数について適用でき、又、フラツト型容器につ
いても同様に適用できるものである。また、本例
では8ピンにGNDを割り当てて説明している
が、任意の端子位置についても同様なことが言え
るのは明白である。
以上説明した様に、任意の端子位置に電源機能
が割り当てられた時、その外部端子を実装上問題
とならないように大きく、かつ、内部リードの面
積を大きくすることによつて誤動作や発振の起こ
りにくい品質の良いモノリシツク集積回路を実現
できるので本発明の効果は甚大である。
が割り当てられた時、その外部端子を実装上問題
とならないように大きく、かつ、内部リードの面
積を大きくすることによつて誤動作や発振の起こ
りにくい品質の良いモノリシツク集積回路を実現
できるので本発明の効果は甚大である。
第1図は従来のモノリシツク集積回路容器とそ
れに搭載した集積回路チツプとを示す斜視図、第
2図は本発明の一実施例の容器に集積回路チツプ
を搭載した状態を示す斜視図である。 1,11……集積回路容器、1pないし16
p,7p′,8p′……外部端子、2……集積回路チ
ツプ、3,3a……内部リード、4……ボンデイ
ングパツド、5,5a,5b……ボンデイングワ
イヤ。
れに搭載した集積回路チツプとを示す斜視図、第
2図は本発明の一実施例の容器に集積回路チツプ
を搭載した状態を示す斜視図である。 1,11……集積回路容器、1pないし16
p,7p′,8p′……外部端子、2……集積回路チ
ツプ、3,3a……内部リード、4……ボンデイ
ングパツド、5,5a,5b……ボンデイングワ
イヤ。
Claims (1)
- 【特許請求の範囲】 1 複数の外部端子と搭載される集積回路チツプ
の複数の電極を前記複数の外部端子にそれぞれ導
く複数の内部リードとを有するモノリシツク集積
回路容器において、前記複数の内部リードのうち
電源電位が与えられる内部リードの表面積を他の
内部リードよりも大きくしたことを特徴とするモ
ノリシツク集積回路容器。 2 前記電源電位が与えられる内部リードにつな
がる外部端子の幅を他の外部端子よりも大きくし
たことを特徴とする特許請求の範囲第1項記載の
モノリシツク集積回路容器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56111947A JPS5814544A (ja) | 1981-07-17 | 1981-07-17 | モノリシツク集積回路容器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56111947A JPS5814544A (ja) | 1981-07-17 | 1981-07-17 | モノリシツク集積回路容器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5814544A JPS5814544A (ja) | 1983-01-27 |
JPS6257258B2 true JPS6257258B2 (ja) | 1987-11-30 |
Family
ID=14574129
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56111947A Granted JPS5814544A (ja) | 1981-07-17 | 1981-07-17 | モノリシツク集積回路容器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5814544A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63316049A (ja) * | 1987-06-19 | 1988-12-23 | Fuji Photo Film Co Ltd | 画像記録装置 |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61144655U (ja) * | 1985-02-28 | 1986-09-06 | ||
JPH0510367Y2 (ja) * | 1986-12-25 | 1993-03-15 | ||
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1981
- 1981-07-17 JP JP56111947A patent/JPS5814544A/ja active Granted
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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Also Published As
Publication number | Publication date |
---|---|
JPS5814544A (ja) | 1983-01-27 |
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