JPS6243201B2 - - Google Patents
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- Publication number
- JPS6243201B2 JPS6243201B2 JP54110383A JP11038379A JPS6243201B2 JP S6243201 B2 JPS6243201 B2 JP S6243201B2 JP 54110383 A JP54110383 A JP 54110383A JP 11038379 A JP11038379 A JP 11038379A JP S6243201 B2 JPS6243201 B2 JP S6243201B2
- Authority
- JP
- Japan
- Prior art keywords
- key
- program
- input
- sequence
- displayed
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Programmable Controllers (AREA)
- Testing And Monitoring For Control Systems (AREA)
Description
【発明の詳細な説明】
本発明はシーケンスコントローラのプログラム
作成方法に系り、特に論理記号で表現されたシー
ケンス制御を入力するのに好適なプログラム作成
方法に関する。
作成方法に系り、特に論理記号で表現されたシー
ケンス制御を入力するのに好適なプログラム作成
方法に関する。
論理演算専用のシーケンスコントローラの形態
上は一種の計算機と言えるが、計算機の知識がな
くてもプログラムが作成できるという使い易さが
特徴になつている。このため、シーケンスコント
ローラのプログラムは従来、ラダー図（リレーシ
ーケンスの表示）やブール代数で記述され、特に
ラダー図についてはCRTデイスプレイその他を
用いて画面上に作図しながらプログラムを作成す
るのが一般的な方法になつている。しかし、この
ラダー図による表現はリレーシーケンスを基本に
したものであり、リレー回路からの置き換え、ま
たはリレー回路に親しんだ人がプログラムを作成
する場合には有効であるが、シーケンス制御の全
てがこれに該当するとは限らない。特に最近は電
子回路が普及しているため、従来、集積回路やト
ランジスタで構成されていたものをシーケンスコ
ントローラで置き換えるというケースが多くなつ
ている。このようなケースではシーケンス制御は
論理記号で記述されるのが普通である。したがつ
て、プログラムの作成をラダー図で行うシーケン
スコントローラにおいては、論理記号で書かれた
シーケンスをラダー図に変換しなければならず、
大きな無駄を生ずる。
上は一種の計算機と言えるが、計算機の知識がな
くてもプログラムが作成できるという使い易さが
特徴になつている。このため、シーケンスコント
ローラのプログラムは従来、ラダー図（リレーシ
ーケンスの表示）やブール代数で記述され、特に
ラダー図についてはCRTデイスプレイその他を
用いて画面上に作図しながらプログラムを作成す
るのが一般的な方法になつている。しかし、この
ラダー図による表現はリレーシーケンスを基本に
したものであり、リレー回路からの置き換え、ま
たはリレー回路に親しんだ人がプログラムを作成
する場合には有効であるが、シーケンス制御の全
てがこれに該当するとは限らない。特に最近は電
子回路が普及しているため、従来、集積回路やト
ランジスタで構成されていたものをシーケンスコ
ントローラで置き換えるというケースが多くなつ
ている。このようなケースではシーケンス制御は
論理記号で記述されるのが普通である。したがつ
て、プログラムの作成をラダー図で行うシーケン
スコントローラにおいては、論理記号で書かれた
シーケンスをラダー図に変換しなければならず、
大きな無駄を生ずる。
さらにラダー図においては、入力信号名はリレ
ーの接点の附近に表示され、それは、外部入力信
号名と内部論理出力を改めて入力信号としたもの
との表示が混在することになるためプログラム作
成者にとつて見にくいという欠点がある。
ーの接点の附近に表示され、それは、外部入力信
号名と内部論理出力を改めて入力信号としたもの
との表示が混在することになるためプログラム作
成者にとつて見にくいという欠点がある。
本発明の目的は上記した従来装置の欠点を無く
し、論理記号に記述されたシーケンスをプログラ
ムとして、そのまま入力できるプログラム作成方
法を提供することにある。
し、論理記号に記述されたシーケンスをプログラ
ムとして、そのまま入力できるプログラム作成方
法を提供することにある。
本発明においては、CRTデイスプレイ上に論
理記号を表示し、これを組合せる作図によつてプ
ログラムを作成することに特徴がある。
理記号を表示し、これを組合せる作図によつてプ
ログラムを作成することに特徴がある。
次に本発明の一実施例について説明する。第１
図ａ，ｂは論理記号によるシーケンス表示を
CRTデイスプレイで行う場合の基本的な画素の
種類を示したものである。CRTデイスプレイは
一般に横５×縦７あるいは横７×縦９のドツトを
用いて文字を表示するため、これを用いて１個の
画素を表示する。この中で、１，５，９，１０は
論理素子間の接続、２は論理素子の入力接続、
３，４は論理積、６，７は論理和、８は否定論理
として用いる。基本的な画素としてはこれら10種
類で全てのシーケンスを表示できる。たとえば、
１つの入力が否定論理の３入力論理積は第１図の
構成例に示すように１〜４および８の画素を合成
して構成できる。
図ａ，ｂは論理記号によるシーケンス表示を
CRTデイスプレイで行う場合の基本的な画素の
種類を示したものである。CRTデイスプレイは
一般に横５×縦７あるいは横７×縦９のドツトを
用いて文字を表示するため、これを用いて１個の
画素を表示する。この中で、１，５，９，１０は
論理素子間の接続、２は論理素子の入力接続、
３，４は論理積、６，７は論理和、８は否定論理
として用いる。基本的な画素としてはこれら10種
類で全てのシーケンスを表示できる。たとえば、
１つの入力が否定論理の３入力論理積は第１図の
構成例に示すように１〜４および８の画素を合成
して構成できる。
第２図は論理記号で書かれたシーケンスを表示
した一例で、論理式がY1＝X1・2・X3＋X4，Y2
＝（X1・X2・X3＋X4）・X5の場合である。このよ
うに第１図に示した画素を用いれば論理記号で書
かれたシーケンスをそのままデイスプレイに表示
することができるが、作図は次のように行う。
した一例で、論理式がY1＝X1・2・X3＋X4，Y2
＝（X1・X2・X3＋X4）・X5の場合である。このよ
うに第１図に示した画素を用いれば論理記号で書
かれたシーケンスをそのままデイスプレイに表示
することができるが、作図は次のように行う。
(1) 左端が入力、右端が出力にする。これは作図
における入力信号、出力信号の表示位置を容易
に判別可能とする為である。
における入力信号、出力信号の表示位置を容易
に判別可能とする為である。
(2) 線の交叉を許す。これは１画面に表示できる
シーケンス量を増加させる為である。
シーケンス量を増加させる為である。
(3) 論理素子の出力の分岐は自由である。これは
右側で一旦出力として定義した後、他のリレー
の入力として用いるという煩雑な手順を要する
ラダー図に比べ表示が容易になると共に１画素
に表示できるシーケンス量を増加させる為であ
る。
右側で一旦出力として定義した後、他のリレー
の入力として用いるという煩雑な手順を要する
ラダー図に比べ表示が容易になると共に１画素
に表示できるシーケンス量を増加させる為であ
る。
(4) 論理素子の入力数に制限はない。（ただし、
入力数に制限を設けてもよい。） 第３図ａ，ｂは以上のような表示方法を利用し
てプログラムを作成する装置の構成を示したもの
である。第３図でシーケンスコントローラ１１は
内部にシーケンス制御のプログラムを書込むメモ
リを持つており、この内容はプログラム装置１２
から指定される。すなわち、プログラム装置１２
はキーボード１４からの操作でデイスプレイ１３
に論理記号によるシーケンスを表示しながら、こ
れをシーケンスコントローラ１１の命令に変換し
て前記のメモリに書込む。同図ｂに示すようにキ
ーボード１４は通常の標準文字・数値キー２０、
記号キー２１の他に、第３図ｂ２２に示すように
ANDキー、ORキー、タイマキー、メモリキー、
設定キーやカーソルシフトキー２４、出力キー及
びシーケンスの新規作成、修正、終了等を選択す
るモード選択キー２３を持つ。一方、プログラム
装置１２はマイクロコンピユータ等の処理装置を
用いた公知の回路で実現できる。そこで次にプロ
グラム装置１２の処理内容について説明する。
入力数に制限を設けてもよい。） 第３図ａ，ｂは以上のような表示方法を利用し
てプログラムを作成する装置の構成を示したもの
である。第３図でシーケンスコントローラ１１は
内部にシーケンス制御のプログラムを書込むメモ
リを持つており、この内容はプログラム装置１２
から指定される。すなわち、プログラム装置１２
はキーボード１４からの操作でデイスプレイ１３
に論理記号によるシーケンスを表示しながら、こ
れをシーケンスコントローラ１１の命令に変換し
て前記のメモリに書込む。同図ｂに示すようにキ
ーボード１４は通常の標準文字・数値キー２０、
記号キー２１の他に、第３図ｂ２２に示すように
ANDキー、ORキー、タイマキー、メモリキー、
設定キーやカーソルシフトキー２４、出力キー及
びシーケンスの新規作成、修正、終了等を選択す
るモード選択キー２３を持つ。一方、プログラム
装置１２はマイクロコンピユータ等の処理装置を
用いた公知の回路で実現できる。そこで次にプロ
グラム装置１２の処理内容について説明する。
第４図はデイスプレイ１３の画面の一例を示す
ものである。この画面を作成するためのキー操作
とプログラム装置１２の処理について説明する。
第４図に示す画面を作成するためにはキーボード
１４は次のように操作する。
ものである。この画面を作成するためのキー操作
とプログラム装置１２の処理について説明する。
第４図に示す画面を作成するためにはキーボード
１４は次のように操作する。
X001、NOT、X002、X003、ANDキー、
M001、SETキー、M001、X004、ORキー、
Y001、OUTキー、SETキー、Y001、X005、
ANDキー、Y002、OUTキー、SETキーの順序で
キー操作を行う。
M001、SETキー、M001、X004、ORキー、
Y001、OUTキー、SETキー、Y001、X005、
ANDキー、Y002、OUTキー、SETキーの順序で
キー操作を行う。
まず論理ブロツクの最初であるX001を押すと
表示位置を示すカーソルが左端に表示されると同
時に、これを入力としてX001を表示する。ここ
でカーソルは１行下がる。次にNOT、X002、
X003を押すと、カーソルは入力の数だけ、すな
わち２行下がる。次にANDキーを押すとカーソ
ルが入力数の中間の行でかつ右へ１つ移動し、１
つが否定入力となる３入力ANDを表示する。こ
こでNOTは否定入力を示す。次にM001、SETキ
ーを押すと、（X001）（002）（X003）＝M001の
シーケンス表示ができたことを示し、結果M001
をも表示する。次の論理演算がM001を入力する
場合は、続いでM001、X004、ORキーと押すと
カーソルがこれらに従つて移動し、２入力ORを
表示する。２入力ORの結果は出力として用いる
ため、Y001、OUTキー、SETキーを押すと、画
面の右端にY001が表示され、出力であることを
示す。Y001を出力と他の論理演算の入力として
用いるから、Y001、X005、ANDキー、Y002、
OUTキー、SETキーと押すと２入力AND及び出
力Y002を表示する。論理素子間の接続には第１
図で示す中の必要な画素を用いて、入力、論理素
子、出力のキーインに応じて表示される。第４図
では縦24×横72の画素を表示できるが、これは
CRTデイスプレイの画素表示面積により決定さ
れる。また、入力は画面の左端に、出力は右端に
統一して表示する。
表示位置を示すカーソルが左端に表示されると同
時に、これを入力としてX001を表示する。ここ
でカーソルは１行下がる。次にNOT、X002、
X003を押すと、カーソルは入力の数だけ、すな
わち２行下がる。次にANDキーを押すとカーソ
ルが入力数の中間の行でかつ右へ１つ移動し、１
つが否定入力となる３入力ANDを表示する。こ
こでNOTは否定入力を示す。次にM001、SETキ
ーを押すと、（X001）（002）（X003）＝M001の
シーケンス表示ができたことを示し、結果M001
をも表示する。次の論理演算がM001を入力する
場合は、続いでM001、X004、ORキーと押すと
カーソルがこれらに従つて移動し、２入力ORを
表示する。２入力ORの結果は出力として用いる
ため、Y001、OUTキー、SETキーを押すと、画
面の右端にY001が表示され、出力であることを
示す。Y001を出力と他の論理演算の入力として
用いるから、Y001、X005、ANDキー、Y002、
OUTキー、SETキーと押すと２入力AND及び出
力Y002を表示する。論理素子間の接続には第１
図で示す中の必要な画素を用いて、入力、論理素
子、出力のキーインに応じて表示される。第４図
では縦24×横72の画素を表示できるが、これは
CRTデイスプレイの画素表示面積により決定さ
れる。また、入力は画面の左端に、出力は右端に
統一して表示する。
以上のようにしてデイスプレイ１３に表示する
と共にシーケンスコントローラ１１の命令に変換
して、これをプログラムとしてメモリに書込む
が、次にこの手順について説明する。
と共にシーケンスコントローラ１１の命令に変換
して、これをプログラムとしてメモリに書込む
が、次にこの手順について説明する。
第５図はシーケンスコントローラ１１の命令の
一例を示すものである。ここに示した命令は命令
コードと入出力番号から成り、演算はアキユムレ
ータと入出力番号で指定された入出力との間で行
う。命令の種類は第５図に示す８種であるが命令
は例えば LD 001 と表示する。この命令を用いて第４図に示した論
理シーケンスを表わすと次のとおりである。
一例を示すものである。ここに示した命令は命令
コードと入出力番号から成り、演算はアキユムレ
ータと入出力番号で指定された入出力との間で行
う。命令の種類は第５図に示す８種であるが命令
は例えば LD 001 と表示する。この命令を用いて第４図に示した論
理シーケンスを表わすと次のとおりである。
LD 001
ANDC 002
AND 003
OR 004
OUT 001
AND 005
OUT 002
このプログラムを機械語としてシーケンスコン
トローラに書込むが第４図の論理シーケンスから
上のプログラムへの変換は直接的であり、プログ
ラム装置１２に容易に実行できる。
トローラに書込むが第４図の論理シーケンスから
上のプログラムへの変換は直接的であり、プログ
ラム装置１２に容易に実行できる。
本実施例によれば、CRTデイスプレイ上に論
理記号を表示し、この組合せによつて作成された
プログラムを機械語としてシーケンスコントロー
ラに書込むため、プログラムの作成が容易とな
る。
理記号を表示し、この組合せによつて作成された
プログラムを機械語としてシーケンスコントロー
ラに書込むため、プログラムの作成が容易とな
る。
本実施例によれば、論理記号で表示できること
により、リレー、トランジスタ、集積回路等論理
機能を有する全ての論理回路に適用できる。
により、リレー、トランジスタ、集積回路等論理
機能を有する全ての論理回路に適用できる。
さらに本実施例によれば、入力を画面の左端
に、出力を右端に統一することにより、表示画面
全体を１つの論理シーケンスと見なすことがで
き、高集積回路の表示も可能となり、プログラム
作成者にとつて見易い表示画面が得られる。
に、出力を右端に統一することにより、表示画面
全体を１つの論理シーケンスと見なすことがで
き、高集積回路の表示も可能となり、プログラム
作成者にとつて見易い表示画面が得られる。
さらに、本実施例では、必要とする画素は第１
図に示すようにわずか10種類であらゆる論理シー
ケンスを表示できる。
図に示すようにわずか10種類であらゆる論理シー
ケンスを表示できる。
論理素子の入力数には制限を設け、最大入力数
を３ケとし、多入力論理演算では複数個の論理素
子の組合せとすることにより、入力の多量キーイ
ンの誤りをなくし、プログラム作成者の論理機能
判断を容易にしてもよい。
を３ケとし、多入力論理演算では複数個の論理素
子の組合せとすることにより、入力の多量キーイ
ンの誤りをなくし、プログラム作成者の論理機能
判断を容易にしてもよい。
さらに、本発明はシーケンスコントローラの命
令が、第５図に示す８種類に制限されることはな
く、画素に応じて増減が可能である。
令が、第５図に示す８種類に制限されることはな
く、画素に応じて増減が可能である。
第４図で、２つ以後の論理演算では、前段の論
理演算結果を引続き以後の論理演算入力として用
いる場合、例えばANDキー、M001、SETキー、
M001、X004、ORキー…とすることなく、AND
キー、M001、X004、ORキー…と次段の入力
M001を省略することも可能である。
理演算結果を引続き以後の論理演算入力として用
いる場合、例えばANDキー、M001、SETキー、
M001、X004、ORキー…とすることなく、AND
キー、M001、X004、ORキー…と次段の入力
M001を省略することも可能である。
本発明によれば、論理記号をラダー図に変更す
ることなく、論理記号に記述されたシーケンスを
プログラムとしてそのまま入力でき、プログラム
処理効率の向上が可能となる効果がある。
ることなく、論理記号に記述されたシーケンスを
プログラムとしてそのまま入力でき、プログラム
処理効率の向上が可能となる効果がある。
第１図は本発明の画素の例、第２図は本発明の
論理記号で書かれたシーケンスの表示例、第３図
は本発明のプログラム作成装置の構成、第４図は
本発明によるデイスプレイの表示例、第５図は本
発明のシーケンスコントローラの命令の一例であ
る。 １１……シーケンスコントローラ、１２……プ
ログラム装置、１３……デイスプレイ、１４……
キーボード、１〜１０……画素。
論理記号で書かれたシーケンスの表示例、第３図
は本発明のプログラム作成装置の構成、第４図は
本発明によるデイスプレイの表示例、第５図は本
発明のシーケンスコントローラの命令の一例であ
る。 １１……シーケンスコントローラ、１２……プ
ログラム装置、１３……デイスプレイ、１４……
キーボード、１〜１０……画素。
Claims (1)
- １ あらかじめ記憶しているプログラムにしたが
つて動作するシーケンスコントローラのプログラ
ムを作成するものにおいて、複数論理記号および
接続線分をその共通な複数画素に分割して記憶
し、キー指定により該分割画素の組合せからなる
複数論理記号を前記記憶内容から続出しCRTデ
イスプレイ上に表示し、該CRT表示面のXY軸上
の一端を入力端子とし、他端を出力端子として論
理回路を作成することを特徴とするシーケンスコ
ントローラのプログラム作成方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11038379A JPS5635212A (en) | 1979-08-31 | 1979-08-31 | Program producing method for sequence controller |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11038379A JPS5635212A (en) | 1979-08-31 | 1979-08-31 | Program producing method for sequence controller |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5635212A JPS5635212A (en) | 1981-04-07 |
| JPS6243201B2 true JPS6243201B2 (ja) | 1987-09-11 |
Family
ID=14534409
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11038379A Granted JPS5635212A (en) | 1979-08-31 | 1979-08-31 | Program producing method for sequence controller |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5635212A (ja) |
Families Citing this family (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58139209A (ja) * | 1982-02-10 | 1983-08-18 | Toshiba Corp | 制御ル−プ表示方法 |
| JPS59218511A (ja) * | 1983-05-27 | 1984-12-08 | Mitsubishi Electric Corp | シ−ケンスプログラム入力方式 |
| JPS59221707A (ja) * | 1983-05-31 | 1984-12-13 | Omron Tateisi Electronics Co | プログラマブルコントロ−ラ |
| JPS6041102A (ja) * | 1983-08-15 | 1985-03-04 | Niigata Eng Co Ltd | シ−ケンス制御装置 |
| JPS60126803U (ja) * | 1984-01-31 | 1985-08-26 | 日本電気精器株式会社 | プログラマブルコントロ−ラのプログラミングパネル |
| JPS6425205A (en) * | 1987-07-21 | 1989-01-27 | Nippon Kokan Kk | Programmable controller |
| JP2532621B2 (ja) * | 1988-11-15 | 1996-09-11 | 三菱電機株式会社 | ディジタル処理装置 |
-
1979
- 1979-08-31 JP JP11038379A patent/JPS5635212A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5635212A (en) | 1981-04-07 |
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