JPS6241475B2 - - Google Patents
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- JPS6241475B2 JPS6241475B2 JP3960781A JP3960781A JPS6241475B2 JP S6241475 B2 JPS6241475 B2 JP S6241475B2 JP 3960781 A JP3960781 A JP 3960781A JP 3960781 A JP3960781 A JP 3960781A JP S6241475 B2 JPS6241475 B2 JP S6241475B2
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- JP
- Japan
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- Prior art date
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- 238000013500 data storage Methods 0.000 claims description 7
- 238000010586 diagram Methods 0.000 description 5
- 239000011295 pitch Substances 0.000 description 2
- 239000008186 active pharmaceutical agent Substances 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005284 excitation Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/485—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes
- B41J2/505—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes from an assembly of identical printing elements
- B41J2/5056—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes from an assembly of identical printing elements using dot arrays providing selective dot disposition modes, e.g. different dot densities for high speed and high-quality printing, array line selections for multi-pass printing, or dot shifts for character inclination
Landscapes
- Engineering & Computer Science (AREA)
- Quality & Reliability (AREA)
- Dot-Matrix Printers And Others (AREA)
Description
【発明の詳細な説明】
本発明はドツト印字ワイヤが千鳥状に配列され
た印字ヘツドにてドツトパターンを印字するイン
パクト式ドツトプリンタにおける印字マグネツト
の駆動方式に関する。
た印字ヘツドにてドツトパターンを印字するイン
パクト式ドツトプリンタにおける印字マグネツト
の駆動方式に関する。
第１図は上記印字ヘツドの一例を示すもので、
各ドツト列の奇数番目のドツトを印字する奇数列
l1の印字ワイヤ２１ａと偶数番目のドツトを印字
する偶数列l2の印字ワイヤ２１ｂとが千鳥状に配
列されており、これらの印字ワイヤで例えば文字
「Ｂ」を第２図に示すように印字する。ところで
奇数列と偶数列の印字ワイヤはその中心位置が横
方向ではＰピツチ離間しているが、種々の寸法の
文字パターンを印字するプリンタでは奇数列の印
字ワイヤ２１ａと偶数列の印字ワイヤ２１ｂを交
互に駆動させるようにしてもドツト列間のピツチ
が前記Ｐに近くなると、各々の印字マグネツトの
励磁時間が重なるようになり、相互の磁気干渉が
印字に影響を及ぼすようになる。
各ドツト列の奇数番目のドツトを印字する奇数列
l1の印字ワイヤ２１ａと偶数番目のドツトを印字
する偶数列l2の印字ワイヤ２１ｂとが千鳥状に配
列されており、これらの印字ワイヤで例えば文字
「Ｂ」を第２図に示すように印字する。ところで
奇数列と偶数列の印字ワイヤはその中心位置が横
方向ではＰピツチ離間しているが、種々の寸法の
文字パターンを印字するプリンタでは奇数列の印
字ワイヤ２１ａと偶数列の印字ワイヤ２１ｂを交
互に駆動させるようにしてもドツト列間のピツチ
が前記Ｐに近くなると、各々の印字マグネツトの
励磁時間が重なるようになり、相互の磁気干渉が
印字に影響を及ぼすようになる。
本発明はかかる磁気干渉の影響を考慮し、ドツ
ト印字マグネツトの駆動時間を各ドツト列の印字
ごとに磁気干渉の度合に応じた適正な時間に設定
して印字品質を良好にかつ均一に保つことを目的
とするもので、各ドツト列の奇数番目及び偶数番
目のドツトデータを蓄積するドツトデータ記憶装
置と、前記奇数番目のドツトデータのみを蓄積す
る第１と第２の二つの記憶装置と、前記偶数番目
のドツトデータのみを蓄積する第３と第４の二つ
の記憶装置と、前記第１の記憶装置と前記第４の
記憶装置の各々の蓄積データを入力とし、これよ
り一緒に駆動されるドツト印字マグネツトの数を
検知してこの数に応じて奇数番目のドツト印字用
マグネツトの駆動パルス幅を変調する第１の駆動
パルス発生回路と、前記第３の記憶装置と前記第
２の記憶装置の各々の蓄積データを入力とし、こ
れより一緒に駆動されるドツト印字マグネツトの
数を検知してこの数に応じて偶数番目のドツト印
字用マグネツトの駆動パルス幅を変調する第２の
駆動パルス発生回路と、前記第１と第３の記憶装
置に蓄積した奇数番目と偶数番目の各々のドツト
データにより駆動すべき奇数番目と偶数番目のド
ツト印字用マグネツトを選択する選択回路と、奇
数番目のドツトを印字するときは前記ドツトデー
タ記憶装置の蓄積データを前記第１の記憶装置に
移すと同時に前記第３の記憶装置の蓄積データを
前記第４の記憶装置に移し、偶数番目のドツトを
印字するときは前記ドツトデータ記憶装置の蓄積
データを前記第３の記憶装置に移すと同時に前記
第１の記憶装置の蓄積データを前記第２の記憶装
置に移す制御手段とを有することを特徴とする。
ト印字マグネツトの駆動時間を各ドツト列の印字
ごとに磁気干渉の度合に応じた適正な時間に設定
して印字品質を良好にかつ均一に保つことを目的
とするもので、各ドツト列の奇数番目及び偶数番
目のドツトデータを蓄積するドツトデータ記憶装
置と、前記奇数番目のドツトデータのみを蓄積す
る第１と第２の二つの記憶装置と、前記偶数番目
のドツトデータのみを蓄積する第３と第４の二つ
の記憶装置と、前記第１の記憶装置と前記第４の
記憶装置の各々の蓄積データを入力とし、これよ
り一緒に駆動されるドツト印字マグネツトの数を
検知してこの数に応じて奇数番目のドツト印字用
マグネツトの駆動パルス幅を変調する第１の駆動
パルス発生回路と、前記第３の記憶装置と前記第
２の記憶装置の各々の蓄積データを入力とし、こ
れより一緒に駆動されるドツト印字マグネツトの
数を検知してこの数に応じて偶数番目のドツト印
字用マグネツトの駆動パルス幅を変調する第２の
駆動パルス発生回路と、前記第１と第３の記憶装
置に蓄積した奇数番目と偶数番目の各々のドツト
データにより駆動すべき奇数番目と偶数番目のド
ツト印字用マグネツトを選択する選択回路と、奇
数番目のドツトを印字するときは前記ドツトデー
タ記憶装置の蓄積データを前記第１の記憶装置に
移すと同時に前記第３の記憶装置の蓄積データを
前記第４の記憶装置に移し、偶数番目のドツトを
印字するときは前記ドツトデータ記憶装置の蓄積
データを前記第３の記憶装置に移すと同時に前記
第１の記憶装置の蓄積データを前記第２の記憶装
置に移す制御手段とを有することを特徴とする。
以下図面に従つて本発明を説明する。
第３図は本発明の一実施例を示すブロツク図
で、PDは図示せぬ文字パターンメモリから列単
位で供給されるドツトデータで、データセツト信
号DSにより奇数番目と偶数番目のドツトデータ
に分かれて奇数用ドツトデータバツフア１と偶数
用ドツトデータバツフア２とに格納される。前記
奇数用ドツトデータバツフア１の出力は第１デー
タバツフア３に接続し、更にこの第１データバツ
フア３の出力は第２データバツフア４に接続して
いる。また偶数用ドツトデータバツフア２の出力
は第３データバツフア５に接続し、この第３デー
タバツフア５の出力は更に第４データバツフア６
に接続している。ODSは奇数データセツト信号
で、前記第１データバツフア３と第４データバツ
フア６に供給され、奇数用ドツトデータバツフア
１に蓄積された奇数ドツトデータを第１データバ
ツフア３に移すと共に第３データバツフア５の蓄
積データを第４データバツフア６に移すように作
用する。同様にEVSは偶数データセツト信号
で、前記第３データバツフア５と第２データバツ
フア４とに供給され、偶数用データバツフア２に
蓄積された偶数ドツトデータを第３データバツフ
ア５に移すと共に第１データバツフア３の蓄積デ
ータを第２データバツフア４に移す。
で、PDは図示せぬ文字パターンメモリから列単
位で供給されるドツトデータで、データセツト信
号DSにより奇数番目と偶数番目のドツトデータ
に分かれて奇数用ドツトデータバツフア１と偶数
用ドツトデータバツフア２とに格納される。前記
奇数用ドツトデータバツフア１の出力は第１デー
タバツフア３に接続し、更にこの第１データバツ
フア３の出力は第２データバツフア４に接続して
いる。また偶数用ドツトデータバツフア２の出力
は第３データバツフア５に接続し、この第３デー
タバツフア５の出力は更に第４データバツフア６
に接続している。ODSは奇数データセツト信号
で、前記第１データバツフア３と第４データバツ
フア６に供給され、奇数用ドツトデータバツフア
１に蓄積された奇数ドツトデータを第１データバ
ツフア３に移すと共に第３データバツフア５の蓄
積データを第４データバツフア６に移すように作
用する。同様にEVSは偶数データセツト信号
で、前記第３データバツフア５と第２データバツ
フア４とに供給され、偶数用データバツフア２に
蓄積された偶数ドツトデータを第３データバツフ
ア５に移すと共に第１データバツフア３の蓄積デ
ータを第２データバツフア４に移す。
７は奇数ドツト用の第１駆動パルス発生回路
で、第１データバツフア３と第４データバツフア
６の各々の蓄積データを入力とし、これより一緒
に駆動されるドツト印字マグネツトの数を検知し
てこの数に応じてその出力である駆動パルス幅を
変調する。８は前記と同じ構成の偶数ドツト用の
第２駆動パルス発生回路で、これは第３データバ
ツフア５と第２データバツフア４の各々の蓄積デ
ータを入力としている。９，１０は前記第１及び
第２駆動パルス発生回路７及び８から出力される
駆動パルスにより奇数ドツト用印字マグネツト１
１と偶数ドツト用印字マグネツト１２に駆動電流
を流すよう動作するドライバ、１３は上記第１デ
ータバツフア３の奇数ドツトデータに従つて駆動
すべき印字マグネツト１１を選択する選択回路、
１４は上記第３データバツフア５の偶数ドツトデ
ータに従つて駆動すべき印字マグネツト１２を選
択する選択回路で、これら選択回路１３，１４と
上記第１及び第２駆動パルス発生回路７及び８は
駆動タイミングパルスDTMが加わることによつ
て動作する。
で、第１データバツフア３と第４データバツフア
６の各々の蓄積データを入力とし、これより一緒
に駆動されるドツト印字マグネツトの数を検知し
てこの数に応じてその出力である駆動パルス幅を
変調する。８は前記と同じ構成の偶数ドツト用の
第２駆動パルス発生回路で、これは第３データバ
ツフア５と第２データバツフア４の各々の蓄積デ
ータを入力としている。９，１０は前記第１及び
第２駆動パルス発生回路７及び８から出力される
駆動パルスにより奇数ドツト用印字マグネツト１
１と偶数ドツト用印字マグネツト１２に駆動電流
を流すよう動作するドライバ、１３は上記第１デ
ータバツフア３の奇数ドツトデータに従つて駆動
すべき印字マグネツト１１を選択する選択回路、
１４は上記第３データバツフア５の偶数ドツトデ
ータに従つて駆動すべき印字マグネツト１２を選
択する選択回路で、これら選択回路１３，１４と
上記第１及び第２駆動パルス発生回路７及び８は
駆動タイミングパルスDTMが加わることによつ
て動作する。
次に上記構成によるドツト印字マグネツトの駆
動について第４図の動作タイムチヤートを参照し
ながら説明する。
動について第４図の動作タイムチヤートを参照し
ながら説明する。
印字すべき列のドツトデータPDは奇数ドツト
データが奇数用ドツトデータバツフア１にそして
偶数ドツトデータは偶数用ドツトデータバツフア
２に夫々分かれて転送され、第４図ａに示すデー
タセツト信号DSにて第４図ｄ PD1〜PD6の如く
セツトされる。その中でいま奇数用ドツトデータ
バツフア１にセツトされた奇数ドツトデータを
OD１、偶数用ドツトデータバツフア２にセツト
された偶数ドツトデータをEV１とすると、第４
図ｂに示す奇数データセツト信号ODSによつて
第１データバツフア３には第４図ｅに示す如く奇
数ドツトデータOD１がセツトされると共に第４
データバツフア６には第４図ｈに示すように第３
データバツフア５のそのときの蓄積データEV０
がセツトされる。これにより奇数用の選択回路１
３には奇数ドツトデータOD１が供給されて駆動
すべき印字マグネツト１１が選択される一方、第
１駆動パルス発生回路７には前記奇数ドツトデー
タOD１と印字駆動中の偶数ドツトデータEV０が
供給されて該奇数ドツトデータOD１を印字する
ための駆動パルス幅が設定され、駆動タイミング
パルスDTM0の供給によつて第４図ｉに示す駆動
パルスDVP0が送出されて印字マグネツト１１に
駆動電流が流される。次に第４図ｃに示す偶数デ
ータセツト信号EVSが発生すると、第３データ
バツフア５には第４図ｆに示す如く偶数ドツトデ
ータEV１がセツトされると共に第２データバツ
フア４に第４図ｇの如く第１データバツフア３の
内容OD１が移される。その結果駆動タイミング
パルスDTMeが供給されると、上記と同様に偶数
ドツトデータEV１により選択された印字マグネ
ツト１２がこの偶数ドツトデータEV１と上記奇
数ドツトデータOD１とによつて一緒に駆動され
る印字マグネツト１１，１２の数に応じた幅の駆
動パルスDVPe（第４図ｊに示す）で駆動され
る。
データが奇数用ドツトデータバツフア１にそして
偶数ドツトデータは偶数用ドツトデータバツフア
２に夫々分かれて転送され、第４図ａに示すデー
タセツト信号DSにて第４図ｄ PD1〜PD6の如く
セツトされる。その中でいま奇数用ドツトデータ
バツフア１にセツトされた奇数ドツトデータを
OD１、偶数用ドツトデータバツフア２にセツト
された偶数ドツトデータをEV１とすると、第４
図ｂに示す奇数データセツト信号ODSによつて
第１データバツフア３には第４図ｅに示す如く奇
数ドツトデータOD１がセツトされると共に第４
データバツフア６には第４図ｈに示すように第３
データバツフア５のそのときの蓄積データEV０
がセツトされる。これにより奇数用の選択回路１
３には奇数ドツトデータOD１が供給されて駆動
すべき印字マグネツト１１が選択される一方、第
１駆動パルス発生回路７には前記奇数ドツトデー
タOD１と印字駆動中の偶数ドツトデータEV０が
供給されて該奇数ドツトデータOD１を印字する
ための駆動パルス幅が設定され、駆動タイミング
パルスDTM0の供給によつて第４図ｉに示す駆動
パルスDVP0が送出されて印字マグネツト１１に
駆動電流が流される。次に第４図ｃに示す偶数デ
ータセツト信号EVSが発生すると、第３データ
バツフア５には第４図ｆに示す如く偶数ドツトデ
ータEV１がセツトされると共に第２データバツ
フア４に第４図ｇの如く第１データバツフア３の
内容OD１が移される。その結果駆動タイミング
パルスDTMeが供給されると、上記と同様に偶数
ドツトデータEV１により選択された印字マグネ
ツト１２がこの偶数ドツトデータEV１と上記奇
数ドツトデータOD１とによつて一緒に駆動され
る印字マグネツト１１，１２の数に応じた幅の駆
動パルスDVPe（第４図ｊに示す）で駆動され
る。
奇数データセツト信号ODSと偶数データセツ
ト信号EVSは第４図ｂ，ｃに示すように交互に
発生し、以下ドツトデータPD2〜PD6についも上
記と同様の動作が繰り返される。
ト信号EVSは第４図ｂ，ｃに示すように交互に
発生し、以下ドツトデータPD2〜PD6についも上
記と同様の動作が繰り返される。
かくして上記構成においては、奇数ドツト用
（又は偶数ドツト用）の印字マグネツトを駆動す
るにあたつて、その駆動される印字マグネツトの
数と今駆動中の偶数ドツト用（又は奇数ドツト
用）の印字マグネツトの数との和に応じて駆動パ
ルスの幅が決定されることになり、磁気干渉の度
合に応じて各印字マグネツトが適切な駆動時間で
駆動される。
（又は偶数ドツト用）の印字マグネツトを駆動す
るにあたつて、その駆動される印字マグネツトの
数と今駆動中の偶数ドツト用（又は奇数ドツト
用）の印字マグネツトの数との和に応じて駆動パ
ルスの幅が決定されることになり、磁気干渉の度
合に応じて各印字マグネツトが適切な駆動時間で
駆動される。
なお上記構成において、駆動パルス発生回路７
及び８は入力されるドツトデータの論理値“１”
（又は“０”）のビツトをデイジタル的又はアナロ
グ的に加算し、その加算結果を示す信号にてパル
ス幅を変調するものであればどのような構成のも
のでもよい。アナログ的に加算する回路を簡単に
構成するには本出願人が別途出願の実開昭57−
162849号公報（実願昭56−47364）に記載の回路
を用いればよい。
及び８は入力されるドツトデータの論理値“１”
（又は“０”）のビツトをデイジタル的又はアナロ
グ的に加算し、その加算結果を示す信号にてパル
ス幅を変調するものであればどのような構成のも
のでもよい。アナログ的に加算する回路を簡単に
構成するには本出願人が別途出願の実開昭57−
162849号公報（実願昭56−47364）に記載の回路
を用いればよい。
以上説明したように本発明によれば、印字ワイ
ヤが千鳥状に配列されたドツトプリンタにおい
て、奇数ドツトと偶数ドツトの印字マグネツトの
駆動が重なつてもその時の磁気干渉の程度に応じ
て適正な駆動時間で駆動できるため、印字品質が
良好でかつ安定する効果がある。
ヤが千鳥状に配列されたドツトプリンタにおい
て、奇数ドツトと偶数ドツトの印字マグネツトの
駆動が重なつてもその時の磁気干渉の程度に応じ
て適正な駆動時間で駆動できるため、印字品質が
良好でかつ安定する効果がある。
第１図は本発明の実施に適したドツト印字ヘツ
ドの一例を示す図、第２図は第１図の印字ヘツド
による印字例を示す図、第３図は本発明の一実施
例の構成を示すブロツク図、第４図は第３図の各
部の動作を説明するためのタイムチヤートであ
る。 １……奇数用ドツトデータバツフア、２……偶
数用ドツトデータバツフア、３……第１データバ
ツフア、４……第２データバツフア、５……第３
データバツフア、６……第４データバツフア、７
……第１駆動パルス発生回路、８……第２駆動パ
ルス発生回路、９，１０……ドライバ、１１……
奇数ドツト用印字マグネツト、１２……偶数ドツ
ト用印字マグネツト、１３，１４……選択回路。
ドの一例を示す図、第２図は第１図の印字ヘツド
による印字例を示す図、第３図は本発明の一実施
例の構成を示すブロツク図、第４図は第３図の各
部の動作を説明するためのタイムチヤートであ
る。 １……奇数用ドツトデータバツフア、２……偶
数用ドツトデータバツフア、３……第１データバ
ツフア、４……第２データバツフア、５……第３
データバツフア、６……第４データバツフア、７
……第１駆動パルス発生回路、８……第２駆動パ
ルス発生回路、９，１０……ドライバ、１１……
奇数ドツト用印字マグネツト、１２……偶数ドツ
ト用印字マグネツト、１３，１４……選択回路。
Claims (1)
- 【特許請求の範囲】 １ 印字ワイヤが千鳥状に配列された印字ヘツド
で各ドツト列を奇数番目のドツトと偶数番目のド
ツトに分けて印字するドツトプリンタの印字マグ
ネツト駆動装置において、 各ドツト列の奇数番目及び偶数番目のドツトデ
ータを蓄積するドツトデータ記憶装置と、 前記奇数番目のドツトデータのみを蓄積する第
１と第２の二つの記憶装置と 前記偶数番目のドツトデータのみを蓄積する第
３と第４の二つの記憶装置と、 前記第１の記憶装置と前記第４の記憶装置の各
各の蓄積データを入力とし、これより一緒に駆動
されるドツト印字マグネツトの数を検知してこの
数に応じて奇数番目のドツト印字用マグネツトの
駆動パルス幅を変調する第１の駆動パルス発生回
路と、 前記第３の記憶装置と前記第２の記憶装置の各
各の蓄積データを入力とし、これより一緒に駆動
されるドツト印字マグネツトの数を検知してこの
数に応じて偶数番目のドツト印字用マグネツトの
駆動パルス幅を変調する第２の駆動パルス発生回
路と、 前記第１と第３の記憶装置に蓄積した奇数番目
と偶数番目の各々のドツトデータにより駆動すべ
き奇数番目と偶数番目のドツト印字用マグネツト
を選択する選択回路と、 奇数番目のドツトを印字するときは前記ドツト
データ記憶装置の蓄積データを前記第１の記憶装
置に移すと同時に前記第３の記憶装置の蓄積デー
タを前記第４の記憶装置に移し、偶数番目のドツ
トを印字するときは前記ドツトデータ記憶装置の
蓄積データを前記第３の記憶装置に移すと同時に
前記第１の記憶装置の蓄積データを前記第２の記
憶装置に移す制御手段と を有することを特徴とするドツト印字マグネツト
の駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3960781A JPS57156271A (en) | 1981-03-20 | 1981-03-20 | System for driving dot printing magnet |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3960781A JPS57156271A (en) | 1981-03-20 | 1981-03-20 | System for driving dot printing magnet |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57156271A JPS57156271A (en) | 1982-09-27 |
| JPS6241475B2 true JPS6241475B2 (ja) | 1987-09-03 |
Family
ID=12557795
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3960781A Granted JPS57156271A (en) | 1981-03-20 | 1981-03-20 | System for driving dot printing magnet |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57156271A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59224364A (ja) * | 1983-05-27 | 1984-12-17 | Fujitsu Ltd | ドツトインパクト・プリンタの印刷方式 |
| US5039237A (en) * | 1987-06-02 | 1991-08-13 | Oki Electric Industry Co., Ltd. | Dot matrix print head drive method |
| JPH03258556A (ja) * | 1990-03-09 | 1991-11-18 | Oki Electric Ind Co Ltd | ワイヤドット印字ヘッドの駆動方法並びに駆動装置 |
-
1981
- 1981-03-20 JP JP3960781A patent/JPS57156271A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57156271A (en) | 1982-09-27 |
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