JPS6234445U - - Google Patents

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JPS6234445U
JPS6234445U JP12665085U JP12665085U JPS6234445U JP S6234445 U JPS6234445 U JP S6234445U JP 12665085 U JP12665085 U JP 12665085U JP 12665085 U JP12665085 U JP 12665085U JP S6234445 U JPS6234445 U JP S6234445U
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JP
Japan
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external leads
circuit board
printed circuit
resin molded
semiconductor device
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  • Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Description

【図面の簡単な説明】
第1図aはこの考案の一実施例を示す平面図、
第1図bは第1図aに示す外部リードのプリント
基板の穴に挿入された状態を示す部分断面図、第
1図cはこの考案の他の外部リードの構造を示す
部分拡大図、第2図aは従来のこの種の半導体装
置の外部リードの一例を示す平面図、第2図bは
第2図aに示すものの切り離し以前の状態を示す
平面図、第2図cは第2図aに示す外部リードの
プリント基板の穴に挿入された状態を示す側面の
部分断面図、第3図aは従来のこの種の半導体装
置の外部リードの他の例を示す平面図、第3図b
は第3図aに示す外部リードの類似した他の例を
示す平面図、第3図cは第3図aに示す外部リー
ドのプリント基板の穴に挿入した状態を示す側面
図である。 1……樹脂モールド部、2……ダム部、3……
外部リード、4……プリント基板、5……穴、6
……半田付け用ランド、7……基板配線。

Claims (1)

    【実用新案登録請求の範囲】
  1. 樹脂モールドの半導体装置において、外部リー
    ドをプリント基板へ実装する際に半田溶着時の発
    熱からモールド樹脂を保護するために樹脂モール
    ド部をプリント基板から離間させる外部リードの
    段差をリードフレームの外部リードとの間のダム
    部を斜めにカツトして形成したことを特徴とする
    半導体装置。
JP12665085U 1985-08-20 1985-08-20 Pending JPS6234445U (ja)

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JP12665085U JPS6234445U (ja) 1985-08-20 1985-08-20

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JP12665085U JPS6234445U (ja) 1985-08-20 1985-08-20

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JPS6234445U true JPS6234445U (ja) 1987-02-28

Family

ID=31020656

Family Applications (1)

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JP12665085U Pending JPS6234445U (ja) 1985-08-20 1985-08-20

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JP (1) JPS6234445U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62177952A (ja) * 1986-01-31 1987-08-04 Mitsui Haitetsuku:Kk 半導体装置の製造方法

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5333574A (en) * 1976-09-10 1978-03-29 Hitachi Ltd Semiconductor integrated circuit package

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5333574A (en) * 1976-09-10 1978-03-29 Hitachi Ltd Semiconductor integrated circuit package

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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