JPS6222195B2 - - Google Patents
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- Publication number
- JPS6222195B2 JPS6222195B2 JP53104720A JP10472078A JPS6222195B2 JP S6222195 B2 JPS6222195 B2 JP S6222195B2 JP 53104720 A JP53104720 A JP 53104720A JP 10472078 A JP10472078 A JP 10472078A JP S6222195 B2 JPS6222195 B2 JP S6222195B2
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- Japan
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- signal
- data
- reproduced
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- Expired
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- 238000001514 detection method Methods 0.000 claims description 9
- 230000005540 biological transmission Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 6
- 230000000630 rising effect Effects 0.000 description 5
- 230000008054 signal transmission Effects 0.000 description 4
- 238000013075 data extraction Methods 0.000 description 3
- 239000002131 composite material Substances 0.000 description 2
- 239000000284 extract Substances 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 230000002238 attenuated effect Effects 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 125000004122 cyclic group Chemical group 0.000 description 1
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- 230000005236 sound signal Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Description
【発明の詳細な説明】
本発明はデータ位相基準信号検出回路に係り、
データ抜き取り用クロツク信号の位相の基準とな
るデータ位相基準信号を、伝送系の特性に無関係
に確実に検出しうる回路を提供することを目的と
する。
データ抜き取り用クロツク信号の位相の基準とな
るデータ位相基準信号を、伝送系の特性に無関係
に確実に検出しうる回路を提供することを目的と
する。
従来より、複合映像信号の映像信号期間の映像
信号に相当する、音声信号等の情報信号をパルス
符号変調（PCM）等の方法により変調して得た
被変調デイジタル信号と、複合映像信号の同期信
号に相当する同期信号とよりなりなるデジタル信
号を、通常の磁気記録再生装置（以下VTRとい
う）や磁気デイスクあるいはビデオデイスクに記
録し、これを再生することが知られている。上記
映像信号期間に相当する期間に存在せしめられる
信号は、一例として上記被変調デイジタル信号
と、これを再生時に抜き取るためのクロツク信号
の位相の基準となるデータ位相基準信号（以下デ
ータシンク信号ともいう）と再生被変調デイジタ
ル信号の正誤を判定するためのサイクリツク・リ
ダンダンシイ・チエツク（CRC）信号とが時分
割多重されてなる。かかるデイジタル信号伝送に
おいては、通常ある帯域に制限されて伝送される
ため、例えばVTRに記録する信号が第１図Ａに
示す如く矩形波である場合には、再生された信号
は高域周波数成分が減衰されたものとなり、同図
Ｂに示す如き波形となる。この再生信号波形は使
用する再生装置の特性によつて変化する。
信号に相当する、音声信号等の情報信号をパルス
符号変調（PCM）等の方法により変調して得た
被変調デイジタル信号と、複合映像信号の同期信
号に相当する同期信号とよりなりなるデジタル信
号を、通常の磁気記録再生装置（以下VTRとい
う）や磁気デイスクあるいはビデオデイスクに記
録し、これを再生することが知られている。上記
映像信号期間に相当する期間に存在せしめられる
信号は、一例として上記被変調デイジタル信号
と、これを再生時に抜き取るためのクロツク信号
の位相の基準となるデータ位相基準信号（以下デ
ータシンク信号ともいう）と再生被変調デイジタ
ル信号の正誤を判定するためのサイクリツク・リ
ダンダンシイ・チエツク（CRC）信号とが時分
割多重されてなる。かかるデイジタル信号伝送に
おいては、通常ある帯域に制限されて伝送される
ため、例えばVTRに記録する信号が第１図Ａに
示す如く矩形波である場合には、再生された信号
は高域周波数成分が減衰されたものとなり、同図
Ｂに示す如き波形となる。この再生信号波形は使
用する再生装置の特性によつて変化する。
しかして、従来のVTRでは再生データシンク
信号の立上りの任意の点で検出していたため、矩
形波で記録されたデータシンク信号は第１図Ｂに
示す信号波形となるので、データシンク信号に引
続いて再生される被変調デイジタル信号（デー
タ）との位相差が使用するVTRによつて異なつ
てしまう。したがつて、従来は使用するVTRに
よつてはデータ抜き取りクロツク信号の位相の基
準となる再生データシンク信号が、その後に続く
ビツトレイトの高いデータを正しく抜き取らせる
位相で再生されず、その結果データを誤まつて再
生することがあるという欠点があつた。
信号の立上りの任意の点で検出していたため、矩
形波で記録されたデータシンク信号は第１図Ｂに
示す信号波形となるので、データシンク信号に引
続いて再生される被変調デイジタル信号（デー
タ）との位相差が使用するVTRによつて異なつ
てしまう。したがつて、従来は使用するVTRに
よつてはデータ抜き取りクロツク信号の位相の基
準となる再生データシンク信号が、その後に続く
ビツトレイトの高いデータを正しく抜き取らせる
位相で再生されず、その結果データを誤まつて再
生することがあるという欠点があつた。
本発明は上記の欠点を除去したものであり、第
２図以下と共にその一実施例について説明する。
２図以下と共にその一実施例について説明する。
第２図は本発明になるデータ位相基準信号検出
回路の一実施例の回路図を示す。同図中、入力端
子１に入来した第３図Ａに示すVTRよりの再生
デイジタル信号ａは抵抗R1、コンデンサＣを直
列に経て帰還抵抗R2を有する演算増幅器２に印
加され、ここで微分、反転増幅される。上記再生
デイジタル信号ａは第３図Ａに示す如く、データ
シンク信号a1と被変調デイジタル信号a2が共に原
信号の矩形波ではなく、前記した理由によりある
傾斜をもつた波形となる。この再生デイジタル信
号ａの波形は、使用するVTRによつて立上り、
立下りの形が変化するが、波形のピーク点はレベ
ルは変動するものの位相は殆ど変化しないことが
確かめられた。そこで、本発明はかかる点に着目
し、データシンク信号a1のピーク点を検出するよ
うにしたものである。
回路の一実施例の回路図を示す。同図中、入力端
子１に入来した第３図Ａに示すVTRよりの再生
デイジタル信号ａは抵抗R1、コンデンサＣを直
列に経て帰還抵抗R2を有する演算増幅器２に印
加され、ここで微分、反転増幅される。上記再生
デイジタル信号ａは第３図Ａに示す如く、データ
シンク信号a1と被変調デイジタル信号a2が共に原
信号の矩形波ではなく、前記した理由によりある
傾斜をもつた波形となる。この再生デイジタル信
号ａの波形は、使用するVTRによつて立上り、
立下りの形が変化するが、波形のピーク点はレベ
ルは変動するものの位相は殆ど変化しないことが
確かめられた。そこで、本発明はかかる点に着目
し、データシンク信号a1のピーク点を検出するよ
うにしたものである。
本実施例ではデータシンク信号a1のピーク点を
検出するために、微分したものであり、上記の如
く演算増幅器２より微分、反転増幅された信号
（第３図Ｂに要部をｂで示す）が取り出される。
この信号ｂは再生データシンク信号a1のピーク点
に対応する位置でｐでゼロクロスする。この信号
ｂは演算増幅器３に印加され、ここで基準電圧
（本実施例では０ボルト）と電圧比較される。そ
の結果、演算増幅器３より第３図Ｃに示す如く、
再生データシンク信号a1のピーク点に対応する位
相で立上るデータシンク信号検出信号ｃが取り出
され、出力端子４より出力される。出力端子４よ
り取り出される信号ｃの立上り位相は、使用する
VTRの如何に拘らず略一定であり、従つて被変
調デイジタル信号（データ）a2を抜き取るための
クロツク信号を常にデータを誤まりなく抜き取り
得、正しい位相とすることができる。
検出するために、微分したものであり、上記の如
く演算増幅器２より微分、反転増幅された信号
（第３図Ｂに要部をｂで示す）が取り出される。
この信号ｂは再生データシンク信号a1のピーク点
に対応する位置でｐでゼロクロスする。この信号
ｂは演算増幅器３に印加され、ここで基準電圧
（本実施例では０ボルト）と電圧比較される。そ
の結果、演算増幅器３より第３図Ｃに示す如く、
再生データシンク信号a1のピーク点に対応する位
相で立上るデータシンク信号検出信号ｃが取り出
され、出力端子４より出力される。出力端子４よ
り取り出される信号ｃの立上り位相は、使用する
VTRの如何に拘らず略一定であり、従つて被変
調デイジタル信号（データ）a2を抜き取るための
クロツク信号を常にデータを誤まりなく抜き取り
得、正しい位相とすることができる。
第４図は本発明回路の出力信号伝送系の一実施
例のブロツク系統図を示す。同図中、５は第２図
に一実施例を示した本発明になるデータ位相基準
信号検出回路で、その出力信号ｃはパルス整形回
路６に供給され、ここで後述するクロツク信号ｅ
の最初のパルスの立上り時点が、再生データa2の
最初の信号のピーク点に略一致する時間（第３図
にＴで示す）遅延され、かつ、微分されて第３図
Ｄに示すパルスｄとされて取り出される。このパ
ルスｄはカウンタ７にリセツトパルスとして印加
される。
例のブロツク系統図を示す。同図中、５は第２図
に一実施例を示した本発明になるデータ位相基準
信号検出回路で、その出力信号ｃはパルス整形回
路６に供給され、ここで後述するクロツク信号ｅ
の最初のパルスの立上り時点が、再生データa2の
最初の信号のピーク点に略一致する時間（第３図
にＴで示す）遅延され、かつ、微分されて第３図
Ｄに示すパルスｄとされて取り出される。このパ
ルスｄはカウンタ７にリセツトパルスとして印加
される。
一方、入力端子８より再生デイジタル信号より
分離され、その後に幅調整、及び位置調整された
再生水平同期信号（周波数ｆH）が位相比較器９
に供給される。この位相比較器９は低域フイルタ
１０、電圧制御発振器（以下VCOという）１
１、及びカウンタ１２と共にフエイズ・ロツド・
ルーブ（PLL）を構成しており、カウンタ１２よ
りの信号と入力端子８よりの信号との位相差に応
じた誤差電圧を出力する。上記のPLLは入力端子
８よりの再生水平同期信号に同期した例えば168
×8fHの周波数の信号をVCO１１より出力せしめ
る。VCO１１の出力信号は、上記カウンタ７に
供給され、ここでカウントされる。カウンタ７は
1/8カウンタであり、168fHの信号をゲート回路１
４に供給する。このゲート回路１４は前記パルス
ｄが印加される制御回路１３の出力をゲートパル
スとして印加せしめられ、第３図Ｅに示す如きク
ロツク信号ｅを出力する。この周波数168fHのク
ロツツク信号ｅはCRC検出回路１５に供給さ
れ、自動利得制御回路（図示せず）を経て入来し
た再生デイジタル信号中のデータ及びCRC信号
を抜き取り、データに誤りがあるか否かを検出す
る。
分離され、その後に幅調整、及び位置調整された
再生水平同期信号（周波数ｆH）が位相比較器９
に供給される。この位相比較器９は低域フイルタ
１０、電圧制御発振器（以下VCOという）１
１、及びカウンタ１２と共にフエイズ・ロツド・
ルーブ（PLL）を構成しており、カウンタ１２よ
りの信号と入力端子８よりの信号との位相差に応
じた誤差電圧を出力する。上記のPLLは入力端子
８よりの再生水平同期信号に同期した例えば168
×8fHの周波数の信号をVCO１１より出力せしめ
る。VCO１１の出力信号は、上記カウンタ７に
供給され、ここでカウントされる。カウンタ７は
1/8カウンタであり、168fHの信号をゲート回路１
４に供給する。このゲート回路１４は前記パルス
ｄが印加される制御回路１３の出力をゲートパル
スとして印加せしめられ、第３図Ｅに示す如きク
ロツク信号ｅを出力する。この周波数168fHのク
ロツツク信号ｅはCRC検出回路１５に供給さ
れ、自動利得制御回路（図示せず）を経て入来し
た再生デイジタル信号中のデータ及びCRC信号
を抜き取り、データに誤りがあるか否かを検出す
る。
なお、以上はVTRによりデイジタル信号を記
録し、これを再生する場合におけるデータシンク
信号の検出動作について説明したが、磁気デイス
ク記録再生装置等にも同様に本発明を適用できる
ことは勿論である。
録し、これを再生する場合におけるデータシンク
信号の検出動作について説明したが、磁気デイス
ク記録再生装置等にも同様に本発明を適用できる
ことは勿論である。
上述の如く、本発明になるデータ位置基準信号
検出回路は、データ位相基準信号を微分回路によ
り微分した後基準電圧と電圧比較することにより
そのビーク点を検出し、その検出出力を上記クロ
ツク信号の位相基準とするよう構成したため、デ
イジタル信号の伝送に使用される装置の特性の相
違により再生されたデータ位相基準信号の波形が
変化しても、確実にデータ位相基準信号を検出で
き、データ抜き取りの基準を正確に定めることが
でき、また第３図ＤにＴで示す遅延量は使用する
装置の特性により変化するが、データ位相基準信
号を立上りで検出する従来回路に比し、その変化
分は半分以下で済み、従つて使用する装置に応じ
て遅延量Ｔをその都度変化させるための調整を不
要にできる等の特長を有するものである。
検出回路は、データ位相基準信号を微分回路によ
り微分した後基準電圧と電圧比較することにより
そのビーク点を検出し、その検出出力を上記クロ
ツク信号の位相基準とするよう構成したため、デ
イジタル信号の伝送に使用される装置の特性の相
違により再生されたデータ位相基準信号の波形が
変化しても、確実にデータ位相基準信号を検出で
き、データ抜き取りの基準を正確に定めることが
でき、また第３図ＤにＴで示す遅延量は使用する
装置の特性により変化するが、データ位相基準信
号を立上りで検出する従来回路に比し、その変化
分は半分以下で済み、従つて使用する装置に応じ
て遅延量Ｔをその都度変化させるための調整を不
要にできる等の特長を有するものである。
第１図Ａ，Ｂは夫々データ位相基準信号の記録
時と再生時の波形図、第２図は本発明回路の一実
施例を示す回路図、第３図Ａ〜Ｅは夫々第２図及
び第４図の動作説明用信号波形図、第４図は本発
明回路の出力信号伝送系の一実施例のブロツク系
統図である。 １……デイジタル信号入力端子、２，３……演
算増幅器、４……データ位相基準信号検出信号出
力端子、８……水平同期信号入力端子。
時と再生時の波形図、第２図は本発明回路の一実
施例を示す回路図、第３図Ａ〜Ｅは夫々第２図及
び第４図の動作説明用信号波形図、第４図は本発
明回路の出力信号伝送系の一実施例のブロツク系
統図である。 １……デイジタル信号入力端子、２，３……演
算増幅器、４……データ位相基準信号検出信号出
力端子、８……水平同期信号入力端子。
Claims (1)
- １ 情報信号を変調して得た被変調デイジタル信
号とこれを再生時に抜き取るためのクロツク信号
の位相の基準となるデータ位相基準信号とが存在
するデイジタル信号の伝送において、上記データ
位相基準信号を微分回路により微分した後基準電
圧と電圧比較することによりそのピーク点を検出
し、この検出出力を上記クロツク信号の位相基準
とするための信号として出力するよう構成したこ
とを特徴とするデータ位相基準信号検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10472078A JPS5532269A (en) | 1978-08-28 | 1978-08-28 | Data phase reference signal detection circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10472078A JPS5532269A (en) | 1978-08-28 | 1978-08-28 | Data phase reference signal detection circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5532269A JPS5532269A (en) | 1980-03-06 |
| JPS6222195B2 true JPS6222195B2 (ja) | 1987-05-16 |
Family
ID=14388314
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10472078A Granted JPS5532269A (en) | 1978-08-28 | 1978-08-28 | Data phase reference signal detection circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5532269A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57103450A (en) * | 1980-12-17 | 1982-06-28 | Nec Corp | Clock extracting circuit |
-
1978
- 1978-08-28 JP JP10472078A patent/JPS5532269A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5532269A (en) | 1980-03-06 |
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