JPS62210740A - 回線等化回路 - Google Patents
回線等化回路Info
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- JPS62210740A JPS62210740A JP61052352A JP5235286A JPS62210740A JP S62210740 A JPS62210740 A JP S62210740A JP 61052352 A JP61052352 A JP 61052352A JP 5235286 A JP5235286 A JP 5235286A JP S62210740 A JPS62210740 A JP S62210740A
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G5/00—Tone control or bandwidth control in amplifiers
- H03G5/16—Automatic control
- H03G5/165—Equalizers; Volume or gain control in limited frequency bands
Landscapes
- Networks Using Active Elements (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は信号の伝送における回線等化回路に関するもの
である。
である。
（従来の技術）
第２図は、従来の回線等化回路の一構成例を示す回路図
であって、ＬＳＩ２はパッケージされた集積回路の全体
を示し、■１〜Ｔ５はその各端子である。演算増幅器Ｏ
ＰＩは、端子Ｔ１を介して＋端子に被増幅用の入力信号
を受け、一端子は、抵抗Ｒ１と、そしてアナログスイッ
チ８１〜３ｎによって択一的に接続されるようにしたコ
ンデンサＣ１〜ｃｎを介して接地され、その出力が可変
抵抗Ｒ２を介して一端子に帰還されていて、高域通過回
路を構成している。演算増幅器ＯＰ１の出力は、低域通
過回路ＬＰＦ２と、帯域外高域の雑音を除去するための
演算増幅器ＯＰ２と、回線の線路長による信号レベル損
失を補正するための演算増幅器ＯＰ３を経て所用の増幅
信号として出力される。信号ピーク検出回路ＰＫＤＥＴ
２は、演算増幅器ＯＰ３のピークレベルを検出して、可
変抵抗Ｒ２を調節して演算増幅ＩＪＯＰ１の利得を調第
するとともに、アナログスイッチ８１〜Ｓｎを選択して
作動させ、そして演算増幅器ＯＰ３の帰還用の可変抵抗
Ｒ３を調節して、以下の如く、適正な周波数補正とレベ
ル補正が維持されるようにしている。
であって、ＬＳＩ２はパッケージされた集積回路の全体
を示し、■１〜Ｔ５はその各端子である。演算増幅器Ｏ
ＰＩは、端子Ｔ１を介して＋端子に被増幅用の入力信号
を受け、一端子は、抵抗Ｒ１と、そしてアナログスイッ
チ８１〜３ｎによって択一的に接続されるようにしたコ
ンデンサＣ１〜ｃｎを介して接地され、その出力が可変
抵抗Ｒ２を介して一端子に帰還されていて、高域通過回
路を構成している。演算増幅器ＯＰ１の出力は、低域通
過回路ＬＰＦ２と、帯域外高域の雑音を除去するための
演算増幅器ＯＰ２と、回線の線路長による信号レベル損
失を補正するための演算増幅器ＯＰ３を経て所用の増幅
信号として出力される。信号ピーク検出回路ＰＫＤＥＴ
２は、演算増幅器ＯＰ３のピークレベルを検出して、可
変抵抗Ｒ２を調節して演算増幅ＩＪＯＰ１の利得を調第
するとともに、アナログスイッチ８１〜Ｓｎを選択して
作動させ、そして演算増幅器ＯＰ３の帰還用の可変抵抗
Ｒ３を調節して、以下の如く、適正な周波数補正とレベ
ル補正が維持されるようにしている。
第３図は、端子Ｔ１に接続されている線路の特性を示ず
もので、第３図（＾）は線路長に対する線路の周波数特
性であり、線路長が長くなると高周波領域においてレベ
ルが低下することを示している。第３図（Ｂ）は線路長
に対する線路損失を含めた周波数特性であり、線路損失
によって全領域においてレベル低下している。
もので、第３図（＾）は線路長に対する線路の周波数特
性であり、線路長が長くなると高周波領域においてレベ
ルが低下することを示している。第３図（Ｂ）は線路長
に対する線路損失を含めた周波数特性であり、線路損失
によって全領域においてレベル低下している。
回線を等化するためには、その等止器として、第３図（
＾）の特性に対しては第４図（Ａ）の特性による補正を
、そして第３図（Ｂ）の特性に対しては第４図（Ｂ）の
特性による補正を必要とする。
＾）の特性に対しては第４図（Ａ）の特性による補正を
、そして第３図（Ｂ）の特性に対しては第４図（Ｂ）の
特性による補正を必要とする。
第５図は、第２図の回路における回線の制御特性を示す
ものであって、第５図（Ａ）に示すように、アナログス
イッチ＄１〜３ｎの選択制御によって、カットオフ周波
数が可変となり、そして、第５図（Ｂ）に示すように、
低域通過回路ＬＰＦ２によって高域カットされて、これ
らの組合わせによって、第５図（Ｃ）の補正特性が得ら
れる。
ものであって、第５図（Ａ）に示すように、アナログス
イッチ＄１〜３ｎの選択制御によって、カットオフ周波
数が可変となり、そして、第５図（Ｂ）に示すように、
低域通過回路ＬＰＦ２によって高域カットされて、これ
らの組合わせによって、第５図（Ｃ）の補正特性が得ら
れる。
（発明が解決しようとする問題点）
しかしながら、上記の構成では、集積回路ＬＳ■２の外
部に付加する部品点数が多く、その結果、集積回路ＬＳ
Ｉ２のパッケージの端子数の増加を招き、また、アナ
ログスイッチ８１〜Ｓｎの導通抵抗の製造上のばらつき
などによって、演算増幅器ＯＰ１に係わる高域通過回路
の特性が安定しないなどの問題があった。
部に付加する部品点数が多く、その結果、集積回路ＬＳ
Ｉ２のパッケージの端子数の増加を招き、また、アナ
ログスイッチ８１〜Ｓｎの導通抵抗の製造上のばらつき
などによって、演算増幅器ＯＰ１に係わる高域通過回路
の特性が安定しないなどの問題があった。
本発明は前記問題点を除去し、安定な伝送特性が得られ
、且つ集積回路化する際にパッケージを小形化できる回
線等化回路を提供することを目的とする。
、且つ集積回路化する際にパッケージを小形化できる回
線等化回路を提供することを目的とする。
（問題点を解決するための手段）
本発明は前記問題点を解決するために、高域通過回路と
、演算増幅器の出力端とマイナス側入力端との間に抵抗
を接続し、該マイナス側入力端子を可変抵抗を介して接
地することにより利得調節可能となしたサレンキー型低
域通過回路と、前記サレンキー型低域通過回路の演算増
幅器のプラス側入力端の信号を増幅する利得制御可能な
増幅回路と、前記増幅回路の出力信号のピークレベルを
検出し、該ピークレベルに応じて前記サレンキー型低域
通過回路の可変抵抗値を制御し、又は前記増幅回路の利
得を制御する手段とから構成した。
、演算増幅器の出力端とマイナス側入力端との間に抵抗
を接続し、該マイナス側入力端子を可変抵抗を介して接
地することにより利得調節可能となしたサレンキー型低
域通過回路と、前記サレンキー型低域通過回路の演算増
幅器のプラス側入力端の信号を増幅する利得制御可能な
増幅回路と、前記増幅回路の出力信号のピークレベルを
検出し、該ピークレベルに応じて前記サレンキー型低域
通過回路の可変抵抗値を制御し、又は前記増幅回路の利
得を制御する手段とから構成した。
（作 用）
本発明によれば、回線を通過することにより高域の減衰
した入力信号が、高域通過回路により一定幅高域強調さ
れ、サレンキー型低域通過回路により、更に高域強調さ
れるとともに帯域外の高周波雑音が除去され、増幅回路
により増幅されて、平坦な周波数特性の信号に等化され
る。
した入力信号が、高域通過回路により一定幅高域強調さ
れ、サレンキー型低域通過回路により、更に高域強調さ
れるとともに帯域外の高周波雑音が除去され、増幅回路
により増幅されて、平坦な周波数特性の信号に等化され
る。
（実施例）
第１図は本発明の実施例を示す回路図であって、ＬＳｌ
ｌはパッケージされた集積回路の全体を示し、Ｔ６ 、
Ｔ７はその端子である。コンデンサＯＡ、抵抗ＲＡ 、
ＲＢは高域通過回路を構成し、被増幅用の入力信号ＩＮ
を入力して、回線の周波数特性を補正する。ＬＰＦｌは
、サレンキー型の低域通過回路であって、第１の演算増
幅器ＯＰ＾は、互いに等しい抵抗値の抵抗ＲＣ、ＲＤと
、互いに等しい容最のコンデンサＣＢ 、ＣＣよりなる
３端子網ＮＷと、端子Ｔ１を介して、その中端子に入力
信号ＩＮの高域通過した信号を低域通過させて受信して
いる。そして、その出力信号は端子Ｔ６と、３端子網Ｎ
ＷのコンデンサＣＢを介して端子中に正帰還されている
。演算増幅器ＯＰＡの出力信号はまた、抵抗ＲＥを介し
て一端子に帰還されて、可変抵抗ＲＦとの結合によって
、その利得を可変にしている。
ｌはパッケージされた集積回路の全体を示し、Ｔ６ 、
Ｔ７はその端子である。コンデンサＯＡ、抵抗ＲＡ 、
ＲＢは高域通過回路を構成し、被増幅用の入力信号ＩＮ
を入力して、回線の周波数特性を補正する。ＬＰＦｌは
、サレンキー型の低域通過回路であって、第１の演算増
幅器ＯＰ＾は、互いに等しい抵抗値の抵抗ＲＣ、ＲＤと
、互いに等しい容最のコンデンサＣＢ 、ＣＣよりなる
３端子網ＮＷと、端子Ｔ１を介して、その中端子に入力
信号ＩＮの高域通過した信号を低域通過させて受信して
いる。そして、その出力信号は端子Ｔ６と、３端子網Ｎ
ＷのコンデンサＣＢを介して端子中に正帰還されている
。演算増幅器ＯＰＡの出力信号はまた、抵抗ＲＥを介し
て一端子に帰還されて、可変抵抗ＲＦとの結合によって
、その利得を可変にしている。
第２の演算増幅器ＯＰＢは、第１の演算増幅器の中端子
（入力端）の信号を受け、その出力信号は、可変抵抗Ｒ
Ｇを介して帰還され、該出力信号は、この集積回路１８
１１の所用の増幅信号をなしている。
（入力端）の信号を受け、その出力信号は、可変抵抗Ｒ
Ｇを介して帰還され、該出力信号は、この集積回路１８
１１の所用の増幅信号をなしている。
信号ピーク検出回路ＰＫＤＥＴ１は、演算増幅器ＯＰＢ
のピークレベルを検出して、可変抵抗ＲＦを調節して演
算増幅器ＯＰＡの利得を調節するとともに、演算増幅器
ＯＰＢの帰還用の可変抵抗ＲＧを調節して、適正な周波
数補正とレベル補正が維持されるようにしている。
のピークレベルを検出して、可変抵抗ＲＦを調節して演
算増幅器ＯＰＡの利得を調節するとともに、演算増幅器
ＯＰＢの帰還用の可変抵抗ＲＧを調節して、適正な周波
数補正とレベル補正が維持されるようにしている。
以上の構成において、以下にその動作を説明する。
被増幅用の入力信号ＩＮは、抵抗ＲＡ、コンデンサＯＡ
よりなる高域通過回路によって高域通過され、その周波
数特性は第６図（Ａ）に示すように、カットオフ周波数
ｆｃ以上の領域に対して漸増傾斜となる。
よりなる高域通過回路によって高域通過され、その周波
数特性は第６図（Ａ）に示すように、カットオフ周波数
ｆｃ以上の領域に対して漸増傾斜となる。
低域通過回路ＬＰＦＩにおいて、演算増幅器ＯＰＡの利
得にと、該低域通過回路ＬＰＦＩのＱとの関係は、抵抗
ＲＣ−ＲＤ 、コンデンサＣＢ−ＣＣであるから、 Ｑ＝１／（３−に） Ｋ ＝ １＋ＲＥ／ＲＦ となる。
得にと、該低域通過回路ＬＰＦＩのＱとの関係は、抵抗
ＲＣ−ＲＤ 、コンデンサＣＢ−ＣＣであるから、 Ｑ＝１／（３−に） Ｋ ＝ １＋ＲＥ／ＲＦ となる。
よって可変抵抗ＲＦによりＱは可変となる。そして演算
増幅器ＯＰＢの入力としては、演算増幅器ＯＰＡの子端
子への入力信号を使用しているので利得にとは無関係に
Ｑの変化による周波数特性が表われる。この特性は第６
図（Ｂ）に示すように、Ｑが大になると、この場合カッ
トオフ周波数ｆｃにピーク値を有する周波数特性が増加
補正され、その組合わせの周波数補正特性は第６図（Ｃ
）のようになる。信号ピーク検出回路ＰＫＤＥＴＩは、
演算増幅器ＯＰＢの出力信号のピークレベルを検出して
、該ピークレベルに応じて、第１と第２の演算増幅器Ｏ
ＰＡ 、ＯＰＢの各可変抵抗ＲＦ。
増幅器ＯＰＢの入力としては、演算増幅器ＯＰＡの子端
子への入力信号を使用しているので利得にとは無関係に
Ｑの変化による周波数特性が表われる。この特性は第６
図（Ｂ）に示すように、Ｑが大になると、この場合カッ
トオフ周波数ｆｃにピーク値を有する周波数特性が増加
補正され、その組合わせの周波数補正特性は第６図（Ｃ
）のようになる。信号ピーク検出回路ＰＫＤＥＴＩは、
演算増幅器ＯＰＢの出力信号のピークレベルを検出して
、該ピークレベルに応じて、第１と第２の演算増幅器Ｏ
ＰＡ 、ＯＰＢの各可変抵抗ＲＦ。
ＲＧを調節して、第３図（Ａ）、（Ｂ）にそれぞれ示す
線路長による周波数特性と、線路長による線路損失が補
正された等化特性が得られる。
線路長による周波数特性と、線路長による線路損失が補
正された等化特性が得られる。
（発明の効果）
以上説明したように本発明によれば、低域通過回路は抵
抗を可変とするのみで、スイッチ要素を含まないで周波
数特性が補償制御されるものであって、抵抗の精度は温
度特性も含めて充分に管理し得るので、補償精度が向上
する。また集積回路の入力側の外付は部品は、集積回路
への人力線と集積回路からの帰還線をそれぞれの端子に
よって接続されるものであるから、端子数は少なくてす
み、集積回路パッケージの小形化にも寄与し得る等の利
点がある。
抗を可変とするのみで、スイッチ要素を含まないで周波
数特性が補償制御されるものであって、抵抗の精度は温
度特性も含めて充分に管理し得るので、補償精度が向上
する。また集積回路の入力側の外付は部品は、集積回路
への人力線と集積回路からの帰還線をそれぞれの端子に
よって接続されるものであるから、端子数は少なくてす
み、集積回路パッケージの小形化にも寄与し得る等の利
点がある。
第１図は本発明の実施例を示す回路図、第２図は従来例
を示す回路図、第３図（Ａ）（Ｂ）は線路の周波数特性
図、第４図（Ａ） （Ｂ）は補正に必要な特性図、第５
図（Ａ）〜（Ｃ）は従来例の補正特性図、第６図（Ａ）
〜（Ｃ）は本発明の実施例の補正特性図である。 ＲＡ、 ＲＢ・・・抵抗、ＯＡ・・・コンデンサ、ＬＰ
ＦＩ・・・低域通過回路、ＯＰＡ・・・第１の演算増幅
器、ＮＷ・・・３端子網、ＯＰＢ・・・第２の演算増幅
器、ＰＫＤＥＴｌ・・・信号ピーク検出回路。
を示す回路図、第３図（Ａ）（Ｂ）は線路の周波数特性
図、第４図（Ａ） （Ｂ）は補正に必要な特性図、第５
図（Ａ）〜（Ｃ）は従来例の補正特性図、第６図（Ａ）
〜（Ｃ）は本発明の実施例の補正特性図である。 ＲＡ、 ＲＢ・・・抵抗、ＯＡ・・・コンデンサ、ＬＰ
ＦＩ・・・低域通過回路、ＯＰＡ・・・第１の演算増幅
器、ＮＷ・・・３端子網、ＯＰＢ・・・第２の演算増幅
器、ＰＫＤＥＴｌ・・・信号ピーク検出回路。
Claims (1)
- 【特許請求の範囲】 高域通過回路と、 演算増幅器の出力端とマイナス側入力端との間に抵抗を
接続し、該マイナス側入力端子を可変抵抗を介して接地
することにより利得調節可能となしたサレンキー型低域
通過回路と、 前記サレンキー型低域通過回路の演算増幅器のプラス側
入力端の信号を増幅する利得制御可能な増幅回路と、 前記増幅回路の出力信号のピークレベルを検出し、該ピ
ークレベルに応じて前記サレンキー型低域通過回路の可
変抵抗値を制御し、又は前記増幅回路の利得を制御する
手段とからなる 回線等化回路。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61052352A JPH0683113B2 (ja) | 1986-03-12 | 1986-03-12 | 回線等化回路 |
| US07/023,107 US4755771A (en) | 1986-03-12 | 1987-03-06 | Equalizing circuit |
| IN186/CAL/87A IN167265B (ja) | 1986-03-12 | 1987-03-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61052352A JPH0683113B2 (ja) | 1986-03-12 | 1986-03-12 | 回線等化回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62210740A true JPS62210740A (ja) | 1987-09-16 |
| JPH0683113B2 JPH0683113B2 (ja) | 1994-10-19 |
Family
ID=12912416
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61052352A Expired - Lifetime JPH0683113B2 (ja) | 1986-03-12 | 1986-03-12 | 回線等化回路 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US4755771A (ja) |
| JP (1) | JPH0683113B2 (ja) |
| IN (1) | IN167265B (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07202949A (ja) * | 1993-11-30 | 1995-08-04 | At & T Corp | 回線長検出機能を有する広帯域等化器 |
| JP2007174637A (ja) * | 2005-12-20 | 2007-07-05 | Altera Corp | 信号調節受信器回路網 |
| WO2011118543A1 (ja) * | 2010-03-24 | 2011-09-29 | 日本電気株式会社 | 波形等化回路および波形等化方法 |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB2209444B (en) * | 1987-07-21 | 1992-03-18 | Plessey Co Plc | Improvements in or relating to amplifiers |
| US5194827A (en) * | 1991-04-10 | 1993-03-16 | Ampex Systems Corporation | Voltage controlled high frequency equalization |
| FR2683695B1 (fr) * | 1991-11-12 | 1995-10-13 | Carpentier Claude | Procede et dispositif d'egalisation dynamique. |
| US5280346A (en) * | 1992-10-23 | 1994-01-18 | Ross John D | Equalizing amplifier |
| FR2728426B1 (fr) * | 1994-12-20 | 1997-04-11 | Carpentier Claude | Procede et dispositif d'egalisation dynamique perfectionne |
| US5581213A (en) * | 1995-06-07 | 1996-12-03 | Hughes Aircraft Company | Variable gain amplifier circuit |
| JP3050203U (ja) * | 1997-12-26 | 1998-06-30 | 船井電機株式会社 | コントロール信号増幅回路 |
| US7184099B1 (en) * | 2000-10-27 | 2007-02-27 | National Semiconductor Corporation | Controllable signal baseline and frequency emphasis circuit |
| GB2502136A (en) * | 2012-05-18 | 2013-11-20 | Tellurium Q Ltd | An output filter for a DAC in an audio playback system |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6024737A (ja) * | 1983-07-20 | 1985-02-07 | Nippon Telegr & Teleph Corp <Ntt> | 可変等化器 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6041332A (ja) * | 1983-08-16 | 1985-03-05 | Nec Corp | 伝送路等化回路 |
-
1986
- 1986-03-12 JP JP61052352A patent/JPH0683113B2/ja not_active Expired - Lifetime
-
1987
- 1987-03-06 US US07/023,107 patent/US4755771A/en not_active Expired - Lifetime
- 1987-03-09 IN IN186/CAL/87A patent/IN167265B/en unknown
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6024737A (ja) * | 1983-07-20 | 1985-02-07 | Nippon Telegr & Teleph Corp <Ntt> | 可変等化器 |
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| WO2011118543A1 (ja) * | 2010-03-24 | 2011-09-29 | 日本電気株式会社 | 波形等化回路および波形等化方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| US4755771A (en) | 1988-07-05 |
| IN167265B (ja) | 1990-09-29 |
| JPH0683113B2 (ja) | 1994-10-19 |
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