JPS62196702A - プログラマブルコントロ−ラの出力制御回路 - Google Patents
プログラマブルコントロ−ラの出力制御回路Info
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- JPS62196702A JPS62196702A JP3854486A JP3854486A JPS62196702A JP S62196702 A JPS62196702 A JP S62196702A JP 3854486 A JP3854486 A JP 3854486A JP 3854486 A JP3854486 A JP 3854486A JP S62196702 A JPS62196702 A JP S62196702A
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- 238000001514 detection method Methods 0.000 claims description 11
- 230000005856 abnormality Effects 0.000 abstract description 8
- 238000010586 diagram Methods 0.000 description 6
- 238000000034 method Methods 0.000 description 3
- 239000003795 chemical substances by application Substances 0.000 description 1
- 239000013256 coordination polymer Substances 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
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- Safety Devices In Control Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明はプログラマブルコントローラの二重化出力制
御をするプログラマブルコントローラの出力制御回路に
関するものである。
御をするプログラマブルコントローラの出力制御回路に
関するものである。
第4図は従来のプログラマブルコントローラノ出力制御
回路を示す回路図であり、図において、1.2はプログ
ラマブルコントローラのデジタル出力カード−1および
−2,3は出力を切換えろ為のバッファリレー、4はバ
ッファリレー3用の電源、5は出力カード141 (1
1と出力カードIV&L2(21を切換える為の切換ス
イッチ、6はバッファリレ−3の出力用の接点である。
回路を示す回路図であり、図において、1.2はプログ
ラマブルコントローラのデジタル出力カード−1および
−2,3は出力を切換えろ為のバッファリレー、4はバ
ッファリレー3用の電源、5は出力カード141 (1
1と出力カードIV&L2(21を切換える為の切換ス
イッチ、6はバッファリレ−3の出力用の接点である。
次に動作について説明する。この二重化出力制御方式で
は、出力カードrI&L1 (11系と出力カード嵐2
(2J系との切換えが手動によるスイッチの切換えによ
り行なわれるようになりている。すなわち、切換スイッ
チ5が操作されると、それにより選択された方の系のバ
ッファリレー3が動作し、外部の回路に信号が伝達され
る。そして、動作中の系に異常が発生したときには、切
換スイッチ5を手動で切換え、もう一方の系により制御
が続行されろことになる。
は、出力カードrI&L1 (11系と出力カード嵐2
(2J系との切換えが手動によるスイッチの切換えによ
り行なわれるようになりている。すなわち、切換スイッ
チ5が操作されると、それにより選択された方の系のバ
ッファリレー3が動作し、外部の回路に信号が伝達され
る。そして、動作中の系に異常が発生したときには、切
換スイッチ5を手動で切換え、もう一方の系により制御
が続行されろことになる。
従来のプログラマブルコントローラの出力制御回路は以
上のように構成されているので、二重化出力の制御方式
では、手動で切換える必要があり、このため、全体の動
作状態を常時監視して異常の発生に備えていなければな
らないという問題点があった。
上のように構成されているので、二重化出力の制御方式
では、手動で切換える必要があり、このため、全体の動
作状態を常時監視して異常の発生に備えていなければな
らないという問題点があった。
この発明は上記のような問題点を解消するためになされ
1こもので、一方の出力系に異常か発生したときには、
自動的にバソクアッグ系のデジタル出力カードに切換わ
って、制御を継続できるプログラマブルコントローラの
出力制御回路を得ることを目的とする。
1こもので、一方の出力系に異常か発生したときには、
自動的にバソクアッグ系のデジタル出力カードに切換わ
って、制御を継続できるプログラマブルコントローラの
出力制御回路を得ることを目的とする。
この発明に係るプログラマブルコントローラの出力制御
回路は、そのデジタル出力カー ド内に、ロジック回路
側の出力信号と、リレー・(ロ)路側σ〕出力信号の不
一致を検出し、不一致が検出されたとき異常として出力
なオフ< OFF )にし、同時に正常信号もオフにす
る回路を持たせたものである。
回路は、そのデジタル出力カー ド内に、ロジック回路
側の出力信号と、リレー・(ロ)路側σ〕出力信号の不
一致を検出し、不一致が検出されたとき異常として出力
なオフ< OFF )にし、同時に正常信号もオフにす
る回路を持たせたものである。
この発明における上記回路は、動作中のデジタル出力カ
ードの出力に異常が検出されたときには、それをオフ状
態にし、これに応じ【バンクアップ用のデジタル出力カ
ードは、動作中のカードより入力されていた正常信号が
OFFになる為、自カードのリレー回路が動作を始め、
出力することができる。
ードの出力に異常が検出されたときには、それをオフ状
態にし、これに応じ【バンクアップ用のデジタル出力カ
ードは、動作中のカードより入力されていた正常信号が
OFFになる為、自カードのリレー回路が動作を始め、
出力することができる。
以下、この発明の一実施例を図について説明する。第1
図において、11はプログラマブルコントローラのCP
U部からの信号ケ受けとるロジック回路、12はロジッ
ク回路11とリレー回路部との絶縁用フォトカプラー、
13は出力の為のリレー、14は出力リレーの接点、1
5は出力リレーの接点14の動作状態を検出する為の出
力検出回路、16はロジック回路11と出力リレーの接
点14の動作状態との不一致を検出する信号不一致検出
回路、17は出力をオフする為の出力オンリレー、18
は出力オフリレー1Tの接点、19は出力が正常である
ときを示す正常信号、20は二重化の相手側か正常であ
るとき入力される相手側正常信号である。
図において、11はプログラマブルコントローラのCP
U部からの信号ケ受けとるロジック回路、12はロジッ
ク回路11とリレー回路部との絶縁用フォトカプラー、
13は出力の為のリレー、14は出力リレーの接点、1
5は出力リレーの接点14の動作状態を検出する為の出
力検出回路、16はロジック回路11と出力リレーの接
点14の動作状態との不一致を検出する信号不一致検出
回路、17は出力をオフする為の出力オンリレー、18
は出力オフリレー1Tの接点、19は出力が正常である
ときを示す正常信号、20は二重化の相手側か正常であ
るとき入力される相手側正常信号である。
動作について説明する。
第2図に、信号不一致検出回路16の内部構成を示し、
以下それに基づいて説明する。ロジック回路11の出力
信号とリレー回路の出力検出回路15の信号との不一致
と、それのタイマー処理により、不一致状態か一定時間
以上続(と、信号不一致検出回路16より出力オフリレ
ー17に出力オフ指令が出て、動作中の出力カード(こ
れなマスター側カードという)のリレー出力は全てオフ
となり、同時に正常信号19もオフとなる。
以下それに基づいて説明する。ロジック回路11の出力
信号とリレー回路の出力検出回路15の信号との不一致
と、それのタイマー処理により、不一致状態か一定時間
以上続(と、信号不一致検出回路16より出力オフリレ
ー17に出力オフ指令が出て、動作中の出力カード(こ
れなマスター側カードという)のリレー出力は全てオフ
となり、同時に正常信号19もオフとなる。
一方、二重化されて(・る相手側カード(これをスレー
ブ側カードという)では、マスター側カードが正常時に
は、正常信号かスレーブ側カードに入力されており、こ
れがインターロックとなり、スレーブ側カードではリレ
ー出力が出力されない。
ブ側カードという)では、マスター側カードが正常時に
は、正常信号かスレーブ側カードに入力されており、こ
れがインターロックとなり、スレーブ側カードではリレ
ー出力が出力されない。
しかして、マスター側カードに異常が検出され、これに
より正常信号がオフされると、スレーブ側カードに正常
信号が入力されなくなり、スレーブ側カードかマスター
側カードに切換わって選択され、リレー出力を出すよう
Kなる。
より正常信号がオフされると、スレーブ側カードに正常
信号が入力されなくなり、スレーブ側カードかマスター
側カードに切換わって選択され、リレー出力を出すよう
Kなる。
このカードの使用法は、第3図に示すように、二重化し
ている各カードの各出力信号を並列に接続し、それぞれ
の正常信号19を相手側正常信号20へ接続すれば良い
。ここで、一方のカード1を例えばマスター側カードと
すれば、他方のカード2がスレーブ側カードとなる。
ている各カードの各出力信号を並列に接続し、それぞれ
の正常信号19を相手側正常信号20へ接続すれば良い
。ここで、一方のカード1を例えばマスター側カードと
すれば、他方のカード2がスレーブ側カードとなる。
なお、上記実施例では、出力にリレー接点出力のものt
示したか、トランジスタなスイッチ素子としたオープン
コレクタ出力方式のものを用い又も同様に実施すること
かできろ。
示したか、トランジスタなスイッチ素子としたオープン
コレクタ出力方式のものを用い又も同様に実施すること
かできろ。
以上のように、この発明によれば、デジタル出力回路を
2重化したものに信号不一致検出回路を設けるよ5に構
成したので、2重化の切換を出力カードの異常により自
動的に行なうことができ、常時監視を要することなく、
常圧確実な制御動作を遂行させることかできる効果があ
る。
2重化したものに信号不一致検出回路を設けるよ5に構
成したので、2重化の切換を出力カードの異常により自
動的に行なうことができ、常時監視を要することなく、
常圧確実な制御動作を遂行させることかできる効果があ
る。
第1図はこの発明の一実施例による出力制御回路を示す
回路図、第2図は信号不一致検出回路の一例を示すロジ
ック構成図、第3図は本発明による出力制御回路の使用
法を示す回路図、第4図は従来の出力制御回路の一例を
示す回路図である。 11はロジック回路、15は出力検出回路、16は信号
不一致検出回路、17は、出力オフリレー、19は正常
信号、20は相手側正常信号。 なお、図中、同一符号は同一、又は相当部分を示す。 特許出願人 三菱電機株式会社 −−−二 代理人 弁理士 1)澤 博 昭 (外2名)
回路図、第2図は信号不一致検出回路の一例を示すロジ
ック構成図、第3図は本発明による出力制御回路の使用
法を示す回路図、第4図は従来の出力制御回路の一例を
示す回路図である。 11はロジック回路、15は出力検出回路、16は信号
不一致検出回路、17は、出力オフリレー、19は正常
信号、20は相手側正常信号。 なお、図中、同一符号は同一、又は相当部分を示す。 特許出願人 三菱電機株式会社 −−−二 代理人 弁理士 1)澤 博 昭 (外2名)
Claims (2)
- (1)同一制御機能を有するデジタル出力カードを複数
備え、二重化出力機能を与えるようにしたプログラマブ
ルコントローラの出力制御回路において、上記デジタル
出力カードのそれぞれに、その内部のロジック部分から
の出力信号と、上記出力信号によって動作する出力回路
の出力信号とを比較し、それらの信号の不一致を検出し
たときと外部から正常信号が供給されたときに上記出力
回路の信号出力動作を停止させると共に、不一致が検出
されないときには外部に正常信号を出力する信号不一致
検出回路を設け、上記複数のデジタル出力カードのそれ
ぞれの上記信号不一致検出回路からの正常信号をそれぞ
れ他のデジタル出力カードに入力するように構成したこ
とを特徴とするプログラマブルコントローラの出力制御
回路。 - (2)上記出力回路がリレー回路およびトランジスタ回
路の少なくとも一方で構成されていることを特徴とする
特許請求の範囲第1項記載のプログラマブルコントロー
ラの出力制御回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3854486A JPS62196702A (ja) | 1986-02-24 | 1986-02-24 | プログラマブルコントロ−ラの出力制御回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3854486A JPS62196702A (ja) | 1986-02-24 | 1986-02-24 | プログラマブルコントロ−ラの出力制御回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62196702A true JPS62196702A (ja) | 1987-08-31 |
Family
ID=12528226
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3854486A Pending JPS62196702A (ja) | 1986-02-24 | 1986-02-24 | プログラマブルコントロ−ラの出力制御回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62196702A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01231101A (ja) * | 1988-03-11 | 1989-09-14 | Toshiba Corp | 二重化プロセス入出力制御装置 |
JP2015099412A (ja) * | 2013-11-18 | 2015-05-28 | 三菱電機株式会社 | デジタル出力装置 |
JP2016201761A (ja) * | 2015-04-14 | 2016-12-01 | 東洋電機製造株式会社 | 故障検出回路 |
-
1986
- 1986-02-24 JP JP3854486A patent/JPS62196702A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01231101A (ja) * | 1988-03-11 | 1989-09-14 | Toshiba Corp | 二重化プロセス入出力制御装置 |
JP2015099412A (ja) * | 2013-11-18 | 2015-05-28 | 三菱電機株式会社 | デジタル出力装置 |
JP2016201761A (ja) * | 2015-04-14 | 2016-12-01 | 東洋電機製造株式会社 | 故障検出回路 |
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