JPH1124702A - 二重化シーケンスコントローラ装置 - Google Patents
二重化シーケンスコントローラ装置Info
- Publication number
- JPH1124702A JPH1124702A JP17394997A JP17394997A JPH1124702A JP H1124702 A JPH1124702 A JP H1124702A JP 17394997 A JP17394997 A JP 17394997A JP 17394997 A JP17394997 A JP 17394997A JP H1124702 A JPH1124702 A JP H1124702A
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- Japan
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- controller
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- sequence
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- Pending
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Abstract
(57)【要約】
【課題】Ｉ／Ｏ基板のみに異常が発生した場合において
も異常を適格に検知し、正常なシーケンスコントローラ
への切替えを行うことのできる二重化シーケンスコント
ローラ装置を提供すること。 【解決手段】ＣＰＵと入力／出力基板を備えた二重化構
成のシーケンスコントローラ相互間を伝送ラインを介し
て信号を授受されるように構成された二重化シーケンス
コントローラ装置において、前記シーケンスコントロー
ラは入力／出力基板の異常を検出する補助リレーを有
し、相手方シーケンスコントローラに対応する補助リレ
ーの動作により異常を検知しているので、互いに適切な
バックアップ運転が行える。
も異常を適格に検知し、正常なシーケンスコントローラ
への切替えを行うことのできる二重化シーケンスコント
ローラ装置を提供すること。 【解決手段】ＣＰＵと入力／出力基板を備えた二重化構
成のシーケンスコントローラ相互間を伝送ラインを介し
て信号を授受されるように構成された二重化シーケンス
コントローラ装置において、前記シーケンスコントロー
ラは入力／出力基板の異常を検出する補助リレーを有
し、相手方シーケンスコントローラに対応する補助リレ
ーの動作により異常を検知しているので、互いに適切な
バックアップ運転が行える。
Description
【０００１】
【発明の属する技術分野】本発明はビル設備、上下水道
設備または工場プラント等に設置されている各種装置及
び機器の自動並に連動制御を行う二重化シーケンスコン
トローラ装置に関する。
設備または工場プラント等に設置されている各種装置及
び機器の自動並に連動制御を行う二重化シーケンスコン
トローラ装置に関する。
【０００２】
【従来の技術】ビル設備、上下水道設備、工場プラント
等における重要な装置や機器をシーケンスコントローラ
にて制御する場合、シーケンスコントローラに異常が発
生した際にも、このような重要な装置や機器を正常な制
御で継続させる必要がある。したがって、重要な装置や
機器の制御に用いられるシーケンスコントローラは、二
重化構成にしており、一方のシーケンスコントローラに
異常が発生した場合でも、他方のシーケンスコントロー
ラが瞬時にシーケンスコントローラの異常を検知し、制
御対象としている装置や機器の運転に影響を及ぼすこと
なく、バックアップ運転を行うことができるように構成
されている。
等における重要な装置や機器をシーケンスコントローラ
にて制御する場合、シーケンスコントローラに異常が発
生した際にも、このような重要な装置や機器を正常な制
御で継続させる必要がある。したがって、重要な装置や
機器の制御に用いられるシーケンスコントローラは、二
重化構成にしており、一方のシーケンスコントローラに
異常が発生した場合でも、他方のシーケンスコントロー
ラが瞬時にシーケンスコントローラの異常を検知し、制
御対象としている装置や機器の運転に影響を及ぼすこと
なく、バックアップ運転を行うことができるように構成
されている。
【０００３】
【発明が解決しようとする課題】上記した従来の二重化
構成は、シーケンスコントローラのＣＰＵ自体に異常が
発生した場合には、お互いを接続している伝送ケーブル
を通じてＣＰＵ異常を検知できるため非常に有効であ
る。
構成は、シーケンスコントローラのＣＰＵ自体に異常が
発生した場合には、お互いを接続している伝送ケーブル
を通じてＣＰＵ異常を検知できるため非常に有効であ
る。
【０００４】しかしながら、二重化構成のシーケンスコ
ントローラでも、ＣＰＵからの指令を出力するＩ／Ｏ基
板のみに異常が発生した場合には、以下に述べるような
問題がある。
ントローラでも、ＣＰＵからの指令を出力するＩ／Ｏ基
板のみに異常が発生した場合には、以下に述べるような
問題がある。
【０００５】例えば、ある装置をシーケンスコントロー
ラで自動運転中にＩ／Ｏ基板のみの異常が発生した場
合、シーケンスコントローラ本体は正常状態であるため
シーケンスコントローラが切替わることはない。このた
めＩ／Ｏ基板の異常による誤出力等の異常制御を行って
しまい、機器や設備の破損や設備などへの悪影響を及ぼ
す危険性があった。
ラで自動運転中にＩ／Ｏ基板のみの異常が発生した場
合、シーケンスコントローラ本体は正常状態であるため
シーケンスコントローラが切替わることはない。このた
めＩ／Ｏ基板の異常による誤出力等の異常制御を行って
しまい、機器や設備の破損や設備などへの悪影響を及ぼ
す危険性があった。
【０００６】本発明（請求項１対応）は、上記の如き問
題を解決するためになされたもので、その目的はＩ／Ｏ
基板のみに異常が発生した場合においても異常を適格に
検知し、正常なシーケンスコントローラへの切替えを行
うことのできる二重化シーケンスコントローラ装置を提
供することにある。
題を解決するためになされたもので、その目的はＩ／Ｏ
基板のみに異常が発生した場合においても異常を適格に
検知し、正常なシーケンスコントローラへの切替えを行
うことのできる二重化シーケンスコントローラ装置を提
供することにある。
【０００７】
【課題を解決するための手段】本発明の請求項１は、Ｃ
ＰＵと入力／出力基板を備えた二重化構成のシーケンス
コントローラ相互間を伝送ラインを介して信号を授受さ
れるように構成された二重化シーケンスコントローラ装
置において、前記各シーケンスコントローラは入力／出
力基板の異常を検出する補助リレーを有し、相手方シー
ケンスコントローラに対応する補助リレーの動作により
異常を検知し、バックアップ運転を行えるように構成し
たことを特徴とする。
ＰＵと入力／出力基板を備えた二重化構成のシーケンス
コントローラ相互間を伝送ラインを介して信号を授受さ
れるように構成された二重化シーケンスコントローラ装
置において、前記各シーケンスコントローラは入力／出
力基板の異常を検出する補助リレーを有し、相手方シー
ケンスコントローラに対応する補助リレーの動作により
異常を検知し、バックアップ運転を行えるように構成し
たことを特徴とする。
【０００８】
【発明の実施の形態】以下、本発明の実施の形態を図を
参照して説明する。図１は本発明（請求項１対応）の一
実施例である二重化シーケンスコントローラ装置の構成
図である。
参照して説明する。図１は本発明（請求項１対応）の一
実施例である二重化シーケンスコントローラ装置の構成
図である。
【０００９】同図に示すように、シーケンスコントロー
ラ１はＣＰＵ４と出力基板６と入力基板８を備えてお
り。シーケンスコントローラ２はＣＰＵ５と出力基板７
と入力基板９を備えている。シーケンスコントローラ１
と２の信号のやり取りは伝送ラインを介して行われる。
１０，１１は出力信号の信号ラインであり、その出力信
号はそれぞれ補助リレー１２，１３にて受信する。１
４，１５は補助リレー１２，１３からシーケンスコント
ローラ１，２への信号ラインである。
ラ１はＣＰＵ４と出力基板６と入力基板８を備えてお
り。シーケンスコントローラ２はＣＰＵ５と出力基板７
と入力基板９を備えている。シーケンスコントローラ１
と２の信号のやり取りは伝送ラインを介して行われる。
１０，１１は出力信号の信号ラインであり、その出力信
号はそれぞれ補助リレー１２，１３にて受信する。１
４，１５は補助リレー１２，１３からシーケンスコント
ローラ１，２への信号ラインである。
【００１０】次に、本実施例の動作について説明する。
まず、シーケンスコントローラ１とシーケンスコントロ
ーラ２が二重化構成とした時に、シーケンスコントロー
ラ１をメイン、シーケンスコントローラ２をサブとして
運用中に、シーケンスコントローラ１のＣＰＵ４に異常
が発生した場合、この異常を伝送ライン３を通じてシー
ケンスコントローラ２のＣＰＵ５が検知し、シーケンス
コントローラ２がバックアップ運転を行う。
まず、シーケンスコントローラ１とシーケンスコントロ
ーラ２が二重化構成とした時に、シーケンスコントロー
ラ１をメイン、シーケンスコントローラ２をサブとして
運用中に、シーケンスコントローラ１のＣＰＵ４に異常
が発生した場合、この異常を伝送ライン３を通じてシー
ケンスコントローラ２のＣＰＵ５が検知し、シーケンス
コントローラ２がバックアップ運転を行う。
【００１１】ところで、シーケンスコントローラ１の出
力基板６は基板が正常な時には“正常時ＯＮ”の出力を
信号ライン１０を介して補助リレー１２に出力する。補
助リレー１２ではこの“正常時ＯＮ”の信号は信号ライ
ン１４を介してシーケンスコントローラ２の入力基板９
に入力する。
力基板６は基板が正常な時には“正常時ＯＮ”の出力を
信号ライン１０を介して補助リレー１２に出力する。補
助リレー１２ではこの“正常時ＯＮ”の信号は信号ライ
ン１４を介してシーケンスコントローラ２の入力基板９
に入力する。
【００１２】したがって、出力基板６に異常が発生した
場合、信号ライン１０、補助リレー１２、信号ライン１
４を介して入力されていた“正常時ＯＮ”の信号は入力
されなくなるため、その状態をシーケンスコントローラ
２が検知し、バックアップ運転を開始する。
場合、信号ライン１０、補助リレー１２、信号ライン１
４を介して入力されていた“正常時ＯＮ”の信号は入力
されなくなるため、その状態をシーケンスコントローラ
２が検知し、バックアップ運転を開始する。
【００１３】上記と同様に、シーケンスコントローラ２
においても出力基板７に異常が発生した場合、信号ライ
ン１１、補助リレー１３、信号ライン１５を介して入力
されていた“正常時ＯＮ”の信号は入力されなくなるた
め、その状態をシーケンスコントローラ１が検知し、バ
ックアップ運転を開始する。
においても出力基板７に異常が発生した場合、信号ライ
ン１１、補助リレー１３、信号ライン１５を介して入力
されていた“正常時ＯＮ”の信号は入力されなくなるた
め、その状態をシーケンスコントローラ１が検知し、バ
ックアップ運転を開始する。
【００１４】上述したように、本実施例によれば、Ｉ／
Ｏ基板の異常信号を検出することにより、シーケンスコ
ントローラ１及び２は互いにバックアップ運転を行うこ
とができるので、より安全な二重化シーケンスコントロ
ーラを提供できる。
Ｏ基板の異常信号を検出することにより、シーケンスコ
ントローラ１及び２は互いにバックアップ運転を行うこ
とができるので、より安全な二重化シーケンスコントロ
ーラを提供できる。
【００１５】
【発明の効果】以上説明したように、本発明（請求項１
対応）によれば、二重化シーケンスコントローラにおい
て、Ｉ／Ｏ基板のみに異常が発生した場合においても互
いに適切なバックアップ運転を行える二重化シーケンス
コントローラ装置を提供することができる。
対応）によれば、二重化シーケンスコントローラにおい
て、Ｉ／Ｏ基板のみに異常が発生した場合においても互
いに適切なバックアップ運転を行える二重化シーケンス
コントローラ装置を提供することができる。
【図１】本発明の一実施例である二重化シーケンスコン
トローラ装置の構成図。
トローラ装置の構成図。
１，２…シーケンスコントローラ、３…伝送ライン、
４，５…ＣＰＵ、６，７…出力基板、８，９…入力基
板、１０，１１，１４，１５…信号ライン、１２，１３
…補助リレー。
４，５…ＣＰＵ、６，７…出力基板、８，９…入力基
板、１０，１１，１４，１５…信号ライン、１２，１３
…補助リレー。
Claims (1)
- 【請求項１】 ＣＰＵと入力／出力基板を備えた二重化
構成のシーケンスコントローラ相互間を伝送ラインを介
して信号を授受されるように構成された二重化シーケン
スコントローラ装置において、前記各シーケンスコント
ローラは入力／出力基板の異常を検出する補助リレーを
有し、相手方シーケンスコントローラに対応する補助リ
レーの動作により異常を検知し、バックアップ運転を行
えるように構成したことを特徴とする二重化シーケンス
コントローラ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17394997A JPH1124702A (ja) | 1997-06-30 | 1997-06-30 | 二重化シーケンスコントローラ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17394997A JPH1124702A (ja) | 1997-06-30 | 1997-06-30 | 二重化シーケンスコントローラ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1124702A true JPH1124702A (ja) | 1999-01-29 |
Family
ID=15970060
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17394997A Pending JPH1124702A (ja) | 1997-06-30 | 1997-06-30 | 二重化シーケンスコントローラ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1124702A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2016212467A (ja) * | 2015-04-28 | 2016-12-15 | 株式会社安川電機 | 製鉄制御システムおよび制御システム |
| WO2017195369A1 (ja) * | 2016-05-13 | 2017-11-16 | 三菱電機株式会社 | プログラム開発支援装置、列車監視制御装置およびプログラム開発支援方法 |
-
1997
- 1997-06-30 JP JP17394997A patent/JPH1124702A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2016212467A (ja) * | 2015-04-28 | 2016-12-15 | 株式会社安川電機 | 製鉄制御システムおよび制御システム |
| WO2017195369A1 (ja) * | 2016-05-13 | 2017-11-16 | 三菱電機株式会社 | プログラム開発支援装置、列車監視制御装置およびプログラム開発支援方法 |
| JPWO2017195369A1 (ja) * | 2016-05-13 | 2019-03-07 | 三菱電機株式会社 | プログラム開発支援装置、列車監視制御装置およびプログラム開発支援方法 |
| US10807620B2 (en) | 2016-05-13 | 2020-10-20 | Mitsubishi Electric Corporation | Program development supporting apparatus, train monitoring and controlling apparatus, and program development supporting method |
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