JPS621082A - 画像デ−タ入力装置 - Google Patents

画像デ−タ入力装置

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JPS621082A
JPS621082A JP13889485A JP13889485A JPS621082A JP S621082 A JPS621082 A JP S621082A JP 13889485 A JP13889485 A JP 13889485A JP 13889485 A JP13889485 A JP 13889485A JP S621082 A JPS621082 A JP S621082A
Authority
JP
Japan
Prior art keywords
signal
circuit
processing system
image data
memory
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP13889485A
Other languages
English (en)
Inventor
Toshiro Nakajima
利郎 中島
Mitsuhito Kamei
光仁 亀井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP13889485A priority Critical patent/JPS621082A/ja
Publication of JPS621082A publication Critical patent/JPS621082A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は画像データを信号処理システムに入力する画
像データ入力装置に関するものである。
〔従来の技術〕
第4図は従来の画像データ入力装置のブロック接続図で
あり、図において、1は画像情報を入力するカメラ(ビ
デオカメラ)、2はカメラ1から出力されるビデオ信号
を2値化する2値化回路、3は時系列の2値化したビデ
オ信号を8ビット単位のパラレルデータに変換する、シ
リアル−パラレル変換回路、4はビデオメモリ5へのデ
ータの入力タイミングを制御するデータ入力コントロー
ル回路、5は2値化したビデオ信号を記憶するビデオメ
モリ部、6は信号処理システム内のメモリへ転送するた
めにビデオメモリ5内のデータを一時的にたくわえてお
くバッファー、7はビデオメモリ5と信号処理システム
メモリとの間のデータ転送をコントロールする転送コン
トロール回路、8は信号処理システム内のパスライン9
と連結している入出力ボートである。また、第5図は従
来のデータ入力装置の動作のタイムチャートを示し、図
において、10はカメラ1からのビデオ信号、11はビ
デオ信号10の水平走査時間、12は垂直走査時間、1
3はカメラ1からの一画面分(1フレ一ム分)のデータ
をビデオメモリ5へ入力するのに要する時間、14はビ
デオメモリ内のデータを信号処理システム内メモリへ転
送するのに要する時間を示す。第6図は従来の画像デー
タ入力装置と信号処理システムとの接続図を示し、図に
おいて、15は従来の画像データ入力装置、16は信号
処理システム、17は信号処理システム16内のCPU
、18は信号処理システム16内のメモリを示す。
次に動作について説明する。カメラ1から取り込まれた
ビデオ信号は2値化回路2によって2値化され、コント
ロール回路4から発生するクロックによって一定の周期
でサンプリングされ、2値の時系列信号となる。この時
系列信号はシリアル−パラレル変換回路3によって順次
8ビットのパラレルデータに変換される。変換されたパ
ラレルデータはデータ入力コントロール回路4でタイミ
ング制御されながらビデオメモリ5に順次入力され、−
垂直走査時間12の後、一画面分の2値化された画像デ
ータがビデオメモリ5に収納される。
この画像データの収納後、収納されたこの一画面分の画
像データは、転送コントロール回路7を通じて、信号処
理システム内のCPU17によって転送制御され、バッ
ファ6、入出力ボート8、パスライン9を経て、信号処
理システム16内のメモリ18へ転送される。この結果
、転送時間14の経過後、信号処理システム内のメモリ
1日への1フレ一ム分の一画面データの転送が終了する
〔発明が解決しようとする問題点〕
従来の画像データ入力装置15は以上のように構成され
ていたので、カメラ1からの画像データを信号処理シス
テム内へ取り込むのに、一度、一画面分の画像データの
全部をビデオメモリ5に一旦収納した後、さらにビデオ
メモリ5かもシステム内メモリ18へデータを転送する
時間が必要となり、カメラ1から得られた画像データの
高速処理ができないほか、一画面分の画像データを格納
するメモリが必要となるので、装置の規模が大きくなり
、かつ価格が高くなるなどの問題点があったO この発明は上記のような問題点を解消するためKなされ
たもので、実時間で画像データを信号処理システム内の
メモリに取り込むことができるとともに、小形のメモリ
の使用によって低コスト化できるデータ入力装置を得る
ことを目的とする。
〔問題点を解決するための手段〕
この発明にかかる画像データ入力装置は、カメラからの
画像信号を2進化回路でディジタル化し、このディジタ
ル化した画像信号を入力切換え回路によって、水平走査
時間ごとに振り分けるように切換出力し、この振り分け
た画像信号を少くとも2系統のシフトレジスタにおいて
水平走査周期ごとに交互に直列−並列変換し、この直列
−並列変換した上記画像信号を、出力選択回路によって
上記各シフトレジスタから選択的に交互に出力して、こ
れをさらに外部に信号処理システムに供給するような構
成としたものである。
〔作 用〕
この発明においては、ビデオ信号を2値化したー水平走
査時間の画像データが、2系列のうちの1つのシフトレ
ジスタに入力されると同時に、他のシフトレジスタ内に
格納されていた他の一水平走査時間の画像データが信号
処理システムに転送され、画像データの取り込みと信号
処理システムへの転送が同時に行われるように動作する
〔実施例〕
以下、この発明の一実施例を図について説明する。第1
図において、19は2値化回路2によって2値化された
ビデオ信号を2系列のシフトレジスタ22.23に振り
分ける入力切換え回路、20は水平走査周期ごとの入力
の切換えをコントロールする入力コントロール回路、2
1はシフトレジスタに対するシフトクロック信号を発生
するクロック回路、22.23は一水平走査時間中の2
値化ビデオ信号を一時的にだくわえる2系列のシフトレ
ジスタ、24はシフトレジスタ22.23内の直列デー
タを、ビデオ信号の水平走査周期ごとに交互に選択し、
並列データとして変換出力する出力選択回路、25は並
列データとしての一水平走査期間の画像データを信号処
理システム16のメモリ18へ転送するための制御を行
う出力コントロール回路、26はシフトレジスタからの
出力データを一時的にだくわえておくバッファを示す。
また・第2図において、27は2値化されたビデオ信号
をシフトレジスタ22.23内へ取り込むコントロール
信号、28はシフトレジスタ22゜23からの出力デー
タをメモリ18へ転送するコントロール信号、29a、
29bはカメラ1からの画像データをシフトレジスタ2
2.23へ取り込む時間、30a、30bはシフトレジ
スタ22.23内のデータをメモリ18へ転送する時間
をそれぞれ示す。また、第3図において、31は本発明
によろ画像データ入力装置を示す。
次にこの実施例の動作を図について説明する。
まず、カメラ1からの第2図に示すようなビデオ信号1
0は、2値化回路2によって2値の時系列信号に変換さ
れて、入力切換え回路19に入力される。入力切換え回
路19に入力した2値信号は入力コントロール回路20
から発生したコントロール信号によって水平走査周期ご
とに切り換えられ、シフトレジスタ22,23のいずれ
かに入力される。そして、時間29aの2値化ビデオ信
号が、クロック回路21から発生したクロック信号によ
ってサンプリングされ、シフトレジスタ22へ入り、次
の水平走査時間29bでは、次の2値化ビデオ信号はも
う一方のシフトレジスタ23へ入力される。この時間2
9bでは画像データの入力と同時に、既にシフトレジス
タ22にだくわえられていた画像データが出力選択回路
24を通り、8ビツトごとくパラレルデータとしてバッ
フ7に入り、パスライン9を経て信号処理システム16
内のメモリ18に転送される。このような画像データの
転送は信号処理システム16内のCPU17を介さずダ
イレクトメモリアクセス(DirectMemory 
Access )動作によって直接性なわれ、−水平走
査時間30a内にシフトレジスタ22にだくわえられて
いたー水平走査時間分の全画像データの転送を完了する
。これらの動作を水平走査周期ごとにシフトレジスタ2
2.23を切り換えながら繰り返し、−垂直走査時間1
2が終了すると同時に、一画面分の画像データの取り込
みおよびメモリ18への転送が完了する。
なお、上記実施例では入力データとしてカメラからの映
像信号を扱ったものについて示したが、入力信号が一定
の周期をもつ信号に同期した画像信号(たとえば光を走
査した物体からの反射光信号)でも同様の効果を得るこ
とが可能である。
〔発明の効果〕
以上のように、この発明によれば、−水平走査周期分の
画像データをたくわえるり7トレジスタを少くとも2系
列設け、画像データの取り込みと、信号処理システム内
への画像データの転送を同時に行なえるように構成した
ので、信号処理システムへの画像データの取り込みが実
時間で可能となるほか、ビデオメモリを2系列のシフト
レジスタに置き換えることによって、コストを低く抑え
られる効果がある。
【図面の簡単な説明】
第1図はこの発明の一実施例による画像データ入力装置
のブロック接続図、第2図はこの発明の一実施例の動作
を示すタイムチャート、第3図はこの発明による画像デ
ータ入力装置と外部の信号処理システムとの関係を示す
ブロック接続図、第4図は従来の画像データ入力装置の
ブロック接続図、第5図は同じ〈従来装置の動作を示す
タイムチャート、第6図は従来の画像データ入力装置と
信号処理システムとの関係を示すブロック接続図である
。 1はカメラ、2は2進化回路、19は入力切換え回路、
22.23はシフトレジスタ、24は出力選択回路。 なお、図中、同一符号は同一または相当部分を示す。 特許出願人  三菱電機株式会社 代理人 弁理士   1)澤 博 昭l(外2名)””
” r−−−−−−一″″″″″″−′″’−−−−1手続
補正書(自発) 58オ。60年9・1イ  8

Claims (1)

    【特許請求の範囲】
  1. カメラからの画像信号をディジタル化する2進化回路と
    、このディジタル化した画像信号を、この画像信号の水
    平走査時間ごとに振り分けて切換出力する入力切換え回
    路と、この振り分けた画像信号を水平走査周期ごとに交
    互に直列−並列変換する少くとも2系統のシフトレジス
    タと、上記直列−並列変換した画像信号を上記各シフト
    レジスタから選択的に交互に出力し、外部の信号処理シ
    ステムに供給する出力選択回路とを備えた画像データ入
    力装置。
JP13889485A 1985-06-27 1985-06-27 画像デ−タ入力装置 Pending JPS621082A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP13889485A JPS621082A (ja) 1985-06-27 1985-06-27 画像デ−タ入力装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP13889485A JPS621082A (ja) 1985-06-27 1985-06-27 画像デ−タ入力装置

Publications (1)

Publication Number Publication Date
JPS621082A true JPS621082A (ja) 1987-01-07

Family

ID=15232604

Family Applications (1)

Application Number Title Priority Date Filing Date
JP13889485A Pending JPS621082A (ja) 1985-06-27 1985-06-27 画像デ−タ入力装置

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JP (1) JPS621082A (ja)

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