JPS6167894A - 液晶デイスプレイ装置 - Google Patents
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- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3618—Control of matrices with row and column drivers with automatic refresh of the display panel using sense/write circuits
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、静止画像の表示を行うための液晶ディスプレ
イ装置に関する。
イ装置に関する。
例えば液晶を用いてテレビ画像を表不することが提案さ
れている。
れている。
第６図において、（１）はテレビの映像信号がＵｊ給さ
れる入力端子で、この入力端子（１）からの信号がそれ
ぞれ例えばＮチャンネルＦＥＴからなるスイッチング素
子Ｍｔ 、 Ｍ２ ・・・Ｍｍを通じて垂直（Ｙ軸）
方向のラインＬＬ、Ｌ２ ・・・Ｌｍに供給される。
れる入力端子で、この入力端子（１）からの信号がそれ
ぞれ例えばＮチャンネルＦＥＴからなるスイッチング素
子Ｍｔ 、 Ｍ２ ・・・Ｍｍを通じて垂直（Ｙ軸）
方向のラインＬＬ、Ｌ２ ・・・Ｌｍに供給される。
なおｍは水平（Ｘ軸）方向の画素数に相当する数である
。さらにｍ段のシフトレジスタ（２）が設けられ、この
シフトレジスタ（２）に水平周波数のｍ倍のクロック信
号Φ□Ｈ２Φ２Ｈが供給され、このシフトレジスタ（２
）の各出力端、子からのクロック信号ΦｉＨ＋ Φ、
Ｈによって順次走査される画素スイッチ信号φＨ１＋
φＨ２・・・φＨＴ１１がスイッチング素子Ｍ１〜Ｍ
ｍの各制御端子に供給される。なおシフトレジスタ（２
）には低電位（Ｖ ｓｓ ）と高電位（■。Ｄ）が供給
され、この２つの電位の駆動パルスが形成される。
。さらにｍ段のシフトレジスタ（２）が設けられ、この
シフトレジスタ（２）に水平周波数のｍ倍のクロック信
号Φ□Ｈ２Φ２Ｈが供給され、このシフトレジスタ（２
）の各出力端、子からのクロック信号ΦｉＨ＋ Φ、
Ｈによって順次走査される画素スイッチ信号φＨ１＋
φＨ２・・・φＨＴ１１がスイッチング素子Ｍ１〜Ｍ
ｍの各制御端子に供給される。なおシフトレジスタ（２
）には低電位（Ｖ ｓｓ ）と高電位（■。Ｄ）が供給
され、この２つの電位の駆動パルスが形成される。
また各ラインＬ１〜Ｌｍにそれぞれ例えばＮチャンネル
ＦＥＴからなるスイッチング素子Ｍｕ＋Ｍ２１１８９Ｍ
ｒＨ，ＭＬ２．Ｍ２２＋１４Ｍｎ２＋ Ｈ’参Ｍ１．
． Ｍ２．・・・Ｍｎｍの一端が接続される。なおｎは
水平走査線数に相当する数である。このスイッチング素
子Ｍｚｔ〜Ｍｎｍの他端がそれぞれ液晶セルＣ１１＋
Ｃ２１・・・Ｃｎｍを通じてターゲット端子（３）に
接続される。
ＦＥＴからなるスイッチング素子Ｍｕ＋Ｍ２１１８９Ｍ
ｒＨ，ＭＬ２．Ｍ２２＋１４Ｍｎ２＋ Ｈ’参Ｍ１．
． Ｍ２．・・・Ｍｎｍの一端が接続される。なおｎは
水平走査線数に相当する数である。このスイッチング素
子Ｍｚｔ〜Ｍｎｍの他端がそれぞれ液晶セルＣ１１＋
Ｃ２１・・・Ｃｎｍを通じてターゲット端子（３）に
接続される。
さらにｎ段のシフトレジスタ（４）が設けられ、このシ
フトレジスタ（４］に水」１２周波数のクロック信号Φ
ｔＶ＋ Φ２ｖが供給され、このシフトレジスタ（４
）の各出力端子からのクロック信号Φｔｖ、 中２ｖ
によって順次走査される走査線スイ・ソチ信号φＶｉ＋
φｖ２・・・φｖｎが、水平（Ｘ軸）方向のゲート
線Ｇ１゜Ｇ２ ・・・Ｇｎを通じてスイッチング素子Ｍ
ＬＩ〜ＭｎｍのＸ軸方向の各列（Ｍｔｔ〜Ｍ１ｍ）、
（Ｍ２１〜Ｍ２１）・・・ （Ｍ０１〜Ｍｎｍ）ごと
の制御端子にそれぞれ供給される。なお、シフトレジス
タ（４）にもシフトレジスタ（２）と同様にＶ ＳＳと
■。。が供給される。
フトレジスタ（４］に水」１２周波数のクロック信号Φ
ｔＶ＋ Φ２ｖが供給され、このシフトレジスタ（４
）の各出力端子からのクロック信号Φｔｖ、 中２ｖ
によって順次走査される走査線スイ・ソチ信号φＶｉ＋
φｖ２・・・φｖｎが、水平（Ｘ軸）方向のゲート
線Ｇ１゜Ｇ２ ・・・Ｇｎを通じてスイッチング素子Ｍ
ＬＩ〜ＭｎｍのＸ軸方向の各列（Ｍｔｔ〜Ｍ１ｍ）、
（Ｍ２１〜Ｍ２１）・・・ （Ｍ０１〜Ｍｎｍ）ごと
の制御端子にそれぞれ供給される。なお、シフトレジス
タ（４）にもシフトレジスタ（２）と同様にＶ ＳＳと
■。。が供給される。
すなわちこの回路において、シフトレジスタ（２）。
（４）には第７図Ａ、Ｈに示すようなりロック信号ΦＩ
Ｈ＋ φ２Ｈ１Φｔｖ、Φ２ｖが供給される。そしてシ
フトレジスタ（２）からは第７図Ｃに示すように各画素
期間ごとにφＨ工〜φ朋が出力され、シフトレジスタ（
４）からは第７図りに示すように１水平期間ごとにφｖ
１〜φｖｎが出力される。さらに入力端子（１）には第
７図Ｅに示すような信号が供給される。
Ｈ＋ φ２Ｈ１Φｔｖ、Φ２ｖが供給される。そしてシ
フトレジスタ（２）からは第７図Ｃに示すように各画素
期間ごとにφＨ工〜φ朋が出力され、シフトレジスタ（
４）からは第７図りに示すように１水平期間ごとにφｖ
１〜φｖｎが出力される。さらに入力端子（１）には第
７図Ｅに示すような信号が供給される。
そしてφＶｉ＋ φＨ□が出力されているときは、ス
イッチング素子Ｍ１とＭ１１〜Ｍ１ＷＬがオンされ、入
力端子（１）→Ｍ１＝Ｌ１→Ｍ ｔｔ ＝ Ｃｔｔ→タ
ーゲット端子（３）の電流路が形成されて液晶セルＣｔ
ｚに入力端子（１）に供給された信号とターゲット端子
（３）との電位差が供給される。このためこのセルＣＬ
Ｉの容量分に、１番目の画素の信号による電位差に相当
する電荷がサンプルホールドされる。この電佃量に対応
して液晶の光透過率が変化される。これと同様のことが
セルＣ１２〜Ｃｎ１１１について順次行われ、さらに次
のフィールドの信号が供給された時点で各セル０１１〜
Ｃｎｍの電荷量が書き換えられる。
イッチング素子Ｍ１とＭ１１〜Ｍ１ＷＬがオンされ、入
力端子（１）→Ｍ１＝Ｌ１→Ｍ ｔｔ ＝ Ｃｔｔ→タ
ーゲット端子（３）の電流路が形成されて液晶セルＣｔ
ｚに入力端子（１）に供給された信号とターゲット端子
（３）との電位差が供給される。このためこのセルＣＬ
Ｉの容量分に、１番目の画素の信号による電位差に相当
する電荷がサンプルホールドされる。この電佃量に対応
して液晶の光透過率が変化される。これと同様のことが
セルＣ１２〜Ｃｎ１１１について順次行われ、さらに次
のフィールドの信号が供給された時点で各セル０１１〜
Ｃｎｍの電荷量が書き換えられる。
このようにして、映像信号の各画素に対応して液晶セル
Ｃ１１〜Ｃｎｍの光透過率が変化され、これが順次繰り
返されてテレビ画像の表示が行われる。
Ｃ１１〜Ｃｎｍの光透過率が変化され、これが順次繰り
返されてテレビ画像の表示が行われる。
ところで液晶で表示を行う場合には、一般にその信頼性
、寿命を良くするため交流駆動が用いられる。例えばテ
レビｉｄ！ｉ１１の表示においては、ｌフィールドまた
は１フレームごとに映像信号を反転させた信号を入力端
子（１１に供給する。すなわち入力端子！１１には第７
図Ｅに示すように１フイールドまたは１フレームごとに
反転された１２号が供給される。
、寿命を良くするため交流駆動が用いられる。例えばテ
レビｉｄ！ｉ１１の表示においては、ｌフィールドまた
は１フレームごとに映像信号を反転させた信号を入力端
子（１１に供給する。すなわち入力端子！１１には第７
図Ｅに示すように１フイールドまたは１フレームごとに
反転された１２号が供給される。
ところで上述の装置において、任意のテレビ画像を静止
画で表示したいという要求がある。その場合に従来から
、例えば１フイールドあるいは１フレ一ム分のメモリを
設け、所望の画像をこのメモリに記憶させ、これを繰返
し続出し、この読出された信号を１フイールドごとに位
相反転して上述の入力端子（１）に供給することが提案
されている。
画で表示したいという要求がある。その場合に従来から
、例えば１フイールドあるいは１フレ一ム分のメモリを
設け、所望の画像をこのメモリに記憶させ、これを繰返
し続出し、この読出された信号を１フイールドごとに位
相反転して上述の入力端子（１）に供給することが提案
されている。
しかしながら上述のような１フイールドあるいはｌフレ
ーム分のメモリは、それ自体大形であり高価であって、
一般の民生用の機器に適用することは困難である。
ーム分のメモリは、それ自体大形であり高価であって、
一般の民生用の機器に適用することは困難である。
これに対して、例えば特開昭５８−１０７７８２号公？
Ｈに示されるように、液晶セルＣのメモリ機能を利用し
て静止画の表示を行うことが提案された。すなわちこの
装置は、１画面ごとに極性が反転される映像信号を複数
ｉ！ｉｉ素に時系列的に供給する第１のサンプルホール
ド回路を有する液晶ビデオディスプレイ駆動回路におい
て、該映像信号を反転し該第１のサンプルボールド回路
へ供給する反転手段と、該複数画素からの該映像信号を
時系列的に読出ず第２のサンプルボールド回路と、外部
端子からの映像信号又は該第２サンプルホールド回路か
らの映像信号を切換えて該反転手段に供給する切換手段
とを有する液晶ビデオディスプレイ駆動回路である。
Ｈに示されるように、液晶セルＣのメモリ機能を利用し
て静止画の表示を行うことが提案された。すなわちこの
装置は、１画面ごとに極性が反転される映像信号を複数
ｉ！ｉｉ素に時系列的に供給する第１のサンプルホール
ド回路を有する液晶ビデオディスプレイ駆動回路におい
て、該映像信号を反転し該第１のサンプルボールド回路
へ供給する反転手段と、該複数画素からの該映像信号を
時系列的に読出ず第２のサンプルボールド回路と、外部
端子からの映像信号又は該第２サンプルホールド回路か
らの映像信号を切換えて該反転手段に供給する切換手段
とを有する液晶ビデオディスプレイ駆動回路である。
ところがこの装置の場合、公報中にも記載されているよ
うに１フイールドの表示を行うごとに画像がｌｒｉ！ｉ
ｌ素分ずつ走査方向にずれて行く。このため１フイール
ドごとに走査方向を逆にするなどの処置が行われるが、
このように走査方向を切換えるためには大規模な回路が
必要であり、また１フイールドごとに交互に１画素分ず
れる状態は残るので、これがフリッカ−等になるおそれ
がある。
うに１フイールドの表示を行うごとに画像がｌｒｉ！ｉ
ｌ素分ずつ走査方向にずれて行く。このため１フイール
ドごとに走査方向を逆にするなどの処置が行われるが、
このように走査方向を切換えるためには大規模な回路が
必要であり、また１フイールドごとに交互に１画素分ず
れる状態は残るので、これがフリッカ−等になるおそれ
がある。
また液晶セルＣの信号を取出し、この信号を再び液晶セ
ルＣに戻し、これを繰返えして静止画表示を行っている
ので、この間の信号の伝達特性に歪みがあると、この歪
みが累積されて画質が短時間に著しく劣化されてしまう
。これに対して反転手段の利得をｎ周シトすることがボ
されζいるが、このような調整を完全に行うのは不ｒＩ
Ｊ能であり、長時間に１って市電な静止画表示を行・う
ごとは極めて困難である。
ルＣに戻し、これを繰返えして静止画表示を行っている
ので、この間の信号の伝達特性に歪みがあると、この歪
みが累積されて画質が短時間に著しく劣化されてしまう
。これに対して反転手段の利得をｎ周シトすることがボ
されζいるが、このような調整を完全に行うのは不ｒＩ
Ｊ能であり、長時間に１って市電な静止画表示を行・う
ごとは極めて困難である。
さらに液晶セルＣから信号を取出す際に、その信号線の
浮遊容９等に残留電荷があると、これによっても信号が
劣化され、長時間に一日っ°ζ静止画表示を行うことが
できなくなってしまう。
浮遊容９等に残留電荷があると、これによっても信号が
劣化され、長時間に一日っ°ζ静止画表示を行うことが
できなくなってしまう。
従来の装置は上述のように構成されていた。このため従
来の装置では、構成が複雑になったり長時間に亘って除
重画像を表示すると画質が極めて劣化されてしまうなど
の問題点があった。
来の装置では、構成が複雑になったり長時間に亘って除
重画像を表示すると画質が極めて劣化されてしまうなど
の問題点があった。
本発明は、水平画素数に等しい数の列線Ｌ１゜Ｌ２ ・
・・Ｌｍにそれぞれ水平画素クロックによって順次形成
される第１の画素スイッチ信号にてオン駆動される第１
の水平スイッチ素子ＭＡ工〜Ｍへ□を介して映像信号を
供給し、水平走査線数に等しい数の行線Ｇｌ、Ｇ２ ・
・・Ｏｎに水平走査クロックによって順次形成される走
査線スイッチ信号を供給し、上記各列線と行線の交点に
それぞれ上記走査線スイッチ信号にてオン駆動される画
素スイッチ素子Ｍｘ１． ＭＲ２・・・Ｍｎｎ＋を設け
、これらのＩ！！ｉｌ素スイッチ素子を介して上記列線
に供給される上記映像信号をそれぞれが１画素を構成す
る液晶表示セルＣＸｉ ｌ Ｃ１２・・・Ｃｎｍに供給
するようにした液晶ディスプレイ装置において、上記各
列線に上記第１の画素スイッチ信号より早い位相の第２
の画素スイッチ信号にて駆動される第２の水平スイッチ
素子Ｍ８１〜ＭＢＷｌを接続し、この第２の水平スイッ
チ素子のオン期間に上記液晶表示セルに記憶された上記
映像信号を上記画素スイッチ素子を介して取り出し、こ
の取り出された信号を反転（１４）及び所定のレベル範
囲ごとに正規化（１５）し、この反転及び正規化された
信号を上記位相の早められた分遅延された位相で上記第
１の水平スイッチ素子を介して上記信号路に供給すると
共に、上記各列線に上記映像信号の水平ブランキング期
間ごとにオン駆動される第３のスイッチ素子ＭＲ１゜Ｍ
Ｒ２・・・ＭＲ，を介し°ζリセット電圧（３）を供給
するようにしたことを特徴とする液晶ディスプレイ装置
である。
・・Ｌｍにそれぞれ水平画素クロックによって順次形成
される第１の画素スイッチ信号にてオン駆動される第１
の水平スイッチ素子ＭＡ工〜Ｍへ□を介して映像信号を
供給し、水平走査線数に等しい数の行線Ｇｌ、Ｇ２ ・
・・Ｏｎに水平走査クロックによって順次形成される走
査線スイッチ信号を供給し、上記各列線と行線の交点に
それぞれ上記走査線スイッチ信号にてオン駆動される画
素スイッチ素子Ｍｘ１． ＭＲ２・・・Ｍｎｎ＋を設け
、これらのＩ！！ｉｌ素スイッチ素子を介して上記列線
に供給される上記映像信号をそれぞれが１画素を構成す
る液晶表示セルＣＸｉ ｌ Ｃ１２・・・Ｃｎｍに供給
するようにした液晶ディスプレイ装置において、上記各
列線に上記第１の画素スイッチ信号より早い位相の第２
の画素スイッチ信号にて駆動される第２の水平スイッチ
素子Ｍ８１〜ＭＢＷｌを接続し、この第２の水平スイッ
チ素子のオン期間に上記液晶表示セルに記憶された上記
映像信号を上記画素スイッチ素子を介して取り出し、こ
の取り出された信号を反転（１４）及び所定のレベル範
囲ごとに正規化（１５）し、この反転及び正規化された
信号を上記位相の早められた分遅延された位相で上記第
１の水平スイッチ素子を介して上記信号路に供給すると
共に、上記各列線に上記映像信号の水平ブランキング期
間ごとにオン駆動される第３のスイッチ素子ＭＲ１゜Ｍ
Ｒ２・・・ＭＲ，を介し°ζリセット電圧（３）を供給
するようにしたことを特徴とする液晶ディスプレイ装置
である。
この装置によれば、液晶セルＣから取出された信号が同
じ液晶セルＣに戻されるので、画像のずれ等が生じるこ
とがなく、特別な走査等が不要で、駆動回路等は従来の
ものがそのまま使用できる。
じ液晶セルＣに戻されるので、画像のずれ等が生じるこ
とがなく、特別な走査等が不要で、駆動回路等は従来の
ものがそのまま使用できる。
また信号の正規化及び信号線の電位のリセットを行って
いるので、これらによって画質が劣化することがなく、
長時間に亘って良好な静１ヒ画表ボを行うことができる
。
いるので、これらによって画質が劣化することがなく、
長時間に亘って良好な静１ヒ画表ボを行うことができる
。
第１図において、上述のスイッチング素子Ｍ１〜Ｍｍが
第１のスイッチング素子ＭＡ□〜ＭＡ、、ｌとされると
共に同等の第２のスイッチング素子ＭＢＩ〜ＭＢイが設
けられる。また上述のシフトレジスタ（２）と同じくｍ
段のシフトレジスタ（２０）が設けられ、このシフトレ
ジスタ（２０）にクロック信号中ＩＨＩΦ２Ｈが供給さ
れる。そしてこのシフトレジスタ（２０）の各出力端子
からの画素スイッチ信号φ清。
第１のスイッチング素子ＭＡ□〜ＭＡ、、ｌとされると
共に同等の第２のスイッチング素子ＭＢＩ〜ＭＢイが設
けられる。また上述のシフトレジスタ（２）と同じくｍ
段のシフトレジスタ（２０）が設けられ、このシフトレ
ジスタ（２０）にクロック信号中ＩＨＩΦ２Ｈが供給さ
れる。そしてこのシフトレジスタ（２０）の各出力端子
からの画素スイッチ信号φ清。
φＨ’２・・・φ晶がスイッチング素子ＭＢ□〜！ＶＩ
Ｂｍの各制御端子に供給される。またシフトレジスタ（
２）には映像信号の水平同期に関連したスタートパルス
φ８が供給されると共に、シフトレジスタ（２０）には
パルスφ８より早い位相のスタートパルスφ′８が供給
される。そして入力端子（１）はｉｌｎ當表ポ／静止画
表示切換スイッチ（１１）の通常表示側接点Ｎを通じて
、スイッチング素子ＭＡ工〜ＭＡ、に接続される。また
スイッチング素子ＭＢｌ〜ＭＢ、ｌｌの接続中点がアン
プ（１２）に接続され、このアンプ（１２）の出力端に
コンデンサ（１３）が接続され、この出力端が反転回路
（１４）を通じて正規化回路（ノーマライザ） （１
５）に接続される。そしてこの正規化回路（１５）の出
力端が切換スイッチ（１１）の静止画表示側接点Ｓに接
続される。さらに各信号ラインし１〜Ｌｍにそれぞれス
イッチング素子ＭＲ□。
Ｂｍの各制御端子に供給される。またシフトレジスタ（
２）には映像信号の水平同期に関連したスタートパルス
φ８が供給されると共に、シフトレジスタ（２０）には
パルスφ８より早い位相のスタートパルスφ′８が供給
される。そして入力端子（１）はｉｌｎ當表ポ／静止画
表示切換スイッチ（１１）の通常表示側接点Ｎを通じて
、スイッチング素子ＭＡ工〜ＭＡ、に接続される。また
スイッチング素子ＭＢｌ〜ＭＢ、ｌｌの接続中点がアン
プ（１２）に接続され、このアンプ（１２）の出力端に
コンデンサ（１３）が接続され、この出力端が反転回路
（１４）を通じて正規化回路（ノーマライザ） （１
５）に接続される。そしてこの正規化回路（１５）の出
力端が切換スイッチ（１１）の静止画表示側接点Ｓに接
続される。さらに各信号ラインし１〜Ｌｍにそれぞれス
イッチング素子ＭＲ□。
ＭＲ２・・・ＭＲｍが接続され、このスイッチング素子
ＭＲＩ〜Ｍ、を通じて所定の電圧源、例えばターゲット
端子（３）に接続される。
ＭＲＩ〜Ｍ、を通じて所定の電圧源、例えばターゲット
端子（３）に接続される。
そしてこの装置におい°（、スイッチング素子ＭＡ１〜
ＭＡ、ｌｌのゲート端子には、第２図のＡ、Ｂに示すよ
うなりロック信号ΦＩＨ１Φ２Ｈ及びＣに示ずようなス
タートパルスφ８によって形成されるＤに示すような画
素スイッチ信号φＨ１〜φＨｍが供給されると共に、ス
イッチング素子Ｍ８１〜ＭＢＩＴｌのゲート端子には、
例えば第２図のＥにボずようなスタートパルスφ′Ｓに
よっ”ζ形成されるＦに示すような画素スイッチ信号φ
Ｈ′１〜φＨ−が供給される。
ＭＡ、ｌｌのゲート端子には、第２図のＡ、Ｂに示すよ
うなりロック信号ΦＩＨ１Φ２Ｈ及びＣに示ずようなス
タートパルスφ８によって形成されるＤに示すような画
素スイッチ信号φＨ１〜φＨｍが供給されると共に、ス
イッチング素子Ｍ８１〜ＭＢＩＴｌのゲート端子には、
例えば第２図のＥにボずようなスタートパルスφ′Ｓに
よっ”ζ形成されるＦに示すような画素スイッチ信号φ
Ｈ′１〜φＨ−が供給される。
これによって、例えば画素スイッチ信号φＭＬの位相に
おいて同相の画素スイッチ信号φＨ′、によってライン
Ｌ３に対応する液晶セルＣの信号が取出され、この信号
がアンプ（１２）を通じてコンデンサ（１３）に蓄積さ
れ、反転回路（１４）、正規化回路（１５）を通じてτ
時間後の１！！ｉｉ＃スイッチ信号φＨ３の位相で同じ
液晶セルＣに書込まれる。ごこて液晶セルＣからの信号
の電位をＶｇとし、コンデンサ（１３）の容量をＣＳと
すると、アンプ（１２）の容量をＣｐとして、コンデン
サ（１３）のホット側反転回路（１４）の利得を−Ａと
すると、この反転となる。そこでこの電位がｖ／／、＝
、、となるように−Ａの値を定めることにより、液晶
セルＣには反転された同じ信号が再四込されることにな
り、交流駆動による静止画表示が行われる。
おいて同相の画素スイッチ信号φＨ′、によってライン
Ｌ３に対応する液晶セルＣの信号が取出され、この信号
がアンプ（１２）を通じてコンデンサ（１３）に蓄積さ
れ、反転回路（１４）、正規化回路（１５）を通じてτ
時間後の１！！ｉｉ＃スイッチ信号φＨ３の位相で同じ
液晶セルＣに書込まれる。ごこて液晶セルＣからの信号
の電位をＶｇとし、コンデンサ（１３）の容量をＣＳと
すると、アンプ（１２）の容量をＣｐとして、コンデン
サ（１３）のホット側反転回路（１４）の利得を−Ａと
すると、この反転となる。そこでこの電位がｖ／／、＝
、、となるように−Ａの値を定めることにより、液晶
セルＣには反転された同じ信号が再四込されることにな
り、交流駆動による静止画表示が行われる。
しかしながらこの場合に、−Ａの値を上述の要領で完全
に定めるのは不可能である。そこで正規化回路（１５）
が設けられる。すなわちこの正規化回路（１５）の入出
力特性は第３図に示す通りであって、これを設けること
により−Ａの値に多少の誤差があっても、常に出力信号
（再書込信号）を一定の値にすることができる。
に定めるのは不可能である。そこで正規化回路（１５）
が設けられる。すなわちこの正規化回路（１５）の入出
力特性は第３図に示す通りであって、これを設けること
により−Ａの値に多少の誤差があっても、常に出力信号
（再書込信号）を一定の値にすることができる。
さらにスイッチング素′子ＭＲ□〜ＭＲＦ１１のゲート
端子には水平ブランキング信号φＨＢ ＬＫが供給され
る。
端子には水平ブランキング信号φＨＢ ＬＫが供給され
る。
このため各信号ラインＬ１〜Ｌｍば水平ブランキングご
とにターゲット電圧にリセットされる。このため各信号
ラインに残留した信号がリセットされ、液晶セルＣの信
号を取出す際に不要信号が混入されることがなくなる。
とにターゲット電圧にリセットされる。このため各信号
ラインに残留した信号がリセットされ、液晶セルＣの信
号を取出す際に不要信号が混入されることがなくなる。
こうして静止画の表示が行われるわけであるが、上述の
装置によれば構成が極めて簡単であると共に、長時間に
亘って表示を行っても信号が劣化されることがなり、富
に良好な静止画表示を行うことができる。
装置によれば構成が極めて簡単であると共に、長時間に
亘って表示を行っても信号が劣化されることがなり、富
に良好な静止画表示を行うことができる。
なお上述の装置において、読出しから書込までの遅れ時
間ではクロック信号Φ１１（１Φ２Ｈの周期で規制され
ているが、シフトレジスタ（２１（２０）に供給される
クロック信号の位相を任意に定めることによって、より
細かい遅延時間の設定を行うこともできる。
間ではクロック信号Φ１１（１Φ２Ｈの周期で規制され
ているが、シフトレジスタ（２１（２０）に供給される
クロック信号の位相を任意に定めることによって、より
細かい遅延時間の設定を行うこともできる。
また上述の装置において、正規化回路（１５）は逐時１
ｉｉ！ｌｉ素クロツク以下の時間で［Ｅ規化処理を行う
必要があるが、正規化の分解能を上げる場合などで処理
の時間が間に合わない場合には例えばｔ１Ｓ４図のよう
にすることもできる。ヌ１は表示部を除いて示しである
。また第５図はフローチャートをポす。
ｉｉ！ｌｉ素クロツク以下の時間で［Ｅ規化処理を行う
必要があるが、正規化の分解能を上げる場合などで処理
の時間が間に合わない場合には例えばｔ１Ｓ４図のよう
にすることもできる。ヌ１は表示部を除いて示しである
。また第５図はフローチャートをポす。
ずなわぢごの図において、例えばＡに示す水平スイッチ
信号のφＨ’１の位相でラインＬ１に接続された液晶セ
ルＣから続出された信号は、Ｂに不すサンプリングパル
スＰａでサンプルホールド（ＳＨ）回路（３１ａ ）に
ホールドされ、已に示すスイッチ信号φａの期間にスイ
ッチング素子Ｍ２を通じて正規化回路（１５ａ ）に供
給される。そして２画素クロック期間かけて正規化され
た信号はＨに示すスイッチ信号φｉの期間にスイッチン
グ素子Ｍ≦を通じて、Ｋに示すサンプルパルスＰＫでサ
ンプルホールド回路（３２ａ ）にホールドされ、Ｎに
示す水平スイッチ信号φＨ１の位相でラインＬ１に接続
された液晶セルＣに書込まれる。以下同様の動作が１画
素クロ７りごとにサフィックスｂ、 ｃを付した回路
で行われ、３画素クロックごとにサフィックスａの回路
に戻って繰返される。従ってこの装置によれば、第１図
の装置の２倍の処理時間を設定することが可能になる。
信号のφＨ’１の位相でラインＬ１に接続された液晶セ
ルＣから続出された信号は、Ｂに不すサンプリングパル
スＰａでサンプルホールド（ＳＨ）回路（３１ａ ）に
ホールドされ、已に示すスイッチ信号φａの期間にスイ
ッチング素子Ｍ２を通じて正規化回路（１５ａ ）に供
給される。そして２画素クロック期間かけて正規化され
た信号はＨに示すスイッチ信号φｉの期間にスイッチン
グ素子Ｍ≦を通じて、Ｋに示すサンプルパルスＰＫでサ
ンプルホールド回路（３２ａ ）にホールドされ、Ｎに
示す水平スイッチ信号φＨ１の位相でラインＬ１に接続
された液晶セルＣに書込まれる。以下同様の動作が１画
素クロ７りごとにサフィックスｂ、 ｃを付した回路
で行われ、３画素クロックごとにサフィックスａの回路
に戻って繰返される。従ってこの装置によれば、第１図
の装置の２倍の処理時間を設定することが可能になる。
なおこの装置は、アモルファスシリコン、ポリシリコン
、シリコンオンサファイア、有機半導体等のＴＰＴを用
いたアクティブマトリクスによる液晶ディスプレイ装置
に通用できる。
、シリコンオンサファイア、有機半導体等のＴＰＴを用
いたアクティブマトリクスによる液晶ディスプレイ装置
に通用できる。
また上述のシフトレジスタ＋２） 、 （４） 、
（２０）は装置を構成するｔＣの外部に設けてもよい。
（２０）は装置を構成するｔＣの外部に設けてもよい。
さらに表示は点順次、線順次のいずれにも通用口Ｊ能で
ある。
ある。
本発明によれば、液晶セルＣから取出された信号が同じ
液晶セルＣに戻されるので、画像のずれ等が生じること
がなく、特別な走査等が不要で、駆動回路等は従来のも
のがそのまま使用できる。
液晶セルＣに戻されるので、画像のずれ等が生じること
がなく、特別な走査等が不要で、駆動回路等は従来のも
のがそのまま使用できる。
また信号の正規化及び信号線の電位のリセットを行って
いるので、これらによって画質が劣化することがなく、
長時間に亘って良好な静止画表示を行うことができるよ
うになった。
いるので、これらによって画質が劣化することがなく、
長時間に亘って良好な静止画表示を行うことができるよ
うになった。
第１図は本発明の一例の構成図、第２図〜第５図はその
説明のための図、第６図、第７図は従来の装置の説明の
だめの図である。 Ｌ１〜Ｌｍは垂直信号ライン、０１〜Ｇｎはゲート線、
Ｍ Ｌ 〜Ｍ ｍｌ Ｍ ！１ ”” Ｍ ｎ ｍ
ｌ Ｍ Ａｌ 〜Ｍ ／ｖｌ１１Ｍ８１〜ＭＢＩ、ｌ
はスイッチング素子、０１１〜ＣｎＩＩ＋は液晶表示セ
ル、＋２１（４１（２０）はシフトレジスタ、（１４）
は反転回路、（１５）はＩＦ規化回路である。 へ
説明のための図、第６図、第７図は従来の装置の説明の
だめの図である。 Ｌ１〜Ｌｍは垂直信号ライン、０１〜Ｇｎはゲート線、
Ｍ Ｌ 〜Ｍ ｍｌ Ｍ ！１ ”” Ｍ ｎ ｍ
ｌ Ｍ Ａｌ 〜Ｍ ／ｖｌ１１Ｍ８１〜ＭＢＩ、ｌ
はスイッチング素子、０１１〜ＣｎＩＩ＋は液晶表示セ
ル、＋２１（４１（２０）はシフトレジスタ、（１４）
は反転回路、（１５）はＩＦ規化回路である。 へ
Claims (1)
- 水平画素数に等しい数の列線にそれぞれ水平画素クロッ
クによって順次形成される第１の画素スイッチ信号にて
オン駆動される第１の水平スイッチ素子を介して映像信
号を供給し、水平走査線数に等しい数の行線に水平走査
クロックによって順次形成される走査線スイッチ信号を
供給し、上記各列線と行線の交点にそれぞれ上記走査線
スイッチ信号にてオン駆動される画素スイッチ素子を設
け、これらの画素スイッチ素子を介して上記列線に供給
される上記映像信号をそれぞれが１画素を構成する液晶
表示セルに供給するようにした液晶ディスプレイ装置に
おいて、上記各列線に上記第１の画素スイッチ信号より
早い位相の第２の画素スイッチ信号にて駆動される第２
の水平スイッチ素子を接続し、この第２の水平スイッチ
素子のオン期間に上記液晶表示セルに記憶された上記映
像信号を上記画素スイッチ素子を介して取り出し、この
取り出された信号を反転及び所定のレベル範囲ごとに正
規化し、この反転及び正規化された信号を上記位相の早
められた分遅延された位相で上記第１の水平スイッチ素
子を介して上記信号路に供給すると共に、上記各列線に
上記映像信号の水平ブランキング期間ごとにオン駆動さ
れる第３のスイッチ素子を介してリセット電圧を供給す
るようにしたことを特徴とする液晶ディスプレイ装置。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59190783A JPH0668672B2 (ja) | 1984-09-12 | 1984-09-12 | 液晶デイスプレイ装置 |
| EP85904667A EP0192784B1 (en) | 1984-09-12 | 1985-09-12 | Liquid crystal display device |
| KR1019860700255A KR940000599B1 (ko) | 1984-09-12 | 1985-09-12 | 액정 디스플레이 장치 |
| DE8585904667T DE3581192D1 (de) | 1984-09-12 | 1985-09-12 | Fluessigkristall-anzeigeanordnung. |
| US06/871,427 US4803480A (en) | 1984-09-12 | 1985-09-12 | Liquid crystal display apparatus |
| PCT/JP1985/000508 WO1986001926A1 (en) | 1984-09-12 | 1985-09-12 | Liquid crystal display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59190783A JPH0668672B2 (ja) | 1984-09-12 | 1984-09-12 | 液晶デイスプレイ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6167894A true JPS6167894A (ja) | 1986-04-08 |
| JPH0668672B2 JPH0668672B2 (ja) | 1994-08-31 |
Family
ID=16263659
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59190783A Expired - Lifetime JPH0668672B2 (ja) | 1984-09-12 | 1984-09-12 | 液晶デイスプレイ装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4803480A (ja) |
| EP (1) | EP0192784B1 (ja) |
| JP (1) | JPH0668672B2 (ja) |
| KR (1) | KR940000599B1 (ja) |
| DE (1) | DE3581192D1 (ja) |
| WO (1) | WO1986001926A1 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6341829A (ja) * | 1986-08-07 | 1988-02-23 | Seiko Epson Corp | 液晶表示装置及びその駆動方法 |
| JPH01140198A (ja) * | 1987-11-26 | 1989-06-01 | Canon Inc | 表示装置及びその駆動制御装置並びに表示方法 |
| JP2009086603A (ja) * | 2007-10-03 | 2009-04-23 | Seiko Epson Corp | 制御方法、制御装置、表示体および情報表示装置 |
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| US6091392A (en) * | 1987-11-10 | 2000-07-18 | Seiko Epson Corporation | Passive matrix LCD with drive circuits at both ends of the scan electrode applying equal amplitude voltage waveforms simultaneously to each end |
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| JPH1062811A (ja) * | 1996-08-20 | 1998-03-06 | Toshiba Corp | 液晶表示素子及び大型液晶表示素子並びに液晶表示素子の駆動方法 |
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| TW428158B (en) * | 1998-02-24 | 2001-04-01 | Nippon Electric Co | Method and device for driving liquid crystal display element |
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| JPS57204592A (en) * | 1981-06-11 | 1982-12-15 | Sony Corp | Two-dimensional address device |
| JPS58186796A (ja) * | 1982-04-26 | 1983-10-31 | 社団法人日本電子工業振興協会 | 液晶表示装置およびその駆動方法 |
| JPS5924892A (ja) * | 1982-08-03 | 1984-02-08 | 日本電信電話株式会社 | 液晶表示装置 |
| JPS5961818A (ja) * | 1982-10-01 | 1984-04-09 | Seiko Epson Corp | 液晶表示装置 |
-
1984
- 1984-09-12 JP JP59190783A patent/JPH0668672B2/ja not_active Expired - Lifetime
-
1985
- 1985-09-12 US US06/871,427 patent/US4803480A/en not_active Expired - Lifetime
- 1985-09-12 WO PCT/JP1985/000508 patent/WO1986001926A1/ja active IP Right Grant
- 1985-09-12 DE DE8585904667T patent/DE3581192D1/de not_active Expired - Lifetime
- 1985-09-12 KR KR1019860700255A patent/KR940000599B1/ko not_active IP Right Cessation
- 1985-09-12 EP EP85904667A patent/EP0192784B1/en not_active Expired - Lifetime
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Also Published As
| Publication number | Publication date |
|---|---|
| WO1986001926A1 (en) | 1986-03-27 |
| KR940000599B1 (ko) | 1994-01-26 |
| EP0192784A1 (en) | 1986-09-03 |
| KR880700380A (ko) | 1988-03-15 |
| EP0192784A4 (en) | 1988-01-21 |
| JPH0668672B2 (ja) | 1994-08-31 |
| EP0192784B1 (en) | 1990-12-27 |
| DE3581192D1 (de) | 1991-02-07 |
| US4803480A (en) | 1989-02-07 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |