JPS6155809B2 - - Google Patents
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- Publication number
- JPS6155809B2 JPS6155809B2 JP54012042A JP1204279A JPS6155809B2 JP S6155809 B2 JPS6155809 B2 JP S6155809B2 JP 54012042 A JP54012042 A JP 54012042A JP 1204279 A JP1204279 A JP 1204279A JP S6155809 B2 JPS6155809 B2 JP S6155809B2
- Authority
- JP
- Japan
- Prior art keywords
- switch
- transistor
- resistor
- turned
- potential
- Prior art date
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- Expired
Links
- 230000002457 bidirectional effect Effects 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 230000005540 biological transmission Effects 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
Landscapes
- Electronic Switches (AREA)
- Logic Circuits (AREA)
Description
【発明の詳細な説明】
本発明は、例えばVTRの遠隔操作において、
VTRのシステムコントロール回路の論理値の高
電位レベルと、遠隔操作の指令機の論理値の高電
位レベルとが異なる場合に、これらのインターフ
エースを行うものである。それと共に、回路を双
方向性として、VTRがどの動作状態にあるかを
指令機側に伝達できるようにしたものである。
VTRのシステムコントロール回路の論理値の高
電位レベルと、遠隔操作の指令機の論理値の高電
位レベルとが異なる場合に、これらのインターフ
エースを行うものである。それと共に、回路を双
方向性として、VTRがどの動作状態にあるかを
指令機側に伝達できるようにしたものである。
例えばVTRのシステムコントロール回路とし
て、論理値の高電位レベルが12Vのものがある。
これに対して、指令機として論理値の高電位レベ
ルが5Vのものがある。
て、論理値の高電位レベルが12Vのものがある。
これに対して、指令機として論理値の高電位レベ
ルが5Vのものがある。
このような指令機を用いて上述のVTRを遠隔
操作する場合に、従来は第１図に示すように、２
個のトランジスタを用いてレベルを調整してい
た。
操作する場合に、従来は第１図に示すように、２
個のトランジスタを用いてレベルを調整してい
た。
すなわち指令機１０側において、スイツチ１１
の一端が接地され、他端が抵抗器１２を通じて
5Vの電源端子１３に接続され、このスイツチ１
１と抵抗器１２との接続点から接続端子１４が導
出される。またVTR２０側において、接続端子
２１が抵抗器２２を通じてトランジスタ２３のベ
ースに接続され、このトランジスタ２３のエミツ
タが接地され、コレクタが抵抗器２４を通じて
12Vの電源端子２５に接続される。さらにトラン
ジスタ２３のコレクタがトランジスタ２６のベー
スに接続され、このトランジスタ２６のエミツタ
が接地され、このコレクタが抵抗器２７を通じて
電源端子２５に接続されると共に、スイツチ２８
を通じて接地される。そしてこのトランジスタ２
６のコレクタから出力端子２９が導出される。
の一端が接地され、他端が抵抗器１２を通じて
5Vの電源端子１３に接続され、このスイツチ１
１と抵抗器１２との接続点から接続端子１４が導
出される。またVTR２０側において、接続端子
２１が抵抗器２２を通じてトランジスタ２３のベ
ースに接続され、このトランジスタ２３のエミツ
タが接地され、コレクタが抵抗器２４を通じて
12Vの電源端子２５に接続される。さらにトラン
ジスタ２３のコレクタがトランジスタ２６のベー
スに接続され、このトランジスタ２６のエミツタ
が接地され、このコレクタが抵抗器２７を通じて
電源端子２５に接続されると共に、スイツチ２８
を通じて接地される。そしてこのトランジスタ２
６のコレクタから出力端子２９が導出される。
この回路によれば、通常のスイツチ１１，２８
がオフのときは、指令機１０側の電源端子１３か
らの5Vの電圧が接続端子１４，２１を通じて
VTR２０側のトランジスタ２３に供給され、ト
ランジスタ２３がオン、トランジスタ２６がオフ
になつて、電源端子２５からの12Vの電圧が出力
端子２９に取り出される。これに対してスイツチ
１１がオンされると、トランジスタ２３がオフ、
トランジスタ２６がオンされて出力端子２９の電
位が０にされる。またスイツチ２８がオンされて
も、出力端子２９の電位は０にされる。
がオフのときは、指令機１０側の電源端子１３か
らの5Vの電圧が接続端子１４，２１を通じて
VTR２０側のトランジスタ２３に供給され、ト
ランジスタ２３がオン、トランジスタ２６がオフ
になつて、電源端子２５からの12Vの電圧が出力
端子２９に取り出される。これに対してスイツチ
１１がオンされると、トランジスタ２３がオフ、
トランジスタ２６がオンされて出力端子２９の電
位が０にされる。またスイツチ２８がオンされて
も、出力端子２９の電位は０にされる。
ところがこの場合に、指令機１０側のスイツチ
１１がオンされた情報はVTR２０側に伝達され
るものの、VTR２０側のスイツチ２８がオンさ
れた情報は指令機１０側へは伝達されない。この
ため指令機１０側でVTR２０の動作状態を表示
したり、動作を記憶して種々の付加動作を行わせ
る場合には、同様に構成された別の回線を設けて
この情報を伝達しなければならず、構成が極めて
複雑になつてしまう。
１１がオンされた情報はVTR２０側に伝達され
るものの、VTR２０側のスイツチ２８がオンさ
れた情報は指令機１０側へは伝達されない。この
ため指令機１０側でVTR２０の動作状態を表示
したり、動作を記憶して種々の付加動作を行わせ
る場合には、同様に構成された別の回線を設けて
この情報を伝達しなければならず、構成が極めて
複雑になつてしまう。
本発明はこのような点にかんがみ、構成が簡単
で、双方向のインターフエース回路を提案するも
のである。以下図面を参照しながら本発明の一実
施例について説明しよう。
で、双方向のインターフエース回路を提案するも
のである。以下図面を参照しながら本発明の一実
施例について説明しよう。
第２図において、端子２１がトランジスタ３１
のエミツタに接続され、トランジスタ３１のベー
スが抵抗器３２を通じて5Vの電源端子３３に接
続される。さらにトランジスタ３１のコレクタが
スイツチ２８、抵抗器２７の接続点に接続され
る。
のエミツタに接続され、トランジスタ３１のベー
スが抵抗器３２を通じて5Vの電源端子３３に接
続される。さらにトランジスタ３１のコレクタが
スイツチ２８、抵抗器２７の接続点に接続され
る。
この回路において、スイツチ１１，２８がオフ
のときは、電源端子１３からの5Vの電圧がトラ
ンジスタ３１のエミツタに供給され、トランジス
タ３１がオフになつて電源端子２５からの12Vの
電圧が出力端子２９に取り出される。これに対し
てスイツチ１１がオンされると、トランジスタ３
１のエミツタ電位が低下し、トランジスタ３１が
オンして出力端子２９の電位が０にされる。さら
にスイツチ２８がオンされても、出力端子２９の
電位は０にされる。
のときは、電源端子１３からの5Vの電圧がトラ
ンジスタ３１のエミツタに供給され、トランジス
タ３１がオフになつて電源端子２５からの12Vの
電圧が出力端子２９に取り出される。これに対し
てスイツチ１１がオンされると、トランジスタ３
１のエミツタ電位が低下し、トランジスタ３１が
オンして出力端子２９の電位が０にされる。さら
にスイツチ２８がオンされても、出力端子２９の
電位は０にされる。
一方、スイツチ１１、スイツチ２８のいずれも
がオフの状態において、スイツチ２８がオンさ
れ、コレクタの電位が０にされると、トランジス
タ３１は逆トランジスタになつてオンされる。こ
のためトランジスタ３１のエミツタの電位が０に
され、端子２１，１４を通じて指令機１０のスイ
ツチ１１と抵抗器１２との接続点の電位が０にさ
れる。
がオフの状態において、スイツチ２８がオンさ
れ、コレクタの電位が０にされると、トランジス
タ３１は逆トランジスタになつてオンされる。こ
のためトランジスタ３１のエミツタの電位が０に
され、端子２１，１４を通じて指令機１０のスイ
ツチ１１と抵抗器１２との接続点の電位が０にさ
れる。
従つてこの回路において、スイツチ１１、抵抗
器１２の接続点から端子１５を導出することによ
り、指令機１０側でスイツチ２８の切換状態を知
ることができる。
器１２の接続点から端子１５を導出することによ
り、指令機１０側でスイツチ２８の切換状態を知
ることができる。
こうして情報が伝達されるわけであるが、本発
明によれば１個のトランジスタのみでレベルの変
換を行うことができると共に、１本の回線を設け
るだけで、スイツチ１１の切換状態をVTR２０
側へ伝達し、スイツチ２８の切換状態を指令機１
０側へ伝達することができる。なおトランジスタ
３１のベース電位が5Vなので、指令機１０側へ
5V以上の電圧が供給されることはない。
明によれば１個のトランジスタのみでレベルの変
換を行うことができると共に、１本の回線を設け
るだけで、スイツチ１１の切換状態をVTR２０
側へ伝達し、スイツチ２８の切換状態を指令機１
０側へ伝達することができる。なおトランジスタ
３１のベース電位が5Vなので、指令機１０側へ
5V以上の電圧が供給されることはない。
さらに第３図は具体回路例であつて、VTRに
おいて巻き戻しＲ、再生Ｐ、早送りＦ、停止Ｓの
動作を行う場合を示している。なお各スイツチは
ノンロツク形で、動作時に低電位となる回路であ
る。
おいて巻き戻しＲ、再生Ｐ、早送りＦ、停止Ｓの
動作を行う場合を示している。なお各スイツチは
ノンロツク形で、動作時に低電位となる回路であ
る。
すなわち図において、第２図と同等の回路が４
組み設けられ、それぞれサフイツクスＲ，Ｐ，
Ｆ，Ｓを付けて示されている。そして巻き戻しの
制御信号、再生の制御信号、早送りの制御信号は
それぞれフリツプフロツプ回路４１Ｒ，４１Ｐ，
４１Ｆのセツト端子に供給され、これらのフリツ
プフロツプ回路４１Ｒ，４１Ｐ，４１Ｆを通じて
システムコントロール回路４２に供給される。ま
た停止の制御信号がシステムコントロール回路４
２に供給されると共に、フリツプフロツプ回路４
１Ｒ，４１Ｐ，４１Ｆのリセツト端子に供給され
る。さらにフリツプフロツプ回路４１Ｒ，４１
Ｐ，４１Ｆの出力信号が、それぞれ抵抗器４３
Ｒ，４３Ｐ，４３Ｆを通じてトランジスタ４４
Ｒ，４４Ｐ，４４Ｆのベースに供給され、これら
のトランジスタ４４Ｒ，４４Ｐ，４４Ｆがそれぞ
れ接続端子２１Ｒ，２１Ｐ，２１Ｆと接地との間
に接続される。またスイツチ１１Ｒ，１１Ｐ，１
１Ｆ，１１Ｓと抵抗器１２Ｒ，１２Ｐ，１２Ｆ，
１２Ｓとの接続点がそれぞれ制御回路４５に接続
される。
組み設けられ、それぞれサフイツクスＲ，Ｐ，
Ｆ，Ｓを付けて示されている。そして巻き戻しの
制御信号、再生の制御信号、早送りの制御信号は
それぞれフリツプフロツプ回路４１Ｒ，４１Ｐ，
４１Ｆのセツト端子に供給され、これらのフリツ
プフロツプ回路４１Ｒ，４１Ｐ，４１Ｆを通じて
システムコントロール回路４２に供給される。ま
た停止の制御信号がシステムコントロール回路４
２に供給されると共に、フリツプフロツプ回路４
１Ｒ，４１Ｐ，４１Ｆのリセツト端子に供給され
る。さらにフリツプフロツプ回路４１Ｒ，４１
Ｐ，４１Ｆの出力信号が、それぞれ抵抗器４３
Ｒ，４３Ｐ，４３Ｆを通じてトランジスタ４４
Ｒ，４４Ｐ，４４Ｆのベースに供給され、これら
のトランジスタ４４Ｒ，４４Ｐ，４４Ｆがそれぞ
れ接続端子２１Ｒ，２１Ｐ，２１Ｆと接地との間
に接続される。またスイツチ１１Ｒ，１１Ｐ，１
１Ｆ，１１Ｓと抵抗器１２Ｒ，１２Ｐ，１２Ｆ，
１２Ｓとの接続点がそれぞれ制御回路４５に接続
される。
この回路において、スイツチ１１Ｒ，２８Ｒ，
１１Ｐ，２８Ｐ，１１Ｆ，２１Ｆがオンされる
と、それぞれ対応するフリツプフロツプ回路４１
Ｒ，４１Ｐ，４１Ｆがセツトされ、システムコン
トロール回路４２に信号が供給される。またスイ
ツチ１１Ｓ，２８Ｓがオンされるとこの信号がシ
ステムコントロール回路４２に供給されると共
に、各フリツプフロツプ回路４１Ｒ，４１Ｐ，４
１Ｆがリセツトされる。さらにフリツプフロツプ
回路４１Ｒ，４１Ｐ，４１Ｆがセツトされている
期間にトランジスタ４４Ｒ，４４Ｐ，４４Ｆがオ
ンされ、接続端子２１Ｒ，２１Ｐ，２１Ｆの電位
が０にされる。
１１Ｐ，２８Ｐ，１１Ｆ，２１Ｆがオンされる
と、それぞれ対応するフリツプフロツプ回路４１
Ｒ，４１Ｐ，４１Ｆがセツトされ、システムコン
トロール回路４２に信号が供給される。またスイ
ツチ１１Ｓ，２８Ｓがオンされるとこの信号がシ
ステムコントロール回路４２に供給されると共
に、各フリツプフロツプ回路４１Ｒ，４１Ｐ，４
１Ｆがリセツトされる。さらにフリツプフロツプ
回路４１Ｒ，４１Ｐ，４１Ｆがセツトされている
期間にトランジスタ４４Ｒ，４４Ｐ，４４Ｆがオ
ンされ、接続端子２１Ｒ，２１Ｐ，２１Ｆの電位
が０にされる。
この例においても、それぞれ１本ずつの回線
で、双方向の情報の伝達が行われる。
で、双方向の情報の伝達が行われる。
第１図は従来の回路の接続図、第２図は本発明
の一例の接続図、第３図は他の例の接続図であ
る。 １１，２８はスイツチ、１３，３３は5Vの電
源端子、１４，２１は接続端子、２５は12Vの電
源端子、３１はトランジスタである。
の一例の接続図、第３図は他の例の接続図であ
る。 １１，２８はスイツチ、１３，３３は5Vの電
源端子、１４，２１は接続端子、２５は12Vの電
源端子、３１はトランジスタである。
Claims (1)
- １ 第１の基準電位とアース間とに第１の抵抗器
と第１のスイツチとよりなる信号路を設け、上記
第１の低抗器と第１のスイツチとの接点より第１
の出力端子を導出した第１の装置と、上記第１の
基準電位より高電位である第２の基準電位とアー
ス間とに第２の抵抗器と第２のスイツチとよりな
る信号路を設け、上記第２の抵抗器と第２のスイ
ツチとの接点より第２の出力端子を導出した第２
の装置とよりなり、上記第２の装置には、上記第
１の装置の第１の抵抗器と第１のスイツチとの接
続点にエミツタが接続され、第１の基準電位と略
同電位の基準電位にベースが接続され、上記第２
の抵抗器と第２のスイツチとの接続点にコレクタ
が接続されるトランジスタが設けられてなるイン
ターフエース回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1204279A JPS55105840A (en) | 1979-02-05 | 1979-02-05 | Interface circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1204279A JPS55105840A (en) | 1979-02-05 | 1979-02-05 | Interface circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55105840A JPS55105840A (en) | 1980-08-13 |
| JPS6155809B2 true JPS6155809B2 (ja) | 1986-11-29 |
Family
ID=11794531
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1204279A Granted JPS55105840A (en) | 1979-02-05 | 1979-02-05 | Interface circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS55105840A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61113430U (ja) * | 1984-12-27 | 1986-07-17 | ||
| JPH058651Y2 (ja) * | 1986-05-27 | 1993-03-04 | ||
| JP2001053598A (ja) | 1999-08-16 | 2001-02-23 | Nec Corp | インターフェイス回路、該インターフェイス回路を備えた電子機器及び通信システム |
-
1979
- 1979-02-05 JP JP1204279A patent/JPS55105840A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55105840A (en) | 1980-08-13 |
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