JPS6147460B2 - - Google Patents
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- JPS6147460B2 JPS6147460B2 JP55012261A JP1226180A JPS6147460B2 JP S6147460 B2 JPS6147460 B2 JP S6147460B2 JP 55012261 A JP55012261 A JP 55012261A JP 1226180 A JP1226180 A JP 1226180A JP S6147460 B2 JPS6147460 B2 JP S6147460B2
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- 238000004891 communication Methods 0.000 claims description 57
- 230000005540 biological transmission Effects 0.000 claims description 43
- 239000000725 suspension Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 6
- 238000005516 engineering process Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 230000004043 responsiveness Effects 0.000 description 1
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/10—Program control for peripheral devices
- G06F13/12—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
- G06F13/122—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware performs an I/O function other than control of data transfer
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- General Physics & Mathematics (AREA)
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- Communication Control (AREA)
- Computer And Data Communications (AREA)
Description
【発明の詳細な説明】
この発明はデータ処理装置と複数の端末装置間
のデータ伝送を行う通信制御装置に係わり、特に
優先度の高いメツセージを優先して伝送すること
を可能にしたものである。
のデータ伝送を行う通信制御装置に係わり、特に
優先度の高いメツセージを優先して伝送すること
を可能にしたものである。
一般に通信制御装置には単回線形と多回線形が
ある。多回線形通信制御装置では共通制御部が多
数の通信回線に対して時分割的に伝送制御を実行
し、複数の通信回線は同時にデータ処理装置とデ
ータの受渡しを行つている。
ある。多回線形通信制御装置では共通制御部が多
数の通信回線に対して時分割的に伝送制御を実行
し、複数の通信回線は同時にデータ処理装置とデ
ータの受渡しを行つている。
ところが通信回線の伝送速度が高速になると共
通制御部（一般にはマイクロプロセツサからな
る）の時分割的な多重伝送処理が、回線速度に追
従できなくなりデータロスが発生してしまう。こ
の様な場合には従来次の様な解決策がある。
通制御部（一般にはマイクロプロセツサからな
る）の時分割的な多重伝送処理が、回線速度に追
従できなくなりデータロスが発生してしまう。こ
の様な場合には従来次の様な解決策がある。
(A) 単回線通信制御装置を回線対応に積み上げ
る。
る。
(B) バイト多重形の通信制御装置の代りに、ブロ
ツク多重形の通信制御装置を用いる。
ツク多重形の通信制御装置を用いる。
上記(A)では回線数が多い場合や回線速度が高い
場合には極めて高価につき現実的でない。上記(B)
の場合には本質的にあるメツセージ・ブロツクの
伝送制御を行つている間は、通信制御装置の共通
制御部は他の通信回線のメツセージ・ブロツクの
処理はできないので、現在伝送中であるメツセー
ジ・ブロツクより緊急度の高い送信要求あるいは
受信要求が発生しても、先行するメツセージ・ブ
ロツクの伝送が終了するまで待つ必要があつた。
この様にリアルタイム性を要求する通信とリアル
タイム性を要求されない通信が同一に扱われてい
たため、リアルタイム性を要求する通信が、リア
ルタイム性を要求されない通信のトラフイツクに
よつて通信が抑圧され、リアルタイム処理ができ
なくなるという欠点があつた。
場合には極めて高価につき現実的でない。上記(B)
の場合には本質的にあるメツセージ・ブロツクの
伝送制御を行つている間は、通信制御装置の共通
制御部は他の通信回線のメツセージ・ブロツクの
処理はできないので、現在伝送中であるメツセー
ジ・ブロツクより緊急度の高い送信要求あるいは
受信要求が発生しても、先行するメツセージ・ブ
ロツクの伝送が終了するまで待つ必要があつた。
この様にリアルタイム性を要求する通信とリアル
タイム性を要求されない通信が同一に扱われてい
たため、リアルタイム性を要求する通信が、リア
ルタイム性を要求されない通信のトラフイツクに
よつて通信が抑圧され、リアルタイム処理ができ
なくなるという欠点があつた。
この発明は、従来のこの様な欠点を除去するた
めに、送信要求に優先度を設け、優先度の高い送
信要求が発生すると、この要求より優先度の低い
データ・メツセージの伝送中であればこの伝送を
一時保留し、優先度の高い要求の処理を先行する
ようにしたもので、以下図面に従つて詳細に説明
する。
めに、送信要求に優先度を設け、優先度の高い送
信要求が発生すると、この要求より優先度の低い
データ・メツセージの伝送中であればこの伝送を
一時保留し、優先度の高い要求の処理を先行する
ようにしたもので、以下図面に従つて詳細に説明
する。
第１図はこの発明の一実施例の構成を説明する
ための説明図であり、図において、DPはデータ
処理装置、CCU1，CCU2，CCU3等CCUは通信制
御装置、T1，T2等Ｔは端末装置、１ａは通信制
御装置CCU1とCCU2とを結ぶ回線、１ｂは通信
制御装置CCU1とCCU3とを結ぶ回線であり、回
線１ａ，１ｂは、各々上りと下りとの２個の伝送
路を持つ。第２図はメツセージを伝送する伝送フ
レームのフオーマツトを示し、Ｆは伝送フレーム
の先頭あるいは最後を示すフラグ、Ｈはヘツダ、
INFは情報フイールド、CRCは誤りチエツクコー
ドである。ヘツダＨは発着信アドレスをのせるア
ドレスフイールドＡと、コマンドCOMとメツセ
ージの優先度を示すプライオリテイPRをのせる
制御フイールドＣとで構成されている。
ための説明図であり、図において、DPはデータ
処理装置、CCU1，CCU2，CCU3等CCUは通信制
御装置、T1，T2等Ｔは端末装置、１ａは通信制
御装置CCU1とCCU2とを結ぶ回線、１ｂは通信
制御装置CCU1とCCU3とを結ぶ回線であり、回
線１ａ，１ｂは、各々上りと下りとの２個の伝送
路を持つ。第２図はメツセージを伝送する伝送フ
レームのフオーマツトを示し、Ｆは伝送フレーム
の先頭あるいは最後を示すフラグ、Ｈはヘツダ、
INFは情報フイールド、CRCは誤りチエツクコー
ドである。ヘツダＨは発着信アドレスをのせるア
ドレスフイールドＡと、コマンドCOMとメツセ
ージの優先度を示すプライオリテイPRをのせる
制御フイールドＣとで構成されている。
第３図は、この発明に係わる通信制御装置
CCUの一構成例で、図中、２ａ，２ｂ等２は回
線１からのメツセージを受信したり、回線１へメ
ツセージを送信する制御を行うライン制御回路、
３は現在伝送中のメツセージのプライオリテイ
PRと、ライン制御回路２によつて受信されたメ
ツセージのプライオリテイPRの比較を行い結果
をライン制御回路２に通知するプライオリテイ制
御回路、４はデータ処理装置DPあるいは端末装
置Ｔからの送信要求や受信要求の解読処理や受信
したメツセージの解読を行つたり、あるいはデー
タ転送の一時保留や再開を決定し、ライン制御回
路２に送信起動などの指示を与える共通制御回
路、５は送受信データの一時蓄積ないし、共通制
御回路４が用いる制御情報を格納するメモリ、６
は共通制御回路４の指示により、データ処理装置
DPあるいは端末装置Ｔとのインターフエースを
制御するインターフエース制御回路である。
CCUの一構成例で、図中、２ａ，２ｂ等２は回
線１からのメツセージを受信したり、回線１へメ
ツセージを送信する制御を行うライン制御回路、
３は現在伝送中のメツセージのプライオリテイ
PRと、ライン制御回路２によつて受信されたメ
ツセージのプライオリテイPRの比較を行い結果
をライン制御回路２に通知するプライオリテイ制
御回路、４はデータ処理装置DPあるいは端末装
置Ｔからの送信要求や受信要求の解読処理や受信
したメツセージの解読を行つたり、あるいはデー
タ転送の一時保留や再開を決定し、ライン制御回
路２に送信起動などの指示を与える共通制御回
路、５は送受信データの一時蓄積ないし、共通制
御回路４が用いる制御情報を格納するメモリ、６
は共通制御回路４の指示により、データ処理装置
DPあるいは端末装置Ｔとのインターフエースを
制御するインターフエース制御回路である。
第３図に示す構成は、通信制御装置CCU1の構
成である。通信制御装置CCU2では、第３図に示
す構成からライン制御回路２ｂを省略した構成と
なり、通信制御装置CCU3では、第３図に示す構
成からライン制御回路２ａを省略した構成とな
る。
成である。通信制御装置CCU2では、第３図に示
す構成からライン制御回路２ｂを省略した構成と
なり、通信制御装置CCU3では、第３図に示す構
成からライン制御回路２ａを省略した構成とな
る。
次に、この通信制御装置CCUの動作について
下記(1)、(2)に示す想定例で説明する。
下記(1)、(2)に示す想定例で説明する。
(1) 優先度を示すプライオリテイPRは低位と高
位の２レベル。
位の２レベル。
(2) データ処理装置DPと端末装置T1が低位の優
先度でデータ伝送を行つている時（端末装置
T1が送信側とする。）、データ処理装置DPに、
端末装置T2から高位のプライオリテイPRの送
信要求メツセージが到着した。
先度でデータ伝送を行つている時（端末装置
T1が送信側とする。）、データ処理装置DPに、
端末装置T2から高位のプライオリテイPRの送
信要求メツセージが到着した。
本発明における通信シーケンスの一例を第４図
に示し、このシーケンスに従つて、通信制御装置
CCU1，CCU2及びCCU3の動作を以下に記述す
る。以下の冒頭に付してある丸印内の数字は、第
４図の図中の数字と一致する。
に示し、このシーケンスに従つて、通信制御装置
CCU1，CCU2及びCCU3の動作を以下に記述す
る。以下の冒頭に付してある丸印内の数字は、第
４図の図中の数字と一致する。
データ処理装置DPの通信制御装置CCU1にお
いて、ライン制御回路２ｂによつて、端末装置
T2の通信制御装置CCU3から回線１ｂを経由し
て送られて来た新たな送信要求メツセージを受
信し、受信伝送フレームの制御フイールドＣ内
のプライオリテイPRと現在伝送中の優先度と
をプライオリテイ制御回路３において比較す
る。この例の場合、前記の受信データのプライ
オリテイPRの方が現在伝送中のプライオリテ
イPRより優先度が高いので、この旨がプライ
オリテイ制御回路３よりライン制御回路２ｂに
伝えられる。上記通知を受けると、ライン制御
回路２ｂはメモリ５へ回線１ｂから受信した受
信メツセージを転送し、端末装置T2よりメツ
セージを受信した事を共通制御回路４に知らせ
る。
いて、ライン制御回路２ｂによつて、端末装置
T2の通信制御装置CCU3から回線１ｂを経由し
て送られて来た新たな送信要求メツセージを受
信し、受信伝送フレームの制御フイールドＣ内
のプライオリテイPRと現在伝送中の優先度と
をプライオリテイ制御回路３において比較す
る。この例の場合、前記の受信データのプライ
オリテイPRの方が現在伝送中のプライオリテ
イPRより優先度が高いので、この旨がプライ
オリテイ制御回路３よりライン制御回路２ｂに
伝えられる。上記通知を受けると、ライン制御
回路２ｂはメモリ５へ回線１ｂから受信した受
信メツセージを転送し、端末装置T2よりメツ
セージを受信した事を共通制御回路４に知らせ
る。
通信制御装置CCU1の共通制御回路４はバツ
フア５から受信メツセージを読出し、解読す
る。端末装置T2からの送信要求であるので、
ライン制御回路２ａに指示して、回線１ａを経
由して端末装置T1の通信制御装置CCU2にデー
タ伝送一時保留を指示するメツセージを送る。
通信制御装置CCU2において、共通制御回路４
によつて受信メツセージの解読がなされ、デー
タ処理装置DPへのデータメツセージの伝送を
一時保留する。
フア５から受信メツセージを読出し、解読す
る。端末装置T2からの送信要求であるので、
ライン制御回路２ａに指示して、回線１ａを経
由して端末装置T1の通信制御装置CCU2にデー
タ伝送一時保留を指示するメツセージを送る。
通信制御装置CCU2において、共通制御回路４
によつて受信メツセージの解読がなされ、デー
タ処理装置DPへのデータメツセージの伝送を
一時保留する。
通信制御装置CCU1において、通信制御装置
CCU2からのデータメツセージがとだえたのを
確認すると、共通制御回路４の指示によりライ
ン制御回路２ｂを起動して、通信制御装置
CCU3へ、データ送信許可メツセージを送り、
通信制御装置CCU3からのデータメツセージの
受信待ちとなる。
CCU2からのデータメツセージがとだえたのを
確認すると、共通制御回路４の指示によりライ
ン制御回路２ｂを起動して、通信制御装置
CCU3へ、データ送信許可メツセージを送り、
通信制御装置CCU3からのデータメツセージの
受信待ちとなる。
通信制御装置CCU3において、共通制御回路
４によりデータ送信許可メツセージが、通信制
御装置CCU1より送られて来た事が認知される
と、共通制御回路４は、インタフエース制御回
路６に起動をかけ、端末T2からのデータをメ
モリ５に取込むとともに、ライン制御回路２に
送信起動をかける。ライン制御回路２は、前記
メモリ５より送信データを取り出し、回線１ｂ
を経由して通信制御装置CCU1にデータメツセ
ージを送る。
４によりデータ送信許可メツセージが、通信制
御装置CCU1より送られて来た事が認知される
と、共通制御回路４は、インタフエース制御回
路６に起動をかけ、端末T2からのデータをメ
モリ５に取込むとともに、ライン制御回路２に
送信起動をかける。ライン制御回路２は、前記
メモリ５より送信データを取り出し、回線１ｂ
を経由して通信制御装置CCU1にデータメツセ
ージを送る。
通信制御装置CCU1において、受信したデー
タメツセージをライン制御回路２ｂよりメモリ
５に取込み、インタフエース制御回路６を経由
してデータ処理装置DPに転送する。
タメツセージをライン制御回路２ｂよりメモリ
５に取込み、インタフエース制御回路６を経由
してデータ処理装置DPに転送する。
通信制御装置CCU1において、最終データを
受信終了すると、共通制御回路４の指示により
ライン制御回路２ｂは、受信データメツセージ
に対する応答メツセージを通信制御装置CCU3
に送る。更に、前記共通制御回路４は、インタ
フエース制御回路６を経由してデータ処理装置
DPに受信完了報告をする。
受信終了すると、共通制御回路４の指示により
ライン制御回路２ｂは、受信データメツセージ
に対する応答メツセージを通信制御装置CCU3
に送る。更に、前記共通制御回路４は、インタ
フエース制御回路６を経由してデータ処理装置
DPに受信完了報告をする。
通信制御装置CCU1において、通信制御装置
CCU3との伝送が終了すると、保留していた通
信制御装置CCU2との伝送を再開するために、
共通制御回路４はライン制御回路２ａを指示し
て、伝送再開要求メツセージを回線１ａを経由
して通信制御装置CCU2に伝送する。
CCU3との伝送が終了すると、保留していた通
信制御装置CCU2との伝送を再開するために、
共通制御回路４はライン制御回路２ａを指示し
て、伝送再開要求メツセージを回線１ａを経由
して通信制御装置CCU2に伝送する。
通信制御装置CCU2において、再開要求メツ
セージを受信すると、共通制御回路４の指示に
より、上記項で伝送を一時保留したデータ及
び後続するデータをメモリ５から取出し、ライ
ン制御回路２により回線１ａを経由して通信制
御装置CCU1に前記両データからなるデータメ
ツセージを送る。
セージを受信すると、共通制御回路４の指示に
より、上記項で伝送を一時保留したデータ及
び後続するデータをメモリ５から取出し、ライ
ン制御回路２により回線１ａを経由して通信制
御装置CCU1に前記両データからなるデータメ
ツセージを送る。
以上、この発明の装置構成例とこの通信制御装
置を用いた通信シーケンス例及びその時の通信制
御装置の動作について説明した。この説明では、
対向形回線の場合を示したが、環状形回線や多分
岐回線においても適用できる。
置を用いた通信シーケンス例及びその時の通信制
御装置の動作について説明した。この説明では、
対向形回線の場合を示したが、環状形回線や多分
岐回線においても適用できる。
以上の様にこの発明に係わる通信制御装置で
は、通信の緊急度により優先度を設けることによ
り、通信中であつてもより優先度の高い送信要求
が発生すると、優先度の高い要求の処理を先行し
て行うことができるので、優先度の高い送信要求
に対する応答性の向上がはかれる。
は、通信の緊急度により優先度を設けることによ
り、通信中であつてもより優先度の高い送信要求
が発生すると、優先度の高い要求の処理を先行し
て行うことができるので、優先度の高い送信要求
に対する応答性の向上がはかれる。
第１図はこの発明の一実施例の構成を説明する
ための説明図、第２図は伝送フレームのフオーマ
ツトを説明する説明図、第３図はこの発明装置の
一構成例を説明するための説明図、第４図はこの
発明装置を用いた通信シーケンスの一例を説明す
るための説明図である。 図中、DPはデータ処理装置、CCU1，CCU2，
CCU3等CCUは通信制御装置、T1，T2等Ｔは端
末装置、１ａ，１ｂ等１は回線、２ａ，２ｂ等２
はライン制御回路、３はプライオリテイ制御回
路、４は共通制御回路、５はメモリ、６はインタ
フエース制御回路である。なお、図中、同一ある
いは相当部分は同一符号を付して示している。
ための説明図、第２図は伝送フレームのフオーマ
ツトを説明する説明図、第３図はこの発明装置の
一構成例を説明するための説明図、第４図はこの
発明装置を用いた通信シーケンスの一例を説明す
るための説明図である。 図中、DPはデータ処理装置、CCU1，CCU2，
CCU3等CCUは通信制御装置、T1，T2等Ｔは端
末装置、１ａ，１ｂ等１は回線、２ａ，２ｂ等２
はライン制御回路、３はプライオリテイ制御回
路、４は共通制御回路、５はメモリ、６はインタ
フエース制御回路である。なお、図中、同一ある
いは相当部分は同一符号を付して示している。
Claims (1)
- １ データ処理装置と複数の端末装置間のデータ
伝送を行う通信制御装置において、伝送メツセー
ジにはアドレス等の識別コードと優先度を含むヘ
ツダが付加されており、上記通信制御装置は、通
常の伝送制御プログラムとともに優先伝送処理プ
ログラムを収容する固定メモリと、上記伝送メツ
セージのヘツダを捕捉して現在伝送中のメツセー
ジの優先度と比較する手段と、上記データ処理装
置あるいは端末装置からの送信要求の優先度と現
在伝送中のメツセージの優先度とを比較する手段
と、データ伝送を一時保留する手段と、保留して
いたデータ伝送を再開する手段とを具備し、現在
伝送中のメツセージの優先度より高いメツセージ
の送信要求が発生した時には、低い優先度のデー
タ伝送の一時保留を上記相手の端末装置あるいは
データ処理装置に伝えてメツセージ伝送を中断さ
せて高い優先度のメツセージの受信あるいは送信
を先行し、これが終ると再び伝送を保留していた
上記相手の端末装置あるいはデータ処理装置に伝
送再開を指示するようにして、最も優先度の高い
メツセージを優先して伝送することを特徴とする
通信制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1226180A JPS56110367A (en) | 1980-02-04 | 1980-02-04 | Communication controller |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1226180A JPS56110367A (en) | 1980-02-04 | 1980-02-04 | Communication controller |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56110367A JPS56110367A (en) | 1981-09-01 |
| JPS6147460B2 true JPS6147460B2 (ja) | 1986-10-20 |
Family
ID=11800423
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1226180A Granted JPS56110367A (en) | 1980-02-04 | 1980-02-04 | Communication controller |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS56110367A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0690616B2 (ja) * | 1984-08-31 | 1994-11-14 | ヤマハ株式会社 | 電子楽器のデ−タ通信装置 |
| JPS63226151A (ja) * | 1986-10-15 | 1988-09-20 | Fujitsu Ltd | 多重パケット通信システム |
| US4914653A (en) * | 1986-12-22 | 1990-04-03 | American Telephone And Telegraph Company | Inter-processor communication protocol |
| JPH01241660A (ja) * | 1988-03-24 | 1989-09-26 | Toshiba Corp | プロセッサ間通信方式 |
-
1980
- 1980-02-04 JP JP1226180A patent/JPS56110367A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56110367A (en) | 1981-09-01 |
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