JPS6146839B2 - - Google Patents
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- Publication number
- JPS6146839B2 JPS6146839B2 JP56173954A JP17395481A JPS6146839B2 JP S6146839 B2 JPS6146839 B2 JP S6146839B2 JP 56173954 A JP56173954 A JP 56173954A JP 17395481 A JP17395481 A JP 17395481A JP S6146839 B2 JPS6146839 B2 JP S6146839B2
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- JP
- Japan
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- displayed
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- color
- pixel
- crt
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- 230000015654 memory Effects 0.000 claims description 22
- 238000009125 cardiac resynchronization therapy Methods 0.000 description 10
- 230000004397 blinking Effects 0.000 description 9
- 230000006870 function Effects 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 239000003086 colorant Substances 0.000 description 1
- 230000010365 information processing Effects 0.000 description 1
Description
【発明の詳細な説明】
本発明は表示する色の制御を可能とする画像表
示装置に関する。
示装置に関する。
コンピユータの高速大容量化ならびに情報処理
技術とくに画像処理技術の進歩によつて、複雑な
画像の処理あるいは複雑高度な情報の画像化が可
能となつたが、そのような処理結果を人間に対し
適確に伝えるために、画像表示装置には複雑多様
な補助表示機能が必要とされている。これらの中
で、ブリンクすなわち表示画像の中の特定の一部
を反復的に点滅させる方法が広く用いられてい
る。
技術とくに画像処理技術の進歩によつて、複雑な
画像の処理あるいは複雑高度な情報の画像化が可
能となつたが、そのような処理結果を人間に対し
適確に伝えるために、画像表示装置には複雑多様
な補助表示機能が必要とされている。これらの中
で、ブリンクすなわち表示画像の中の特定の一部
を反復的に点滅させる方法が広く用いられてい
る。
第１図はブリンク機能を備える画像表示装置の
従来例の構成図を示す。図において１はCRTの
表示面を構成する全画素の各に対応して８ビツト
ずつ設けられ、CRTに表示する画像に対応して
各の画素に表示すべき色信号を指定する８ビツト
のコードを記憶するパターン・メモリ、２はパタ
ーン・メモリ１に記憶される８ビツトのコードに
対応する色信号を赤Ｒ、緑Ｇ、青Ｂに分け各８ビ
ツトのデータとして記憶するテーブル、３はテー
ブル２のＲ、Ｇ、Ｂの各の出力に対し８組ずつ設
けられ、後記NAND回路の出力との論理積を得る
AND回路、４はAND回路２を経て送られたＲ、
Ｇ、Ｂの各８ビツトのデータをアナログ値に変換
しCRTに供給するＤ／Ａ変換回路、５はCRTの
表示面を構成する全画素の各に対応して１ビツト
ずつ設けられ、CRTに表示する画像のうちブリ
ンクするパターンに対応する画素を記憶するコン
トロール・メモリ、６はコントロール・メモリ５
の出力とブリンク信号Ｓとの否定積を得るNAND
回路である。
従来例の構成図を示す。図において１はCRTの
表示面を構成する全画素の各に対応して８ビツト
ずつ設けられ、CRTに表示する画像に対応して
各の画素に表示すべき色信号を指定する８ビツト
のコードを記憶するパターン・メモリ、２はパタ
ーン・メモリ１に記憶される８ビツトのコードに
対応する色信号を赤Ｒ、緑Ｇ、青Ｂに分け各８ビ
ツトのデータとして記憶するテーブル、３はテー
ブル２のＲ、Ｇ、Ｂの各の出力に対し８組ずつ設
けられ、後記NAND回路の出力との論理積を得る
AND回路、４はAND回路２を経て送られたＲ、
Ｇ、Ｂの各８ビツトのデータをアナログ値に変換
しCRTに供給するＤ／Ａ変換回路、５はCRTの
表示面を構成する全画素の各に対応して１ビツト
ずつ設けられ、CRTに表示する画像のうちブリ
ンクするパターンに対応する画素を記憶するコン
トロール・メモリ、６はコントロール・メモリ５
の出力とブリンク信号Ｓとの否定積を得るNAND
回路である。
このような構成によつて、ブリンク信号Ｓが
「０」のときにはパターン・メモリ１に記憶され
るコードに対応する色信号がテーブル２から選択
されCRTの各の画素に表示されることによつて
画像表示がおこなわれる。またブリンク信号Ｓが
「１」のときには、CRTに表示された前記画像の
うち、コントロール・メモリ５によつて指定され
る画素が非表示となる。このようにしてブリンク
表示をおこなう。なお、パターン・メモリ１およ
びコントロール・メモリ５の内容は、それぞれホ
スト・コンピユータ（図示せず）から送られる信
号ＰおよびＣによつて任意に書替えられる。
「０」のときにはパターン・メモリ１に記憶され
るコードに対応する色信号がテーブル２から選択
されCRTの各の画素に表示されることによつて
画像表示がおこなわれる。またブリンク信号Ｓが
「１」のときには、CRTに表示された前記画像の
うち、コントロール・メモリ５によつて指定され
る画素が非表示となる。このようにしてブリンク
表示をおこなう。なお、パターン・メモリ１およ
びコントロール・メモリ５の内容は、それぞれホ
スト・コンピユータ（図示せず）から送られる信
号ＰおよびＣによつて任意に書替えられる。
前記従来例においては、ブリンクするパターン
に対応する画素を記憶するためにコントロール・
メモリ５を必要とし、コントロール・メモリ５の
記憶容量は、例えばCRTの表示面を構成する画
素が1024×1024であれば、これと同数すなわち
1Mビツトを必要とする。また前記従来例におい
ておこなわれるブリンクは表示画像の一部画素の
点滅すなわち表示・非表示であり、したがつてブ
リンクによる非表示画素と、もともと非表示であ
つた画素との識別が困難であつた。
に対応する画素を記憶するためにコントロール・
メモリ５を必要とし、コントロール・メモリ５の
記憶容量は、例えばCRTの表示面を構成する画
素が1024×1024であれば、これと同数すなわち
1Mビツトを必要とする。また前記従来例におい
ておこなわれるブリンクは表示画像の一部画素の
点滅すなわち表示・非表示であり、したがつてブ
リンクによる非表示画素と、もともと非表示であ
つた画素との識別が困難であつた。
本発明は上記のような欠点を解消し、コントロ
ール・メモリを必要とせず、したがつて安価であ
り、またブリンク・パターンの識別が容易なブリ
ンク機能を有する画像表示装置を提供することを
目的とする。
ール・メモリを必要とせず、したがつて安価であ
り、またブリンク・パターンの識別が容易なブリ
ンク機能を有する画像表示装置を提供することを
目的とする。
すなわち、本発明においては、CRTに表示す
る画像を画素ごとにコードによつて記憶するパタ
ーン・メモリと、前記コードをそれぞれ所定の色
信号に変換する複数のテーブルと、所定周期のブ
リンク信号によつて前記複数のテーブルの出力を
選択するセレクタとを備え、前記テーブルに記憶
する色信号のうち、一部のコードに対応するもの
をテーブルによつて異ならせるようにしたもので
ある。
る画像を画素ごとにコードによつて記憶するパタ
ーン・メモリと、前記コードをそれぞれ所定の色
信号に変換する複数のテーブルと、所定周期のブ
リンク信号によつて前記複数のテーブルの出力を
選択するセレクタとを備え、前記テーブルに記憶
する色信号のうち、一部のコードに対応するもの
をテーブルによつて異ならせるようにしたもので
ある。
以下、第２図に示す実施例により本発明の要旨
の具体的な説明をおこなう。第２図において１と
４は第１図において説明したパターン・メモリと
Ｄ／Ａ変換回路、２ａはパターン・メモリ１に記
憶される８ビツトのコードに対応する色信号を赤
Ｒ、緑Ｇ、青Ｂに分け、各８ビツトのデータで記
憶し、パターン・メモリ１から送られるコードに
応じて色信号を出力する第１のテーブル、２ｂは
パターン・メモリ１に記憶される８ビツトのコー
ドに対応し、その一部が第１のテーブル２ａと異
なる色信号を赤Ｒ、緑Ｇ、青Ｂに分け、各８ビツ
トのデータで記憶し、パターン・メモリ１から送
られるコードに応じて色信号を出力する第２のテ
ーブル、３′は第１のテーブル２ａと第２のテー
ブル２ｂの色信号を受け、１秒の周期で切り替わ
るブリンク信号Ｓが「０」のときには第１のテー
ブル２ａの色信号を出力し、ブリンク信号Ｓが
「１」のときには第２のテーブル２ｂの色信号を
出力するセレクタである。
の具体的な説明をおこなう。第２図において１と
４は第１図において説明したパターン・メモリと
Ｄ／Ａ変換回路、２ａはパターン・メモリ１に記
憶される８ビツトのコードに対応する色信号を赤
Ｒ、緑Ｇ、青Ｂに分け、各８ビツトのデータで記
憶し、パターン・メモリ１から送られるコードに
応じて色信号を出力する第１のテーブル、２ｂは
パターン・メモリ１に記憶される８ビツトのコー
ドに対応し、その一部が第１のテーブル２ａと異
なる色信号を赤Ｒ、緑Ｇ、青Ｂに分け、各８ビツ
トのデータで記憶し、パターン・メモリ１から送
られるコードに応じて色信号を出力する第２のテ
ーブル、３′は第１のテーブル２ａと第２のテー
ブル２ｂの色信号を受け、１秒の周期で切り替わ
るブリンク信号Ｓが「０」のときには第１のテー
ブル２ａの色信号を出力し、ブリンク信号Ｓが
「１」のときには第２のテーブル２ｂの色信号を
出力するセレクタである。
以上のような構成によつて、ブリンク信号Ｓが
「０」のときには、パターン・メモリ１に記憶さ
れているコードに対応して第１のテーブル２ａに
記憶されている色信号がCRTの各の画素に表示
される。またブリンク信号Ｓが「１」のときには
パターン・メモリ１に記憶されているコードに対
応して第２のテーブル２ｂに記憶されている色信
号がCRTに表示される。
「０」のときには、パターン・メモリ１に記憶さ
れているコードに対応して第１のテーブル２ａに
記憶されている色信号がCRTの各の画素に表示
される。またブリンク信号Ｓが「１」のときには
パターン・メモリ１に記憶されているコードに対
応して第２のテーブル２ｂに記憶されている色信
号がCRTに表示される。
したがつて、パターン・メモリ１に記憶されて
いるコードのうち、ブリンクの対象となる画素に
対応するコードに対して、第１のテーブルと異な
る色情報を第２のテーブルに記憶しておけば、ブ
リンク信号Ｓを「１」とすることによつて、ブリ
ンクの対象とする画素に対して異なつた色を表示
することができる。
いるコードのうち、ブリンクの対象となる画素に
対応するコードに対して、第１のテーブルと異な
る色情報を第２のテーブルに記憶しておけば、ブ
リンク信号Ｓを「１」とすることによつて、ブリ
ンクの対象とする画素に対して異なつた色を表示
することができる。
以上説明したように、本発明によれば、コント
ロール・メモリを必要としないので安価であり、
また、ブリンクの対象とする画素に対して予め定
めた任意の色をブリンク信号によつて表示するも
のでブリンク・パターンの識別容易な画像表示装
置を得ることができる。
ロール・メモリを必要としないので安価であり、
また、ブリンクの対象とする画素に対して予め定
めた任意の色をブリンク信号によつて表示するも
のでブリンク・パターンの識別容易な画像表示装
置を得ることができる。
第１図は画像表示装置の従来例、また第２図は
本発明実施例の構成図を示し、これらの図におい
て１はパターン・メモリ、２ａは第１のテーブ
ル、２ｂは第２のテーブル、３′はセレクタであ
る。
本発明実施例の構成図を示し、これらの図におい
て１はパターン・メモリ、２ａは第１のテーブ
ル、２ｂは第２のテーブル、３′はセレクタであ
る。
Claims (1)
- １ CRTの表示面を構成する画素の各に対応し
て設けられ、各の画素に表示すべき色信号を指定
するコードを記憶するパターン・メモリ１と、前
記コードをそれぞれ所定の色信号に変換する複数
のテーブル２ａ，２ｂと、所定周期のブリンク信
号によつて前記複数のテーブル２ａ，２ｂの出力
を交互に選択するセレクタ３′とを備えることを
特徴とする画像表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17395481A JPS5876883A (ja) | 1981-10-30 | 1981-10-30 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17395481A JPS5876883A (ja) | 1981-10-30 | 1981-10-30 | 画像表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5876883A JPS5876883A (ja) | 1983-05-10 |
| JPS6146839B2 true JPS6146839B2 (ja) | 1986-10-16 |
Family
ID=15970131
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17395481A Granted JPS5876883A (ja) | 1981-10-30 | 1981-10-30 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5876883A (ja) |
Families Citing this family (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60165696A (ja) * | 1984-02-08 | 1985-08-28 | 株式会社アスキ− | デイスプレイコントロ−ラ |
| JPS60235195A (ja) * | 1984-05-09 | 1985-11-21 | 株式会社日立製作所 | 図形表示装置 |
| JPS60247690A (ja) * | 1984-05-24 | 1985-12-07 | 富士通株式会社 | ブリンク制御回路 |
| JPS6193492A (ja) * | 1984-10-13 | 1986-05-12 | 株式会社日立製作所 | 表示修飾装置 |
| JPS61180289A (ja) * | 1985-02-04 | 1986-08-12 | 株式会社明電舎 | 図形表示装置 |
| JPS61275797A (ja) * | 1985-05-31 | 1986-12-05 | 株式会社安川電機 | カラ−表示装置 |
| JPS62135885A (ja) * | 1985-12-10 | 1987-06-18 | 株式会社 アスキ− | 表示コントロ−ラ |
| JPS6310193A (ja) * | 1986-07-01 | 1988-01-16 | 日本電気株式会社 | カラ−表示装置 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53148232A (en) * | 1977-05-30 | 1978-12-23 | Fujitsu Ltd | Arithmetic system for image data matrix |
| JPS5459030A (en) * | 1977-10-19 | 1979-05-12 | Nec Corp | Color picture emphasizing display unit |
| JPS5522771A (en) * | 1978-08-08 | 1980-02-18 | Nippon Electric Co | Image quntizing device |
-
1981
- 1981-10-30 JP JP17395481A patent/JPS5876883A/ja active Granted
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53148232A (en) * | 1977-05-30 | 1978-12-23 | Fujitsu Ltd | Arithmetic system for image data matrix |
| JPS5459030A (en) * | 1977-10-19 | 1979-05-12 | Nec Corp | Color picture emphasizing display unit |
| JPS5522771A (en) * | 1978-08-08 | 1980-02-18 | Nippon Electric Co | Image quntizing device |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5876883A (ja) | 1983-05-10 |
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