JPS61231245A - 織機の集中制御方法 - Google Patents
織機の集中制御方法Info
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- G—PHYSICS
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- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
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- G05B19/042—Programme control other than numerical control, i.e. in sequence controllers or logic controllers using digital processors
- G05B19/0421—Multiprocessor system
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- D—TEXTILES; PAPER
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- D03D—WOVEN FABRICS; METHODS OF WEAVING; LOOMS
- D03D33/00—Multiple looms, i.e. two or more looms assembled together, whether or not they have mechanisms in common
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- D03D—WOVEN FABRICS; METHODS OF WEAVING; LOOMS
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、複数の織機を集中的に制御する方法に関し、
特に、複数のマイクロコンピュータのＣＰＵによって制
御される織機が複数台存在し、これらの各織機がホスト
ＣＰＵに通信回線を介して接続されている織機の集中制
御装置における制御方法に関する。
特に、複数のマイクロコンピュータのＣＰＵによって制
御される織機が複数台存在し、これらの各織機がホスト
ＣＰＵに通信回線を介して接続されている織機の集中制
御装置における制御方法に関する。
従来技術
複数の織機をホストＣＰＵによって制御する織機の集中
制御方法として、例えば、特開昭５９−２１１６５８号
公報に記載された発明がある。その発明の方法は、ＣＰ
ＵとこのＣＰＵによって直接制御される織機が複数台存
在し、これら織機の群が各織機制御用ＣＰＵおよびデー
タバスを介してホストＣＰＵと接続し、ホストＣＰＵか
らの制御データによって指定された織機に対して機台停
止指令および機台起動禁止指令を含む特定の指令を与え
る。そのとき、特定の織機のＣＰＵはその特定の指令に
応じた動作を行う。
制御方法として、例えば、特開昭５９−２１１６５８号
公報に記載された発明がある。その発明の方法は、ＣＰ
ＵとこのＣＰＵによって直接制御される織機が複数台存
在し、これら織機の群が各織機制御用ＣＰＵおよびデー
タバスを介してホストＣＰＵと接続し、ホストＣＰＵか
らの制御データによって指定された織機に対して機台停
止指令および機台起動禁止指令を含む特定の指令を与え
る。そのとき、特定の織機のＣＰＵはその特定の指令に
応じた動作を行う。
発明の技術的課題
このような手法では、制御データが織機の停止や運転禁
止などの単なるオン、オフ制御を少数だけ行う場合は、
直接パスラインを介して、ホストＣＰＵと織機制御用Ｃ
ＰＵとを接続しても、問題はない。しかし、実際に織機
を制御しようとすれば、例えばエアージェットルームで
は、織機の原動モータの回転数、打込数、経糸張力、各
ノズルのオン、オフタイミングおよび緯入れ用空気圧な
どの多数のデータが必要となる。
止などの単なるオン、オフ制御を少数だけ行う場合は、
直接パスラインを介して、ホストＣＰＵと織機制御用Ｃ
ＰＵとを接続しても、問題はない。しかし、実際に織機
を制御しようとすれば、例えばエアージェットルームで
は、織機の原動モータの回転数、打込数、経糸張力、各
ノズルのオン、オフタイミングおよび緯入れ用空気圧な
どの多数のデータが必要となる。
さらに、近年織機の制御回路が高度化し、しかもＣＰＵ
が安価になってきたことがら、複数個のＣＰＵによる分
散制御方式がとられるようになってきている。例えば送
り出し専用ＣＰＵ、緯入れ専用ＣＰＵなとである。また
、織機の回転数も益々高くなる傾向にあり、制御の高速
化が要求されている。
が安価になってきたことがら、複数個のＣＰＵによる分
散制御方式がとられるようになってきている。例えば送
り出し専用ＣＰＵ、緯入れ専用ＣＰＵなとである。また
、織機の回転数も益々高くなる傾向にあり、制御の高速
化が要求されている。
この様に、多量のデータを複数の織機ＣＰＵに送って、
迅速な制御を行おうとすると、織機ＣＰＵとホストＣＰ
Ｕとを直接パスラインを介して接続するのは好ましくな
い。その理由は、中央制御装置と複数の織機側ＣＰＵと
の間で、直接パスラインを介してデータ伝送を行おうと
すると、機台番号の他に、織機のどのＣＰＵとのデータ
伝送であるかを示すＣＰＵ識別コードをも伝送する必要
があり、また全台の織機制御ＣＰＵでは、機台コードを
受信し自己か否かの判断を行う必要もあり、伝送データ
の確認処理も考慮すると、１台の織機がパスラインを専
有している時間が必然的に長くなるからである。したが
って、織機台数が多くなると、全織機を一巡するのに時
間を要し、素早い制御が不可能となるという問題がある
からである。
迅速な制御を行おうとすると、織機ＣＰＵとホストＣＰ
Ｕとを直接パスラインを介して接続するのは好ましくな
い。その理由は、中央制御装置と複数の織機側ＣＰＵと
の間で、直接パスラインを介してデータ伝送を行おうと
すると、機台番号の他に、織機のどのＣＰＵとのデータ
伝送であるかを示すＣＰＵ識別コードをも伝送する必要
があり、また全台の織機制御ＣＰＵでは、機台コードを
受信し自己か否かの判断を行う必要もあり、伝送データ
の確認処理も考慮すると、１台の織機がパスラインを専
有している時間が必然的に長くなるからである。したが
って、織機台数が多くなると、全織機を一巡するのに時
間を要し、素早い制御が不可能となるという問題がある
からである。
例えば、前記公報の従来技術における運転禁止制御にお
いて、運転禁止指令を出した後に、織機側の運転可能条
件が整っても、次にホストＣＰＵが織機に対する処理を
開始するまでは、織機を運転することはできない。した
がって、織機台数が多（なると、実際に起動がかかるま
での時間遅れが大きくなり、これが集中制御の進行上無
視できない。
いて、運転禁止指令を出した後に、織機側の運転可能条
件が整っても、次にホストＣＰＵが織機に対する処理を
開始するまでは、織機を運転することはできない。した
がって、織機台数が多（なると、実際に起動がかかるま
での時間遅れが大きくなり、これが集中制御の進行上無
視できない。
発明の目的
本発明は、このような従来技術における問題点に鑑みて
なされたもので、その目的は、多量のデータに基づき、
多数の織機を高速で集中制御することのできる集中制御
方法を提供しようとするものである。
なされたもので、その目的は、多量のデータに基づき、
多数の織機を高速で集中制御することのできる集中制御
方法を提供しようとするものである。
発明の概要
そこで、本発明の方法は、ホストＣＰＵと織機内の複数
のＣＰＵとを結ぶ通信回線上に、各織機に１台の通信制
御用ＣＰＵを介在させ、この通信制御用ｃｐｕがホスト
ＣＰＵまたは織機制御用ＣＰＵからのデータを一旦自己
のメモリに格納し、その後複数の織機制御ＣＰＵまたは
ホストＣＰＵとの間で、データの送受を行うことを特徴
としている。
のＣＰＵとを結ぶ通信回線上に、各織機に１台の通信制
御用ＣＰＵを介在させ、この通信制御用ｃｐｕがホスト
ＣＰＵまたは織機制御用ＣＰＵからのデータを一旦自己
のメモリに格納し、その後複数の織機制御ＣＰＵまたは
ホストＣＰＵとの間で、データの送受を行うことを特徴
としている。
また、本発明の他の方法は、ホストＣＰＵと、織機内の
複数のＣＰＵとを結ぶ通信回線上に、各織機に１台の通
信制御ＣＰＵを介在させるとともに、ホストＣＰＵと通
信制’＋Ｂ ＣＰ Ｕとの間に、さらに中継ＣＰＵを介
在させ、この中継ＣＰＵがホストＣＰＵまたは指定され
た織機の通信制御ｃＰＵからのデータを一旦自己のメモ
リに格納し、その後その中継ＣＰＵが担当している複数
の通信制御ＣＰＵとの間またはホストＣＰＵとの間で、
データの送受を行うことを特徴としている。
複数のＣＰＵとを結ぶ通信回線上に、各織機に１台の通
信制御ＣＰＵを介在させるとともに、ホストＣＰＵと通
信制’＋Ｂ ＣＰ Ｕとの間に、さらに中継ＣＰＵを介
在させ、この中継ＣＰＵがホストＣＰＵまたは指定され
た織機の通信制御ｃＰＵからのデータを一旦自己のメモ
リに格納し、その後その中継ＣＰＵが担当している複数
の通信制御ＣＰＵとの間またはホストＣＰＵとの間で、
データの送受を行うことを特徴としている。
これらの方法をとることによって、多数の織機が高速で
集中制御できるようになる。
集中制御できるようになる。
実施例１
以下、本発明を図面に基づいて詳細に説明する。
第１図は、本発明の方法を実現するための装置の構成を
示している。図において、ホス１−ＣＰＵ１は複数の織
機の集中制御を行う装置の中核をなす。そして、制御対
象の織機１３は、各被制御部をそれぞれ制御している複
数の織機制御用ｃｐｕ２を内蔵し、本発明において特徴
としている通信制御ＣＰＵ３に接続されている。この通
信制＠ＣＰＵ３は、メモリ４に接続され、かつホストＣ
ＰＵ１と、複数の織機制御用ＣＰＵ２とを結ぶ通信回線
（双方向データバス）５上にそれぞれ介在させである。
示している。図において、ホス１−ＣＰＵ１は複数の織
機の集中制御を行う装置の中核をなす。そして、制御対
象の織機１３は、各被制御部をそれぞれ制御している複
数の織機制御用ｃｐｕ２を内蔵し、本発明において特徴
としている通信制御ＣＰＵ３に接続されている。この通
信制＠ＣＰＵ３は、メモリ４に接続され、かつホストＣ
ＰＵ１と、複数の織機制御用ＣＰＵ２とを結ぶ通信回線
（双方向データバス）５上にそれぞれ介在させである。
このように構成された装置において、本発明の制御方法
では、通信回線５上に介在させた通信制＠ｃｐｕ３が、
ホストＣＰＵＩから送られてくる多量のデータを全て、
一旦自己のメモリ４に格納する。次に、ホストＣＰＵＩ
は、直ちに、その通信制御ＣＰＵ３へ伝送終結を伝えた
後、次の通信制御ＣＰＵ３を選択し、データの伝送を開
始する。
では、通信回線５上に介在させた通信制＠ｃｐｕ３が、
ホストＣＰＵＩから送られてくる多量のデータを全て、
一旦自己のメモリ４に格納する。次に、ホストＣＰＵＩ
は、直ちに、その通信制御ＣＰＵ３へ伝送終結を伝えた
後、次の通信制御ＣＰＵ３を選択し、データの伝送を開
始する。
また、通信制御ＣＰＵ３は、ホストＣＰＵ１が他の通信
制御ＣＰ Ｕ ３とデータ送受を行っている間に、対応
の複数の織機制御用ＣＰＵ２ヘメモリ４内のデータを順
次伝送する。
制御ＣＰ Ｕ ３とデータ送受を行っている間に、対応
の複数の織機制御用ＣＰＵ２ヘメモリ４内のデータを順
次伝送する。
逆に、ホストＣＰＵＩが他の織機１３とデータ送受を行
っている間に、通信制御ＣＰＵ３は、織機制御用ＣＰＵ
２からのデータを自己のメモリ４に格納しておき、その
通信制’４９ＣＰＵ３がセレクティングされた時点で、
ホストＣＰＵ１へそれらのデータを送り出す。
っている間に、通信制御ＣＰＵ３は、織機制御用ＣＰＵ
２からのデータを自己のメモリ４に格納しておき、その
通信制’４９ＣＰＵ３がセレクティングされた時点で、
ホストＣＰＵ１へそれらのデータを送り出す。
第２図は、通信制御ＣＰＵ３と織機制御用ＣＰＵ２とか
らなる織機側ＣＰＵにおいて、フィードバック制御を行
う場合の要部の構成を示す。この場合、ホストＣＰＵＩ
は、通信制御ＣＰＵ３に目標値だけを与える。そこで、
実際のフィードバック制御は、個々の織機の織機制御用
ＣＰＵ２によって行われる。この織機制御用ＣＰＵ２は
、互いに接続された入力ポートロ、演算制御部７、ＲＡ
Ｍ８、ＲＯＭ９および出カポ−）１０で構成されている
。通信制？ｌｌＣＰＵ３は、ホストＣＰＵＩから伝送さ
れた目標値を織機制御用ＣＰＵ２へ伝送し、織機制御用
ＣＰＵ２は、ＲＡＭ８に格納する。
らなる織機側ＣＰＵにおいて、フィードバック制御を行
う場合の要部の構成を示す。この場合、ホストＣＰＵＩ
は、通信制御ＣＰＵ３に目標値だけを与える。そこで、
実際のフィードバック制御は、個々の織機の織機制御用
ＣＰＵ２によって行われる。この織機制御用ＣＰＵ２は
、互いに接続された入力ポートロ、演算制御部７、ＲＡ
Ｍ８、ＲＯＭ９および出カポ−）１０で構成されている
。通信制？ｌｌＣＰＵ３は、ホストＣＰＵＩから伝送さ
れた目標値を織機制御用ＣＰＵ２へ伝送し、織機制御用
ＣＰＵ２は、ＲＡＭ８に格納する。
この目標値は、読み出し後に、偏差検出回路１１に与え
られ、ここでフィードバック要素１６からのフィードバ
ック信号との偏差が検出され、制御要素１２で例えばＰ
ＩＤ演算が施され、織機１３の制御対象１４に出力され
る。織機１３からの制御結果は、検出器１５で検出され
、フィードバック要素１６を介して偏差検出回路１１に
加わる。
られ、ここでフィードバック要素１６からのフィードバ
ック信号との偏差が検出され、制御要素１２で例えばＰ
ＩＤ演算が施され、織機１３の制御対象１４に出力され
る。織機１３からの制御結果は、検出器１５で検出され
、フィードバック要素１６を介して偏差検出回路１１に
加わる。
なお、ここでは偏差検出回路１１、制御要素１２および
フィードバック要素１６をＣＰＵとは別個の機能ブロッ
クとして示したが、これらの各ブロックの機能は、ＣＰ
Ｕによって行うようにしてもよい。
フィードバック要素１６をＣＰＵとは別個の機能ブロッ
クとして示したが、これらの各ブロックの機能は、ＣＰ
Ｕによって行うようにしてもよい。
また、オープンループ制御を行う場合は、第２図におい
て、フィードバック要素１６を含む信号系統は省略され
る。この場合、ホストＣＰＵＩは、通信制御ＣＰＵ３に
対して織機１３の制御条件だけを与え、通信制４１ Ｃ
Ｐ Ｕ ３は、この制御条件を織機制御用ＣＰＵ２に伝
送する。織機制御用ＣＰＵ２は、この条件を判断して織
機１３に制御指令を出すことになる。このとき、織機制
御用ＣＰＵ２を介さずに、通信制御ＣＰＵ３が、直接、
織機１３の制御対象１４に制御指令を出すようにしても
よい。
て、フィードバック要素１６を含む信号系統は省略され
る。この場合、ホストＣＰＵＩは、通信制御ＣＰＵ３に
対して織機１３の制御条件だけを与え、通信制４１ Ｃ
Ｐ Ｕ ３は、この制御条件を織機制御用ＣＰＵ２に伝
送する。織機制御用ＣＰＵ２は、この条件を判断して織
機１３に制御指令を出すことになる。このとき、織機制
御用ＣＰＵ２を介さずに、通信制御ＣＰＵ３が、直接、
織機１３の制御対象１４に制御指令を出すようにしても
よい。
例えば、通信制御ＣＰＵ３または、織機制御用ＣＰＵ２
に時計機能を持たせれば、ホストＣＰＵ１は、その時計
の時刻修正および操業停止時刻のみを通信制＠ＣＰ Ｕ
３へ伝送することにより、通信制御ＣＰＵ３または織
機制御用ＣＰＵ２は、実際の時刻と操業停止時刻との比
較や、織機１３への停止指令信号の送出を行う。また、
運転禁止制御の場合であれば、予めホストＣＰＵ１が運
転禁止条件を各通信制御ＣＰＵ３へ伝送しておき、通信
制御ＣＰＵ３または織機制御用ＣＰＵ２は、実際の織機
１３の状態を常時監視し、それが運転禁止条件と一致し
ているかどうかを判断して、運転禁止指令のオン、オフ
を行う。
に時計機能を持たせれば、ホストＣＰＵ１は、その時計
の時刻修正および操業停止時刻のみを通信制＠ＣＰ Ｕ
３へ伝送することにより、通信制御ＣＰＵ３または織
機制御用ＣＰＵ２は、実際の時刻と操業停止時刻との比
較や、織機１３への停止指令信号の送出を行う。また、
運転禁止制御の場合であれば、予めホストＣＰＵ１が運
転禁止条件を各通信制御ＣＰＵ３へ伝送しておき、通信
制御ＣＰＵ３または織機制御用ＣＰＵ２は、実際の織機
１３の状態を常時監視し、それが運転禁止条件と一致し
ているかどうかを判断して、運転禁止指令のオン、オフ
を行う。
このように、フィードバック制御やオープンループ制御
が、通信制御ＣＰＵ３または織機制御用ＣＰＵ２で行う
ことによって、ホストＣＰＵＩは、それだけ負担が軽く
なり、複数の織機１３の全体の集中制御を高速に行うこ
とが可能となる。
が、通信制御ＣＰＵ３または織機制御用ＣＰＵ２で行う
ことによって、ホストＣＰＵＩは、それだけ負担が軽く
なり、複数の織機１３の全体の集中制御を高速に行うこ
とが可能となる。
実施例２
次に、第３図は、織機１３の数が更に増大した場合に有
効な本発明方法の他の例を実現する装置の構成を示す。
効な本発明方法の他の例を実現する装置の構成を示す。
この装置は、ホストＣＰＵＩと複数の通信制御ＣＰＵ３
とを結ぶ通信回線５上に、更に何台かの中継用ＣＰＵ１
７を介在させている。そして、メモリ１８は各中継用Ｃ
ＰＵ１７毎に接続されている。
とを結ぶ通信回線５上に、更に何台かの中継用ＣＰＵ１
７を介在させている。そして、メモリ１８は各中継用Ｃ
ＰＵ１７毎に接続されている。
このような構成の装置において、ホストＣＰＵ１は、あ
る織機１３に対するデータを、まず中継用ＣＰＵ１７に
伝送する。そこで、その中継用ＣＰＵ１７は、織機ぬ例
えばｒｉｌｌ ｒ１２Ｊ ・・「Ｉｎ」を含む各デー
タを一旦自己のメモリ１８に格納する。その後、各中継
用ＣＰＵＩ ７は、織機随に対応する織機１３の通信制
御ＣＰＵ３に、データ伝送を実行する。この間に、ホス
トＣＰＵ１はその中継用ＣＰＵ１７とは別の中継用ＣＰ
Ｕ１７に接続されている織機１３に対するデータ伝送を
開始する。
る織機１３に対するデータを、まず中継用ＣＰＵ１７に
伝送する。そこで、その中継用ＣＰＵ１７は、織機ぬ例
えばｒｉｌｌ ｒ１２Ｊ ・・「Ｉｎ」を含む各デー
タを一旦自己のメモリ１８に格納する。その後、各中継
用ＣＰＵＩ ７は、織機随に対応する織機１３の通信制
御ＣＰＵ３に、データ伝送を実行する。この間に、ホス
トＣＰＵ１はその中継用ＣＰＵ１７とは別の中継用ＣＰ
Ｕ１７に接続されている織機１３に対するデータ伝送を
開始する。
中継用ＣＰＵ１７を介在させたこのような制御方法によ
れば、ホストＣＰＵＩは織機台数に比べてはるかに少な
い数の中継用ＣＰＵ１７に対して順次スキャンすればよ
いので、個々の織機１３を順次スキャンする場合に比べ
て一巡する速度を格段に早くすることができる。また、
中継用ＣＰＵ１７は、ホストＣＰＵ１が他の中継用ＣＰ
ＵＩ ７とデータを送受信している間に、織機１３から
の指示要求信号を受信しておけるので、自局がセレクテ
ィングされると、直ちにその指示要求データをホストＣ
ＰＵＩへ送り出すことができる。したがって、織機１３
側から見たホストＣＰＵ１の対応の遅れを非常に小さく
することができる。
れば、ホストＣＰＵＩは織機台数に比べてはるかに少な
い数の中継用ＣＰＵ１７に対して順次スキャンすればよ
いので、個々の織機１３を順次スキャンする場合に比べ
て一巡する速度を格段に早くすることができる。また、
中継用ＣＰＵ１７は、ホストＣＰＵ１が他の中継用ＣＰ
ＵＩ ７とデータを送受信している間に、織機１３から
の指示要求信号を受信しておけるので、自局がセレクテ
ィングされると、直ちにその指示要求データをホストＣ
ＰＵＩへ送り出すことができる。したがって、織機１３
側から見たホストＣＰＵ１の対応の遅れを非常に小さく
することができる。
また、実際の織布工場では、稼動中の全織機において、
例えば試織中の織機だけを稼動させ、残りの織機はすべ
て停止させたいという場合があるが、本発明の方法は、
このような場合にも、迅速に対応できる。すなわち、稼
動を続けたい機台コードと、残りの一斉停止させたい機
台コードとを、ホストＣＰＵＩから、各中継用ＣＰＵ１
７に送り、各中継用ＣＰＵ１７が各々の織機へ稼動停止
を示す信号を送ることで迅速な対応が行える。
例えば試織中の織機だけを稼動させ、残りの織機はすべ
て停止させたいという場合があるが、本発明の方法は、
このような場合にも、迅速に対応できる。すなわち、稼
動を続けたい機台コードと、残りの一斉停止させたい機
台コードとを、ホストＣＰＵＩから、各中継用ＣＰＵ１
７に送り、各中継用ＣＰＵ１７が各々の織機へ稼動停止
を示す信号を送ることで迅速な対応が行える。
さて、第４図は、本発明方法における、データ伝送の様
子を示すタイムチャートである。ここでは、中継用ＣＰ
Ｕ１７をｍ台、通信制御ＣＰＵ３がｎ台、織機１３の全
台数がＮ台（Ｎ”ｍｘｎ）である場合を想定している。
子を示すタイムチャートである。ここでは、中継用ＣＰ
Ｕ１７をｍ台、通信制御ＣＰＵ３がｎ台、織機１３の全
台数がＮ台（Ｎ”ｍｘｎ）である場合を想定している。
ホストＣＰＵ１から中継用ＣＰＵ１７に対してデータ伝
送を行うのに要する時間をｔ９、中継用ＣＰＵ１７と１
台の織機１３とのデータ伝送時間を１ｔで示しである。
送を行うのに要する時間をｔ９、中継用ＣＰＵ１７と１
台の織機１３とのデータ伝送時間を１ｔで示しである。
ｔｌはｎ台分の伝送データを含むので、ｔ２に比べて長
くなっている。このタイムチャートから明らかなように
、Ｎ台すべての織機１３にデータ伝送を行うに要する時
間Ｔ１は、Ｔ、＝ｍ−ｔ、＋ｎ−ｔ、となる。ここで、
ｍ＝２０、ｎ＝２０、Ｎ−４００，ｔ＋−４秒、ｔ２聴
２秒とすれば、Ｔ、＝１２０秒となる。
くなっている。このタイムチャートから明らかなように
、Ｎ台すべての織機１３にデータ伝送を行うに要する時
間Ｔ１は、Ｔ、＝ｍ−ｔ、＋ｎ−ｔ、となる。ここで、
ｍ＝２０、ｎ＝２０、Ｎ−４００，ｔ＋−４秒、ｔ２聴
２秒とすれば、Ｔ、＝１２０秒となる。
第５図は、従来技術の場合のデータ伝送の様子を示すタ
イムチャートである。この場合においては、Ｎ台すべて
の織機にデータ伝送を行うに要する時間Ｔ２は、ホスト
ＣＰＵが１台の織機にデータ伝送を行う時間をｔとする
と、ＴＺ＝Ｎ−ｔとなる。ここで、Ｎ＝４００、ｔ＝２
秒とすれば、Ｔｚ＝８００秒となる。
イムチャートである。この場合においては、Ｎ台すべて
の織機にデータ伝送を行うに要する時間Ｔ２は、ホスト
ＣＰＵが１台の織機にデータ伝送を行う時間をｔとする
と、ＴＺ＝Ｎ−ｔとなる。ここで、Ｎ＝４００、ｔ＝２
秒とすれば、Ｔｚ＝８００秒となる。
第６図は、本発明の方法を実現する装置の他の構成例を
示す図である。この例ではホストＣＰＵ１と、通信制御
ＣＰＵ３とを結ぶ通信回線として光ケーブル１９にそれ
ぞれ光変換器２０を介して多量のデータを光信号で伝送
するようにしている。
示す図である。この例ではホストＣＰＵ１と、通信制御
ＣＰＵ３とを結ぶ通信回線として光ケーブル１９にそれ
ぞれ光変換器２０を介して多量のデータを光信号で伝送
するようにしている。
一般に通信回線に電線ケーブルを使用すると、総ケーブ
ル長が長くなったり、周辺機器の数が多くなった場合、
アース回路に電位差が生じ易く、またノイズの影響を受
は易くなって、高速でデータ伝送を行うことが困難とな
る。
ル長が長くなったり、周辺機器の数が多くなった場合、
アース回路に電位差が生じ易く、またノイズの影響を受
は易くなって、高速でデータ伝送を行うことが困難とな
る。
しかし、この第６図の実施例によれば、アース回路が絶
縁できるとともに、ノイズ耐量を上げることができ、高
速で多量のデータを高い信頼性の下に伝送することが可
能となる。
縁できるとともに、ノイズ耐量を上げることができ、高
速で多量のデータを高い信頼性の下に伝送することが可
能となる。
なお、第６図実施例は、第１図の装置において通信回線
３を光ケーブルとしたものであるが、第３図の装置にお
けるホストＣＰＵＩ、中継ＣＰＵ１７および通信制御Ｃ
ＰＵ３のそれぞれの間を光ケーブルによって接続するよ
うにしてもよい。
３を光ケーブルとしたものであるが、第３図の装置にお
けるホストＣＰＵＩ、中継ＣＰＵ１７および通信制御Ｃ
ＰＵ３のそれぞれの間を光ケーブルによって接続するよ
うにしてもよい。
次に、第７図は、第３図に示す装置におけるホストＣＰ
ＵＩの機能ブロック図である。このホストＣＰＵＩにお
いて、中継器隘歩進手段２２は、時間パルス発生手段２
１からの時間パルスを人力するとともに、最大中継器磁
信号発生手段２３および処理完了判別手段２４からの信
号を入力し、中継ＣＰＵＩ ７を順次選択するための信
号をつくる。中継器選択信号送信手段２５は、出力チャ
ンネル２７を介して中継ＣＰＵＩ ７を選択する信号を
送信する。また、制御データ送信手段２６は、制御デー
タ続出手段２８で読出された制御データを出力チャンネ
ル２７を介して、中継ＣＰＵ１７側へ送信する。織機隘
受信手段２９および要求信号受信手段３０は、それぞれ
入力チャンネル３１を介して、中１ｃＰＵ１７側から伝
送してくる織機患および要求信号を受信す・る。そして
、要求信号解析手段３２は、要求信号受信手段３０で受
信した要求信号を解析し、この解析結果に応じて、処理
完了判別手段２４または制御データ読出指令手段３３に
信号を出力する。オペレータコンソール３４は、制御デ
ータ入力手段３５、メモリ制御手段３６を介して制御デ
ータ記憶手段３７に、織機制御のための各種のデータを
入力させたり、また必要に応じて訂正あるいは表示させ
たりする。
ＵＩの機能ブロック図である。このホストＣＰＵＩにお
いて、中継器隘歩進手段２２は、時間パルス発生手段２
１からの時間パルスを人力するとともに、最大中継器磁
信号発生手段２３および処理完了判別手段２４からの信
号を入力し、中継ＣＰＵＩ ７を順次選択するための信
号をつくる。中継器選択信号送信手段２５は、出力チャ
ンネル２７を介して中継ＣＰＵＩ ７を選択する信号を
送信する。また、制御データ送信手段２６は、制御デー
タ続出手段２８で読出された制御データを出力チャンネ
ル２７を介して、中継ＣＰＵ１７側へ送信する。織機隘
受信手段２９および要求信号受信手段３０は、それぞれ
入力チャンネル３１を介して、中１ｃＰＵ１７側から伝
送してくる織機患および要求信号を受信す・る。そして
、要求信号解析手段３２は、要求信号受信手段３０で受
信した要求信号を解析し、この解析結果に応じて、処理
完了判別手段２４または制御データ読出指令手段３３に
信号を出力する。オペレータコンソール３４は、制御デ
ータ入力手段３５、メモリ制御手段３６を介して制御デ
ータ記憶手段３７に、織機制御のための各種のデータを
入力させたり、また必要に応じて訂正あるいは表示させ
たりする。
また、メモリ制御手段３６は、制御データ読出指令手段
３３からの信号によって、必要な制御データを制御デー
タ記憶手段３７から読出し、制御データ続出手段２８に
出力する。
３３からの信号によって、必要な制御データを制御デー
タ記憶手段３７から読出し、制御データ続出手段２８に
出力する。
そして、第８図は第３図に示す装置における中継用ＣＰ
Ｕ１７の機能ブロック図である。この中継ＣＰＵ１７に
おいて、制御データ受信手段３８および中継器魚受信手
段３９は、入力チャンネル４０を介してホストＣＰＵＩ
側から伝送された制御データおよび中継器ぬを受信する
。制御データ一時記憶手段４１は、第３図におけるメモ
リ１８に相当し、自機選択判別手段４２によって当該中
継用ＣＰＵ１７が選択さ、れた時、制御データをここに
一時記憶するものである。また、要求信号送信手段４３
は、同じく当該中継用ＣＰＵ１７が選択された時、要求
信号を出力チャンネル４４を介して、ホストＣＰＵＩ側
に送信する。
Ｕ１７の機能ブロック図である。この中継ＣＰＵ１７に
おいて、制御データ受信手段３８および中継器魚受信手
段３９は、入力チャンネル４０を介してホストＣＰＵＩ
側から伝送された制御データおよび中継器ぬを受信する
。制御データ一時記憶手段４１は、第３図におけるメモ
リ１８に相当し、自機選択判別手段４２によって当該中
継用ＣＰＵ１７が選択さ、れた時、制御データをここに
一時記憶するものである。また、要求信号送信手段４３
は、同じく当該中継用ＣＰＵ１７が選択された時、要求
信号を出力チャンネル４４を介して、ホストＣＰＵＩ側
に送信する。
織機隘歩進手段４５は、時間パルス発生手段４６、最大
、最小織機魚発生手段４７、要求要否判定手段４８およ
び要求信号送信手段４３からの信号をそれぞれ入力し、
ｍ機選択信号をつくっている。織機選択信号送信手段４
９は、この選択信号を入出力チャンネル５０を介して送
信する。また、制御データ送信手段５１も、制御データ
一時記憶手段４１に記憶されている制御データを、順次
、入出力チャンネル５０と、通信制御ＣＰＵ３とを介し
てｍ機工３側に送信する。織機データ受信手段５２は、
通信制御ＣＰＵ３と入出力チャンネル５０とを介して織
機１３側から伝送されてくる織機データを受信する。要
求信号一時記憶手段５３は、第３図におけるメモリ１８
に相当しており、織機データ受信手段５２で受信された
要求信号を一時記憶し、要求要否判定手段４８からの信
号によって読み出される。
、最小織機魚発生手段４７、要求要否判定手段４８およ
び要求信号送信手段４３からの信号をそれぞれ入力し、
ｍ機選択信号をつくっている。織機選択信号送信手段４
９は、この選択信号を入出力チャンネル５０を介して送
信する。また、制御データ送信手段５１も、制御データ
一時記憶手段４１に記憶されている制御データを、順次
、入出力チャンネル５０と、通信制御ＣＰＵ３とを介し
てｍ機工３側に送信する。織機データ受信手段５２は、
通信制御ＣＰＵ３と入出力チャンネル５０とを介して織
機１３側から伝送されてくる織機データを受信する。要
求信号一時記憶手段５３は、第３図におけるメモリ１８
に相当しており、織機データ受信手段５２で受信された
要求信号を一時記憶し、要求要否判定手段４８からの信
号によって読み出される。
第９図は、第３図における通信制＠ＣＰＵ３の機能ブロ
ック図である。この通信制ｍｃＰＵ３において、制御デ
ータ受信手段５４および織機隘受信手段５５は、入力チ
ャンネル５６を介して中継ＣＰＵ１７側から伝送された
制御データおよび織機隘を受信する。制御データ一時記
憶手段５７は、第３図におけるメモリ４に相当するもの
であって、自機選択判別手段５８によって、その通信制
御ＣＰＵ３が選択された時、受信した制御データをここ
に一時記憶する。この制御データ一時記憶手段５７に記
憶された制御データは、制御データ設定手段５９および
入出力インターフェース６０を介してｔ＠機制御用ＣＰ
Ｕ２へ順次送られる。フィードバック情報読込手段６１
は、時間パルス発生手段６２からの時間パルスを人力し
、入出力インターフェース６０を介して織機制御用ＣＰ
Ｕ２側から送られるフィードバンク情報を読み込み、織
機データ作成手段６３に送出する。織機データ送信手段
６４は、自機選択判別手段５８からの信号によって自機
が選択された時、織機データを出力チャンネル６５を介
して中継ＣＰＵ１７側に送信する。
ック図である。この通信制ｍｃＰＵ３において、制御デ
ータ受信手段５４および織機隘受信手段５５は、入力チ
ャンネル５６を介して中継ＣＰＵ１７側から伝送された
制御データおよび織機隘を受信する。制御データ一時記
憶手段５７は、第３図におけるメモリ４に相当するもの
であって、自機選択判別手段５８によって、その通信制
御ＣＰＵ３が選択された時、受信した制御データをここ
に一時記憶する。この制御データ一時記憶手段５７に記
憶された制御データは、制御データ設定手段５９および
入出力インターフェース６０を介してｔ＠機制御用ＣＰ
Ｕ２へ順次送られる。フィードバック情報読込手段６１
は、時間パルス発生手段６２からの時間パルスを人力し
、入出力インターフェース６０を介して織機制御用ＣＰ
Ｕ２側から送られるフィードバンク情報を読み込み、織
機データ作成手段６３に送出する。織機データ送信手段
６４は、自機選択判別手段５８からの信号によって自機
が選択された時、織機データを出力チャンネル６５を介
して中継ＣＰＵ１７側に送信する。
発明の詳細
な説明したように、本発明に係る方法によれば、ホスト
ＣＰＵＩから見た各織機とのデータ送受信のスピードが
見掛上向上するので、多数の織機群の集中制御を高速に
行うことができる。
ＣＰＵＩから見た各織機とのデータ送受信のスピードが
見掛上向上するので、多数の織機群の集中制御を高速に
行うことができる。
第１図は本発明の方法を実現するための装置の構成ブロ
ック図、第２図は通信制御ｃｐｕまたは織機制御用ＣＰ
Ｕにおいてフィードバック制御を行う場合の要部のブロ
ック図、第３図は本発明の他の方法を実現する装置の構
成ブロック図、第４図は本発明の方法によるデータ伝達
の様子を示すタイムチャート、第５図は従来の手法によ
るデータ伝送の様子を示すタイムチャート、第６図は本
発明の方法を実現する装置の他の構成ブロック図、ブロ
ック図、第８図は中継ＣＰＵの機能プロ７り図、第９図
は通信制御ＣＰＵの機能ブロック図である。 １・・ホストＣＰＵ、２・・織機制御用ＣＰＵ、３・・
通信制御ＣＰＵ、４・・メモリ、５・・通信回線、１７
・・中継ＣＰＵ、１８・・メモリ。 第７図
ック図、第２図は通信制御ｃｐｕまたは織機制御用ＣＰ
Ｕにおいてフィードバック制御を行う場合の要部のブロ
ック図、第３図は本発明の他の方法を実現する装置の構
成ブロック図、第４図は本発明の方法によるデータ伝達
の様子を示すタイムチャート、第５図は従来の手法によ
るデータ伝送の様子を示すタイムチャート、第６図は本
発明の方法を実現する装置の他の構成ブロック図、ブロ
ック図、第８図は中継ＣＰＵの機能プロ７り図、第９図
は通信制御ＣＰＵの機能ブロック図である。 １・・ホストＣＰＵ、２・・織機制御用ＣＰＵ、３・・
通信制御ＣＰＵ、４・・メモリ、５・・通信回線、１７
・・中継ＣＰＵ、１８・・メモリ。 第７図
Claims (3)
- （１）複数のＣＰＵと、これらのＣＰＵによって制御さ
れる織機が複数台存在し、これらの各織機がホストＣＰ
Ｕに通信回線を介して接続されている織機の集中制御装
置において、前記通信回線上に前記各織機に対応させて
それぞれ通信制御ＣＰＵを介在させ、この通信制御ＣＰ
Ｕは、前記ホストＣＰＵまたは前記織機を制御している
織機制御用ＣＰＵからのデータを一旦自己のメモリに格
納し、その後、複数の織機制御用ＣＰＵまたはホストＣ
ＰＵとの間でデータの送受を行うことを特徴とする織機
の集中制御方法。 - （２）ホストＣＰＵから伝送するデータは、織機を制御
するための目標値であり、通信制御ＣＰＵは、伝送され
た前記目標値を該当する織機制御用ＣＰＵに伝送し織機
を制御することを特徴とする特許請求の範囲第１項記載
の織機の集中制御方法。 - （３）複数のＣＰＵと、これらのＣＰＵによって制御さ
れる織機が複数存在し、これらの各織機がホストＣＰＵ
に通信回線を介して接続されている織機の集中制御装置
において、前記通信回線上に前記各織機に対応させてそ
れぞれ通信制御ＣＰＵを介在させるとともに、前記ホス
トＣＰＵと前記通信制御ＣＰＵとの間に中継ＣＰＵを介
在させ、この中継ＣＰＵは、前記ホストＣＰＵまたは指
定された織機の通信制御ＣＰＵからのデータを一旦自己
のメモリに格納し、その後当該中継ＣＰＵが担当する複
数の通信制御ＣＰＵとの間またはホストＣＰＵとの間で
データの送受を行うことを特徴とする織機の集中制御方
法。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60071158A JPS61231245A (ja) | 1985-04-05 | 1985-04-05 | 織機の集中制御方法 |
| KR1019860002232A KR890000562B1 (ko) | 1985-04-05 | 1986-03-25 | 직기의 집중제어방법 |
| EP86104649A EP0196677A3 (en) | 1985-04-05 | 1986-04-04 | Centralized loom control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60071158A JPS61231245A (ja) | 1985-04-05 | 1985-04-05 | 織機の集中制御方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61231245A true JPS61231245A (ja) | 1986-10-15 |
Family
ID=13452536
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60071158A Pending JPS61231245A (ja) | 1985-04-05 | 1985-04-05 | 織機の集中制御方法 |
Country Status (3)
| Country | Link |
|---|---|
| EP (1) | EP0196677A3 (ja) |
| JP (1) | JPS61231245A (ja) |
| KR (1) | KR890000562B1 (ja) |
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| EP0196677A2 (en) | 1986-10-08 |
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