JPS61173554A - パケット通信装置 - Google Patents
パケット通信装置Info
- Publication number
- JPS61173554A JPS61173554A JP60013565A JP1356585A JPS61173554A JP S61173554 A JPS61173554 A JP S61173554A JP 60013565 A JP60013565 A JP 60013565A JP 1356585 A JP1356585 A JP 1356585A JP S61173554 A JPS61173554 A JP S61173554A
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- JP
- Japan
- Prior art keywords
- level
- packet communication
- processing
- packet
- central processing
- Prior art date
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- Granted
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- Data Exchanges In Wide-Area Networks (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は１国際電信型話諮問委員会、いわゆるＣＣＩＴ
Ｔ勧告Ｘ２５に準拠した手順に従い回線との間で通信を
行なうパケット通信装置に係り、特にＸ２５のレベル３
の通信も中央処理部によることなく処理可能とされたパ
ケット通信装置に関するものである。
Ｔ勧告Ｘ２５に準拠した手順に従い回線との間で通信を
行なうパケット通信装置に係り、特にＸ２５のレベル３
の通信も中央処理部によることなく処理可能とされたパ
ケット通信装置に関するものである。
これまでＸ２５の通信規約に従い回線との間で通信を行
なうパケット通信装置においては１回線対応部にＸ２５
のレベル２で定義されているフラグシーケンスの認識を
行ない、かつフィルドチェックシーケンスの判定、付加
を行なう通信用ＬＳＩを導入し、Ｘ２５のレベル２での
通信処理およびＸ２５のレベル３での通信処理はプロセ
ッサを有する中央処理部のソフトウェアにより処理され
ていたのが実情である。しかしながら、このように通信
処理を行なう場合はＸ２５のレベル２．およびレベル３
の処理ともにソフトウェアにとっては大きな負荷となり
、パケット通信装置のパケット処理能力に大きな影響を
与えることになる。このようなパケット通信装置のパケ
ット処理能力を高めるべく出現したのが「通信制御用Ｖ
ＬＳ Ｉの検討」（電子通信学会情報ネットワーク研究
会Ｉ Ｎ８２−５３）に示す通信制御用ＶＬＳＩである
。このＶＬＳＩはＸ２５のレベル２での通信処理を行な
い、中央処理部に代ってＸ２５レベル２の処理を代行す
るものとなっている。したがって、このＶＬＳＩにより
パケット通信装置のパケット処理能力は格段に高められ
たものである。
なうパケット通信装置においては１回線対応部にＸ２５
のレベル２で定義されているフラグシーケンスの認識を
行ない、かつフィルドチェックシーケンスの判定、付加
を行なう通信用ＬＳＩを導入し、Ｘ２５のレベル２での
通信処理およびＸ２５のレベル３での通信処理はプロセ
ッサを有する中央処理部のソフトウェアにより処理され
ていたのが実情である。しかしながら、このように通信
処理を行なう場合はＸ２５のレベル２．およびレベル３
の処理ともにソフトウェアにとっては大きな負荷となり
、パケット通信装置のパケット処理能力に大きな影響を
与えることになる。このようなパケット通信装置のパケ
ット処理能力を高めるべく出現したのが「通信制御用Ｖ
ＬＳ Ｉの検討」（電子通信学会情報ネットワーク研究
会Ｉ Ｎ８２−５３）に示す通信制御用ＶＬＳＩである
。このＶＬＳＩはＸ２５のレベル２での通信処理を行な
い、中央処理部に代ってＸ２５レベル２の処理を代行す
るものとなっている。したがって、このＶＬＳＩにより
パケット通信装置のパケット処理能力は格段に高められ
たものである。
しかしながら、Ｘ２５のレベル３の処理は依然として中
央処理部によるソフトウェア処理に依っており、Ｘ２５
のレベル３の処理もＸ２５のレベル２の処理同様シーケ
ンス番号管理やヘッダエリアの分析９編集等類似の処理
も多いことから、パケット処理能力の向上には限度があ
るものとなっている。
央処理部によるソフトウェア処理に依っており、Ｘ２５
のレベル３の処理もＸ２５のレベル２の処理同様シーケ
ンス番号管理やヘッダエリアの分析９編集等類似の処理
も多いことから、パケット処理能力の向上には限度があ
るものとなっている。
一方、ソフトウェアを設計する観点からすれば。
Ｘ、２５のレベル２，３を実現するために必要なプロダ
ラムは数１０にステップに及び非常に複雑な処理を実現
しなければならないが、既述のＶＬＳＩを採用する場合
はソフトウェアはＸ２５レベル３のもの実現するだけで
済まされることになる。しかしながら、Ｘ２５レベル３
の処理はＸ２５レベル２のものと同様に複雑なため、依
然としてソフトウェアによって複雑な処理を実現する必
要がある。
ラムは数１０にステップに及び非常に複雑な処理を実現
しなければならないが、既述のＶＬＳＩを採用する場合
はソフトウェアはＸ２５レベル３のもの実現するだけで
済まされることになる。しかしながら、Ｘ２５レベル３
の処理はＸ２５レベル２のものと同様に複雑なため、依
然としてソフトウェアによって複雑な処理を実現する必
要がある。
本発明の目的は、中央処理部はＸ２５のレベル３の処理
も行なわないで済まされるパケット通信装置を供するに
ある。
も行なわないで済まされるパケット通信装置を供するに
ある。
この目的のため本発明は、中央処理部とＸ２５のレベル
２の処理を行なうフレーム処理回路との間に、Ｘ２５の
レベル３の処理を行なうパケット通信回路を論理チャネ
ル数分並列的に設けるようになしたものである。
２の処理を行なうフレーム処理回路との間に、Ｘ２５の
レベル３の処理を行なうパケット通信回路を論理チャネ
ル数分並列的に設けるようになしたものである。
以下、本発明を第１図、第２図により説明する。
先ず本発明によるパケット通信装置の一例での構成につ
いて説明する。第１図はその構成を示したものである。
いて説明する。第１図はその構成を示したものである。
これによるとパケット通信装置全体の制御を行なう中央
処理部１と、Ｘ２５レベル２の処理を行なうフレーム処
理回路３との間にはバス４，５を介しパケット通信回路
２が論理チャネル数分並列的に設けられたものとなって
いる。パケット通信回路２は中央処理部１がら通信開始
に先立ち、論理チャネル番号やウィンドウサイズ。
処理部１と、Ｘ２５レベル２の処理を行なうフレーム処
理回路３との間にはバス４，５を介しパケット通信回路
２が論理チャネル数分並列的に設けられたものとなって
いる。パケット通信回路２は中央処理部１がら通信開始
に先立ち、論理チャネル番号やウィンドウサイズ。
コール（パーマネントバーチャルコールおよびバーチャ
ルコール）の区別等のＸ２５レベル３の通信規約にて定
義されるパラメータの設定を受け、以降Ｘ２５レベル３
の処理を行なうためのものである。
ルコール）の区別等のＸ２５レベル３の通信規約にて定
義されるパラメータの設定を受け、以降Ｘ２５レベル３
の処理を行なうためのものである。
なお、６は回線を示す。
以上のようにしてなるパケット通信装置の動作を第２図
を用いて説明すれば以下のようである。
を用いて説明すれば以下のようである。
即ち、先ずパケット通信装置のシステム立上げ後、中央
処理部１はパケット通信回路２の何れが１つに初期設定
指令〈イ〉を発行するようになっている。そのパケット
通信回路２では初期設定指令〈イ〉を受信すると、自己
の論理チャネル番号等のパラメータを中央処理部１内部
のメモリより読み出すべく読出制御信号〈口〉を発する
が、これによって読み出されたパラメータはそのパケッ
ト通信回路２に設定されるものである。この場合、中央
処理部１からパケット通信回路２への初期設定は個別に
行なわれ、パケット通信回路２は個別に各種パラメータ
の設定を行なうようになっている。
処理部１はパケット通信回路２の何れが１つに初期設定
指令〈イ〉を発行するようになっている。そのパケット
通信回路２では初期設定指令〈イ〉を受信すると、自己
の論理チャネル番号等のパラメータを中央処理部１内部
のメモリより読み出すべく読出制御信号〈口〉を発する
が、これによって読み出されたパラメータはそのパケッ
ト通信回路２に設定されるものである。この場合、中央
処理部１からパケット通信回路２への初期設定は個別に
行なわれ、パケット通信回路２は個別に各種パラメータ
の設定を行なうようになっている。
次に、パケット通信回路２はフレーム処理回路３へ初期
設定指令くハ〉を発行するようになっている。ここでパ
ケット通信回路２が論理チャネル番号対応に存在するの
に対して、フレーム処理回路３は回線対応に存在する。
設定指令くハ〉を発行するようになっている。ここでパ
ケット通信回路２が論理チャネル番号対応に存在するの
に対して、フレーム処理回路３は回線対応に存在する。
従って、パケット通信回路２からのフレーム処理回路３
への初期設定指令〈ハ〉は、システム的に予め定められ
た何れか１つのパケット通信回路２より送出されるよう
になっている。
への初期設定指令〈ハ〉は、システム的に予め定められ
た何れか１つのパケット通信回路２より送出されるよう
になっている。
さて、フレーム処理回路３はパケット通信回路２からの
初期設定指令くハ〉を受信した場合、中央処理部１内部
のメモリより通信に必要なバラメ−タを読み出したうえ
自己内部に設定すべく予め定められた何れか１つのパケ
ット通信回路２を介し中央処理部１に読出制御信号〈二
〉を発するようになっている。
初期設定指令くハ〉を受信した場合、中央処理部１内部
のメモリより通信に必要なバラメ−タを読み出したうえ
自己内部に設定すべく予め定められた何れか１つのパケ
ット通信回路２を介し中央処理部１に読出制御信号〈二
〉を発するようになっている。
以上で、パケット通信回路２およびフレーム処理回路３
への初期設定は終了するが、以降は任意の時点で中央処
理部１は通信開始指令くホ〉を送出することによってパ
ケット通信回路２およびフレーム処理回路３を通信可能
状態におくようになっている。これによって通信が可能
となるわけである。
への初期設定は終了するが、以降は任意の時点で中央処
理部１は通信開始指令くホ〉を送出することによってパ
ケット通信回路２およびフレーム処理回路３を通信可能
状態におくようになっている。これによって通信が可能
となるわけである。
ここで中央処理部１が回線６ヘデータを送出する場合に
ついて説明すれば、データ送出に際しては中央処理部１
はパケット通信回路２ヘデータ送信指令〈へ〉を発行す
るようになっている。パケット通信回路２各々はデータ
送信指令くべ〉中の論理チャネル番号と自己の論理チャ
ネル番号を比較し一致に係るパケット通信回路２はその
データ送信指令くべ〉を取り込んだうえフレーム処理回
路３ヘデータ送信指令くへ〉を伝えるとともに、送信す
べきデータを中央処理部１から受は取り、Ｘ２５レベル
３のヘッダを付加してフレーム処理回路３へ渡すものと
なっている。フレーム処理回路３ではそのデータに更に
Ｘ２５レベル２のヘッダ。
ついて説明すれば、データ送出に際しては中央処理部１
はパケット通信回路２ヘデータ送信指令〈へ〉を発行す
るようになっている。パケット通信回路２各々はデータ
送信指令くべ〉中の論理チャネル番号と自己の論理チャ
ネル番号を比較し一致に係るパケット通信回路２はその
データ送信指令くべ〉を取り込んだうえフレーム処理回
路３ヘデータ送信指令くへ〉を伝えるとともに、送信す
べきデータを中央処理部１から受は取り、Ｘ２５レベル
３のヘッダを付加してフレーム処理回路３へ渡すものと
なっている。フレーム処理回路３ではそのデータに更に
Ｘ２５レベル２のヘッダ。
具体的にはＡパート、Ｃパート、フィルドチェックシー
ケンスデータを付加して回線６へ送信するところとなる
ものである。この送信フレームに対してはやがて応答〈
ト〉が回線６より受領されるが、これにより先ずフレー
ム処理回路３はＸ２５レベル２の通信規約に従った処理
を行ないＸ２５レベル２のヘッダを削除してパケット通
信回路２へ渡すとともに、応答（フレーム）〈ト〉に対
するＸ２５レベル２の応答（フレーム）くり〉を送出す
るものとなっている。Ｘ２５レベル２のヘッダが削除さ
れた応答くチ〉はフレーム処理回路３からバス５を介し
パケット通信回路２各々へ入力されるが。
ケンスデータを付加して回線６へ送信するところとなる
ものである。この送信フレームに対してはやがて応答〈
ト〉が回線６より受領されるが、これにより先ずフレー
ム処理回路３はＸ２５レベル２の通信規約に従った処理
を行ないＸ２５レベル２のヘッダを削除してパケット通
信回路２へ渡すとともに、応答（フレーム）〈ト〉に対
するＸ２５レベル２の応答（フレーム）くり〉を送出す
るものとなっている。Ｘ２５レベル２のヘッダが削除さ
れた応答くチ〉はフレーム処理回路３からバス５を介し
パケット通信回路２各々へ入力されるが。
パケット通信回路２各々では応答〈チ〉の中に含まれる
論理チャネル番号と自己の論理チャネル番号を比較し一
致に係るパケット通信回路２はＸ２５レベル３のヘッダ
の処理を行ないそのヘッダ部分を削除してデータ〈力〉
を中央処理部１へ渡すと同時に、Ｘ２５レベル３での応
答〈ル〉をフレーム処理回路３へ渡すようになっている
。フレーム処理回路３ではその応答〈ル〉にＸ２５？ベ
ル２のヘッダを付加し応答〈ヲ〉として回線６へ送出す
る一方、応答〈ヲ〉に対する応答〈ワ〉を回線６より受
領することによって、データ送出指令くべ〉に対する一
連の動作を終了するものである。なお、回線からのデー
タ受信については説明を省略する。
論理チャネル番号と自己の論理チャネル番号を比較し一
致に係るパケット通信回路２はＸ２５レベル３のヘッダ
の処理を行ないそのヘッダ部分を削除してデータ〈力〉
を中央処理部１へ渡すと同時に、Ｘ２５レベル３での応
答〈ル〉をフレーム処理回路３へ渡すようになっている
。フレーム処理回路３ではその応答〈ル〉にＸ２５？ベ
ル２のヘッダを付加し応答〈ヲ〉として回線６へ送出す
る一方、応答〈ヲ〉に対する応答〈ワ〉を回線６より受
領することによって、データ送出指令くべ〉に対する一
連の動作を終了するものである。なお、回線からのデー
タ受信については説明を省略する。
本発明は以上のようなものであるが、フレーム処理回路
は公知文献に示すように既に実現されており、パケット
通信回路にしても同一レベルの技術を用いればその実現
は容易となっている。このように、中央処理部によらな
いＸ２５のレベル２゜３の処理実現はパケット通信回路
とフレーム処理回路とを組合せることによって容易であ
り、その分中央処理部はＸ２５レベル２，３の複雑な通
信規約処理を行なうことを要しなくパケット処理能力は
必然的に向上されることになるものである。
は公知文献に示すように既に実現されており、パケット
通信回路にしても同一レベルの技術を用いればその実現
は容易となっている。このように、中央処理部によらな
いＸ２５のレベル２゜３の処理実現はパケット通信回路
とフレーム処理回路とを組合せることによって容易であ
り、その分中央処理部はＸ２５レベル２，３の複雑な通
信規約処理を行なうことを要しなくパケット処理能力は
必然的に向上されることになるものである。
以上説明したように本発明は、中央処理部とＸ２５のレ
ベル２の処理を行なうフレーム処理回路との間に、Ｘ２
５のレベル３の処理を行なうパケット通信回路を論理チ
ャネル数分並列的に設けるようになしたものである。し
たがって、本発明による場合は、中央処理部はＸ２５の
レベル２，３の処理を行なうことを要しないことから、
パケット処理能力はこれまでに比し更に向上されるとい
う効果がある。
ベル２の処理を行なうフレーム処理回路との間に、Ｘ２
５のレベル３の処理を行なうパケット通信回路を論理チ
ャネル数分並列的に設けるようになしたものである。し
たがって、本発明による場合は、中央処理部はＸ２５の
レベル２，３の処理を行なうことを要しないことから、
パケット処理能力はこれまでに比し更に向上されるとい
う効果がある。
第１図は、本発明によるパケット通信装置の一例での全
体構成を示す図、第２図は、その−動作例を説明するた
めの図である。 １・・・中央処理部、２・・・パケット通信回路、３・
・・フレーム処理回路、４，５・・・バス、６・・・回
線。
体構成を示す図、第２図は、その−動作例を説明するた
めの図である。 １・・・中央処理部、２・・・パケット通信回路、３・
・・フレーム処理回路、４，５・・・バス、６・・・回
線。
Claims (1)
- ＣＣＩＴＴ勧告Ｘ２５に準拠した手順に従い回線との間
で通信を行なうパケット通信装置であって、回線との間
で授受されるフレームデータをＸ２５レベル２に従った
通信規約にて処理するフレーム処理回路と、データの送
信契機および受信契機を判断し回線へのフレーム送出指
令、回線からのフレーム受信指令を発行する中央処理部
との間に、該中央処理部から通信開始に先立ってＸ２５
レベル３の通信規約にて定義され、該レベル３での通信
を可能とするパラメータの設定を受け、通信開始以後は
設定パラメータに従いフレーム処理回路からのデータに
対してはＸ２５レベル３の通信規約にてパケットレベル
の処理を行なう一方、中央処理部からの送出指令の対象
となるデータに対してはＸ２５レベル３の通信規約に従
うパケットレベルの処理を行なうパケット通信回路を論
理チャネル数分並列的に設けた構成を特徴とするパケッ
ト通信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60013565A JPH0831875B2 (ja) | 1985-01-29 | 1985-01-29 | バケツト通信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60013565A JPH0831875B2 (ja) | 1985-01-29 | 1985-01-29 | バケツト通信装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61173554A true JPS61173554A (ja) | 1986-08-05 |
| JPH0831875B2 JPH0831875B2 (ja) | 1996-03-27 |
Family
ID=11836685
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60013565A Expired - Lifetime JPH0831875B2 (ja) | 1985-01-29 | 1985-01-29 | バケツト通信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0831875B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63269844A (ja) * | 1987-04-28 | 1988-11-08 | Nec Corp | 通信制御処理装置 |
| US6493356B1 (en) | 1998-01-09 | 2002-12-10 | Nec Corporation | Segmentation and reassembly system for ATM communication network improved in throughput |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59185448A (ja) * | 1983-04-04 | 1984-10-22 | Nec Corp | パケツト交換制御用通信制御装置 |
-
1985
- 1985-01-29 JP JP60013565A patent/JPH0831875B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59185448A (ja) * | 1983-04-04 | 1984-10-22 | Nec Corp | パケツト交換制御用通信制御装置 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63269844A (ja) * | 1987-04-28 | 1988-11-08 | Nec Corp | 通信制御処理装置 |
| US6493356B1 (en) | 1998-01-09 | 2002-12-10 | Nec Corporation | Segmentation and reassembly system for ATM communication network improved in throughput |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0831875B2 (ja) | 1996-03-27 |
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