JPS61133403A - 電磁作動器駆動装置 - Google Patents
電磁作動器駆動装置Info
- Publication number
- JPS61133403A JPS61133403A JP25635284A JP25635284A JPS61133403A JP S61133403 A JPS61133403 A JP S61133403A JP 25635284 A JP25635284 A JP 25635284A JP 25635284 A JP25635284 A JP 25635284A JP S61133403 A JPS61133403 A JP S61133403A
- Authority
- JP
- Japan
- Prior art keywords
- current
- output
- comparator
- electromagnetic actuator
- cpu
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B11/00—Automatic controllers
- G05B11/01—Automatic controllers electric
- G05B11/26—Automatic controllers electric in which the output signal is a pulse-train
- G05B11/28—Automatic controllers electric in which the output signal is a pulse-train using pulse-height modulation; using pulse-width modulation
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Feedback Control In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は内燃機関などの制御に使用するりニアソレノイ
ドの駆動を制御する駆動装置に関する。
ドの駆動を制御する駆動装置に関する。
従来、内燃機関の制御などに使用するりニアソレノイド
の駆動回路としては例えば特開昭５７−１３７９０１号
公報のものがあった。これは全駆動回路を比較器や演算
増幅器および個別素子を用いた回路で構成したものであ
り、部品数が多くなるという欠点があった。
の駆動回路としては例えば特開昭５７−１３７９０１号
公報のものがあった。これは全駆動回路を比較器や演算
増幅器および個別素子を用いた回路で構成したものであ
り、部品数が多くなるという欠点があった。
近年、制御回路に１チツプマイクロコンピユータが使用
されるようになり、自動車用制御回路が複合機能を制御
するようになってきた。そのため、リニアソレノイドの
駆動回路も■千ノブマイクロコンピュータの１部機能を
活用することによって回路を簡略化する必要性がでてき
た。
されるようになり、自動車用制御回路が複合機能を制御
するようになってきた。そのため、リニアソレノイドの
駆動回路も■千ノブマイクロコンピュータの１部機能を
活用することによって回路を簡略化する必要性がでてき
た。
本発明は、マイクロコンピュータより電磁弁を駆動する
目標デユーティ電圧を出力し、この目標値と実際のりニ
アソレノイドの電流の差を一周期ごとに検出することで
、リニ“アソレノイドを駆動するポート出力を制御する
ことにより駆動回路を簡略化することを目的とする。
目標デユーティ電圧を出力し、この目標値と実際のりニ
アソレノイドの電流の差を一周期ごとに検出することで
、リニ“アソレノイドを駆動するポート出力を制御する
ことにより駆動回路を簡略化することを目的とする。
リニアソレノイドを０Ｎ１０ＦＦするポートにマイクロ
コンピュータの出力ポートをＰｌに？ＪｊＱ付け、目標
とする電流値に計算されたデユーティ比電圧をコントロ
ールするポートに、アナログ出カポ−）Ｐ２を割付ける
。リニアソレノイドは０Ｎ１０ Ｆ Ｆの一定周波数に
て出力駆動し、リニアソレノイドに供給される０Ｎ１０
ＦＦ電流を検出するＶ／Ｉ変換を用いてソレノイド電流
を検出し、前記目標デユーティ比電圧とＶ／ｒ変換の出
力をコンデンサと抵抗を用いて積分する。次に、検出さ
れたソレノイド電流と目標値を比較し、もし両者が一致
していれば、−周期後のコンデンサの両端子の電圧は０
である。目標値と実際値の電流がずれていれば、−周期
後比較器の出力は°Ｈ”レベル又は“Ｌ”レベルの出力
となり、この比較器の出力をマイクロコンピュータの人
力ポートＰ３に入力することで、目標とする制御ができ
る。
コンピュータの出力ポートをＰｌに？ＪｊＱ付け、目標
とする電流値に計算されたデユーティ比電圧をコントロ
ールするポートに、アナログ出カポ−）Ｐ２を割付ける
。リニアソレノイドは０Ｎ１０ Ｆ Ｆの一定周波数に
て出力駆動し、リニアソレノイドに供給される０Ｎ１０
ＦＦ電流を検出するＶ／Ｉ変換を用いてソレノイド電流
を検出し、前記目標デユーティ比電圧とＶ／ｒ変換の出
力をコンデンサと抵抗を用いて積分する。次に、検出さ
れたソレノイド電流と目標値を比較し、もし両者が一致
していれば、−周期後のコンデンサの両端子の電圧は０
である。目標値と実際値の電流がずれていれば、−周期
後比較器の出力は°Ｈ”レベル又は“Ｌ”レベルの出力
となり、この比較器の出力をマイクロコンピュータの人
力ポートＰ３に入力することで、目標とする制御ができ
る。
以下図面に基づいて本発明の実施例について説明する。
第１図に本発明の第１実施例の回路図を示す。
マイクロコンピュータ（以下ＣＰＵと記す）１は、レジ
スタ２．３を介して、トランジスタ４を駆動し、電磁作
動器５を、周期的に０Ｎ１０ＦＦ駆動する。電磁作動器
５に供給される電流はトラジスタ４がＯＮ時、このトラ
ンジスタ４を介して、トランジスタ４がＯＦＦ時、ツェ
ナーダイオード６を介してサージ電流として、電流検出
用抵抗７に流れる。この電流検出用抵抗７の両端の電圧
を、増幅または整合させるため、オペアンプ８とレジス
タ９．１０がある。またｃｐｕ ｔは、電磁作動Ｂ５に
供給すべき電流値に相当する目標値を０Ｎ１０ＦＦのデ
ユーティ値により出力する。たとえば、デユーティ出力
や、Ａ／Ｄ変換を用いた電圧出力が有る。前述のオペア
ンプ８の出力とこの目標値の差をコンデンサ１２、レジ
スタ１３より構成される、積分器１１にて積分し、この
積分用コンデンサ１２の充電電圧の極性をコンデンサ１
２の両端子を入力として受ける比較器１４にて検出し、
ＣＰＵＩに１（／ Ｌの出力として伝える。
スタ２．３を介して、トランジスタ４を駆動し、電磁作
動器５を、周期的に０Ｎ１０ＦＦ駆動する。電磁作動器
５に供給される電流はトラジスタ４がＯＮ時、このトラ
ンジスタ４を介して、トランジスタ４がＯＦＦ時、ツェ
ナーダイオード６を介してサージ電流として、電流検出
用抵抗７に流れる。この電流検出用抵抗７の両端の電圧
を、増幅または整合させるため、オペアンプ８とレジス
タ９．１０がある。またｃｐｕ ｔは、電磁作動Ｂ５に
供給すべき電流値に相当する目標値を０Ｎ１０ＦＦのデ
ユーティ値により出力する。たとえば、デユーティ出力
や、Ａ／Ｄ変換を用いた電圧出力が有る。前述のオペア
ンプ８の出力とこの目標値の差をコンデンサ１２、レジ
スタ１３より構成される、積分器１１にて積分し、この
積分用コンデンサ１２の充電電圧の極性をコンデンサ１
２の両端子を入力として受ける比較器１４にて検出し、
ＣＰＵＩに１（／ Ｌの出力として伝える。
次に上記回路の作動について説明する。
ＣＰＵＩは、電磁作動器５に電流を供給すべ（、供給す
る電流値に相当した目標値をボー）Ｐ２よりアナログ出
力する。同時にボー）Ｐ＋より電磁作動器を駆動する周
期パルスを出力し、レジスタ２．３とトランジスタ４に
より、電磁作動器５を一定周期でＯＮ１０ Ｆ Ｆ駆動
する。トランジスタ４がＯＮ時電磁作動器５の電流は、
ＯＮ電流としてトランジスタ４を介して電流検出用抵抗
７に流れ、トランジスタ４がＯＦＦ時電磁作動器５の電
流は、サージ電流（ＯＦＦ電流）として、ツェナーダイ
オード６を介して電流検出用抵抗７に流れる。この電流
検出用抵抗７の両端電圧をオペアンフ８とレジスタ９．
１０を用いて、増幅する。前述のＣＰＵＩのポートＰ２
より出力された目標値と、オペアンプ８の出力として検
出した実際に電磁作動器５に供給されている電流値の差
を、積分コンデンサ１２、レジスタ１．３により構成さ
れる積分器１１にて積分する。積分コンデンサ１２の両
端電圧の極性を比較器１４で検出し、ＣＰＵのポートＰ
３に“Ｈ″レヘル信号は“し”レベル信号（以下Ｈ／Ｌ
信号と記す）として伝達する。
る電流値に相当した目標値をボー）Ｐ２よりアナログ出
力する。同時にボー）Ｐ＋より電磁作動器を駆動する周
期パルスを出力し、レジスタ２．３とトランジスタ４に
より、電磁作動器５を一定周期でＯＮ１０ Ｆ Ｆ駆動
する。トランジスタ４がＯＮ時電磁作動器５の電流は、
ＯＮ電流としてトランジスタ４を介して電流検出用抵抗
７に流れ、トランジスタ４がＯＦＦ時電磁作動器５の電
流は、サージ電流（ＯＦＦ電流）として、ツェナーダイ
オード６を介して電流検出用抵抗７に流れる。この電流
検出用抵抗７の両端電圧をオペアンフ８とレジスタ９．
１０を用いて、増幅する。前述のＣＰＵＩのポートＰ２
より出力された目標値と、オペアンプ８の出力として検
出した実際に電磁作動器５に供給されている電流値の差
を、積分コンデンサ１２、レジスタ１．３により構成さ
れる積分器１１にて積分する。積分コンデンサ１２の両
端電圧の極性を比較器１４で検出し、ＣＰＵのポートＰ
３に“Ｈ″レヘル信号は“し”レベル信号（以下Ｈ／Ｌ
信号と記す）として伝達する。
第２図に積分コンデンサ１２と比較器１４等の波形を示
す。ａはＣＰ Ｕ ｉ 、ポートＰ１の電磁作動器５の
駆動パルス出力、ｂはＣＰＵＩのポートＰ２の電磁作動
器５に供給すべき電流の目標値出力で、ＣＰＵＩ内で（
Ｄ／Ａ）変換されたアナログ出力とする。Ｃはオペアン
プ８の出力で、電磁作動器５に流れる実際の０Ｎ１０Ｆ
Ｆ電流値である。ｄは積分コンデンサの両端電圧波形で
、ｅは比較器１４の出力で積分コンデンサ１２の両端電
圧の極性を判定している。
す。ａはＣＰ Ｕ ｉ 、ポートＰ１の電磁作動器５の
駆動パルス出力、ｂはＣＰＵＩのポートＰ２の電磁作動
器５に供給すべき電流の目標値出力で、ＣＰＵＩ内で（
Ｄ／Ａ）変換されたアナログ出力とする。Ｃはオペアン
プ８の出力で、電磁作動器５に流れる実際の０Ｎ１０Ｆ
Ｆ電流値である。ｄは積分コンデンサの両端電圧波形で
、ｅは比較器１４の出力で積分コンデンサ１２の両端電
圧の極性を判定している。
第３図にＣＰＵＩの作動としてフローチャートを示す。
第１図〜第３図より、ＣＰＵＩは電磁作動画５を駆動す
べく第２図のａに示す１サイクル分のポートＰ１の出力
を算出する。そのポー）Ｐ＋の出力により駆動され電磁
作動器５に、第２図のＣに示す１サイクル分の０Ｎ１０
ＦＦ電流が供給される。もし、０Ｎ１０ＦＦ電流の平均
値と、ＣＰＵＩのポートＰ２に出力される目標値が等し
い時は、第２図のｄの実線に示すように積分コンデンサ
１２の両端電圧は１サイクルの終了時点は０■となり、
比較器１４は、第２図のｅの実線のように１サイクル終
了時点に反転する。次に電磁作動器５の０Ｎ１０ＦＦ電
流の平均値と、ＣＰＵＩのボートＰ２出力である目標値
にずれが生じている時、たとえば０Ｎ１０ＦＦ電流の平
均値が小の時、第２図のｄの破線のように積分コンデン
サ１２は充電され、１サイクル終了時点より以前に、比
較器１４は、第２図のｅの破線のように反転する。逆に
０Ｎ１０ＦＦ電流の平均値が大の時は、前述とは逆に１
サイクル終了時点より以後に比較器１４は、第２図のｅ
の一点鎖線のように反転する。よって１サイクル終了時
点の比較Ｎ１４の出力をＣＰＵＩに１°、 “０“信号
として１サイクル終了時点に取り込むことで、ＣＰ Ｌ
Ｊ ｌが電磁作動器５を０Ｎ１０ＦＦ駆動し、供給され
る０Ｎ１０ＦＦ電流の平均値の目標よりのずれをビ 、
′０°信号で１サイクル毎にＣＰ Ｕ １は認識し、“
１°を検出すれば、次サイクルの駆動パルスを減補正し
、逆に“０′を検出すれば加補正する。
べく第２図のａに示す１サイクル分のポートＰ１の出力
を算出する。そのポー）Ｐ＋の出力により駆動され電磁
作動器５に、第２図のＣに示す１サイクル分の０Ｎ１０
ＦＦ電流が供給される。もし、０Ｎ１０ＦＦ電流の平均
値と、ＣＰＵＩのポートＰ２に出力される目標値が等し
い時は、第２図のｄの実線に示すように積分コンデンサ
１２の両端電圧は１サイクルの終了時点は０■となり、
比較器１４は、第２図のｅの実線のように１サイクル終
了時点に反転する。次に電磁作動器５の０Ｎ１０ＦＦ電
流の平均値と、ＣＰＵＩのボートＰ２出力である目標値
にずれが生じている時、たとえば０Ｎ１０ＦＦ電流の平
均値が小の時、第２図のｄの破線のように積分コンデン
サ１２は充電され、１サイクル終了時点より以前に、比
較器１４は、第２図のｅの破線のように反転する。逆に
０Ｎ１０ＦＦ電流の平均値が大の時は、前述とは逆に１
サイクル終了時点より以後に比較器１４は、第２図のｅ
の一点鎖線のように反転する。よって１サイクル終了時
点の比較Ｎ１４の出力をＣＰＵＩに１°、 “０“信号
として１サイクル終了時点に取り込むことで、ＣＰ Ｌ
Ｊ ｌが電磁作動器５を０Ｎ１０ＦＦ駆動し、供給され
る０Ｎ１０ＦＦ電流の平均値の目標よりのずれをビ 、
′０°信号で１サイクル毎にＣＰ Ｕ １は認識し、“
１°を検出すれば、次サイクルの駆動パルスを減補正し
、逆に“０′を検出すれば加補正する。
即ち、比較器１４の出力が１サイクル終了時点で常に反
転するように作動させることで、電磁作動器５の０Ｎ１
０ＦＦ電流の平均値を目標値に維持させる。１サイクル
終了時点の比較器１４の出力の取り込みは、第３図のフ
ローチャートに示すようにＣＰＵ ］がポー）Ｐ＋、Ｐ
２に出力起動する直前に行うことで実現し、この値をメ
モリ （Ａ）に書き込むことで、次サイクルの駆動パル
スを加減補正する際にこのメモリ （Ａ）の値を用いる
ものである。 以上のように、■サイクルの終了時点に
比較器１４が反転することが、０Ｎ１０ＦＦ電流の平均
値と、目標値が等しいという点に着目し、ＣＰＵＩが、
サイクル終了毎に、比較器１４の出力を認識し、次サイ
クルの駆動パルスを補正することで電流制御を可能とし
た。
転するように作動させることで、電磁作動器５の０Ｎ１
０ＦＦ電流の平均値を目標値に維持させる。１サイクル
終了時点の比較器１４の出力の取り込みは、第３図のフ
ローチャートに示すようにＣＰＵ ］がポー）Ｐ＋、Ｐ
２に出力起動する直前に行うことで実現し、この値をメ
モリ （Ａ）に書き込むことで、次サイクルの駆動パル
スを加減補正する際にこのメモリ （Ａ）の値を用いる
ものである。 以上のように、■サイクルの終了時点に
比較器１４が反転することが、０Ｎ１０ＦＦ電流の平均
値と、目標値が等しいという点に着目し、ＣＰＵＩが、
サイクル終了毎に、比較器１４の出力を認識し、次サイ
クルの駆動パルスを補正することで電流制御を可能とし
た。
次に他の実施例を第４図に示す。
第１図の第１実施例との違いは、ＣＰＵＩのポ）Ｐ２よ
りデユーティの目標電圧が出力されるようにトランジス
タ２６、レジスタ２７．２８．２９が追加された点と、
サージ電流（ＯＦ Ｆ電流）を電源に返す構成にするた
めにダイオード２１、サージ（ＯＦ Ｆ）電流検出抵抗
２０、およびレジスタ２２．２３．２４．２５が追加さ
れ、ツェナーダイオード６を削除した点である。第５図
に第２図と同様に第４図の各波形を示す。
りデユーティの目標電圧が出力されるようにトランジス
タ２６、レジスタ２７．２８．２９が追加された点と、
サージ電流（ＯＦ Ｆ電流）を電源に返す構成にするた
めにダイオード２１、サージ（ＯＦ Ｆ）電流検出抵抗
２０、およびレジスタ２２．２３．２４．２５が追加さ
れ、ツェナーダイオード６を削除した点である。第５図
に第２図と同様に第４図の各波形を示す。
ａ、ｃ、ｄ、ｅは第２図と同一部の波形でありｂ′はト
ランジスタ２６、レジスタ２７．２８．２９とＣＰＵ
ｌのポートＰ２で出力されるデユーティ目標出力値であ
り、目標が破線のようにデユーティにて変化する。第１
実施例の場合、ＣＰＵ１はＡ／Ｄ変換機能を有す高価な
ＣＰＵであり電圧制御し、目標値を出力した第２実施例
の場合はＡ／Ｄ変換機能を有さない安価なＣＰＵのため
、“１゛、′０”出力で目標を構成している。第２図と
同様に、電磁作動器５の０Ｎ１０ＦＦ電流の平均値が目
標値と等しい場合、第５図のｅのように、１サイクルの
終了時点に比較器１４は反転するために、第１実施例と
同一の作用で電流制御可能である。尚サージ電流（ＯＦ
Ｆ電流）を電源に返す構成について補足すると、第１実
施例のツェナーダイオード６の発熱を防止するため削除
し、サージ（ＯＦＦ）電流検出抵抗２０を追加して、サ
ージ電流（ＯＦＦ電流）を検出し、電流検出抵抗７で、
ＯＮ電流を検出し、オペアンプ８で、サージ電流（ＯＦ
Ｆ電流）とＯＮ電流を検出することで、第１実施例と
同一の出力を得る。
ランジスタ２６、レジスタ２７．２８．２９とＣＰＵ
ｌのポートＰ２で出力されるデユーティ目標出力値であ
り、目標が破線のようにデユーティにて変化する。第１
実施例の場合、ＣＰＵ１はＡ／Ｄ変換機能を有す高価な
ＣＰＵであり電圧制御し、目標値を出力した第２実施例
の場合はＡ／Ｄ変換機能を有さない安価なＣＰＵのため
、“１゛、′０”出力で目標を構成している。第２図と
同様に、電磁作動器５の０Ｎ１０ＦＦ電流の平均値が目
標値と等しい場合、第５図のｅのように、１サイクルの
終了時点に比較器１４は反転するために、第１実施例と
同一の作用で電流制御可能である。尚サージ電流（ＯＦ
Ｆ電流）を電源に返す構成について補足すると、第１実
施例のツェナーダイオード６の発熱を防止するため削除
し、サージ（ＯＦＦ）電流検出抵抗２０を追加して、サ
ージ電流（ＯＦＦ電流）を検出し、電流検出抵抗７で、
ＯＮ電流を検出し、オペアンプ８で、サージ電流（ＯＦ
Ｆ電流）とＯＮ電流を検出することで、第１実施例と
同一の出力を得る。
以上述べたように、本発明は電磁作動器を定周期電流駆
動するための装置であって、ＣＰＵにて計算された駆動
パルス出力にて制御されるスイッチング素子と、該スイ
ッチング素子にて付勢される電磁作動器と、該電磁作動
器に流れる電流を検出する電流検出用抵抗と、該電流検
出用抵抗の両端電圧を増幅する増幅器と、該増幅器の出
力と前記ＣＰＵにて前記電磁作動器に供給すべき電流に
相当した目標値に計算された出力の差を積分するコンデ
ンサと、該コンデンサの両端子を入力として受ける比較
器と、該比較器の出力を入力として前記ＣＰＵに受ける
構成を有し、前記ＣＰＵは、前記定周期駆動のサイクル
の終了時点に、前記比較器の出力をサンプリングし、該
サンプリング信号に基づいて前記ＣＰＵにて計算する駆
動パルス出力を補正する事を特徴とする、電磁作動器駆
動装置であるので、素子数が少なく構成できコストパフ
ォーマンスと信頼性が向上するという優れた効果を有す
る。
動するための装置であって、ＣＰＵにて計算された駆動
パルス出力にて制御されるスイッチング素子と、該スイ
ッチング素子にて付勢される電磁作動器と、該電磁作動
器に流れる電流を検出する電流検出用抵抗と、該電流検
出用抵抗の両端電圧を増幅する増幅器と、該増幅器の出
力と前記ＣＰＵにて前記電磁作動器に供給すべき電流に
相当した目標値に計算された出力の差を積分するコンデ
ンサと、該コンデンサの両端子を入力として受ける比較
器と、該比較器の出力を入力として前記ＣＰＵに受ける
構成を有し、前記ＣＰＵは、前記定周期駆動のサイクル
の終了時点に、前記比較器の出力をサンプリングし、該
サンプリング信号に基づいて前記ＣＰＵにて計算する駆
動パルス出力を補正する事を特徴とする、電磁作動器駆
動装置であるので、素子数が少なく構成できコストパフ
ォーマンスと信頼性が向上するという優れた効果を有す
る。
第１図は本発明第１実施例の回路図、第２図は第１図回
路の各部の波形を示すタイミング図、第３図はｃｐｕの
制御手段を示す流れ図、第４０図は本発明の第２実施例
の回路図、第５図は第１図回路の各部の波形を示すタイ
ミング図である。 ■・・・マイクロコンピュータ、４・・・トランジスタ
。 ５・・・電磁作動器、６・・・ツェナーダイオード、７
・・・電流検出用抵抗、８・・・演算増幅器、１１・・
・積分器。 １４・・・比較器。
路の各部の波形を示すタイミング図、第３図はｃｐｕの
制御手段を示す流れ図、第４０図は本発明の第２実施例
の回路図、第５図は第１図回路の各部の波形を示すタイ
ミング図である。 ■・・・マイクロコンピュータ、４・・・トランジスタ
。 ５・・・電磁作動器、６・・・ツェナーダイオード、７
・・・電流検出用抵抗、８・・・演算増幅器、１１・・
・積分器。 １４・・・比較器。
Claims (1)
- 電磁作動器を定周期電流駆動するための装置であって
、マイクロコンピュータにて計算された駆動パルス出力
にて制御されるスイッチング手段と、該スイッチング手
段にて付勢される電磁作動器と、該電磁作動器に流れる
電流を検出する電流検出用抵抗と、該電流検出用抵抗の
両端電圧を増幅する増幅器と、該増幅器の出力と前記マ
イクロコンピュータにて前記電磁作動器に供給すべき電
流に相当した目標値に計算された出力の差を積分するコ
ンデンサと、該コンデンサの両端子を入力と受ける比較
器と、該比較器の出力を前記マイクロコンピュータに入
力し、前記マイクロコンピュータは、前記定周期駆動の
サイクルの終了時点に、前記比較器の出力をサンプリン
グし、該サンプリング信号に基づいて前記マイクロコン
ピュータにて計算する駆動パルス出力を補正する事を特
徴とする電磁作動器駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25635284A JPS61133403A (ja) | 1984-12-03 | 1984-12-03 | 電磁作動器駆動装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25635284A JPS61133403A (ja) | 1984-12-03 | 1984-12-03 | 電磁作動器駆動装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61133403A true JPS61133403A (ja) | 1986-06-20 |
Family
ID=17291487
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25635284A Pending JPS61133403A (ja) | 1984-12-03 | 1984-12-03 | 電磁作動器駆動装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61133403A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06222806A (ja) * | 1992-04-02 | 1994-08-12 | Deutsche Aerospace Ag | デジタル変調方法とその装置 |
-
1984
- 1984-12-03 JP JP25635284A patent/JPS61133403A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06222806A (ja) * | 1992-04-02 | 1994-08-12 | Deutsche Aerospace Ag | デジタル変調方法とその装置 |
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