JPS6113291A - デイスプレイ領域を生成する制御回路及び方法 - Google Patents

デイスプレイ領域を生成する制御回路及び方法

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JPS6113291A
JPS6113291A JP60125277A JP12527785A JPS6113291A JP S6113291 A JPS6113291 A JP S6113291A JP 60125277 A JP60125277 A JP 60125277A JP 12527785 A JP12527785 A JP 12527785A JP S6113291 A JPS6113291 A JP S6113291A
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JP60125277A
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アンソニイ・バーナード・ビンク
エドワード・エフ・アサム
デユエイン・ジエイ・フエリス
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    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/14Display of multiple viewports
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/34Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators for rolling or scrolling
    • G09G5/346Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators for rolling or scrolling for systems having a bit-mapped display memory

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Controls And Circuits For Display Device (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)
  • Vessels, Lead-In Wires, Accessory Apparatuses For Cathode-Ray Tubes (AREA)
  • Digital Computer Display Output (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は一般には陰極線管(CRT )ディスプレイに
おける独立スクロール可能な(scrol 1able
)ディスプレイ領域(時折「窓」と呼ばれる)の提供(
provi−s jc+n )及び前記の窓におけるス
クローリングの準備に関する。更に詳細には、本発明は
ビット・マツブト(bit−mapped)データディ
スプレイシステムにおけるウィンドウィング(wind
owing>及びスクローリング双方を提供するための
比較的簡単な回路に関する。
従来の技術及び発明が解決しようとする問題点窓機能及
びスクローリング機能の双方を提供するために従来技術
には多(の機構が存在する。「部分的スクローリングビ
デオゼネレータ(PartialScrolling 
Video Generator)Jと題するリチャー
ド エヌ・ポツプ(R1charcj N−Pope)
等による1982年8月3日付の米国特許第4,342
゜991号はスクローリングシステムについて記述しで
いる。この特許の第3欄頂部に、スクローリングは従来
のデザインのCRTC(Il!極線管制御器(cath
ode−ray tube controller))
からアドレスするリフレッシュメモリを除くことによっ
て、且つ第1のマルチプレクサを通りリフレッシュメモ
リのアドレス入力に交互にアクセスするす7レツl) シュアドレスカウンタ及ゾ間接アドレスカウンタとして
プリセット可能な2進カウンタを取替えることによって
達成されると述べている。
「スロースクローリングボジショニングを提供する制御
手段及びデータディスプレイシステムにお1するスペー
シング(Control Means t。
Provide S low ScrollingPo
sitioningandSpacing in a 
Digital Video Display 5ys
t−es+)Jと題するチャールス エル・セイツ等(
Char−1es L −5eitz)による1981
年8月18日付の米国特許$4.284,988号はス
クローリング機能を提供する他の手段についで記載して
いる。
その特許の第11欄に記載されている如く、文学論(c
haracter wheel)が使用されており、そ
して3つのパラメータ(即ち、初期の位置、カウント及
びマスク)が各文字ラインの初めにそれぞれのレジスタ
内にロードされる。これ等のパラメータを調整すること
によって、文字ラインの初期の走査ラインは文字スペー
スの底部に加えられる追加の走査ラインと共に自動的に
上に移動する残りの走査ラインと共に抹消されることが
でき、そして文字はその結果上に移動するように思われ
る。
他の機構は[スクローリングディスプレイリフレッシュ
メモリアドレス生成装置(Scrolling Dis
play Refresh Memory Adres
s GenerationA pparatus)Jと
題するグビット ビ・オーゝキー7等(David B
−0’Keefe et al)による1983年3月
1日付米国特許第4,375,638号に記載されてい
る。その特許の第2欄に述べられでいる如く、ライン6
1で始っている、文字情報の行はディスプレイ制御器リ
フレッシュメモリ内に固定長の行で記憶される。ディス
プレイ制御器はロールレノスタ(roll regis
ter)を含み、これはディスプレイスクリーン上の情
報がロールされる(スクロールされる)べき行数に対応
する値をロードされ、そしてこの値は再配置されたアド
レスを生成するのに使用され、再配置されたアドレスは
リフレッシュメモリ内に記憶それた文字情報を取り戻す
のに使用される。
この分野に関するなお他の特許は:「多重スクローリン
グ領域のためのディスプレイ制御器(D 1sp−1a
y Controller For Multiple
 ScrollingRegions)Jと題するワイ
・シー・バンプイア等(Y、 C,Pandya et
 al)による1983年5月31日付の米国特許第4
,386,410号;「多重スクローリング領域を有す
るディスプレイシステム(D 1splay Syst
em with Multiple Scrollin
gRegions)Jと題するエル噂エフ・ワット等(
L。
F 、 Watt et al)による1983年10
月25日付の米国特許第4,412,294号;「ビデ
オディスプレイモジュールのための制御装置(Cont
、rolD evice F or V 1deo D
 1splay Module)Jと題するエル・7エ
ルセンシユタイン(■−・F elsenstei−n
)による1979年2月20日付の米国特許第4゜14
1.003号;[可視ディスプレイ装置のためのスクロ
ーリング回路(S crollingC1rcuit 
F ora V 1sual D i、5ply A 
pparatus)Jと題するノー・シー・ジベル(G
、 C9Zobel)による1975年9月2日付の米
国特許第3,903,510号;及1「自動ベージング
を有するビデオディスプレイターミナル(V 1cle
o D 1sply Terminal WithA 
uto論atic P aging)Jと題するエイ・
ジエイ・クラインシュニッツ(A 、  J 、 K 
Ieinschnitz)による1972年8月8日付
の米国特許第3,683゜359号を含んでいる。
問題点を解決するための手段 本発明は窓におれるスクローリングの提供(pro−v
isiou)と結合されたCRTディスプレイ装置上の
ディスプレイに窓の提供に向けられている。本発明はマ
ルチプレクサを制御するのに使用される窓検出回路を提
供することによってこれを達成する;このマルチプレク
サは2つの適切なアドレスの1方を選択すゐのに用いら
れる。このアドレスは窓なし・(lon−window
)ディスプレイからのアドレスか、又は窓ディスプレイ
からのアドレスであることができる。窓検出回路、極端
に簡易化した言葉では、垂直及び水平方向の双方におい
てCRTディスプレイを監視することによって機能する
水平方向においてディスプレイが窓を指示するときも、
垂直方向においてディスプレイが窓を指示すると鰺も所
定の信号を生成する。
換言すれば、本発明はビット・マツブト(bit−ma
pped)データディスプレイシステムにおける陰極線
管(CRT )の面上に独立の、スクロール可能なディ
スプレイ領域を生成するための制御回路であり、この制
御回路は二垂直軸線に沿って独立ディスプレイ領域の開
始を検出する第1の垂直境界検出手段と:垂直軸線に沿
って独立ディスプレイ領域の終了を検出する第2の垂直
境界検出手段と;水平軸線に沿って独立ディスプレイ領
域の開始を検出する第1の水平境界検出手段と;水平軸
線に沿って独立ディスプレイ領域の終了を検出する第2
の水平検出手段と;第1及び第2の垂直境界検出手段並
びに第1及び第2の水平境界手段に応答して、存在する
独立ディスプレイ領域を指示するwilの値と、存在し
ない独立ディスプレイ領域を指示する第2の値とを有す
る2進信号を生成する制御手段と;2進信号に応答して
、独立ディスプレイ領域に属するメモリアドレスか、又
は独立ディスプレイ領域に属しないメモリアドレスかの
いづれかを選択するメモリアドレス選択手段とを具備し
ている。
換言すれば、本発明はビット・マップドデータデイスプ
レイシステムにおける陰極線管(CRT )の面上に独
立スクロール可能なディスプレイ領域を生成する方法で
ある。この方法は:第1の軸線に沿って存在する独立領
域を指示する第1の状態と、第1の軸線に沿って存在し
ない独立領域を指示する第2の状態とを有している第1
の2進信号を生成すること;第2の軸線に沿って存在す
る独立領域を指示する第1の状態と、第2の軸線に沿っ
て存在しない独立領域を指示する第2の状態とを有して
いる第2の2進信号を生成すること;第1及び第2の2
進信号の双方がそれ等の第1の状態にあるとき存在する
独立領域を指示する第1の状態と、第1及び第2の2進
信号の双方がそれ等の第1の状態にあるとき、存在しな
い独立領域を指示する第2の状態とを有している115
3の2進信号を生成するように第1及ゾ第2の2進信号
を組合わせること;そして第3の2進信号に応答して第
1のアドレスソース又は第2のアドレスソースのいづれ
かを選択することとを含んでいる。
実施例 添付図面を参照して更に詳細に本発明を説明する。この
場合いくつかの図の中の同様な部分は同じ参照文字によ
って示されている。
第1図はCRTディスプレイ31にウィンドウィング(
windowing)及びスクローリング(scrol
ling)を提供するために本発明によって構成された
窓(window)制御回路36を含んでいるコンピー
タシステム10の簡単化された表現を示している。シス
テム10はモトローラ(Motorola)によって製
造された68000マイクロプロセツサであるマイクロ
プロセッサ11の制御下にある。マイクロプロセッサ1
1は17ビツトデータバス15を経て16ビツトバス1
2に連絡している。マイクロプロセッサ11を除いては
、システム10め主構成要素はCRT制御器13であり
、これはシダネティクス(S igneties)によ
って製造されたモデル2674であって、そして8ビツ
トパス14、バッファ16及v8ビツトパス17を経て
パス12に接続される。ROM(読出し専用メモリ)1
8(実例2764A)はビットパス19を経てパス12
に接続されている。ROM18の目的はファームウェア
(fir−1are)コードをマイクロプロセッサ11
に提供することである。
メモリ21は16ビ7トパス22、バッファ23.16
ビツトバス24を経て、及び16ビツトパス26、バッ
フT27.16ビツトバス28を経てパス12にインタ
ーフェースされている。CRTディスプレイ31はCR
Tそれのみならず、またディスプレイを提供することと
関連している標準付属装置を含んでいる。窓制御回路は
16ビツト両方向パス37を経てパス12に接続される
窓制御回路36は本明細書に後でより詳細に記載されて
いるウィンドウィング及びスクローリングのための制御
槻能を備えている。付加的な可能出力(capabil
ities)が両方向バス38、バッフ7−39、及び
両方向パス40を経て、パス12に接l&されたエキス
パンシヨン(expansion)インターフェース3
7によって提供される。
窓検出回路36について更に詳細に説明する。
$2図及ゾ第3図は一緒に第1図において窓制御回路3
6として示された回路を具備しでいる。回路を説明する
ために第2図及び第3図に戻る前に、概念的に何がなさ
れるのかを理解するために第4図を見るのが重要である
。第4図はプレーン(pla−ne)1及びプレーン2
に関する2つのメモリプレーンを示している。プレーン
1はメモリにおける領域の様式化された(styliz
ed)表現であり、その内容がCRT(即ち、窓なしく
norrwindow)メモリ)の面上にディスプレイ
される。プレーン2はメモリにおける領域の様式化され
た表現であって、それ等の内容がCRT(即ち、窓メモ
リ)の表面上の窓内に表示される。プレーン1において
、窓はプレーン1の境界内の中実の(solicl)長
方形82によって表わされている。プレーン1に含まれ
るメモリ内にあるすべての情報は中実の長方形82の境
界内のその情報を除いてCRTの表面上にディスプレイ
される。同様に、プレーン2はその面上に示された点線
の長方形83の境界内のその情報のみをディスプレイす
る。換言すれば、プレーン1内の中実の長方形82はプ
レーン2上の点線の長方形82に対応しており、そして
プレーン1内の長方形82にない情報がディスプレイさ
れ、プレーン2内の長方形83内のその情報のみがディ
スプレイされる。*た第4図に示された如く、ブレーン
1内の長方形82(即ち、窓)は負の下方部分の方に示
された水平な窓境界(window boundary
)と、負の側部の方に指示された垂直な窓境界とを有し
ている。第2図及び第3図に関して論述される回路は水
平な境界及び垂直な境界の双方をまず第1に決定する回
路であり、これ等の2つの境界が一致するとき、窓は存
在すると宣言される。窓が存在すると宣言されたとき、
CRTにディスプレイされるべ訃メモリのためのアドレ
スはブレーン2から取り出される。窓が存在しないと宣
言されれば、ブレーン1内のメモリはアドレスされる。
第2図は図に示された如(、相互に接続された窓検出回
路41を示しており、これに注目する。
垂直(Vertical)境界検出回路42は窓の垂直
境界を検出し、一方水平(horizontal)境界
検出回路43が窓の水平境界を検出する。垂直境界検出
回路42は下記の如く機能する。ラッチ46(例えばモ
トローラ(Motorola)による7474)はパス
74を経てマイクロプロセッサ11(第1図)からスタ
ート値をロードされる。同様にラッチ47(例えば、7
474)はパス37を経てマイクロプロセッサ11(第
1図)からストップ値をロードされる。カウンタ48は
カウンタ48のロード入力に印加される、リード線44
上の垂直ブランキング信号の制御下でラッチ46から初
期値をロードされる。カウンタ48はモトローラによっ
て製造されたモデル74161である。カウンタ49は
そのロード入力に印加されるリード線44上の垂直ブラ
ンキング信号の制御下でラッチ47から初期値をロード
される。カウンタ49はモトローラによって製造それた
モデル74161である。ラッチ46内に記憶された値
はカウンタ48が所望の点で(例えば垂直窓境界が始ま
るべきところ)オーバー70−するようになっている。
同様に、カウンタ49はラッチ47から値をロードされ
て、カウンタ49が所望の点で(例えば垂直窓境界が終
るべきところ)オーバー70−するようになっている。
カウンタ48からのオーバー70−信号はリード線51
によってフリップ・フロップ53(例えば74109)
のJ−人力に印加される。リード線52上のカウンタ4
9からのオーバーフロー信号はフリップ・フロップ53
のに一人力に印加される。フリップ・フロップ53のQ
−出力は窓が存在すると見なされたとき論理1信号であ
り、窓が存在しないと見なされ−たとき論理0信号であ
る。
フリップ・フロップ53のQ−出力はリード線54を経
てアンドデート56の1方の入力に印加される。
水平境界検出回路43は回路42と同様な様式でオペレ
ートする。ラッチ57(例えば、7474)はバス37
を経てマイクロプロセッサ11(第1図)からスタート
値をロードされる。同様に、ラッチ58(例えば747
4)はバス37を経てマイクロプロセッサ11(第1図
)からストップ値をロードされる。カウンタ61(例え
ば、a74161)はカウンタ61のロード入力に印加
されるリード線63上の水平ブランキング信号の制御の
下でラッチ57から初期値をロードされる。ラッチ57
からカウンタ61に印加された初期値は、所望の点で、
即ち水平窓境界がスタートすべきところでオーバ70−
が生ずるようになっている。同様に、カウンター62(
例えば、a74161)はそのロード入力に印加される
、リード116B上の水平ブランキング信号の制御下で
ラッチ58から初期値°をロードされる。ラッチ58か
らカウンタ62に印加される初期値は、所望の点で、即
ち水平窓境界がストップしたいところでオーバ70−が
生ずるようになっている。リード線64上のカウンタ6
1からのオニバフ0一信号はフリップ・フロップ66の
J−人力に印加される。リード線67上のカウンタ62
からのオーバ70−信号は7リツプ・7aツブ66のに
一人力に印加される。
リード線68上の7リツプ・プロップ66のQ−出力は
アンドデート56の入力の1方に印加される。リード1
16B上の7リツ゛ブ・70ツブのQ−出力は窓が存在
するとみなされるとき論理1であり、そして窓が存在し
ないと見なされるとき論理0である。その結果、アンド
デート56の出力(す−ド線59上の)は窓が存在する
とき論理1であり、そして窓が存在しないと見なされる
とき論理0である。
ディスプレイスクリーンの上方部分に中心のある、約5
インチ(約127m+e)平方の窓に対する例示的な実
施例として、ラッチ46内に記憶された値はFFA(1
6進方で)であり、ラッチ47内に記憶された値はFE
B(16進法で)であり、ラッチ57内に記憶された値
はEl(16進法で)であり、そして最後に、ラッチ5
8内に記憶された値はEA(16進法で)である。
第3図はアドレスモレ225フ回路69を示している。
アドレスモレ2292回路69の機能はどのアドレスが
メモリ21(第1図)に印加されるかを選択することで
ある。換言すると、アドレスが窓なしくnon−win
dow)メモリプレーンに対するアドレスであるか、又
はそれが窓メモリプレーンに対するアドレスであるか?
ラッチ71(例えば、モトローラによらて製造されたモ
デル7474)はバス37を経てマイクロプロセッサ1
1(第1図)からスタートアドレスを受けとる。ラッチ
71内のこのアドレスは、カウンタ72の負荷六方に印
加される、リード[73上の垂直ブランキング信号の制
御下で、窓なしアドレスカウンタ72内にロードされる
。カウンタ72の出力は窓なしメモリプレーン、即ち第
4図のプレーン1に対するアドレスである。これ等は1
6ビツトアドレスであり、そしてバス74を経て、マル
チプレクサ(例えば、74157)のA人力に印加され
る。
ラッチ77はバス37を経てマイクロプロセッサ11(
第1図)からスターティングアドレスを受けとる。窓7
ドルスカウンタ78はそのロード入力に印加されるリー
ド線79上の垂直ブランキング信号の制御下でラッチ7
7の内容をロードされる。カウンタ78の出力は、第4
図のプレーン2に示された窓83に含まれている情報の
ためのアドレスを含んでいる16ビツトパス81である
バス81はマルチプレクサ76のB−人力に印加される
。マルチプレクサ76の出力は16ビツトパス37であ
り、これはメモリ2(第1図)にアドレスをキャリする
。バス37は両方向バスであり、そして窓制御回路36
をバス12に接続するのと同じ第1図及び第2図に示さ
れたバスであることに注目すべきである。
クロックAは周波数22.222キロヘルツを有してい
る方形波である(水平ブランキング信号と同じ)。
クロックBは周波数1.23767〃ヘルツを有してい
る方形波である。ライン44.73及び79上の垂直ブ
ランキング信号の周波数は60ヘルツである。垂直ブラ
ンキング信号は矩形波形を有しており、且つ周期の95
.38パーセントに対して低レベル(low)である。
ライン63上の水平ブランキング信号の周波数は22.
222キロヘルツ(45マイクロ秒の周期)である。水
平ブランキング信号の波形は周期の80.357パーセ
ントに対して低レベルである信号を有している矩形波で
ある。
上述の実施態様において、窓の境界の大きさは水平方向
に16絵索(picture element)の個別
ステップに増分され、そして垂直方向に1絵素まで増分
されることに注目すべきである。16絵索のステップ以
外によって水平方向に窓を調整することが望まれるとき
は、これはファームウェア(fir−m ware)の
制御下で行なわれることができる。)アームウェア(即
ち、ソフトウェア)は従っで1方のメモリプレーンから
他方のメモリプレーンにf’ −タを転送するのに使用
される;即ち、窓境界が8絵索(16の代りに)のステ
ップで増分されるべきであれば、ファームウェアは1方
のメモリプレーンから他方のメモリプレーンにディスプ
レイ情報の8絵索を転送する。この境界領域(boun
daryarea)(即ち、8絵素幅)のスクローリン
グはまた窓におけるスクローリングに対応するように7
アームウエアの制御下にある。
【図面の簡単な説明】
tlS1図は主な構成要素の相互接続を示しているCR
Tディスプレイユニットの簡単化された全ブロック線図
である; 第2図は窓検出信号を決定する回路を示している簡単化
されたブロック線図である; 第3図は窓又は窓なしアドレスカウンタのいづれかから
のメモリアドレス選択を示している簡単化されたブロッ
ク線図である;そして 第4図は本発明の作動の背後の概念を単に目に見えるに
するための2平面のメモリ(1つの窓メモリ、1つの窓
なしメモリ)の様式化された表現である。 10・・・コンピュータシステム 11・・・マイクロプロセッサ 12・・・16ビツトバス 13・・・CRT制御器 14.23,27,32.38・・・バッフ746.4
7,5.7,58,71.77・・・ラッチ48.49
,61.62・・・カウンタ53.66・・・フリップ
・フロップ 56・・・アンドデート 72.78・・・アドレスカウンタ 76・・・マルチプレクサ ダ2図 噸 都

Claims (1)

  1. 【特許請求の範囲】 1、ビット・マップドデータデイスプレイシステムにお
    ける陰極線管(CRT)の面上に独立の、スクロール可
    能なデイスプレイ領域を生成する制御回路において: 垂直軸線に沿って該独立デイスプレイ領域の開始を検出
    する第1の垂直境界検出手段と; 該垂直軸線に沿って独立デイスプレイ領域の終了を検出
    する第2の垂直境界検出手段と; 水平軸線に沿って該独立デイスプレイ領域の開始を検出
    する第1の水平境界検出手段と; 該水平軸線に沿って該独立デイスプレイ領域の終了を検
    出する第2の水平境界手段と; 該第1及び第2の境界検出手段並びに該第1及び第2の
    水平境界手段に応答して、存在する該独立デイスプレイ
    領域を指示する第1の値と、存在しない独立デイスプレ
    イ領域を指示する第2の値とを有する2進信号を生成す
    る制御手段と;そして 該2進信号に応答して、該独立デイスプレイ領域に属す
    るメモリアドレスか、又は該独立デイスプレイ領域に属
    しないメモリアドレスかのいづれかを選択するメモリア
    ドレス選択手段と を具備していることを特徴とする制御回路。 2、該制御手段が第1及び第2のフリップ・フロップと
    、アンドゲートとを具備していて、これ等が、該第1の
    フリップ・フロップが該第1の垂直境界検出手段及び該
    第2の垂直境界検出手段の双方からの信号に応答し:該
    第2のフリップ・フロップが該第1の水平境界検出手段
    及び該第2の水平境界検出手段の双方からの信号に応答
    し:そして該アンドゲートが該第1のフリップ・フロッ
    プ及び該第2のフリップ・フロップの双方からの出力信
    号に応答するように相互に接続されている特許請求の範
    囲第1項記載の制御回路。 3、ビット・マップドデータデイスプレイシステムにお
    ける陰極線管(CRT)の面上に独立スクロール可能な
    デイスプレイ領域を生成する方法において: 第1の軸線に沿って存在する独立領域を指示する第1の
    状態と、該第1の軸線に沿って存在しない該独立領域を
    指示する第2の状態とを有している第1の2進信号を生
    成すること; 第2の軸線に沿って存在する該独立領域を指示する第1
    の状態と、該第2の軸線に沿って存在しない該独立領域
    を指示する第2の状態とを有している第2の2進信号を
    生成すること; 該第1及び第2の2進信号の双方がそれ等の第1の状態
    にあるとき存在する該独立領域を指示する第1の状態と
    、該第1及び第2の2進信号の双方がそれ等の第1の状
    態にあるとき、存在しない該独立領域を指示する第2の
    状態とを有している第3の2進信号を生成するように該
    第1及び第2の2進信号を組合わせること;そして 該第3の2進信号に応答して第1のアドレスソース又は
    第2のアドレスソースのいづれかを選択することを含む
    ことを特徴とする方法。 4、該第1の状態が論理1である特許請求の範囲第3項
    記載の方法。 5、更に該第1のアドレスソースによってアクセスされ
    る記憶手段から該第2のアドレスソースによってアクセ
    スされる記憶手段に、ソフトウエアの制御の下で、デー
    タを移動することを含み、これによって該CRTの面上
    にデイスプレイされるとき独立スクロール可能なデイス
    プレイ領域の水平境界の位置の精密な制御が達成される
    特許請求の範囲第4項記載の方法。
JP60125277A 1984-06-11 1985-06-11 デイスプレイ領域を生成する制御回路及び方法 Pending JPS6113291A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US619373 1984-06-11
US06/619,373 US4633415A (en) 1984-06-11 1984-06-11 Windowing and scrolling for a cathode-ray tube display

Publications (1)

Publication Number Publication Date
JPS6113291A true JPS6113291A (ja) 1986-01-21

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