JPS6092646A - 二層構造リ−ドフレ−ム - Google Patents
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は半導体装置の構成部品であるリードフレームを
改良した二層構造リードフレームに関する。
改良した二層構造リードフレームに関する。
従来のリードフレームは、第1図、第2図に示すように
吊りピン1で保持されたアイランド20周辺に、放射状
にインナーリード3が配置された構成となっている。こ
の構造のリードフレームにおいて、第3図、第4図に示
す如く半導体素子4をアイランド2上にマウントし、メ
ンディングワイヤ6にて半導体素子4の一1極部とイン
ナーリード3と全配線する。
吊りピン1で保持されたアイランド20周辺に、放射状
にインナーリード3が配置された構成となっている。こ
の構造のリードフレームにおいて、第3図、第4図に示
す如く半導体素子4をアイランド2上にマウントし、メ
ンディングワイヤ6にて半導体素子4の一1極部とイン
ナーリード3と全配線する。
第5図に示すようにインナーリード3の先端近傍の幅a
、及びインナーリード3どうしの間隔すには、リードフ
レームの製作上及びメンディングワイヤ5による配線上
の制限により、最小値が決まっている。その値はリード
フレームの厚さにも依存し1例えはリードフレームの厚
さが0.25 wgとすると、a、b共に0.2111
1程度である。従って第5図に示すアイランド中心6か
らインナーリード3先端までの距離eI 。
、及びインナーリード3どうしの間隔すには、リードフ
レームの製作上及びメンディングワイヤ5による配線上
の制限により、最小値が決まっている。その値はリード
フレームの厚さにも依存し1例えはリードフレームの厚
さが0.25 wgとすると、a、b共に0.2111
1程度である。従って第5図に示すアイランド中心6か
らインナーリード3先端までの距離eI 。
lヨを決めれば、幾何学的にインナーリード3の最大値
も決まる。逆に云うとインナーリード3の数により、最
小の距離11 、llの値が決まる。現在インナーリー
ド3の数が100本程度のものもあシ、そのときの距離
1..1.の値は約6 mmと極めて大きい。tll、
i、の値に比べ、半導体素子4の機能上必要な大きさが
”zxg、−6’tたは2 X 1t−6”Wigより
小さくなった場合、即ちワイヤがンディング距離が3謔
を超える場合、自動マリンによるワイヤがンデイングが
極めて困難または不可能になってしまう。これを解決す
るには、半導体素子4を大きくシ、ワイヤゴンディング
距離を短がくするしかないが、半導体素子のコスト高と
なり、更に多ピンになった場合問題は深刻になる。
も決まる。逆に云うとインナーリード3の数により、最
小の距離11 、llの値が決まる。現在インナーリー
ド3の数が100本程度のものもあシ、そのときの距離
1..1.の値は約6 mmと極めて大きい。tll、
i、の値に比べ、半導体素子4の機能上必要な大きさが
”zxg、−6’tたは2 X 1t−6”Wigより
小さくなった場合、即ちワイヤがンディング距離が3謔
を超える場合、自動マリンによるワイヤがンデイングが
極めて困難または不可能になってしまう。これを解決す
るには、半導体素子4を大きくシ、ワイヤゴンディング
距離を短がくするしかないが、半導体素子のコスト高と
なり、更に多ピンになった場合問題は深刻になる。
本発明は上記実情に鑑みてなされたもので。
ワイヤビンディング距離を急くするものでありながら、
多数のインナーリードが配置できるようにした二11#
構造リードフレームを提供しようとするものである。
多数のインナーリードが配置できるようにした二11#
構造リードフレームを提供しようとするものである。
本発明は、絶縁シートの両面にリードフレームを接1す
ることにより、少なくともインナーリード部を2111
構造としたものである。
ることにより、少なくともインナーリード部を2111
構造としたものである。
以下図面を膠照して本発明の一実施例を説明する。第6
図、@7図は同実施例を示すが、これは前記従来のもの
と対応させた場合の例であるから、対応個所には適宜同
一符号を用いる。
図、@7図は同実施例を示すが、これは前記従来のもの
と対応させた場合の例であるから、対応個所には適宜同
一符号を用いる。
即ち従来と同様な登載リードフレームの上に。
そのアイランド2と、インナーリード3B先端が例えば
0.3〜0.5 IK程度覗くような孔8のあいた例え
ばポリイずドでつくられた厚さ0.05〜0.2 m程
度の絶縁シート7を被せ、更にその上ニアイランドを有
しないリードフレーム(ここではインナーリード3bの
み示される)′fr:被せた構造とする。
0.3〜0.5 IK程度覗くような孔8のあいた例え
ばポリイずドでつくられた厚さ0.05〜0.2 m程
度の絶縁シート7を被せ、更にその上ニアイランドを有
しないリードフレーム(ここではインナーリード3bの
み示される)′fr:被せた構造とする。
上記リードフレームと絶縁シート7との固定は1例えば
エポキシ系の接着剤を予め絶縁シート7の両面に塗布し
ておき、この両面にリードフレームを挾むように被せ、
その後上紀接曹剤を固化させるという方法により達成す
ればよい。
エポキシ系の接着剤を予め絶縁シート7の両面に塗布し
ておき、この両面にリードフレームを挾むように被せ、
その後上紀接曹剤を固化させるという方法により達成す
ればよい。
しかして本構成は、先に述べた如く下層のリードフレー
ムのインナーリード3a先端が0.3〜0.5龍程匣覗
くように絶縁シート7に孔8がおいているか、アイラン
ドを有しない上層のリードフレームのインナーリード3
b先端は、その絶縁シート7の孔8の際近くまで延びて
いる。
ムのインナーリード3a先端が0.3〜0.5龍程匣覗
くように絶縁シート7に孔8がおいているか、アイラン
ドを有しない上層のリードフレームのインナーリード3
b先端は、その絶縁シート7の孔8の際近くまで延びて
いる。
この二層構造をしたリードフレームに、第8図。
第9図に示すように半・導体素子4を19ン卜し。
上下のインナーリード:i m 、 3 bと半導体素
子4の電極部ftデンディングワイヤ5で配線すること
になるものである。
子4の電極部ftデンディングワイヤ5で配線すること
になるものである。
本発明のリードフレームは、二層構造とすることによシ
従来に比べ、同−設計基準でIPJ2’倍のインナーリ
ードを配置することができ、今までのようにワイヤボン
ディング距離が大きすぎるにもかかわらず歩留1品貴、
マシンインデック等の低下の犠牲の上に生産するとか、
または?ンディング距離を矩かくするために価格上昇に
は目をつぶり、半導体素□子の外形寸法を大きくすると
いった妥協策をとる必要性を大きく緩和してくれる。ま
たリードフレーム設計上寸法的に自由度が増し、インナ
ーリード部及びそれらの間隔を6最小値十α”とする余
裕が生まれ。
従来に比べ、同−設計基準でIPJ2’倍のインナーリ
ードを配置することができ、今までのようにワイヤボン
ディング距離が大きすぎるにもかかわらず歩留1品貴、
マシンインデック等の低下の犠牲の上に生産するとか、
または?ンディング距離を矩かくするために価格上昇に
は目をつぶり、半導体素□子の外形寸法を大きくすると
いった妥協策をとる必要性を大きく緩和してくれる。ま
たリードフレーム設計上寸法的に自由度が増し、インナ
ーリード部及びそれらの間隔を6最小値十α”とする余
裕が生まれ。
その結果ワイヤビンディング距離における歩留向上1品
質向上、マシン稼動率向上等の副次的な効果も期待でき
る。更にインナーリードは絶縁1y−)GCC接置固定
れているので、?ラントないしモールドの各工程におい
てリードの踊りがおさえられ、よυ安定した品質の製品
を生むことにもなるものである。
質向上、マシン稼動率向上等の副次的な効果も期待でき
る。更にインナーリードは絶縁1y−)GCC接置固定
れているので、?ラントないしモールドの各工程におい
てリードの踊りがおさえられ、よυ安定した品質の製品
を生むことにもなるものである。
第1図は従来のリードフレームのアイランド付近の要部
を示す平面図、第2図は同断面図。 第3図は従来のリードフレームに半導体素子のマウント
とワイヤーがンディングをした状態の平面図、第4図は
同断面図、第5図は従来のリードフレームのアイランド
付近の要部を示す平面図、第6図は本発明の一実施例の
要部を示す平面図、第7図は同断面図、第8図は本発明
のリードフレームに半導体素子のマウントワイヤーがン
デイングをした状態の平面図、tPJ9図は同断面図1
である。 2・・・アイランド、3・・・インナーリード、+da
、Jb・・・インナーリード、4・・・半導体素子。 7・・・絶縁シート。 出願人代理人 弁理士 鈴 江 武 彦第1図 第6図 ja Z Ja 第8図 ! 第9図
を示す平面図、第2図は同断面図。 第3図は従来のリードフレームに半導体素子のマウント
とワイヤーがンディングをした状態の平面図、第4図は
同断面図、第5図は従来のリードフレームのアイランド
付近の要部を示す平面図、第6図は本発明の一実施例の
要部を示す平面図、第7図は同断面図、第8図は本発明
のリードフレームに半導体素子のマウントワイヤーがン
デイングをした状態の平面図、tPJ9図は同断面図1
である。 2・・・アイランド、3・・・インナーリード、+da
、Jb・・・インナーリード、4・・・半導体素子。 7・・・絶縁シート。 出願人代理人 弁理士 鈴 江 武 彦第1図 第6図 ja Z Ja 第8図 ! 第9図
Claims (1)
- (1) 絶にシートの両面にリードツレ−ムラ接着する
ことによシ、少くともインナーリード部を2層構造とし
たことを特徴とする二層構造リードフレーム。 (21前記インナーリード部は、半導体素子を1ドフレ
ーム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58201305A JPS6092646A (ja) | 1983-10-27 | 1983-10-27 | 二層構造リ−ドフレ−ム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58201305A JPS6092646A (ja) | 1983-10-27 | 1983-10-27 | 二層構造リ−ドフレ−ム |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6092646A true JPS6092646A (ja) | 1985-05-24 |
Family
ID=16438794
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58201305A Pending JPS6092646A (ja) | 1983-10-27 | 1983-10-27 | 二層構造リ−ドフレ−ム |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6092646A (ja) |
Cited By (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62229951A (ja) * | 1986-03-31 | 1987-10-08 | Toshiba Corp | 半導体集積回路装置 |
US4801996A (en) * | 1987-10-14 | 1989-01-31 | Hewlett-Packard Company | Gigahertz rate integrated circuit package incorporating semiconductive MIS power-line substrate |
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WO1990016079A2 (en) * | 1989-06-09 | 1990-12-27 | Lee Jaesup N | Low impedance packaging |
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US5168368A (en) * | 1991-05-09 | 1992-12-01 | International Business Machines Corporation | Lead frame-chip package with improved configuration |
US5296744A (en) * | 1991-07-12 | 1994-03-22 | Vlsi Technology, Inc. | Lead frame assembly and method for wiring same |
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US20110309483A1 (en) * | 2007-10-19 | 2011-12-22 | Rohm Co., Ltd. | Semiconductor Device |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5462778A (en) * | 1977-10-28 | 1979-05-21 | Toshiba Corp | Laminated frame for power ic |
JPS589585A (ja) * | 1981-07-06 | 1983-01-19 | Toshiba Corp | ブラシレス同期電動機の始動制御装置 |
-
1983
- 1983-10-27 JP JP58201305A patent/JPS6092646A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
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