JPS6088549U - アナログ・デイジタル混在集積回路 - Google Patents
アナログ・デイジタル混在集積回路Info
- Publication number
- JPS6088549U JPS6088549U JP18023083U JP18023083U JPS6088549U JP S6088549 U JPS6088549 U JP S6088549U JP 18023083 U JP18023083 U JP 18023083U JP 18023083 U JP18023083 U JP 18023083U JP S6088549 U JPS6088549 U JP S6088549U
- Authority
- JP
- Japan
- Prior art keywords
- analog
- integrated circuit
- digital mixed
- digital
- mixed integrated
- Prior art date
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- Pending
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- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案による一実施例の要部断面図、第２図は
同平面図である。 １：基板、２：ディジタル信号ライン、３゜５：層間絶
縁膜、４：ポリシリコン、６：アナログ信号ライン、７
：配線。
同平面図である。 １：基板、２：ディジタル信号ライン、３゜５：層間絶
縁膜、４：ポリシリコン、６：アナログ信号ライン、７
：配線。
Claims (1)
- 同一半導体チップ内にアナログ信号処理回路とディジタ
ル信号処理回路が混在してなる集積回路において、アナ
ログ信号ラインとディジタル信号ラインが交差する両信
号ラインの間隙に、一定電位が与えられたポリシリコン
を介挿し、該ポリシリコンによってアナログ信号ライン
をディジタル信号から遮断してなることを特徴とするア
ナログ・ディジタル混在集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18023083U JPS6088549U (ja) | 1983-11-22 | 1983-11-22 | アナログ・デイジタル混在集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18023083U JPS6088549U (ja) | 1983-11-22 | 1983-11-22 | アナログ・デイジタル混在集積回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6088549U true JPS6088549U (ja) | 1985-06-18 |
Family
ID=30390836
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18023083U Pending JPS6088549U (ja) | 1983-11-22 | 1983-11-22 | アナログ・デイジタル混在集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6088549U (ja) |
-
1983
- 1983-11-22 JP JP18023083U patent/JPS6088549U/ja active Pending
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