JPS607281A - 表示回路 - Google Patents

表示回路

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Publication number
JPS607281A
JPS607281A JP58114957A JP11495783A JPS607281A JP S607281 A JPS607281 A JP S607281A JP 58114957 A JP58114957 A JP 58114957A JP 11495783 A JP11495783 A JP 11495783A JP S607281 A JPS607281 A JP S607281A
Authority
JP
Japan
Prior art keywords
pulse
counter
circuit
noise
supplied
Prior art date
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Pending
Application number
JP58114957A
Other languages
English (en)
Inventor
Toyoji Yabe
矢部 東洋治
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
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Filing date
Publication date
Application filed by Sony Corp filed Critical Sony Corp
Priority to JP58114957A priority Critical patent/JPS607281A/ja
Publication of JPS607281A publication Critical patent/JPS607281A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N7/00Television systems
    • H04N7/025Systems for the transmission of digital non-picture data, e.g. of text during the active part of a television frame
    • H04N7/0255Display systems therefor

Landscapes

  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Television Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 この発明は、テレテキストなどにお心」る表ボ回1−各
に関する。
背景技術とその問題点 テレビ文字多重放送の受信部あるいは受信用アダプタは
、例えば第1図にネオように構成されCいる。
すなわち、第1図において、映像検波回路(図示せず)
からのビデオ信号が、入力端子(1)からスライス回路
(2)を通して人力データ取り込め処理回路(3)に供
給されると共に、そのビデオ信号がクロック再生回路(
4)に供給されてクロックが肖ヰされ、このクロックが
処理回路(3)に供給されてビデオ(i?号中の文字信
号がバッフアメ′F:1月5)に一度貯えられる。
そして、このメモリ(5)の文字信号が、マイクロコン
ピュータ(6)に(l給されて処理され、表示に必要な
データが表示メモリ回路(7)に順次71き込まれる。
また、端子(1)からのビデオ信号が同期分l111を
回路(11)に(jt給されて水平同期パルスPl+が
取り出され、このパルスphがPLL(12)に供給さ
れて周波数364f h (”5.73MIIz 6f
 hは水平周波数)で、パルスP I+に同期したクロ
ックCL Kが形成され、このクロックCL■(が読の
出しアドレス制御回路(16)に供給されると共に、こ
のクロックが1/ 364分周を行うカウンタ(13)
に供給されて第2囚人にンバずように水47周期のパル
スQ、hが取り出され、このパルスQbが制御回路(1
6)に供給される。
さらに、カウンタ(13)から周波数2fhのパルスが
取り出され、このパルスが1/ 525分周を行うカウ
ンタ(14)にカウント人力として供給されると共に、
同期分1’sIt回路(11)から複合同期パルスが垂
直同期検出回路(17)に供給されて第2しIB、Dの
左側(第2図り以降は、時間軸を圧縮L7て示ず)にボ
ずように垂直同期パルスpvが取り出され、このパルス
Pvがカウンタ(14)にリセット人力として供給され
る。従っC、カウンタ(14)のカラン1−値は、第2
t4VIC,Eの左側に示すようにパルスPVO時点に
10」からスタートし、パルスQ hの2周期ごとに「
1」づづインクリメントされていき、次のパルスl) 
vの時点の1つ前ではr’524Jになる。
そしC1ごのカウンタ(14)のカランI・値がデコー
ダ(15)に供給され、第2図Fの左側に月くずように
パルスPvに同期した〕1ム直周期のパルス。νが取り
出されて制御回路(I6)に供給されると共に、複合同
期パルスQcも取り出される。
そして、制御回路(16)におい”ζ、パルスC1,、
K 。
Qh、Qvにより水平走査位置及び垂直走査位置に対応
した読み出しアドレス信号が形成され、このアドレス信
号がメモリ回1/3 te+に供給されて表示データが
読み出されると共に三原色信号R,G、B及び輝度信号
Yに変換され′ζ表示モニタ(8)に供給される。また
、複合同期パルスQcも゛εεツタ81に供給される。
従って、モニタ(8)に文字放送による画面を表子でき
る。
そして、この場合、カウンタ(14)は11525分周
を使っているので、検出回路(17)が垂直同期パルス
PVの検出ミスを生じたとしても、パルスQv 、Qc
を得ることができ、同期がはずれることばない。
さらに、端子(11のビデオ信号がなくなっても、PL
L(12)はフリーランで発振し、しがも、その発振回
路のQは向く、水平周波数fhにきわめて近い周波数で
発振しているので、カウンタ(13)(14)は正常に
動作し、従って、パルスCL K 。
Ql+ 、Qv 、Qcは正常に形成されるので、メモ
リ回路(7)に表示データカ<7!1き込まれていれば
、その画像を安定に表示できる。
ところが、この場合、検出回路(17)は、人力ビデオ
信号から分離された複合同期パルスを積分及びスライス
して垂直同期パルスPvを検出しているので、入力ビデ
オ信号にノイズが重畳していたり、あるいはチューナが
空きチャンネルにセットされ°(/イズだけになったり
すると、第2図りの右側に承ずように検出回IM(17
)からは垂直同期パルスPV以外にノイズパルスN P
 (ffs 2 図りにX印を付けてポず)が得られ、
このノイズパルスNPによりカウンタ(14)がリセッ
トされ”ζしまう。従って、この場合には、カウンタ(
14)のカウント値は第2図Eの右側に示すように変化
するので、デコーダ(14)からの垂直同期パルスQv
は、第2図Fの右側に示すように不規則になってしまう
そして、パルスQνがこのように不規則のときには、制
御回路(16)におい゛ζ形成される読み出しアドレス
信号が乱れるので、画面の内容は乱れてしまう。また、
このとき、同期パルス(λCも不規則になるので、画面
が流れζしまう。
発明の目的 この発明は、このような点にかんがみ、耐ノイズ性を向
上させようとするものである。
発明の概要 このため、この発明においては、正規の訓直同期パルス
Pvが得られる期間だけ“1”となるウィンドウ信号を
形成し、このウィンドウ龜)によりノイズパルスN、を
有する垂直同期パルスl) vをゲートして正規の垂直
同期パルスPvだりをカウンタ(14)に供給するよう
にしたものである。
実施例 すなわち、例えば第3図に不ずように、パルスQhが9
ビツトのカウンタ(21)にカラン1−人力として(j
(給されると共に、パルスP■がカウン1(21)にリ
セット人力とし′C供給され、このカウンタ(21)の
カウント値が検出回路(22) !こ供給される。
この検出回路(22)は、カウンタ(21)のカウント
値がr’262Jになづたとき、これを検出するもので
、その検出出力Q22はカランI・値がr262Jの期
間だけ“1”になる。そして、この検出信号Q22が、
立ぢ」二がりトリガタイプのRSフリ・ノフ。
フロップ(23)にセ1.ト人力として供給されると共
に、パルスPvがインバータ(24)を通してソリツブ
フロップ(23)にリセ・ント人力とし”ζ供給される
。さらに、パルスpvがアンド回Il!8(25)に供
給されると共に、フリップフロ・ンプ(23)の出力Q
23がアンド回路(25)に供給され、アンド回路(2
5)の出力信号Q25がカウンタ(14)4こiJ上セ
ツト力として供給される。
従って、第4図Aの左側に示すように、ノ〈パルスPv
にノイズパルスNPが混入していなし)場合Gこは、カ
ウンタ(21)はパルスQhをカウントすると共に、パ
ルスPvによりリセ・ノドされるので、。
カウント値は、パルスPVO時点に「0」からスター(
・シてr262Jまでを繰り返す。
そして、このとき、第5図Aにンムずように時点t1に
262番目のパルスQhがカラン7 (21)に供給さ
れると、第5図゛Bに示すように、検出回路(22)の
出力Q22が“0゛からI″になり、この信号Q22に
よりフリップフロップ(23)がセットされるので、第
5図Cにλマずように、信号(ユ23は“′1″になる
そして、時点t2に、第5図1〕に示すようにパルスP
vが1”になると、これに上りカウンタ(21)がリセ
ットされ、Q22−“O”となる。
続いて262番目と263番目のパルスQ I+の中火
の時点t3になると、pv=’“0′′になるが、これ
によりフリップフロップ(23)はリセットされるので
、Q23−“0”となる。
そして、アンド回路(25)において、パルス+Pvば
信号Q23によりゲートされているので、アンド回路(
25)からは第5図E及び第4銘1cの左側に示すよう
に、パルスl) vと同しパルスQ25が得られる。そ
して、このパルス0匹がカウンタ (14)にリセット
人力として(」(給されているので、カウンタ(14)
からは上述のように正しい垂直同期パルスQv及び複合
同期パルスQc、が得られる。
一方、第4図Aの右側に示すようにパルスPVにノイズ
パルスNPが混入している場合には、カウンタ(21)
はこのノイズパルスNPによってもリセットされるので
、第4図Bの右側に示すように、ノイズパルスNpのと
きには、カウンタ(21)のカウント値は+ 2624
に達しない。従つ”C、ノイズパルスNPのときには、
Q22−“0″のままであるから023−“0”のまま
であり、従つ°ζ、そのノイズパルスNPはアンド回1
?δ(25)において阻止され、アンド回路(25)か
らは、第4図Cの右側に小ずようにパルスPvに対応し
たパルスQ25だりがeJられる。
従って、カウンタ(14)のカウンントは正常に1−1
われ、正規のパルス(IV 、 (lcが得られる。な
お、このとき、本来のパルスpvの前にノイズパルスN
Pがあると、続(パルスPvもアンド回113(25)
において阻止されてパルスQ2SがIMられないが、上
述のように、カウンタ(14)は11525分周を行っ
ているので、パルスQ25が得られなくても、同11.
Itがはずれることはない。
こうし°ζ、この発明によれば、耐ノイズ性が大幅に向
上し、ビデオ信号にノイズが含まれたりしても、画面の
内容が乱れたり、画面の同期が流れたりすることがない
なお、上述において、カウンタ(2I)に供給されるパ
ルスPv、Qhに代えでパルスPh、C1,にとし、検
出回路(22)においir l 364 Jを検出する
と共に、アンド回路(25)の出力でカウンタ(13)
ヲリセソトずれば、パルスP t+について同様に耐ノ
イズ性を向上できる。
発明の効果 耐ノイズ性が向上し、画面の内容が乱れたり、画面の同
期が流れたりすることがない。
【図面の簡単な説明】
第1図、第2図、第41g+、第5図はこの発明を説明
するための図、第3図はこの発明の一例の接続図である
。 (21)はカウンタ、(22)は検出回1洛である。

Claims (1)

    【特許請求の範囲】
  1. ビデオ信号の同期パルスに同期した基準パルスをアドレ
    ス制御回路に供給して読め出しアドレス信号を形成し、
    この読み出しアドレス信号を表示メモリ回路に供給して
    表示データを読み出し、この読み出された表示データを
    表示モニタに供給して文字画像情報を表示するようにし
    た表示回路において、上記基準パルスをカウントして上
    記同期パルスの位置を示すウィンドウ信号を形成し、こ
    のウィンドウ信号で」二記同期パシスヲ’r”−1−L
    、このゲート出力により上記基準パルスをリセ・ノド」
    ゛るようにした表示回路。
JP58114957A 1983-06-24 1983-06-24 表示回路 Pending JPS607281A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58114957A JPS607281A (ja) 1983-06-24 1983-06-24 表示回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58114957A JPS607281A (ja) 1983-06-24 1983-06-24 表示回路

Publications (1)

Publication Number Publication Date
JPS607281A true JPS607281A (ja) 1985-01-16

Family

ID=14650826

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Application Number Title Priority Date Filing Date
JP58114957A Pending JPS607281A (ja) 1983-06-24 1983-06-24 表示回路

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JP (1) JPS607281A (ja)

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