JPS606589B2 - カラ−撮像装置 - Google Patents
カラ−撮像装置Info
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- JPS606589B2 JPS606589B2 JP54157155A JP15715579A JPS606589B2 JP S606589 B2 JPS606589 B2 JP S606589B2 JP 54157155 A JP54157155 A JP 54157155A JP 15715579 A JP15715579 A JP 15715579A JP S606589 B2 JPS606589 B2 JP S606589B2
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N23/00—Cameras or camera modules comprising electronic image sensors; Control thereof
- H04N23/10—Cameras or camera modules comprising electronic image sensors; Control thereof for generating image signals from different wavelengths
- H04N23/13—Cameras or camera modules comprising electronic image sensors; Control thereof for generating image signals from different wavelengths with multiple sensors
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Testing, Inspecting, Measuring Of Stereoscopic Televisions And Televisions (AREA)
- Processing Of Color Television Signals (AREA)
Description
【発明の詳細な説明】
本発明は力ラー撮像装置に関し、特に映像信号のホワイ
トバランスを容易に且つ正確に調整し、ホワイトバラン
スがとれたことの表示をするものである。
トバランスを容易に且つ正確に調整し、ホワイトバラン
スがとれたことの表示をするものである。
一般に力ラー撮像装置にあっては、白い画面を撮影した
場合、赤、緑、青信号系より得られる信号レベルを等量
にすることによってホワイトバランスをとっている。
場合、赤、緑、青信号系より得られる信号レベルを等量
にすることによってホワイトバランスをとっている。
これは調整するのに非常に時間を要するため、第１図に
示すようにスイッチのオンオフ操作でホワイトバランス
が自動的に調整されるものが考えられている。第１図に
おいて、１はカメラヘッドとプロセス部を示し、この出
力端子２，３，４より得られる赤、緑、青信号を夫々の
伝送路を通じてェンコ−ダ５に供給し、標準テレビジョ
ン信号を得ている。
示すようにスイッチのオンオフ操作でホワイトバランス
が自動的に調整されるものが考えられている。第１図に
おいて、１はカメラヘッドとプロセス部を示し、この出
力端子２，３，４より得られる赤、緑、青信号を夫々の
伝送路を通じてェンコ−ダ５に供給し、標準テレビジョ
ン信号を得ている。
この例においては、赤信号および青信号伝送路に利得制
御回路６ａ，６ｂを介装すると共にこれら利得制御回路
６ａ，６ｂに、制御信号を供給して、その状態を保持す
る記憶回路Ｔａ，７ｂを設ける。この場合記憶回路７ａ
，７ｂには夫々互に連動する手動の常開スイッチＳ，，
Ｓ２を通して整流回路を含む比較減算回路８ａ，８ｂか
ら色信号の比較出力が供給される。即ち赤信号系側に設
けた記憶回路７ａには赤信号と緑信号との比較出力を供
給し、又青信号系側に設けた記憶回路７ｂには青信号と
緑信号との比較出力を供給する様になされている。記憶
回路７ａ，７ｂは手動スイッチＳ．亨Ｓ２を一旦オン操
作する事によりその時点の比較減算回路８ａ，８ｂの出
力が記憶され、スイッチＳ，，Ｓ２のオフの後はその状
態を保持し、その記憶レベルでもつて利得制御回路６ａ
− ６ｂを制御している。このようにスイッチＳ，，Ｓ
２をオンすることにより、負帰還ループが構成され「利
得制御回路６ａ，６ｂ出力と緑のレベルが等量になるよ
うに働き、スイッチＳ，，Ｓ２のオフの後はオフする前
の制御電圧で利得制御回路６ａ，６ｂを動作させている
。記憶回路としては第２図のＭＯＳＦＥＴ９と抵抗１０
とコンデンサ畳１によって構成した回路を使用する。こ
の記憶回路７ａ，７ｂはＭＯＳＦＥＴ９の入力インピー
ダンスが高いことを利用し、コンデンサー１に電荷を蓄
積して記憶している。しかしながら、この記憶回路７ａ
，７ｂでは、スイッチＳ，，Ｓ２と記憶回路７ａ，７ｂ
とのりード線や、ＭＯＳＦＥＴ９、コンデンサー１の露
出部が湿度によりコンデンサ１１に蓄積された電荷を放
電するので、長時間の記憶は不可能である。これを防止
するためリードリレー１２を用い、第２図の一点鎖線で
示す部分を樹脂でモールドしている。しかしこの方法で
も、ＭＯＳＦＥＴ９の入力インピーダンスに限りがある
ので、いずれはコンデンサー１の電荷は放電されてしま
う。以上のように、従来では、リードリレーを用いるた
め装置が大きくなり、非常に長時間の記憶が不可能であ
るという欠点があり、ホワイトバランスがあったかどう
か判別ができない。本発明は記憶時間を無限にし、且つ
小型化が可能な力ラー撮像装置を提供せんとするもので
ある。
御回路６ａ，６ｂを介装すると共にこれら利得制御回路
６ａ，６ｂに、制御信号を供給して、その状態を保持す
る記憶回路Ｔａ，７ｂを設ける。この場合記憶回路７ａ
，７ｂには夫々互に連動する手動の常開スイッチＳ，，
Ｓ２を通して整流回路を含む比較減算回路８ａ，８ｂか
ら色信号の比較出力が供給される。即ち赤信号系側に設
けた記憶回路７ａには赤信号と緑信号との比較出力を供
給し、又青信号系側に設けた記憶回路７ｂには青信号と
緑信号との比較出力を供給する様になされている。記憶
回路７ａ，７ｂは手動スイッチＳ．亨Ｓ２を一旦オン操
作する事によりその時点の比較減算回路８ａ，８ｂの出
力が記憶され、スイッチＳ，，Ｓ２のオフの後はその状
態を保持し、その記憶レベルでもつて利得制御回路６ａ
− ６ｂを制御している。このようにスイッチＳ，，Ｓ
２をオンすることにより、負帰還ループが構成され「利
得制御回路６ａ，６ｂ出力と緑のレベルが等量になるよ
うに働き、スイッチＳ，，Ｓ２のオフの後はオフする前
の制御電圧で利得制御回路６ａ，６ｂを動作させている
。記憶回路としては第２図のＭＯＳＦＥＴ９と抵抗１０
とコンデンサ畳１によって構成した回路を使用する。こ
の記憶回路７ａ，７ｂはＭＯＳＦＥＴ９の入力インピー
ダンスが高いことを利用し、コンデンサー１に電荷を蓄
積して記憶している。しかしながら、この記憶回路７ａ
，７ｂでは、スイッチＳ，，Ｓ２と記憶回路７ａ，７ｂ
とのりード線や、ＭＯＳＦＥＴ９、コンデンサー１の露
出部が湿度によりコンデンサ１１に蓄積された電荷を放
電するので、長時間の記憶は不可能である。これを防止
するためリードリレー１２を用い、第２図の一点鎖線で
示す部分を樹脂でモールドしている。しかしこの方法で
も、ＭＯＳＦＥＴ９の入力インピーダンスに限りがある
ので、いずれはコンデンサー１の電荷は放電されてしま
う。以上のように、従来では、リードリレーを用いるた
め装置が大きくなり、非常に長時間の記憶が不可能であ
るという欠点があり、ホワイトバランスがあったかどう
か判別ができない。本発明は記憶時間を無限にし、且つ
小型化が可能な力ラー撮像装置を提供せんとするもので
ある。
以下本発明の一実施例を図面を用いて詳細に説明する。
第３図の１〜５は第１図と同じものである。２，３，４
は夫々赤、緑、青信号の出力端子であり、夫々信号伝送
路を通してホワイトバランスのあった赤、緑、青信号が
ェンコーダ５へ供給されるようになっている。
は夫々赤、緑、青信号の出力端子であり、夫々信号伝送
路を通してホワイトバランスのあった赤、緑、青信号が
ェンコーダ５へ供給されるようになっている。
この実施例においては赤、青信号系に夫々利得制御回路
１３ａ，】３ｂを介袋しＤＡ変換器１４ａ，１４ｂの出
力で利得を制御し、利得制御回路１３ａ，１３ｂの出力
と緑信号のレベルをそれぞれ比較回路１５ａ，１５ｂで
比較し可逆計数回路１６ａ，翼６ｂの増減のための信号
を得ている。すなわち比較回路１５ａ？ １５ｂの出力
を用いてデジタル回路で構成された可逆計数回路１６ａ
？ １６ｂの増減の方向を決め、（ＣＰ）端子より供給
されるクロックパルスで駆動している。そしてこの可逆
計数回路亀６ａ亨 畳６ｂの出力計数をＤＡ変換器１４
ａ，量４ｂでＤＡ変換し、利得制御回路１３ａ，寛３ｂ
に制御信号として加えている。又比較回路１５ａ，１５
ｂ出力がホワイトバランスのとれたときに」クロツクパ
ルスと同期して日（ＨＩＧＨレベル）、１（ＬＯＷレベ
ル）を順次繰り返すことを利用し、比較回路１５ａ，１
５ｂ出力を表示信号発生器官７ａ，１７ｂに加えて表示
信号を得るように構成している。但し可逆計数回路１６
ａ，１６ｂの増減と、利得制御回路１３ａ，１３ｂの利
得の増減とが同方向であり〜端子２７４に供給される赤
および青信号レベルが端子３に供給される緑信号レベル
に較べて小さいならば、比較回路１５ａ，亀５ｂは可逆
計数回路１６ａ，１６ｂを増加させるための信号を出し
、端子２；４に供給される赤および青信号レベルが端子
３に供給される緑信号レベルに較べて大きいならば、比
較回路１５ａ，１５ｂは可逆計数回路１６ａ，１６ｂを
減少させる信号を出すようにしておく。クロツクパルス
をオンオフ操作する事により系も動作させ、一旦オンす
るとループとして働き、オフすると可逆計数回路１６ａ
，１６ｂの出力計数がオフする直前の状態で保持され、
その保持された信号レベル利得制御回路１３ａ，１３ｂ
を制御する。
１３ａ，】３ｂを介袋しＤＡ変換器１４ａ，１４ｂの出
力で利得を制御し、利得制御回路１３ａ，１３ｂの出力
と緑信号のレベルをそれぞれ比較回路１５ａ，１５ｂで
比較し可逆計数回路１６ａ，翼６ｂの増減のための信号
を得ている。すなわち比較回路１５ａ？ １５ｂの出力
を用いてデジタル回路で構成された可逆計数回路１６ａ
？ １６ｂの増減の方向を決め、（ＣＰ）端子より供給
されるクロックパルスで駆動している。そしてこの可逆
計数回路亀６ａ亨 畳６ｂの出力計数をＤＡ変換器１４
ａ，量４ｂでＤＡ変換し、利得制御回路１３ａ，寛３ｂ
に制御信号として加えている。又比較回路１５ａ，１５
ｂ出力がホワイトバランスのとれたときに」クロツクパ
ルスと同期して日（ＨＩＧＨレベル）、１（ＬＯＷレベ
ル）を順次繰り返すことを利用し、比較回路１５ａ，１
５ｂ出力を表示信号発生器官７ａ，１７ｂに加えて表示
信号を得るように構成している。但し可逆計数回路１６
ａ，１６ｂの増減と、利得制御回路１３ａ，１３ｂの利
得の増減とが同方向であり〜端子２７４に供給される赤
および青信号レベルが端子３に供給される緑信号レベル
に較べて小さいならば、比較回路１５ａ，亀５ｂは可逆
計数回路１６ａ，１６ｂを増加させるための信号を出し
、端子２；４に供給される赤および青信号レベルが端子
３に供給される緑信号レベルに較べて大きいならば、比
較回路１５ａ，１５ｂは可逆計数回路１６ａ，１６ｂを
減少させる信号を出すようにしておく。クロツクパルス
をオンオフ操作する事により系も動作させ、一旦オンす
るとループとして働き、オフすると可逆計数回路１６ａ
，１６ｂの出力計数がオフする直前の状態で保持され、
その保持された信号レベル利得制御回路１３ａ，１３ｂ
を制御する。
もう少し詳しく第４図を用いて赤信号系について説明す
る。
る。
ｉ３ａは差動アンプで構成される利得制御回路、１６ａ
は可逆計数回路、１４ａはＤＡ変換器である。利得制御
回路１３ａより得られる赤信号と緑信号をそれぞれクラ
ンプ回路１８，１９でその黒レベルをクランプし、オベ
アンプを用いた比較回路１５ａだ可逆計数回路１６ａの
増減を判定する信号日（ＨＩＧＨレベル）、Ｌ（ＬＷレ
ベル）を発生する。次に可逆計数回路１６ａの反転回路
２０とＮＡＮＤ回路２１，２２によって、第５図に示す
ように、増減判別回路１５ａの出力がＨレベルならば、
アップダウンカウンタ２３の（ＣＰｏ）端子にＨレベル
を、（ＣＰＵ）端子にクロックパルスの反転信号をそれ
ぞれ印加し、比較回路１５ａの出力がＬレベルであるな
らば（ＣＰｏ端子にクロックパルスの反転信号を、（Ｃ
ＰＵ）端子にＨレベルをそれぞれ印放する。４ビットの
アップダウンカウンタ２３は第６図に示す動作をし、先
に述べた（ＣＰＵ）、（ＣＰｏ）端子に加えられた信号
で、出力計数が増加したり、減少したりする。
は可逆計数回路、１４ａはＤＡ変換器である。利得制御
回路１３ａより得られる赤信号と緑信号をそれぞれクラ
ンプ回路１８，１９でその黒レベルをクランプし、オベ
アンプを用いた比較回路１５ａだ可逆計数回路１６ａの
増減を判定する信号日（ＨＩＧＨレベル）、Ｌ（ＬＷレ
ベル）を発生する。次に可逆計数回路１６ａの反転回路
２０とＮＡＮＤ回路２１，２２によって、第５図に示す
ように、増減判別回路１５ａの出力がＨレベルならば、
アップダウンカウンタ２３の（ＣＰｏ）端子にＨレベル
を、（ＣＰＵ）端子にクロックパルスの反転信号をそれ
ぞれ印加し、比較回路１５ａの出力がＬレベルであるな
らば（ＣＰｏ端子にクロックパルスの反転信号を、（Ｃ
ＰＵ）端子にＨレベルをそれぞれ印放する。４ビットの
アップダウンカウンタ２３は第６図に示す動作をし、先
に述べた（ＣＰＵ）、（ＣＰｏ）端子に加えられた信号
で、出力計数が増加したり、減少したりする。
この世力計数を抵抗２４，２５，２６，２７が順次倍々
になる抵抗倍数型のＤＡ変換器１４ａでＤＡ変換し、抵
抗５０と電源５１とで必要な制御電圧にして利得制御回
路１３ａに加えている。ここで緑信号が利得制御回路１
３ａ出力の赤信号と比べて大きいとき比較回路１５ａ出
力がＨレベル、（ＣＰ。
になる抵抗倍数型のＤＡ変換器１４ａでＤＡ変換し、抵
抗５０と電源５１とで必要な制御電圧にして利得制御回
路１３ａに加えている。ここで緑信号が利得制御回路１
３ａ出力の赤信号と比べて大きいとき比較回路１５ａ出
力がＨレベル、（ＣＰ。
）端子がＨレベルとなり、（ＣＰＵ）端子にクロックパ
ルスの反転信号が入り、４ビットのアップダウンカウン
タ２３を増加させ、その出力計数はＤＡ変換器１４ａで
ＤＡ変換されて、利得制御回路１３ａの利得を増加させ
るように働く。逆に緑信号が利得制御回路１３ａ出力の
赤信号と比べて小さいとき、比較回路１５ａ出力がＬレ
ベル、（ＣＰｕ）端子がＨレベルとなり「（ＣＰｏ）端
子にクロックパルスの反転信吾号が入り、４ビットのア
ップダウンカウン夕２３を減少させ、その出力計数はＤ
Ａ変換器１４ａで変換されて利得制御回路１３ａの利得
を減少させるように働く。従って、緑信号と利得制御回
路１３ａ出力の赤信号がほぼ同等になった所で比較回路
１５ａ出力がＨレベル、Ｌレベルを順次繰り返し、利得
制御回路１３ａ出力の赤信号が順次増減する。
ルスの反転信号が入り、４ビットのアップダウンカウン
タ２３を増加させ、その出力計数はＤＡ変換器１４ａで
ＤＡ変換されて、利得制御回路１３ａの利得を増加させ
るように働く。逆に緑信号が利得制御回路１３ａ出力の
赤信号と比べて小さいとき、比較回路１５ａ出力がＬレ
ベル、（ＣＰｕ）端子がＨレベルとなり「（ＣＰｏ）端
子にクロックパルスの反転信吾号が入り、４ビットのア
ップダウンカウン夕２３を減少させ、その出力計数はＤ
Ａ変換器１４ａで変換されて利得制御回路１３ａの利得
を減少させるように働く。従って、緑信号と利得制御回
路１３ａ出力の赤信号がほぼ同等になった所で比較回路
１５ａ出力がＨレベル、Ｌレベルを順次繰り返し、利得
制御回路１３ａ出力の赤信号が順次増減する。
この状態がホワイトバランスのとれた状態である。もし
ホワイトバランスのとれた状態で赤信号の順次に増減す
る中が大きければアップダウンカウンタ２３のビット数
を増加することによっていくらでも少なくすることがで
きる。以上のようにホワイトバランスがとれた状態でク
ロックパルスをオフすると、可逆計数回路１６ａの出力
計数がクロツクパルスをオフする前の状態で保持され、
利得制御回路１３ａの利得を制御することになる。
ホワイトバランスのとれた状態で赤信号の順次に増減す
る中が大きければアップダウンカウンタ２３のビット数
を増加することによっていくらでも少なくすることがで
きる。以上のようにホワイトバランスがとれた状態でク
ロックパルスをオフすると、可逆計数回路１６ａの出力
計数がクロツクパルスをオフする前の状態で保持され、
利得制御回路１３ａの利得を制御することになる。
又表示回路１７ａは反転回路２８、遅延回路２９、ＡＮ
Ｄ回路３０で構成され、この実施例においてホワイトバ
ランスがとれたとき、比較回路出力３２が、第７図の時
間郡。
Ｄ回路３０で構成され、この実施例においてホワイトバ
ランスがとれたとき、比較回路出力３２が、第７図の時
間郡。
以後のように、ＨレベルとＬレベルを繰り返すことを利
用し、比較回路出力３２を反転回路２８で反転し、この
信号３３を遅延回路２９でクロツクパルスの一周期遅延
させて信号３４を得る。この遅延回路出力３４と前記比
較回路出力３２とをＡＮＤ回路３０で論理積をとると、
ＡＮＤ回路出力３５となり、ホワイトバランスのとれる
までＬレベルで、ホワイトバランスがとれてから以降は
Ｈレベルをクロックパルスと同期して繰り返すことにな
る。この表示信号発生回路１７ａ出力でＬＥＤを駆動す
ればホワイトバランスの表示として使用できる表示信号
発生回路の他の実施例を第８図に、その各部出力波形を
第９図に示す。
用し、比較回路出力３２を反転回路２８で反転し、この
信号３３を遅延回路２９でクロツクパルスの一周期遅延
させて信号３４を得る。この遅延回路出力３４と前記比
較回路出力３２とをＡＮＤ回路３０で論理積をとると、
ＡＮＤ回路出力３５となり、ホワイトバランスのとれる
までＬレベルで、ホワイトバランスがとれてから以降は
Ｈレベルをクロックパルスと同期して繰り返すことにな
る。この表示信号発生回路１７ａ出力でＬＥＤを駆動す
ればホワイトバランスの表示として使用できる表示信号
発生回路の他の実施例を第８図に、その各部出力波形を
第９図に示す。
この表示信号発生回路は、反転回路３６、遅延回路３７
，３８、ＡＮＤ回路３９，４０、ＯＲ回路４１で構成さ
れている。比較回路１５ａの出力が４３の波形であるな
らば、ホワイトバランスがとれた時間はｔｏである。増
減判別回路出力４３を遅延回路３７の出力４４と反転回
路３６で反転した出力４５とをＡＮＤ回路３９で論理積
をとると、信号４６が得られる。比較回路出力４３と反
転回路出力４５を遅延回路３８で遅延させた信号４７と
をＡＮＤ回路４０で論理積をとると、信号４８が得られ
る。次に３９，４０のＡＮＤ回路出力４６と４８とをＯ
Ｒ回路４１で論理和をとると、信号４９が得られる。従
ってホワイトバランスがとれた時間ｔｏ以降は信号はＨ
レベル、それ以前はＬレベルとなり、ホワイトバランス
の表示用信号として使用できる。この実施例では赤、緑
の信号をそれぞれクランプしたが、色差信号をクランプ
し、このクランプされた色差信号とクランプ電位とを比
較回路に入れることによっても同じことが云える。
，３８、ＡＮＤ回路３９，４０、ＯＲ回路４１で構成さ
れている。比較回路１５ａの出力が４３の波形であるな
らば、ホワイトバランスがとれた時間はｔｏである。増
減判別回路出力４３を遅延回路３７の出力４４と反転回
路３６で反転した出力４５とをＡＮＤ回路３９で論理積
をとると、信号４６が得られる。比較回路出力４３と反
転回路出力４５を遅延回路３８で遅延させた信号４７と
をＡＮＤ回路４０で論理積をとると、信号４８が得られ
る。次に３９，４０のＡＮＤ回路出力４６と４８とをＯ
Ｒ回路４１で論理和をとると、信号４９が得られる。従
ってホワイトバランスがとれた時間ｔｏ以降は信号はＨ
レベル、それ以前はＬレベルとなり、ホワイトバランス
の表示用信号として使用できる。この実施例では赤、緑
の信号をそれぞれクランプしたが、色差信号をクランプ
し、このクランプされた色差信号とクランプ電位とを比
較回路に入れることによっても同じことが云える。
又青信号についても赤信号と全く同じものを設ける。以
上のように本発明によれば、記憶回路としてデジタル回
路を用いているため、電源が入っている限りにおいては
記憶時間は常に一定である。しかもこのデジタル部をＣ
ＭＯＳで構成すれば消費電力が少ないので電池でも駆動
でき、一旦ホワイトバランスを合せておけば、同じ光源
で用いる場合力ラー撮嫁装置のメイン電源を何度切って
も力ラー撮像装置のホワイトバランスを合せる必要がな
い。又従来例のようにリードリレーを使用する必要がな
いので、ＩＣ化が容易で、小型にすることができ更にデ
ジタル回路を使用している為ホワイトバランスがあった
ことを知らせる表示信号発生回路を容易に構成できる等
の所をもっている。色信号の利得を制御するための利得
制御回路と、前記利得制御回路出力と基準信号を比較す
る比較回路と、クロックパルスで駆動され、前記比較回
路出力により増減を制御される可逆計数回路と、前記可
逆計数回路出力をアナログ変換し前記利得制御回路の制
御信号を得るＤＡ変換器とにより前記利得制御回路出力
の色信号と前記基準信号を一致せしめる負帰還ループを
構成し、前記比較回路出力が前記クロックパルスの１′
２の周波数でハィレベル、ローレベルを順次繰り返した
時にホワイトバランスの調整が完了したことを示す信号
を、前記／・ィレベル、ローレベルを繰り返さない時に
はホワイトバランスの未調整を示す信号を発生する表示
信号発生回路を備えたため、力ラー撮像装置のホワイト
バランスが合った事を表示する表示信号を最も誤差の少
ない状態で発生することができる。つまり、上記負帰還
ループを構成した場合には、ホワイトバランスの合った
状態において前記可逆計数回路の出力信号は二つの計数
値を繰り返す。
上のように本発明によれば、記憶回路としてデジタル回
路を用いているため、電源が入っている限りにおいては
記憶時間は常に一定である。しかもこのデジタル部をＣ
ＭＯＳで構成すれば消費電力が少ないので電池でも駆動
でき、一旦ホワイトバランスを合せておけば、同じ光源
で用いる場合力ラー撮嫁装置のメイン電源を何度切って
も力ラー撮像装置のホワイトバランスを合せる必要がな
い。又従来例のようにリードリレーを使用する必要がな
いので、ＩＣ化が容易で、小型にすることができ更にデ
ジタル回路を使用している為ホワイトバランスがあった
ことを知らせる表示信号発生回路を容易に構成できる等
の所をもっている。色信号の利得を制御するための利得
制御回路と、前記利得制御回路出力と基準信号を比較す
る比較回路と、クロックパルスで駆動され、前記比較回
路出力により増減を制御される可逆計数回路と、前記可
逆計数回路出力をアナログ変換し前記利得制御回路の制
御信号を得るＤＡ変換器とにより前記利得制御回路出力
の色信号と前記基準信号を一致せしめる負帰還ループを
構成し、前記比較回路出力が前記クロックパルスの１′
２の周波数でハィレベル、ローレベルを順次繰り返した
時にホワイトバランスの調整が完了したことを示す信号
を、前記／・ィレベル、ローレベルを繰り返さない時に
はホワイトバランスの未調整を示す信号を発生する表示
信号発生回路を備えたため、力ラー撮像装置のホワイト
バランスが合った事を表示する表示信号を最も誤差の少
ない状態で発生することができる。つまり、上記負帰還
ループを構成した場合には、ホワイトバランスの合った
状態において前記可逆計数回路の出力信号は二つの計数
値を繰り返す。
この状態の時においてのみ比較回路出力はクロツクパル
スの１′２周波数で“Ｈ”レベルと“Ｌ”レベルを順次
繰り返すので、これを利用して表示信号を得ることによ
って、可逆計数回路の出力が二つの計数値を繰り返した
時のみ、即ち、ホワイトバランスの誤差が可逆計数回路
のＩＬＳＢ以内に入ったときのみ表示信号が出力される
。また、このホワイトバランスの誤差を少なくするため
には、可逆計数回路のビット数を増加させても、他は変
更する必要がなく、必ずホワイトバランスの誤差が可逆
計数回路のＩＬＢＳ以内に入ったときのみ表示信号が出
力された誤動作のない精度のよい表示信号を得ることが
できる。
スの１′２周波数で“Ｈ”レベルと“Ｌ”レベルを順次
繰り返すので、これを利用して表示信号を得ることによ
って、可逆計数回路の出力が二つの計数値を繰り返した
時のみ、即ち、ホワイトバランスの誤差が可逆計数回路
のＩＬＳＢ以内に入ったときのみ表示信号が出力される
。また、このホワイトバランスの誤差を少なくするため
には、可逆計数回路のビット数を増加させても、他は変
更する必要がなく、必ずホワイトバランスの誤差が可逆
計数回路のＩＬＢＳ以内に入ったときのみ表示信号が出
力された誤動作のない精度のよい表示信号を得ることが
できる。
第１図はカラー緑像装置の従来例を示す系統図、第２図
は第１図の姿部の具体例を示す接続図、第３図は本発明
装置の一実施例を示す系統図、第４図は第３図の菱部詳
細図、第５図は第４図における各部の波形図、第６図は
第４図に用いた４ビットのアップダウンカウンタの動作
モードを示す説明図、第７図は第４図に示す表示信号発
生回路の各部の波形図、第８図は表示信号発生回路の他
の実施例の詳細図、第９図は第８図に示す表示信号発生
回路の各部の波形図である。 １３ａ，１３ｂ……利得制御回路、１４ａ，１４ｂ・・
・・・・ＤＡ変換器、１５ａ，１５ｂ・・・・・・比較
回路、１６ａ，１６ｂ・・・・・・可逆計数回路、７ａ
，１７ｂ・・・・・・表示信号発生回路、２３・・・・
・・アップダウンカウンタ、２８，３６・・・・・・反
転回路、２９，３７，３８……遅延回路、３０，３９，
４０……ＡＮＤ回路、４１・・・・・・ＯＲ回路。 第１図 第２図 第３図 第４図 第５図 第６図 第７図 第８図 第９図
は第１図の姿部の具体例を示す接続図、第３図は本発明
装置の一実施例を示す系統図、第４図は第３図の菱部詳
細図、第５図は第４図における各部の波形図、第６図は
第４図に用いた４ビットのアップダウンカウンタの動作
モードを示す説明図、第７図は第４図に示す表示信号発
生回路の各部の波形図、第８図は表示信号発生回路の他
の実施例の詳細図、第９図は第８図に示す表示信号発生
回路の各部の波形図である。 １３ａ，１３ｂ……利得制御回路、１４ａ，１４ｂ・・
・・・・ＤＡ変換器、１５ａ，１５ｂ・・・・・・比較
回路、１６ａ，１６ｂ・・・・・・可逆計数回路、７ａ
，１７ｂ・・・・・・表示信号発生回路、２３・・・・
・・アップダウンカウンタ、２８，３６・・・・・・反
転回路、２９，３７，３８……遅延回路、３０，３９，
４０……ＡＮＤ回路、４１・・・・・・ＯＲ回路。 第１図 第２図 第３図 第４図 第５図 第６図 第７図 第８図 第９図
Claims (1)
- 【特許請求の範囲】 １ 色信号の利得を制御するための利得制御回路と、前
記利得制御回路出力と基準信号を比較する比較回路と、
クロツクパルスで駆動され前記比較回路出力により増減
を制御される可逆計数回路と、前記可逆計数回路出力を
アナログ変換し、前記利得制御回路の制御信号を得るＤ
Ａ変換器とにより前記利得制御回路出力の色信号と前記
基準信号を一致せしめる負帰還ループを構成し、この負
帰還ループを少なくとも２色の伝送系に備え、前記比較
回路出力が前記クロツクパルスの１／２の周波数でハイ
レベル、ローレベルを順次繰り返した時にホワイトバラ
ンスの調整が完了したことを示す信号を、前記ハイレベ
ル、ローレベルを繰り返さない時にはホワイトバランス
の未調整を示す信号を発生する表示信号発生回路を設け
たカラー撮像装置。 ２ 表示信号発生回路を、比較回路出力を反転する反転
回路と、前記比較回路出力と前記反転回路出力とのいづ
れか一方を遅延する遅延回路と、この遅延回路出力と前
記比較回路出力か前記反転回路出力のうち前記遅延回路
に接続しない方の信号との論理積をとるＡＮＤ回路とに
より構成したことを特徴とする特許請求の範囲第１項記
載のカラー撮像装置。 ３ 表示信号発生回路を、比較回路出力を反転する反転
回路と、この反転回路出力を前記クロツクパルスの一周
期遅延させる第１の遅延回路と、前記比較回路出力と前
記第１の遅延回路出力の論理積をとる第１のＡＮＤ回路
と、前記比較回路出力を前記クロツクパルスの一周期遅
延させる第２の遅延回路と、前記反転回路出力と、前記
第２の遅延回路出力との論理積をとる第２のＡＮＤ回路
と、前記第１のＡＮＤ回路出力と前記第２のＡＮＤ回路
出力との論理和をとるＯＲ回路とにより構成したことを
特徴とする特許請求の範囲第１項記載のカラー撮像装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54157155A JPS606589B2 (ja) | 1979-12-04 | 1979-12-04 | カラ−撮像装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54157155A JPS606589B2 (ja) | 1979-12-04 | 1979-12-04 | カラ−撮像装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5680987A JPS5680987A (en) | 1981-07-02 |
| JPS606589B2 true JPS606589B2 (ja) | 1985-02-19 |
Family
ID=15643377
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP54157155A Expired JPS606589B2 (ja) | 1979-12-04 | 1979-12-04 | カラ−撮像装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS606589B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS606590U (ja) * | 1983-06-24 | 1985-01-17 | 狭山精密工業株式会社 | 全自動麻雀卓に於ける牌送り出し装置 |
-
1979
- 1979-12-04 JP JP54157155A patent/JPS606589B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS606590U (ja) * | 1983-06-24 | 1985-01-17 | 狭山精密工業株式会社 | 全自動麻雀卓に於ける牌送り出し装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5680987A (en) | 1981-07-02 |
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