JPS6064430A - GaAs系化合物半導体装置の製造方法 - Google Patents

GaAs系化合物半導体装置の製造方法

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JPS6064430A
JPS6064430A JP17138283A JP17138283A JPS6064430A JP S6064430 A JPS6064430 A JP S6064430A JP 17138283 A JP17138283 A JP 17138283A JP 17138283 A JP17138283 A JP 17138283A JP S6064430 A JPS6064430 A JP S6064430A
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compound semiconductor
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野中 敏夫
Hiroshi Nakamura
浩 中村
Nagayasu Yamagishi
山岸 長保
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Oki Electric Industry Co Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (技術分野) 本発明は、GaAs系化合物半導体装置の製造方法に関
し、特にそのオーミック電極と素子間配線の製造方法に
関する。
(従来技術) GaAs系化合物半導体装置、例えばGaAs MES
FETにおいては、一般にオーミック接触予定領域のn
+型GaAs領域内の表面にAuGeを被着し、400
℃〜450℃の温度のアニールによってGaAsとAu
Geとを合金化し、これによってオーミック接触を形成
している。しかし、このアニールを行うと、GaAsと
AuGeとの界面に凸凹が生じ、GaAs基板表面の均
質性が劣化し、またAuGe表面にはボールアップが生
じることがある。
また、配線材としては一般にTi/Pt/Auあるいは
Ti/Auの多層構成が用いられるが400℃以上の熱
処理を行うとAuGe中Auと配線相中のTiとが反応
し、またゴールアップ防止のためにオーミ、り電極材を
AuGe/Ni/Auの3層構成にした場合にはその最
上層のAuと配線材中のTiとが反応し、配線材の表面
並びにオーミ、り電極と配線材との界面におけるモtロ
ノ−(状態)が悪化しく例えば接触抵抗が増大し)、オ
ーミック処理後は400℃以上のプロセスは前記の配線
材とオーミック材との反応により適当ではない。
(発明の目的) 本発明は、GaAs系化合物半導体基板とオーミック電
極とのオーミック接触を得ること、及び界面劣化のない
、又オーミック電極の表面上木口・ノーの劣化を防止し
たオーミ、り電極及び配線を形成し、耐熱性、安定性の
優れたGaAs系化合物半導体装置を提供することを目
的とするものである。
(実施例) 第1図ないし第4図は本発明をGaAs MESFET
に適用した実施例の工程説明図である。
まず第1図に示すように、GaAs半絶縁性基板1、そ
の基板1中に形成したれ+型打込領域2、n型打込FE
T活性層3、W−Al材質の7ヨツトキーグート電極4
及び絶縁膜としての5102膜5からなるものを作成す
る。
次に第2図に示すように、オーミック電極を形成する予
定領域において、S iO2膜を開口し、次いでGeを
500久程度の厚さに蒸着し、そのGe膜6を電極形状
に・ぐターンニングする。コノ状態においてはGe膜は
非晶質かまたは多結晶化しているため、通常は絶縁物か
p型となっている。
次に第2図に示した構成において、このGe膜6の膜厚
方向中央にピークを持つようにn型不純物であるAsを
イオン注入法によりピーク濃度が約10 cm 以上に
なるように打込む。
次に第3図で示すようにGe膜6中のAsイオンの活性
化を行うために、高融点配線材金属であるW−Al膜7
で全面を被覆し800℃程度の温度で20分間のアニー
ルを行う。
以上の工程により、Ge膜6は高濃度n++型となり下
部のn生型GaAs層2とオーミック接触となる。
次に第4図に示すように、W−A/膜7を配線・やター
ン状に加工し、・ぞラドのS iO2膜5を選択的に除
去することにより、FETは作製される。
第5図は、第2図に示しだAsイオン注入工程における
Asイオンの濃度グロファイル8を示すものであり、横
軸はn型GaAs/GeのGe表iMiからの深さであ
り、縦軸はイオン濃度である。
(発明の効果) 以上説明したように、本発明ではオーミック電極利とし
てGeを用い、そのGe膜の膜厚方向中央伺近でAsイ
オン濃度がピークとなるようにイオン注入してその熱処
理を行っているため、このAsイオンによる効果はGe
膜を高濃度のn型にすることのみに寄与し、GaAs系
基板に対するAsイオンの影響はない。また、Asイオ
ンが注入されだGe膜のアニールは高融点配線材金属を
被覆して行っているため、GeからのAs及びGe自体
の蒸発は防止される。
これらの理由によって、Ge/GaAs界面状態、Ge
/W −Al界面状態及び表面七才・ロジーは非常に良
く、更に電極及び配線の層構成も簡易であシ、+IjJ
熱性、熱性性安定性たGaAs系化合物半導体装置を得
られるという利点がある。
(応用分野) 本発明は、面1熱性を有するオーミック材及び配線材料
による素子の製造方法を示しているものであり、例えば
、アナログ、 GaAs FET及びGaAs ICな
どへ利用した場合には、信頼性の高いデバイスが実現可
能となる。
【図面の簡単な説明】
第1図ないし第4図は本発明の実施例によるMESFE
Tの構造断面図、第5図は本発明におけるn+GaAs
上のn+Geの表面からのAsイオンの濃度グロファイ
ル図である。 1・・・半絶縁性GaAs基板、2− n−’型GaA
s層、3・・・n型GaAs層、4・・・ダート電極、
5・・S IO2−絶縁膜、6・・・Ge膜、7・・・
W −Al被覆、8・・・Asイオンノ儂M 7’ロフ
アイル。 特許出願人 沖電気工業株式会社

Claims (1)

  1. 【特許請求の範囲】 GaAs系化合物半導体基板にイオンを注入して複数の
    素子をつくる工程と、前記素子間を配線する工程とを含
    むGaAs系化合物半導体装置の製造方法る工程と、 不純物濃度分布が当該Ge膜の膜厚方向中央付近で最大
    となるように当該Ge膜にAsイオンを高濃度にイオン
    注入する工程と、 その後、高融点配線利料金属を前記Ge膜を含む全面に
    被着させ、アニールする工程とを含むGaAs系化合物
    半導体装置の製造方法。
JP17138283A 1983-09-19 1983-09-19 GaAs系化合物半導体装置の製造方法 Granted JPS6064430A (ja)

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Application Number Priority Date Filing Date Title
JP17138283A JPS6064430A (ja) 1983-09-19 1983-09-19 GaAs系化合物半導体装置の製造方法
US06/602,578 US4540446A (en) 1983-09-19 1984-04-20 Method of forming ohmic contact on GaAs by Ge film and implanting impurity ions therethrough

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JP17138283A JPS6064430A (ja) 1983-09-19 1983-09-19 GaAs系化合物半導体装置の製造方法

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JPS6064430A true JPS6064430A (ja) 1985-04-13
JPH046089B2 JPH046089B2 (ja) 1992-02-04

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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61248470A (ja) * 1985-04-23 1986-11-05 インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション ▲iii▼―▲v▼族半導体デバイス
JPS62205622A (ja) * 1986-03-06 1987-09-10 Agency Of Ind Science & Technol オ−ミツク接触の形成方法
JPS6457680A (en) * 1987-03-18 1989-03-03 Fujitsu Ltd Compound semiconductor integrated circuit device
US4983653A (en) * 1986-11-12 1991-01-08 Diafoil Company, Ltd. Polyester shrinkable film containing benzotriazole
US4985538A (en) * 1986-11-12 1991-01-15 Diafoil Company, Limited Shrinkable polyester film

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JPH046089B2 (ja) 1992-02-04

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