JPS603035A - 記憶装置 - Google Patents
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- JPS603035A JPS603035A JP58110356A JP11035683A JPS603035A JP S603035 A JPS603035 A JP S603035A JP 58110356 A JP58110356 A JP 58110356A JP 11035683 A JP11035683 A JP 11035683A JP S603035 A JPS603035 A JP S603035A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は記憶装置、特に′電子タイプライタなどの電ｒ
機器に用いられる記憶装置に関する。
機器に用いられる記憶装置に関する。
従来技術
最近、タイプライクは電子化され、このような電ｒ式タ
イプライタでは機械式タイプラ・イタのキーホーＩ・や
プリンタ部に関する制ｊ！ｕか′屯ｒ化され、それによ
り機械式タイプライクにおける種々の欠点が除去され、
比較的良好なキー押ト時の感触が得られ、さらに多種の
機能か実現されている。
イプライタでは機械式タイプラ・イタのキーホーＩ・や
プリンタ部に関する制ｊ！ｕか′屯ｒ化され、それによ
り機械式タイプライクにおける種々の欠点が除去され、
比較的良好なキー押ト時の感触が得られ、さらに多種の
機能か実現されている。
一方、このような゛＋−ｒｈｒタイプライタでは腫々の
機能を実行するために記憶装置か用いられているか、近
年の記憶書−ｒの高集積度化、低価格化に（ｆない、フ
ロッピーディスクのような外部記憶装置を用いなくても
低価格で比較的容量の大きい不揮発ｆ１の記憶装置か利
用でき、これを文字列の記憶に用いている。これら文字
列記憶装置を備えたりｒブラインでは 文へ１或い１オ
良く使用する慣用句、中１：１１旨イ１所″９をそれぞ
れに対応する１文字或いは複枚文字で構成された見出し
を′ｊえ、それによりタイプライタ内部の記憶装置に複
数の種類の登録を行っている。 力、記憶装置に登録さ
れた文字列をＩＩｆひ出１２それを印字することもでき
るようになっており、罪名；、に石川な電子式タイプラ
イタか提供されている。
機能を実行するために記憶装置か用いられているか、近
年の記憶書−ｒの高集積度化、低価格化に（ｆない、フ
ロッピーディスクのような外部記憶装置を用いなくても
低価格で比較的容量の大きい不揮発ｆ１の記憶装置か利
用でき、これを文字列の記憶に用いている。これら文字
列記憶装置を備えたりｒブラインでは 文へ１或い１オ
良く使用する慣用句、中１：１１旨イ１所″９をそれぞ
れに対応する１文字或いは複枚文字で構成された見出し
を′ｊえ、それによりタイプライタ内部の記憶装置に複
数の種類の登録を行っている。 力、記憶装置に登録さ
れた文字列をＩＩｆひ出１２それを印字することもでき
るようになっており、罪名；、に石川な電子式タイプラ
イタか提供されている。
しかし、従来の′重子りイプライタに用いられる文字列
記ｔＱ装置では、文字列か多種類登録されている場合に
は、見出し部登録の際、非常に時間がかかる。
記ｔＱ装置では、文字列か多種類登録されている場合に
は、見出し部登録の際、非常に時間がかかる。
例えは、第１図には従来の文字列記憶装置を備えたシス
テムの構成がブロック図として概略図示されており、同
図において文字列記憶装７ｒｊ ｌならびに文字列訂１
１−川ハッファ２はそれぞれ１読み書きのタイミングを
決定する（ｌｒ５１：ｉ線Ｃ３ならびにアトレステータ
パフＡＤＢと接続されており、信シ）線Ｃ３に現れる読
み書きのタイミング信けに従ってア］・レスデータバス
ＡＤＨに現れるアＩ・レスにそれぞれ所定のデータを読
み書きしている。
テムの構成がブロック図として概略図示されており、同
図において文字列記憶装７ｒｊ ｌならびに文字列訂１
１−川ハッファ２はそれぞれ１読み書きのタイミングを
決定する（ｌｒ５１：ｉ線Ｃ３ならびにアトレステータ
パフＡＤＢと接続されており、信シ）線Ｃ３に現れる読
み書きのタイミング信けに従ってア］・レスデータバス
ＡＤＨに現れるアＩ・レスにそれぞれ所定のデータを読
み書きしている。
文字列記憶装置１は、７Ｊ、２図に図示されたように内
１°１ｂに文字列の数な示ず記憶域ＤＩＲＣＮＴと４イ
Φのディレクトり部（見出し）、すなわちＤＩＲ（Ａ）
、ＤＪ、Ｒ（Ｂ）、ＤＩＲ（Ｃ）、ＤＩＲ（Ｄ）とその
ディレクトリ部に対応する文字列（Ａ）、（Ｂ）、（Ｃ
）、（Ｄ）から構成されており、各ディレクトり部、例
えはＤＩＲ（Ｂ）は第３１Δに図示したように８ハイド
から成る見出しくＪＤ）と２ハイ）から成る各文字列に
対する先頭ア）・レス（アｉ・レス情ｔ［、！部ΔＤＲ
）及び２パイｌから成る文字数を記憶した有効文字数情
報部（ＣＮＴ）から１ノにっている。また１文字列 （
Ａ）。
１°１ｂに文字列の数な示ず記憶域ＤＩＲＣＮＴと４イ
Φのディレクトり部（見出し）、すなわちＤＩＲ（Ａ）
、ＤＪ、Ｒ（Ｂ）、ＤＩＲ（Ｃ）、ＤＩＲ（Ｄ）とその
ディレクトリ部に対応する文字列（Ａ）、（Ｂ）、（Ｃ
）、（Ｄ）から構成されており、各ディレクトり部、例
えはＤＩＲ（Ｂ）は第３１Δに図示したように８ハイド
から成る見出しくＪＤ）と２ハイ）から成る各文字列に
対する先頭ア）・レス（アｉ・レス情ｔ［、！部ΔＤＲ
）及び２パイｌから成る文字数を記憶した有効文字数情
報部（ＣＮＴ）から１ノにっている。また１文字列 （
Ａ）。
（Ｂ）、 （Ｃ）、 （Ｄ）は、文字に対Ｉ心したコー
１’ （例えはＡＳＣＩ Ｉコート）で構成された文字
列であり、それぞれの文字列の長さはＯｆ変に構成され
ている。このような構成において！ｌまたに文字列Ｅを
追加１．ようと１７だときディレクトすｉ％にＤＩＲ（
Ｅ）を追加するためには第２図に示す文字列（Ａ）。
１’ （例えはＡＳＣＩ Ｉコート）で構成された文字
列であり、それぞれの文字列の長さはＯｆ変に構成され
ている。このような構成において！ｌまたに文字列Ｅを
追加１．ようと１７だときディレクトすｉ％にＤＩＲ（
Ｅ）を追加するためには第２図に示す文字列（Ａ）。
（Ｂ）、（Ｃ）、（Ｄ）の全てを１２バイト分シフトし
なけれはならない。さらにそれらのブイレフＩ・り部Ｄ
ＩＲＣＡ）〜ＤＩＲ（Ｄ）も更新しなけれはならない。
なけれはならない。さらにそれらのブイレフＩ・り部Ｄ
ＩＲＣＡ）〜ＤＩＲ（Ｄ）も更新しなけれはならない。
更新後の文字列記憶装置のメモリ−ブツビングを第４図
に示す。
に示す。
このため文字列記憶装置の制御手順が複雑になり、処理
時間に多くの時間か必凹であった。このことはＤＩＲ（
Ａ）〜ＤＩＲ（Ｄ）で示ｙれるテイレクトリト”％に続
いて文字列（Ａ）〜（Ｄ）かイｆイ１することに原因が
あり、従来の文字夕］１記憶装置は、ＩＩ 富に効率の
悪い処理方式を取っていた。
時間に多くの時間か必凹であった。このことはＤＩＲ（
Ａ）〜ＤＩＲ（Ｄ）で示ｙれるテイレクトリト”％に続
いて文字列（Ａ）〜（Ｄ）かイｆイ１することに原因が
あり、従来の文字夕］１記憶装置は、ＩＩ 富に効率の
悪い処理方式を取っていた。
目的
本発明は十述の点にＷｌみ成されたもので、筒中な制御
手順でかつ文字列を新たに１１゛１加する場合にも他の
文字列を全＜（Ｉ）配置する心霊のない肥土は装置を提
案することを［１的とする。
手順でかつ文字列を新たに１１゛１加する場合にも他の
文字列を全＜（Ｉ）配置する心霊のない肥土は装置を提
案することを［１的とする。
実施例
以下図面を参照して本発明の一実施例について説明する
。
。
第５１図に本発明による文字列記憶装置の制御を行うた
めのシステムのブロック１図を示す。図中ＩＯはマイク
ロプロセッサ（以ト−ＭＰＵという）てあり、ンステト
全体の制御をつかさどる。１１は固定記憶装置（以ＦＲ
ＯＭという）で、システ１、の制御を１１う制す１手１
ｌｌｌ′ｌ（例えば後で説明する第７１Ａに示すプロク
ラ１．）を制ｊコ■コードの形で内蔵しており、ＭＰＵ
１ＯはＲＯＭ１ｌとデータバスを介１７て接続されてお
り、ＲＯＭＩＩの内容を参ｊｊｊｊ Ｌ、なからシステ
ムの制御１を４ｉうちのである。
めのシステムのブロック１図を示す。図中ＩＯはマイク
ロプロセッサ（以ト−ＭＰＵという）てあり、ンステト
全体の制御をつかさどる。１１は固定記憶装置（以ＦＲ
ＯＭという）で、システ１、の制御を１１う制す１手１
ｌｌｌ′ｌ（例えば後で説明する第７１Ａに示すプロク
ラ１．）を制ｊコ■コードの形で内蔵しており、ＭＰＵ
１ＯはＲＯＭ１ｌとデータバスを介１７て接続されてお
り、ＲＯＭＩＩの内容を参ｊｊｊｊ Ｌ、なからシステ
ムの制御１を４ｉうちのである。
１２はランタムアクセスメモリ（以下ＲＡＭという）で
あり、ＭＰＵｌ０のハードウェアスタック（システ１、
の状Ｉハ：或いは一時的に用いられる記憶情報な待機さ
せる記憶部）などに用いられる。
あり、ＭＰＵｌ０のハードウェアスタック（システ１、
の状Ｉハ：或いは一時的に用いられる記憶情報な待機さ
せる記憶部）などに用いられる。
１３は第１図の文字列記憶装置１と同様な文字列記憶装
置であり、後述場る如く本発明による制御かｔｉわれる
６ １４はメモリアトレスレコータであり、ＭＰＵｌ０
とアドレスバスＡＢとに接続されていて、このアドレス
バスＡＢから得られるアト［／スをテコ−］・してそれ
ぞれＲＯＭＩ ｌ 、ＲＡＭ１２、文字列記士、ａ装置
１３の選択を行い、データバスＤＢを介してＭＰＵ １
０との接続を？ｉいシステｊ、コントロールハスＳＣＨ
の制御によりンステ１、制ｊ２０のだめの読み１１）き
信壮の伝送、アドレス情報の伝送、各デバイス間のデー
ク送受を９１うちのである。
置であり、後述場る如く本発明による制御かｔｉわれる
６ １４はメモリアトレスレコータであり、ＭＰＵｌ０
とアドレスバスＡＢとに接続されていて、このアドレス
バスＡＢから得られるアト［／スをテコ−］・してそれ
ぞれＲＯＭＩ ｌ 、ＲＡＭ１２、文字列記士、ａ装置
１３の選択を行い、データバスＤＢを介してＭＰＵ １
０との接続を？ｉいシステｊ、コントロールハスＳＣＨ
の制御によりンステ１、制ｊ２０のだめの読み１１）き
信壮の伝送、アドレス情報の伝送、各デバイス間のデー
ク送受を９１うちのである。
ｌ、記の構成において、文字列記憶装置１３は第６図に
図示されたように構成される。第２図と同様に文字列の
数を示す記憶域ＤＩＲＣＮＴ、ティｌ／り１・り部ＤＩ
Ｒならひに文字夕１１登記↑、１１する部分から構成さ
れているか、第２図とｌ／、Ｉ、なりＤＩＲ（Ｄ）の直
後に文字列（Ａ）〜（Ｄ）を）！〔置しているのではな
く、文字列記＋北装置１３の物Ｊ１目的な最終アドレス
よりスタテイカルにＤＩＲＣＮＴ。
図示されたように構成される。第２図と同様に文字列の
数を示す記憶域ＤＩＲＣＮＴ、ティｌ／り１・り部ＤＩ
Ｒならひに文字夕１１登記↑、１１する部分から構成さ
れているか、第２図とｌ／、Ｉ、なりＤＩＲ（Ｄ）の直
後に文字列（Ａ）〜（Ｄ）を）！〔置しているのではな
く、文字列記＋北装置１３の物Ｊ１目的な最終アドレス
よりスタテイカルにＤＩＲＣＮＴ。
ＤＩＲ（Ａ）、、ＤＩＲ（Ｂ）、ＤＩＲ（Ｃ）、ＤＪＲ
（Ｄ）のｌ１ｌＩ′１に１ｒ１置する。そして物理的な
先頭７ ｌ・レスより文字夕１１を文字列（Ａ）９文字
列（Ｂ）１文字列（Ｃ） 、 文字列（Ｄ ） （７）
ｌ１ｈｌ ニｌ’に２ ｆ’ｉする。
（Ｄ）のｌ１ｌＩ′１に１ｒ１置する。そして物理的な
先頭７ ｌ・レスより文字夕１１を文字列（Ａ）９文字
列（Ｂ）１文字列（Ｃ） 、 文字列（Ｄ ） （７）
ｌ１ｈｌ ニｌ’に２ ｆ’ｉする。
この扛な構成において、いま文字列（Ｅ）を追加］−よ
うとするとき、第７図に示す様な制御毛順か用いられる
。
うとするとき、第７図に示す様な制御毛順か用いられる
。
ま丈ステップＳｌにおいて、文字列記憶装置１３の物理
的最終アドレス（ＲＡ Ｍ Ｅ Ｎ Ｄとする）を基に
（１）式の様に文字列（Ｅ）を示すブイレフｌす部Ｄ
Ｉ ｒ（（Ｅ）の格納アドレスをめる（ここではメモリ
の１番地を１バイトと１−る）。
的最終アドレス（ＲＡ Ｍ Ｅ Ｎ Ｄとする）を基に
（１）式の様に文字列（Ｅ）を示すブイレフｌす部Ｄ
Ｉ ｒ（（Ｅ）の格納アドレスをめる（ここではメモリ
の１番地を１バイトと１−る）。
［Ｄ［（Ｅ）スター １−７ Ｆレス］ ＝ ＋（ＲＡ
ＭＥＮＤ）−１２Ｘ（ＤＩＲＣＲＴ）＋ ｌ ｌ −（
領域間ＲｃＮＴＣ））専右ハイＩ−数）・・・（１） 次にステップＳ２で文字列（Ｅ）を格納する先υｆ１−
アドレス（ＡＤＲ（Ｅ））を（２）式によりめる。
ＭＥＮＤ）−１２Ｘ（ＤＩＲＣＲＴ）＋ ｌ ｌ −（
領域間ＲｃＮＴＣ））専右ハイＩ−数）・・・（１） 次にステップＳ２で文字列（Ｅ）を格納する先υｆ１−
アドレス（ＡＤＲ（Ｅ））を（２）式によりめる。
ＡＤＲ（Ｅ）−ＡＤＲ［ＤＩＲ（Ｄ）］ 十 ＣＮＴ
［ＤＩＲ（Ｄ）］ −＝ （：）ｌ）そしてステップＳ
３で（１）式でめたアｉ・レスよりｌ１ｌｆｉにま才女
字列（Ｅ）の見出しを８バーｆ ｌ・分格納し、ｂｌ：
いて（２）式でめた文字夕１１（Ｅ）の先頭アト１／ス
を２バイト分格納する。文字毅情報部ＣＮ Ｔ Ｉ日文
字夕１１（Ｅ）が仝て０釘されてから格納するため、こ
こでは格納されない。ステップＳ４にて文字列の数を示
す記ｔａ域ＤＩＲＣＮＴの内容をプラス１して文字列（
Ｅ）の０釘べ”＝ ［ｉｉを終ｒする。これで文字列（
Ｅ）が０録呵能となる。
［ＤＩＲ（Ｄ）］ −＝ （：）ｌ）そしてステップＳ
３で（１）式でめたアｉ・レスよりｌ１ｌｆｉにま才女
字列（Ｅ）の見出しを８バーｆ ｌ・分格納し、ｂｌ：
いて（２）式でめた文字夕１１（Ｅ）の先頭アト１／ス
を２バイト分格納する。文字毅情報部ＣＮ Ｔ Ｉ日文
字夕１１（Ｅ）が仝て０釘されてから格納するため、こ
こでは格納されない。ステップＳ４にて文字列の数を示
す記ｔａ域ＤＩＲＣＮＴの内容をプラス１して文字列（
Ｅ）の０釘べ”＝ ［ｉｉを終ｒする。これで文字列（
Ｅ）が０録呵能となる。
その後ステップＳ５で文字列（Ｅ）の（Ｊ ６４を１１
う。登録力）６冬ｒすると（ステップ“Ｓ６−Ｙ）、登
録された文字数をもとにブイレフＩ・り部Ｄ Ｔ Ｒ（
Ｅ）の文字数情報ＣＮＴを算出し、ＣＮＴに格納し文字
列（Ｅ）の登録を終了する（ステップＳ７）。
う。登録力）６冬ｒすると（ステップ“Ｓ６−Ｙ）、登
録された文字数をもとにブイレフＩ・り部Ｄ Ｔ Ｒ（
Ｅ）の文字数情報ＣＮＴを算出し、ＣＮＴに格納し文字
列（Ｅ）の登録を終了する（ステップＳ７）。
以１．の手順により文字列記憶装置１３は第８図に示す
メモリ構成となる。
メモリ構成となる。
同様のｒｌｌｌｌｉを局・り返ずことにより、何ら文字
夕１［の＋１１１配置を行うことなく文字列（Ｆ）９文
字列（Ｇ）の如く新規文字列の０録を追加できる。
夕１［の＋１１１配置を行うことなく文字列（Ｆ）９文
字列（Ｇ）の如く新規文字列の０録を追加できる。
以上述べた様に文字列の新規登録時に文字列の再配置な
どが全くないため第１図に示す様な文字列訂ｉＥ用バッ
ファ２の様な冨時はとんど使用されていない記ｔ（１装
置を必要とせず、また電源の瞬断等があった場合にも文
字列移動に伴なう記憶内容の破壊もなく、Ｊ１常に効率
のよい電子タイプライタなどの電子機器か実現する。
どが全くないため第１図に示す様な文字列訂ｉＥ用バッ
ファ２の様な冨時はとんど使用されていない記ｔ（１装
置を必要とせず、また電源の瞬断等があった場合にも文
字列移動に伴なう記憶内容の破壊もなく、Ｊ１常に効率
のよい電子タイプライタなどの電子機器か実現する。
効果
以−１、説明した様に本発明によれば記憶内容の更新、
追加、削除等を）（−常に効率よく行うことのできる記
憶装置が実現する。
追加、削除等を）（−常に効率よく行うことのできる記
憶装置が実現する。
第１１）４〜第３図は従来の方法を説明するもので、第
１図はシステ１、の構成を示したブロック図、 第２図は文字列記憶装置の構成を示した説す１図、 第３図はブイレフＩ・り部のヒツト構成を小した説明図
、 第４図は文字列をさらに追加した場合の文字列記憶装置
の構成を示した説明図、 第５図〜第８図は本発明による方法を説明するもので、
第５図は全体のシステムの構成を示したブロック図、 第６図は文字列記憶装置の構成を示した説明第７図は文
字列制御装置の制御手順を示したフローチャーＩ・。 第８図は文字列を追加した場合の文字列記憶装置の構成
を小した説明図である。 図において、１０・・・ＭＰＵ、１１・・・ＲＯＭ。 ２・・・ＲＡＭ、１３・・・文字列記ｔ０装置、１４・
・・メモリアドレスデコーダ、ＤＩＲ・・・ティレフ］
・す、・【８、Ａ−Ｆ、・・・文字列である。 ’ｌ１１’ ＋ｉ’ｌ出願人 キャノン株式会ン１代理
人 弁理１： 大 塚 康 徳
１図はシステ１、の構成を示したブロック図、 第２図は文字列記憶装置の構成を示した説す１図、 第３図はブイレフＩ・り部のヒツト構成を小した説明図
、 第４図は文字列をさらに追加した場合の文字列記憶装置
の構成を示した説明図、 第５図〜第８図は本発明による方法を説明するもので、
第５図は全体のシステムの構成を示したブロック図、 第６図は文字列記憶装置の構成を示した説明第７図は文
字列制御装置の制御手順を示したフローチャーＩ・。 第８図は文字列を追加した場合の文字列記憶装置の構成
を小した説明図である。 図において、１０・・・ＭＰＵ、１１・・・ＲＯＭ。 ２・・・ＲＡＭ、１３・・・文字列記ｔ０装置、１４・
・・メモリアドレスデコーダ、ＤＩＲ・・・ティレフ］
・す、・【８、Ａ−Ｆ、・・・文字列である。 ’ｌ１１’ ＋ｉ’ｌ出願人 キャノン株式会ン１代理
人 弁理１： 大 塚 康 徳
Claims (3)
- （１）複数の情＋Ｉｊ Ｉ！Ｙと、該情報ＲＶを管理す
る管Ｊ（Ｐ情ｔｖを記憶１１丁能な記憶装置において、
前記情報群と前記管理情報との記憶領域を分け、両記憶
領域間に”％ ／ｌ（ｌ域を設けたことを４１１徴とす
る記憶装置。 - （２）情＋ｌ、ｔ Ａ’ｌ ｋ文字コードで表された文
字列とすることを特徴とする特許ふ請求の範囲第１項記
載の記憶装置。 - （３）情報Ｉ＋Ｙはｉにｒタイプライタのキーボードよ
り入力された人力文字情報であることを特徴とする特１
ｊ’ｌ、請求の範囲第１項又は第２項記載の記憶装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58110356A JPS603035A (ja) | 1983-06-20 | 1983-06-20 | 記憶装置 |
| GB08415106A GB2143066B (en) | 1983-06-14 | 1984-06-13 | Memory control unit |
| DE19843421919 DE3421919A1 (de) | 1983-06-14 | 1984-06-13 | Speichersteuereinheit |
| US07/632,643 US5157784A (en) | 1983-06-14 | 1990-12-26 | Memory control system responsive to determination, allocating adjacent test space for editing space, relocating adjacent text and editing selected text |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58110356A JPS603035A (ja) | 1983-06-20 | 1983-06-20 | 記憶装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS603035A true JPS603035A (ja) | 1985-01-09 |
Family
ID=14533694
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58110356A Pending JPS603035A (ja) | 1983-06-14 | 1983-06-20 | 記憶装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS603035A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61216016A (ja) * | 1985-02-26 | 1986-09-25 | Fujitsu Ltd | デ−タベ−スの領域管理方式 |
| JPS6349952A (ja) * | 1986-08-20 | 1988-03-02 | Canon Inc | メモリ管理方式 |
| JPS63165986A (ja) * | 1986-12-26 | 1988-07-09 | Toshiba Corp | Ｉｃカードのデータ記憶方法 |
-
1983
- 1983-06-20 JP JP58110356A patent/JPS603035A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61216016A (ja) * | 1985-02-26 | 1986-09-25 | Fujitsu Ltd | デ−タベ−スの領域管理方式 |
| JPS6349952A (ja) * | 1986-08-20 | 1988-03-02 | Canon Inc | メモリ管理方式 |
| JPS63165986A (ja) * | 1986-12-26 | 1988-07-09 | Toshiba Corp | Ｉｃカードのデータ記憶方法 |
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