JPS6025319A - レベルコンパレ−タ - Google Patents
レベルコンパレ−タInfo
- Publication number
- JPS6025319A JPS6025319A JP13418383A JP13418383A JPS6025319A JP S6025319 A JPS6025319 A JP S6025319A JP 13418383 A JP13418383 A JP 13418383A JP 13418383 A JP13418383 A JP 13418383A JP S6025319 A JPS6025319 A JP S6025319A
- Authority
- JP
- Japan
- Prior art keywords
- input signal
- capacitor
- voltage
- level
- charging
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/01—Shaping pulses
- H03K5/08—Shaping pulses by limiting; by thresholding; by slicing, i.e. combined limiting and thresholding
- H03K5/082—Shaping pulses by limiting; by thresholding; by slicing, i.e. combined limiting and thresholding with an adaptive threshold
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はレベルコンパレータに関し、特に記録媒体から
読取られたディジタル情報や信号伝送路を経たディジタ
ル情報を波形整形して２値レベルの矩形波信号に変換す
るレベルコンパレータに関するものである。
読取られたディジタル情報や信号伝送路を経たディジタ
ル情報を波形整形して２値レベルの矩形波信号に変換す
るレベルコンパレータに関するものである。
従来この種の装置として第１図に示すものがある。図に
おいて、波形整形されるべき入力信号はオペアンプ（演
算増幅器）からなる入力バッファｌを介してピークホー
ルド回路２へ供給される。
おいて、波形整形されるべき入力信号はオペアンプ（演
算増幅器）からなる入力バッファｌを介してピークホー
ルド回路２へ供給される。
このピークホールド回路２は、バッファ１の出力がベー
スに印加され電源がコレクタに印加されたＮＰＮトラン
ジスタＱ１と、このトランジスタのエミッタ出力により
充電々流が供給される蓄電素子たるコンデンサＣ□とか
らなっている。
スに印加され電源がコレクタに印加されたＮＰＮトラン
ジスタＱ１と、このトランジスタのエミッタ出力により
充電々流が供給される蓄電素子たるコンデンサＣ□とか
らなっている。
コンデンサＣ４の蓄電々圧すなわち入力信号のピークホ
ールド電圧がオペアンプからなるバッファ３を介して抵
抗Ｒ１，Ｉ’Ｌ、及びコンデンサＣ３からなるレベル比
較用基準電圧設定回路４へ入力される。
ールド電圧がオペアンプからなるバッファ３を介して抵
抗Ｒ１，Ｉ’Ｌ、及びコンデンサＣ３からなるレベル比
較用基準電圧設定回路４へ入力される。
このレベル比較用基準電圧■ｒはコンパレータ回路５の
１入力となってもうｌ力の入力である入力信号とレベル
比較されるようになっている。
１入力となってもうｌ力の入力である入力信号とレベル
比較されるようになっている。
か＼る構成において、入力信号がコンデンサＣよの蓄電
々圧よりも犬であれば、トランジスタＱ１がオンとなり
コンデンサＣ工に充電々流が流れて充電が行われる。従
って、入力信号の正ピークレベル捷で充電がなされ、入
力信号レベルが低下するとトランジスタＱ０はオフとな
りコンデンサＣＩには入力信号のピークレベルがホール
ドされることになる。このピークレベルが抵抗Ｒ０とＲ
８とによシ分圧されるから、Ｒよ−Ｒ２としておけば入
力信号のピークレベルの半分の電圧がレベルコンパレー
タ回路５０基準電圧■ｒとなる。この基準電圧Ｖｒに対
して入力信号レベルの大小に応じてコンパレータ回路５
の出力には２値レベルの矩形波信号が得られるのである
。
々圧よりも犬であれば、トランジスタＱ１がオンとなり
コンデンサＣ工に充電々流が流れて充電が行われる。従
って、入力信号の正ピークレベル捷で充電がなされ、入
力信号レベルが低下するとトランジスタＱ０はオフとな
りコンデンサＣＩには入力信号のピークレベルがホール
ドされることになる。このピークレベルが抵抗Ｒ０とＲ
８とによシ分圧されるから、Ｒよ−Ｒ２としておけば入
力信号のピークレベルの半分の電圧がレベルコンパレー
タ回路５０基準電圧■ｒとなる。この基準電圧Ｖｒに対
して入力信号レベルの大小に応じてコンパレータ回路５
の出力には２値レベルの矩形波信号が得られるのである
。
しかしながら、ＶＴＲ（ビデオテープレコーダ）の長時
間記録モード等により得られたビデオテープの再生ビデ
オフォーマット波形はかなシ乱れることがあシ、例えば
第２図（α）に示す如き乱れた再生波形が入力されるこ
とがある。か＼る乱れたビデオフォーマット信号の場合
のレベル比較用基準電圧■ｒは図（ａ）の一点鎖線にて
示す如き波形となり、その結果レベルコンパレータ出力
は図ＣＬ）の如くなる。すなわち、正確な波形整形がな
されず誤動作を行うことになる。
間記録モード等により得られたビデオテープの再生ビデ
オフォーマット波形はかなシ乱れることがあシ、例えば
第２図（α）に示す如き乱れた再生波形が入力されるこ
とがある。か＼る乱れたビデオフォーマット信号の場合
のレベル比較用基準電圧■ｒは図（ａ）の一点鎖線にて
示す如き波形となり、その結果レベルコンパレータ出力
は図ＣＬ）の如くなる。すなわち、正確な波形整形がな
されず誤動作を行うことになる。
そこで、再生されたビデオンオーマット信号を特殊な回
路を用いて８／Ｎを改善した後にレベルコンパレートす
る等の方法を行っているが、回路構成が複雑化してコス
トアップの要因となる。
路を用いて８／Ｎを改善した後にレベルコンパレートす
る等の方法を行っているが、回路構成が複雑化してコス
トアップの要因となる。
本発明は上記の様な従来のものの欠点を除去すべくなさ
れたものであって、その目的とするところは、入力信号
波形がかなシ乱れたものでも何等誤動作することなく正
確に波形整形を行いうる簡単な構成のレベルコンパレー
タを提供することにある。
れたものであって、その目的とするところは、入力信号
波形がかなシ乱れたものでも何等誤動作することなく正
確に波形整形を行いうる簡単な構成のレベルコンパレー
タを提供することにある。
本発明によるレベルコンパレータは、入力信号の１方の
ピークに追従して充電されかつこの入力信号の正規振幅
の略半分のレベルに相当する中点電位へ向けて所定時定
数をもって放電される第１の充放電回路と、この入力信
号の他方のピークに追従して充電されかつ中点電圧へ向
けて所定時定数をもって放電される第２の充放電回路と
、両光放電−回路の充電々圧の和の略半分の電圧を発生
する電圧発生回路とを有し、この電圧発生回路の出力電
圧をレベル比較用基準電圧として入力信号のレベル比較
をなすことを特徴としている。
ピークに追従して充電されかつこの入力信号の正規振幅
の略半分のレベルに相当する中点電位へ向けて所定時定
数をもって放電される第１の充放電回路と、この入力信
号の他方のピークに追従して充電されかつ中点電圧へ向
けて所定時定数をもって放電される第２の充放電回路と
、両光放電−回路の充電々圧の和の略半分の電圧を発生
する電圧発生回路とを有し、この電圧発生回路の出力電
圧をレベル比較用基準電圧として入力信号のレベル比較
をなすことを特徴としている。
こうすることによシ、連続して振幅が変化する入力信号
の瞬時瞬時における上下ピークレベルを第１及び第２の
充放電回路に」：り各々ある時間保持し、この保持され
たピーク対ピークの略１／２のレベルを比較基準レベル
とすることができることになって、入力信号が犬きく乱
れても常に正確な波形整形が可能となる。
の瞬時瞬時における上下ピークレベルを第１及び第２の
充放電回路に」：り各々ある時間保持し、この保持され
たピーク対ピークの略１／２のレベルを比較基準レベル
とすることができることになって、入力信号が犬きく乱
れても常に正確な波形整形が可能となる。
以下に本発明につき図面を用いて説明する。
第３図は本発明の実施例の回路図であり、入力信号は、
入力バッファ１’！ｚ介して第１の充放電回路６へ供給
されると共に第２の充放電回路７へ供給される。第１の
充放電回路は、入力信号が抵抗Ｒ８を介してベースに印
加された充電用ＮＰＮ ）ランジスタＱ２と、このトラ
ンジスタＱ、のエミッタとアースとの間に設けられて尚
該エミッタ電流により充電される第１のコンデンサＣ８
と、このコンデンサＣ８の放電用抵抗Ｒ６と金有し、こ
の抵抗１も、のｌ端には基準電圧Ｅが供給されている。
入力バッファ１’！ｚ介して第１の充放電回路６へ供給
されると共に第２の充放電回路７へ供給される。第１の
充放電回路は、入力信号が抵抗Ｒ８を介してベースに印
加された充電用ＮＰＮ ）ランジスタＱ２と、このトラ
ンジスタＱ、のエミッタとアースとの間に設けられて尚
該エミッタ電流により充電される第１のコンデンサＣ８
と、このコンデンサＣ８の放電用抵抗Ｒ６と金有し、こ
の抵抗１も、のｌ端には基準電圧Ｅが供給されている。
よって、充電トランジスタＱ２がオフのときコンデン？
Ｃ８は、このコンデンサＣ８と抵抗Ｒ５とによシ定まる
時定数をもって当該電圧Ｅへ向けて放電される。
Ｃ８は、このコンデンサＣ８と抵抗Ｒ５とによシ定まる
時定数をもって当該電圧Ｅへ向けて放電される。
第２の充放電回路は、入力信号が抵抗比４を介してベー
スに印加された充電用１）ＮＰ）ランジスタＱｌｌと、
このトランジスタＱ８のエミッタと回路電源（＋■）と
の間に設けられて当該エミッタ電流にょシ充電される第
２のコンデンサＣ４と、このコンデンサＣ４の放電用抵
抗１輸とを有し、この抵抗几。のｌ端には基準電圧Ｅが
供給されている。よって、充電トランジスタＱ８がオフ
のときコンデンサＣ２は、このコンデンサＣ１１と抵抗
Ｒ１１とにより定まる時定数をもって当該電圧Ｅへ向け
て放電される。
スに印加された充電用１）ＮＰ）ランジスタＱｌｌと、
このトランジスタＱ８のエミッタと回路電源（＋■）と
の間に設けられて当該エミッタ電流にょシ充電される第
２のコンデンサＣ４と、このコンデンサＣ４の放電用抵
抗１輸とを有し、この抵抗几。のｌ端には基準電圧Ｅが
供給されている。よって、充電トランジスタＱ８がオフ
のときコンデンサＣ２は、このコンデンサＣ１１と抵抗
Ｒ１１とにより定まる時定数をもって当該電圧Ｅへ向け
て放電される。
両コンデンサＣ８，Ｃ４の充電々圧出力は夫々バッファ
８，９を介して抵抗１％７． Ｒ８によシ合成される。
８，９を介して抵抗１％７． Ｒ８によシ合成される。
この合成電圧がレベルコンパレーク１０ルベル比較用基
準電圧ｖｒとなり、入力信号とのレベル比較がなされる
ものである。
準電圧ｖｒとなり、入力信号とのレベル比較がなされる
ものである。
か＼る構成において、入力信号が第４図（α）に示す様
にディジタルデータを含有するビデオフォーマット信号
であシ、基準電圧Ｅが当該ディジタルデータの正規振幅
Ａの略半分のレベルＶ２に相当する電圧に設定されてい
るとする。当該ペデスタル部分では信号レベルはグラン
ド１ノベルであるから、第２の充放電回路７の充電用ト
ランジスタＱ８がオンとなっており、第２コンデンサＣ
４はグランドレベルまで充電されている。この時、第１
の充放電回路の充電用トランジスタＱ２はオフとなって
いるから、第２コンデンサＣ８の充電々圧は中点電圧Ｅ
＝ Ｎつとなっている。従って、Ｒ８＝Ｒ７としてお
けば１． Ｖｒ ” ”’／２に設定されている。尚、
トランジスタのベース エミッタ間電圧は無視するもの
とする。
にディジタルデータを含有するビデオフォーマット信号
であシ、基準電圧Ｅが当該ディジタルデータの正規振幅
Ａの略半分のレベルＶ２に相当する電圧に設定されてい
るとする。当該ペデスタル部分では信号レベルはグラン
ド１ノベルであるから、第２の充放電回路７の充電用ト
ランジスタＱ８がオンとなっており、第２コンデンサＣ
４はグランドレベルまで充電されている。この時、第１
の充放電回路の充電用トランジスタＱ２はオフとなって
いるから、第２コンデンサＣ８の充電々圧は中点電圧Ｅ
＝ Ｎつとなっている。従って、Ｒ８＝Ｒ７としてお
けば１． Ｖｒ ” ”’／２に設定されている。尚、
トランジスタのベース エミッタ間電圧は無視するもの
とする。
この状態で、信号が変化し始めて立上ると、トランジス
タＱ８はオフとなシ第２コンデンザＣ４の電荷が抵抗Ｒ
６を介して中点電圧Ｅへ向けて放電を開始する。この場
合の信号レベルが第１コンデンザＣ８の充電々圧である
Ｅ以下であれば、トランジスタＱ、は依然としてオフで
あるから、この間は第２のコンデンサＣ６の充電々圧と
電圧Ｅとの中点電位がＶｒとなる。
タＱ８はオフとなシ第２コンデンザＣ４の電荷が抵抗Ｒ
６を介して中点電圧Ｅへ向けて放電を開始する。この場
合の信号レベルが第１コンデンザＣ８の充電々圧である
Ｅ以下であれば、トランジスタＱ、は依然としてオフで
あるから、この間は第２のコンデンサＣ６の充電々圧と
電圧Ｅとの中点電位がＶｒとなる。
信号レベルが更に増大して当該電圧Ｅより大となれば、
トランジスタＱ２がオンとなり信号の上側ピークに追従
するように第１コンデンサＣ８が充電される。このとき
、第２の充放電回路の充電用トランジスタＱ８はオフと
なっているから、第２コンデンサＣ２は中点電圧へ向け
て放電している。この瞬時瞬時の両コンデンザＣ８，Ｃ
，の充電電圧の和の半分がｖｒとして抵抗Ｒ，、Ｒ８に
ょシ得られる。
トランジスタＱ２がオンとなり信号の上側ピークに追従
するように第１コンデンサＣ８が充電される。このとき
、第２の充放電回路の充電用トランジスタＱ８はオフと
なっているから、第２コンデンサＣ２は中点電圧へ向け
て放電している。この瞬時瞬時の両コンデンザＣ８，Ｃ
，の充電電圧の和の半分がｖｒとして抵抗Ｒ，、Ｒ８に
ょシ得られる。
信号が上側ピークから立下って中点レベルＥに達する迄
は、両トランジスタＱ、 、 Ｃ３は共にオフであるか
ら、第１及び第２コンデンサＣ８及びＣ６は中点レベル
Ｅへ向けて放電する。信号レベルが更に低下して中点レ
ベルＥよシ小となると、トランジスタＱ８のみがオンと
なシ、信号レベルの下側ピークに追従するように第２コ
ンデンサＣ４が充電され始める。この場合も第１コンデ
ンサＣ８は中点レベルＥへ向けて放電している。この瞬
時瞬時の両コンデンサＣ３，Ｃ，の充電々圧の和の半分
がＶｒとして得られる。
は、両トランジスタＱ、 、 Ｃ３は共にオフであるか
ら、第１及び第２コンデンサＣ８及びＣ６は中点レベル
Ｅへ向けて放電する。信号レベルが更に低下して中点レ
ベルＥよシ小となると、トランジスタＱ８のみがオンと
なシ、信号レベルの下側ピークに追従するように第２コ
ンデンサＣ４が充電され始める。この場合も第１コンデ
ンサＣ８は中点レベルＥへ向けて放電している。この瞬
時瞬時の両コンデンサＣ３，Ｃ，の充電々圧の和の半分
がＶｒとして得られる。
第４図（ａ）に第３図の回路の上記動作波形が示されて
おシ、実線の入力信号波形に対して第１及び第２コンデ
ンザの充放電波形■、１及びｖＬが夫々点線にて示され
ている。そして、両ＶｌｆとｖＬとの電圧レベルの各和
の半分がＶｒとして一点鎖線にて示されている。この電
圧■、がレベルコンパレータ回路１０の基準電圧として
用いられるから、回路出力は第４図＜ｂ＞の如き矩形波
となり、不安定な入力波形に対しても確実にディジタル
データの弁別が可能となるのである。
おシ、実線の入力信号波形に対して第１及び第２コンデ
ンザの充放電波形■、１及びｖＬが夫々点線にて示され
ている。そして、両ＶｌｆとｖＬとの電圧レベルの各和
の半分がＶｒとして一点鎖線にて示されている。この電
圧■、がレベルコンパレータ回路１０の基準電圧として
用いられるから、回路出力は第４図＜ｂ＞の如き矩形波
となり、不安定な入力波形に対しても確実にディジタル
データの弁別が可能となるのである。
叙上の如く、本発明によれば簡単な構成にて乱れた入力
信号波形のディジタルデータを正しく弁別して矩形波に
整形することができる利点を有する０ 尚、上記実施例においては、ビデオフォーマット信号の
ディジタルデータ弁別につき述べたが、一般に交流信号
において波形が乱れることが予測される場合にも同様に
適用可能である。
信号波形のディジタルデータを正しく弁別して矩形波に
整形することができる利点を有する０ 尚、上記実施例においては、ビデオフォーマット信号の
ディジタルデータ弁別につき述べたが、一般に交流信号
において波形が乱れることが予測される場合にも同様に
適用可能である。
また、バッファとしてオペアンプ構成を用いているが、
トランジスタを用いて構成してもよく、種々の回路の改
変が可能であり、要は信号が連続して変化する場合の上
下ピークを夫々所定時定数をもって中点電位へ向けて放
電するようにして所定時間保持し、そのピークの中点（
”／２ ）レベルで入力信号を比較するようにする回路
方式とすれば良い。
トランジスタを用いて構成してもよく、種々の回路の改
変が可能であり、要は信号が連続して変化する場合の上
下ピークを夫々所定時定数をもって中点電位へ向けて放
電するようにして所定時間保持し、そのピークの中点（
”／２ ）レベルで入力信号を比較するようにする回路
方式とすれば良い。
第１図は従来のレベルコンパレータの回路図、第２図は
第１図の回路の動作波形を示す図、第３図は本発明の実
施例の回路図、第４図は第３図の回路の動作波形図であ
る。 主要部分の符号の説明 ６・・・第１の充放電回路 ７・・・第２の充放電回路
１０・・・レベルコンパレータ回路 Ｃ８・・・第１のコンデンサ Ｃ２・・・第２のコンデ
ンサ出願人 パイオニア株式会社 代理人 弁理士 藤 村 元 彦 （外１名）
第１図の回路の動作波形を示す図、第３図は本発明の実
施例の回路図、第４図は第３図の回路の動作波形図であ
る。 主要部分の符号の説明 ６・・・第１の充放電回路 ７・・・第２の充放電回路
１０・・・レベルコンパレータ回路 Ｃ８・・・第１のコンデンサ Ｃ２・・・第２のコンデ
ンサ出願人 パイオニア株式会社 代理人 弁理士 藤 村 元 彦 （外１名）
Claims (2)
- （１）入力信号の１方のピークに追従して充電されかつ
この入力信号の正規振幅の略半分のレベルに相当する中
点電圧へ向けて所定時定数をもって放電される第１の充
放電回路と、前記入力信号の他方のピークに追従して充
電されかつ前記中点電圧へ向けて所定時定数をもって放
電される第２の充放電回路と、前記第１及び第２の充放
電回路の充電々圧の和の略半分の電圧を発生する電圧発
生回路とを含み、この電圧発生回路の出力電圧をレベル
比較用基準電圧として前記入力信号のレベル比較をなす
ようにしてなるレベルコンパレータ。 - （２）前記第１の充放電回路は、第１のコンデンサと、
前記入力信号がこの第１のコンデンサの充電々圧よシも
犬なるときにこのコンデンサを前記入力信号に追従して
充電し、小なるときにこのコンデンサを前中点電圧へ向
けて所定時定数をもって放電する手段とからなシ、前記
第２の充放電回路は、第２のコンデンサと、前記入力信
号がこの第２のコンデンサの充電々圧よりも小なるとき
にこの第２のコンデンサを前記入力信号に追従して充電
し、大なるときこの第２のコンデンサを前記中点電圧へ
向けて所定時定数をもって放電する手段とからなる特許
請求の範囲第１項記載のレベルコンパレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13418383A JPS6025319A (ja) | 1983-07-22 | 1983-07-22 | レベルコンパレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13418383A JPS6025319A (ja) | 1983-07-22 | 1983-07-22 | レベルコンパレ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6025319A true JPS6025319A (ja) | 1985-02-08 |
Family
ID=15122375
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13418383A Pending JPS6025319A (ja) | 1983-07-22 | 1983-07-22 | レベルコンパレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6025319A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63312537A (ja) * | 1987-06-05 | 1988-12-21 | イートン コーポレーション | ねじり振動減衰機構を備えるフライホィールアセンブリ |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55150645A (en) * | 1979-05-14 | 1980-11-22 | Sony Corp | Data sampling circuit |
-
1983
- 1983-07-22 JP JP13418383A patent/JPS6025319A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55150645A (en) * | 1979-05-14 | 1980-11-22 | Sony Corp | Data sampling circuit |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63312537A (ja) * | 1987-06-05 | 1988-12-21 | イートン コーポレーション | ねじり振動減衰機構を備えるフライホィールアセンブリ |
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