JPS6014358A - 情報収集装置 - Google Patents
情報収集装置Info
- Publication number
- JPS6014358A JPS6014358A JP58121200A JP12120083A JPS6014358A JP S6014358 A JPS6014358 A JP S6014358A JP 58121200 A JP58121200 A JP 58121200A JP 12120083 A JP12120083 A JP 12120083A JP S6014358 A JPS6014358 A JP S6014358A
- Authority
- JP
- Japan
- Prior art keywords
- information
- memory
- register
- address
- adder
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/30—Monitoring
- G06F11/34—Recording or statistical evaluation of computer activity, e.g. of down time, of input/output operation ; Recording or statistical evaluation of user activity, e.g. usability assessment
Landscapes
- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（１） 発明の属する技術分野の説明
本発明は、情報収集装置に関し、特に、情報処理装置の
内部動作状態（性能等）に関する情報を収集する情報収
集装置に関するものである。
内部動作状態（性能等）に関する情報を収集する情報収
集装置に関するものである。
（２） 従来技術の説明
従来、情報処理装置において、装置内部の動作状態を調
査する（例えば性能測定等）場合には、測定用に接続端
子等を設け、これにカウンタを接続して測定していた。
査する（例えば性能測定等）場合には、測定用に接続端
子等を設け、これにカウンタを接続して測定していた。
又、複数の信号の組合わせ− 」 −〇ｒＰ
の状態を測定する場合には、それぞれの組合せに応じた
組合せ回路を必要とした。特に、装置間のインタフェー
スに使用される通信コードの使用回数を各使用コード毎
に測定したい場合には通信コードのデコード回路を必要
とし、かつカウンタ等もデコード出力の数だけ必要とし
、測定の実行上不便であった。
組合せ回路を必要とした。特に、装置間のインタフェー
スに使用される通信コードの使用回数を各使用コード毎
に測定したい場合には通信コードのデコード回路を必要
とし、かつカウンタ等もデコード出力の数だけ必要とし
、測定の実行上不便であった。
（３） 発明の詳細な説明
本発明は従来の技術に内在する上記欠点を解消する為に
なされたものであり、従って本発明の目的は、装置の内
部状態の収集、特に、コード化されたデータのコード別
の出現頻度を調査する為に、デコード回路、測定器等を
使用することなく簡単に状態情報の収集ができる新規な
情報収集装置を提供することにある。
なされたものであり、従って本発明の目的は、装置の内
部状態の収集、特に、コード化されたデータのコード別
の出現頻度を調査する為に、デコード回路、測定器等を
使用することなく簡単に状態情報の収集ができる新規な
情報収集装置を提供することにある。
（４） 発明の構成
上記目的を達成する為に、本発明に係る情報収集装置ｔ
は、２ワードの容量をもつメモリと、ｎビットの情報を
保持し前記メモリへのアドレス可能なレジスタと、前記
メモリのＵｔみ出された内容を ２− ″′１′″加算する加算器と、前記加賀゛器の出力を前
記メモリへ曹込む手段とを備えて構成される。
は、２ワードの容量をもつメモリと、ｎビットの情報を
保持し前記メモリへのアドレス可能なレジスタと、前記
メモリのＵｔみ出された内容を ２− ″′１′″加算する加算器と、前記加賀゛器の出力を前
記メモリへ曹込む手段とを備えて構成される。
（５） 発明の実施例の説明
次に、本発明をその好ましい一実施例について図面を参
照して詳Ａ４１１ ｈこ説明する。
照して詳Ａ４１１ ｈこ説明する。
第１図は本発明に係Ｚ）情報収集装置ばの一実施例を示
すブロック構成図である。図をこおいて、本発明の一実
施例は、１で示される２ワードのメモリと、２で示され
るｎビットのレジスタと、３で示される＋１を行う加社
器と、４で示されるメモリへの１込み制御を行う回路と
により構成される。
すブロック構成図である。図をこおいて、本発明の一実
施例は、１で示される２ワードのメモリと、２で示され
るｎビットのレジスタと、３で示される＋１を行う加社
器と、４で示されるメモリへの１込み制御を行う回路と
により構成される。
情報処理装置において、内部の動作状態を知る為に必９
ｙｚ ｎビットのｉ′１１報があり、これらの１“Ｕ
報のダイナミックな動作を四側したい時に、本発明が有
効となる。
ｙｚ ｎビットのｉ′１１報があり、これらの１“Ｕ
報のダイナミックな動作を四側したい時に、本発明が有
効となる。
前記ｎビットの情報は、同じｎピントの長さをもつレジ
スタ２へ導ひかれセットされる。レジスタ２は、メモリ
１へのアドレス情報を与え、このアドレスに従って、メ
モリ１の該当する内容が胱出され、加η器３で＋１され
る。メモリ１へのｌ込み制御回路４け、情報処理装置Ｍ
内の特定信号（例えばクロック信＠）によＶ加ｑ器３の
出力データとメモリ１のレジスタ２で示されるアドレス
へ書込みを行う。
スタ２へ導ひかれセットされる。レジスタ２は、メモリ
１へのアドレス情報を与え、このアドレスに従って、メ
モリ１の該当する内容が胱出され、加η器３で＋１され
る。メモリ１へのｌ込み制御回路４け、情報処理装置Ｍ
内の特定信号（例えばクロック信＠）によＶ加ｑ器３の
出力データとメモリ１のレジスタ２で示されるアドレス
へ書込みを行う。
更に具体的な実施例として、装置間の通信を通信コート
で行っている場合の通信コードの出現頻度を調査するケ
ースについて説明する。レジスタ２へＨｎピットの通信
コードが入力され、メモリ１への書込制御回路４へ一通
信の周期信号が入力される。今、通信が通信コード″ａ
”で実行されると、レジスタ２の内容がａ”と’ａＤｓ
その結果としてメモリ１のａ番地の内容が読出され、加
算器３により＋１されて、更に″″ａ″ａ″箱地みが行
なわれ、通信コード″ａ″が１回実行されたことがメモ
リ】に記録される。このようにして順次記録されること
により、必る時点でメモリ】の内容を読出すことにより
、通信コード毎にその出現頻度を知ることができる。又
、ｎビットのう−夕の特定のｍ （ｍ （ｎ ）ピント
で代表されるデータ（ｎ−ｍビットが不定でよいコード
）の出現頻度をめる場合には、データの記録方法は前記
ｎビットの場合と同じであるが、胱出しの時、ｍビット
でアトｌ／スされる複数ワードの内容をすべて加算する
ことによりその出現頻度をめることが可能である。
で行っている場合の通信コードの出現頻度を調査するケ
ースについて説明する。レジスタ２へＨｎピットの通信
コードが入力され、メモリ１への書込制御回路４へ一通
信の周期信号が入力される。今、通信が通信コード″ａ
”で実行されると、レジスタ２の内容がａ”と’ａＤｓ
その結果としてメモリ１のａ番地の内容が読出され、加
算器３により＋１されて、更に″″ａ″ａ″箱地みが行
なわれ、通信コード″ａ″が１回実行されたことがメモ
リ】に記録される。このようにして順次記録されること
により、必る時点でメモリ】の内容を読出すことにより
、通信コード毎にその出現頻度を知ることができる。又
、ｎビットのう−夕の特定のｍ （ｍ （ｎ ）ピント
で代表されるデータ（ｎ−ｍビットが不定でよいコード
）の出現頻度をめる場合には、データの記録方法は前記
ｎビットの場合と同じであるが、胱出しの時、ｍビット
でアトｌ／スされる複数ワードの内容をすべて加算する
ことによりその出現頻度をめることが可能である。
（６） 発明の詳細な説明
本発明には、以上説明したように、情報収集の対象デー
タを収集用のメモリのアドレスとして使用することによ
り、コード化された情報の頻度を簡増に収集できるとい
う効果がある。
タを収集用のメモリのアドレスとして使用することによ
り、コード化された情報の頻度を簡増に収集できるとい
う効果がある。
＠１図は本発明の一実施例を示すブロック構成図である
。 １・・・２？１ワードのメモリ、２・ｓｏｎビットのレ
ジスタ、３・・−＋１を行う加算器、４・・・メモリ書
込の制御回路 特許出願人 日本亀気株式会社 代 理 人 弁理士 熊 谷雄太部 第１ 図
。 １・・・２？１ワードのメモリ、２・ｓｏｎビットのレ
ジスタ、３・・−＋１を行う加算器、４・・・メモリ書
込の制御回路 特許出願人 日本亀気株式会社 代 理 人 弁理士 熊 谷雄太部 第１ 図
Claims (1)
- 情報処理装置において、２ワードの容量をもつメモリと
、ｎビットの情報を保持し前記メモリへのアドレス可能
なレジスタと、前記メモリの読出された内容を″１″加
算する加算器と、前記加算器の出力を前記メモリへ曹込
む手段とを有することを特徴とした情報収集装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58121200A JPS6014358A (ja) | 1983-07-04 | 1983-07-04 | 情報収集装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58121200A JPS6014358A (ja) | 1983-07-04 | 1983-07-04 | 情報収集装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6014358A true JPS6014358A (ja) | 1985-01-24 |
Family
ID=14805340
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58121200A Pending JPS6014358A (ja) | 1983-07-04 | 1983-07-04 | 情報収集装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6014358A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61286940A (ja) * | 1985-06-13 | 1986-12-17 | テクトロニツクス・インコ−ポレイテツド | イベントカウンタ |
-
1983
- 1983-07-04 JP JP58121200A patent/JPS6014358A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61286940A (ja) * | 1985-06-13 | 1986-12-17 | テクトロニツクス・インコ−ポレイテツド | イベントカウンタ |
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