JPS60112327A - Ｍｏｓ集積回路のｄａコンバ−タ - Google Patents
Ｍｏｓ集積回路のｄａコンバ−タInfo
- Publication number
- JPS60112327A JPS60112327A JP21987783A JP21987783A JPS60112327A JP S60112327 A JPS60112327 A JP S60112327A JP 21987783 A JP21987783 A JP 21987783A JP 21987783 A JP21987783 A JP 21987783A JP S60112327 A JPS60112327 A JP S60112327A
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- JP
- Japan
- Prior art keywords
- component
- resistor
- integrated circuit
- potential
- mos
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/66—Digital/analogue converters
- H03M1/74—Simultaneous conversion
- H03M1/76—Simultaneous conversion using switching tree
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明はＭＯ５集積回路が形成された同一半導体チップ
内に、抵抗を縦列接続して構成されるＤＡコンバータに
関するものである。
内に、抵抗を縦列接続して構成されるＤＡコンバータに
関するものである。
〈従来技術〉
Ｍ ＯＳ ）ランジスタを利用したディジタル回路技術
が著しく進歩するのに伴って、従来はバイポーラトラン
ジスタを利用した回路で処理されていたアナログ信号が
、ＡＤ変換されてＭＯＳディジタル回路でも取り扱われ
るようになってきた。
が著しく進歩するのに伴って、従来はバイポーラトラン
ジスタを利用した回路で処理されていたアナログ信号が
、ＡＤ変換されてＭＯＳディジタル回路でも取り扱われ
るようになってきた。
従来からＭ ＯＳ集積回路と同一チップ内に形成されて
ＡＤ変換のために用いられるＤＡコンバータの等価回路
を第２図に示す。同図は２ピツ）（Ａ。
ＡＤ変換のために用いられるＤＡコンバータの等価回路
を第２図に示す。同図は２ピツ）（Ａ。
Ａ、Ｂ、Ｂ ）からなるデコード信号が与えられて動作
する回路で、５個の単位抵抗Ｒが基準電圧ｖｆと接地端
子間に縦列接続され、各単位抵抗Ｒにスイッチング）・
ランジスタＴが接続され、スイッチングトランジスタを
上記デコード信号で制御することによって選択した一つ
の電位を形成している。
する回路で、５個の単位抵抗Ｒが基準電圧ｖｆと接地端
子間に縦列接続され、各単位抵抗Ｒにスイッチング）・
ランジスタＴが接続され、スイッチングトランジスタを
上記デコード信号で制御することによって選択した一つ
の電位を形成している。
上記抵抗ラダーを備えてなるＤＡコンバータは、ＭＯ５
集積回路が形成された半導体チップに、第３図に示す如
く拡散によって直線状の抵抗体ＲＱを作成し、該抵抗体
ＲＱの単位毎にリード線Ｑをを引き出し、該リード線Ｑ
に接続されたデコードスイッチとなるＭＯＳトランジス
タＴを作成して構成されている。
集積回路が形成された半導体チップに、第３図に示す如
く拡散によって直線状の抵抗体ＲＱを作成し、該抵抗体
ＲＱの単位毎にリード線Ｑをを引き出し、該リード線Ｑ
に接続されたデコードスイッチとなるＭＯＳトランジス
タＴを作成して構成されている。
処で単位抵抗体Ｒの抵抗値は拡散層の長さくＬ）と幅Ｏ
Ｖ）で決まり、例えばＬ−２０μで８ビツトＯＤＡ千ン
バータを作成する場合には、８ビツトであるため２０Ｘ
２５６＝５１２０（μ）の長さが必要になる。集積回路
を作成したチップサイズが充分大きい場合には、上記の
ような抵抗体ＲＱ も内蔵し得るが、ＬＳ’ｌの高密度
化が進む中でＤＡコンバータも効率的な空間配置が望壕
れていた。
Ｖ）で決まり、例えばＬ−２０μで８ビツトＯＤＡ千ン
バータを作成する場合には、８ビツトであるため２０Ｘ
２５６＝５１２０（μ）の長さが必要になる。集積回路
を作成したチップサイズが充分大きい場合には、上記の
ような抵抗体ＲＱ も内蔵し得るが、ＬＳ’ｌの高密度
化が進む中でＤＡコンバータも効率的な空間配置が望壕
れていた。
またＬＳＩ内の周辺回路との関係等によって、上記抵抗
体ＲＱを第４図の如く２本ＲｏＪ、 Ｒｏｌ に形成し
、両紙抗体Ｒｏ′の間を拡散層にコンタクトする金属Ｍ
で接続することにより、折９返した形態の抵抗体として
いる。このような抵抗体では長さしの減少は図れるが、
コンタクト抵抗で誤差が生じ、また折り返点周辺での配
線部分で面積が大きくなるという問題があった。このよ
うな不都合に対して便さしによる占有空間の増加を軽減
するため幅Ｗを細くすることも考えられるが、幅Ｗを細
くした場合には拡散層の線幅のばらつきによる誤差が大
きくなり、精度が著しく低下するという欠点がある。
体ＲＱを第４図の如く２本ＲｏＪ、 Ｒｏｌ に形成し
、両紙抗体Ｒｏ′の間を拡散層にコンタクトする金属Ｍ
で接続することにより、折９返した形態の抵抗体として
いる。このような抵抗体では長さしの減少は図れるが、
コンタクト抵抗で誤差が生じ、また折り返点周辺での配
線部分で面積が大きくなるという問題があった。このよ
うな不都合に対して便さしによる占有空間の増加を軽減
するため幅Ｗを細くすることも考えられるが、幅Ｗを細
くした場合には拡散層の線幅のばらつきによる誤差が大
きくなり、精度が著しく低下するという欠点がある。
〈発明の目的〉
本発明は上記従来装置の欠点を除去し、長さＬを長くし
ても占有面積をわずかに増加させるだけで、長さをほと
んど変えることなく抵抗網を得ることができるＤＡコン
バータである。
ても占有面積をわずかに増加させるだけで、長さをほと
んど変えることなく抵抗網を得ることができるＤＡコン
バータである。
〈実施例〉
第１図は本発明による一実施例を示す平面図で、Ｍ Ｏ
Ｓ集積回路が形成された同一半導体チップに組込まれて
ＤＡコンバータを構成する。即ちＭＯ５集積回路が形成
された半導体チップ１に拡散により抵抗体２（等測的に
単位抵抗をラダーに接続）が形成される。該抵抗体２は
幅Ｗの拡散層を、間隔Ｈの間して延びた主抵抗成分２ａ
と、該抵抗成分２ａの夫々の端に直角方向に延びた従抵
抗成分２ｂとを連結させ、デコーダ機能に必要な分解能
を得るために多段に蛇行させて対称形に形成され、電気
的に抵抗成分２ａ及び２ｂからなる単位抵抗がラダー接
続して構成される。
Ｓ集積回路が形成された同一半導体チップに組込まれて
ＤＡコンバータを構成する。即ちＭＯ５集積回路が形成
された半導体チップ１に拡散により抵抗体２（等測的に
単位抵抗をラダーに接続）が形成される。該抵抗体２は
幅Ｗの拡散層を、間隔Ｈの間して延びた主抵抗成分２ａ
と、該抵抗成分２ａの夫々の端に直角方向に延びた従抵
抗成分２ｂとを連結させ、デコーダ機能に必要な分解能
を得るために多段に蛇行させて対称形に形成され、電気
的に抵抗成分２ａ及び２ｂからなる単位抵抗がラダー接
続して構成される。
上記抵抗体２は主抵抗成分２ａを挾んで、一方の従抵抗
成分２ｂの中央から他方の従抵抗成分２ｂの中央までの
長さしの単位抵抗として形成され、各従抵抗成分２ｂの
中央位置には電位を取シ出すためのリード線Ｑが接線さ
れている。従抵抗成分２ｂは主抵抗成分２ａの両側に位
置していることから、リード線Ｑもまた両側に引き出さ
れ、各リード線Ｑの他端は同一半導体チップに形成され
たＭＯＳ）ランジスタＴのソース又はドレインに接続さ
れている。該ＭＯ３）ランジスタＴは出力電位を選択し
て取υ出すためのデコードスイッチを構成し、ゲートに
は出力電位を選択するだめのデコード信号（Ａ、Ａ、、
Ｂ、■）が与えられ、デコード動作に必要な段数が順次
接続されている。
成分２ｂの中央から他方の従抵抗成分２ｂの中央までの
長さしの単位抵抗として形成され、各従抵抗成分２ｂの
中央位置には電位を取シ出すためのリード線Ｑが接線さ
れている。従抵抗成分２ｂは主抵抗成分２ａの両側に位
置していることから、リード線Ｑもまた両側に引き出さ
れ、各リード線Ｑの他端は同一半導体チップに形成され
たＭＯＳ）ランジスタＴのソース又はドレインに接続さ
れている。該ＭＯ３）ランジスタＴは出力電位を選択し
て取υ出すためのデコードスイッチを構成し、ゲートに
は出力電位を選択するだめのデコード信号（Ａ、Ａ、、
Ｂ、■）が与えられ、デコード動作に必要な段数が順次
接続されている。
尚デコードスイッチについては、従抵抗成分に直接接続
された初段が抵抗体の両側に位置して設けられ、以降の
デコードスイッチについては≠櫟十；≠４→禰涌関ト＝
巳助鋒社リード線で右側に移して構成する。
された初段が抵抗体の両側に位置して設けられ、以降の
デコードスイッチについては≠櫟十；≠４→禰涌関ト＝
巳助鋒社リード線で右側に移して構成する。
上記デコードスイッチＱのオン・オフを制御することに
よシ、一つのタップ電位を選択して出力することができ
る。出力された電位は、アナログ信号が入力された比較
器に与えられ、Ａ、 Ｄ変換のだめの参照電位を提供す
る。
よシ、一つのタップ電位を選択して出力することができ
る。出力された電位は、アナログ信号が入力された比較
器に与えられ、Ａ、 Ｄ変換のだめの参照電位を提供す
る。
〈効 果〉
以上本発明によれば、拡散抵抗を多重に蛇行させて配置
し、出力を抵抗体の両側から引き出すことによシ、単位
抵抗体として長い抵抗体を必要とする場合にも、ＤＡコ
ンバータの占有面積の幅をわずかに大きくするたけで、
対応することができ、捷だ長さの変更による抵抗値の増
大が容易であるため線幅に対する負担が著しく軽減され
、線幅のバラツキによる誤差がほとんどなく、信頼性の
高いＤＡコンバータを得ることができる。
し、出力を抵抗体の両側から引き出すことによシ、単位
抵抗体として長い抵抗体を必要とする場合にも、ＤＡコ
ンバータの占有面積の幅をわずかに大きくするたけで、
対応することができ、捷だ長さの変更による抵抗値の増
大が容易であるため線幅に対する負担が著しく軽減され
、線幅のバラツキによる誤差がほとんどなく、信頼性の
高いＤＡコンバータを得ることができる。
【図面の簡単な説明】
第１図は本発明による一実施例を示す要部パターン図、
第２図ばＤＡコンバータを示す等価回路図、第３図は従
来装置のパターン図、第４図は他の従来装置の要部パタ
ーン図である。 １：集積回路チップ ２：抵抗体 Ｑ：リードＩ″ 線 Ｔニー・Δ（ＯＳトランジスタ ♀ 代理人 弁理士 福 士 愛 彦（他２名）第２ 図 Ｎ 梁４ 図 第１図 ＄３図
第２図ばＤＡコンバータを示す等価回路図、第３図は従
来装置のパターン図、第４図は他の従来装置の要部パタ
ーン図である。 １：集積回路チップ ２：抵抗体 Ｑ：リードＩ″ 線 Ｔニー・Δ（ＯＳトランジスタ ♀ 代理人 弁理士 福 士 愛 彦（他２名）第２ 図 Ｎ 梁４ 図 第１図 ＄３図
Claims (1)
- １）ＭＯ５回路が形成された同一チップ内に抵抗を縦列
接続してなるＤＡコンバータにおいて、抵抗は所定面積
間に蛇行させて形成され、該蛇行状抵抗の両側に位置さ
せてデコードスイッチが設けられたことを特徴とするＭ
Ｏ５集積回路ＯＤＡコンバータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21987783A JPS60112327A (ja) | 1983-11-22 | 1983-11-22 | Ｍｏｓ集積回路のｄａコンバ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21987783A JPS60112327A (ja) | 1983-11-22 | 1983-11-22 | Ｍｏｓ集積回路のｄａコンバ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60112327A true JPS60112327A (ja) | 1985-06-18 |
Family
ID=16742456
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21987783A Pending JPS60112327A (ja) | 1983-11-22 | 1983-11-22 | Ｍｏｓ集積回路のｄａコンバ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60112327A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2642588A1 (fr) * | 1989-01-31 | 1990-08-03 | Jaeger | Dispositif de mise en forme de signaux analogiques frequentiels, a dynamique elevee |
| FR2642585A1 (fr) * | 1989-01-31 | 1990-08-03 | Jaeger | Dispositif de mise en forme de signaux analogiques frequentiels |
| FR2642586A1 (fr) * | 1989-01-31 | 1990-08-03 | Jaeger | Dispositif de mise en forme de signaux analogiques frequentiels, presentant des impulsions utiles de polarite positive ou negative |
| FR2642587A1 (fr) * | 1989-01-31 | 1990-08-03 | Jaeger | Perfectionnements aux dispositifs assurant une mise en forme de signaux analogiques frequentiels |
| EP0708532A1 (en) * | 1994-10-21 | 1996-04-24 | AT&T Corp. | Resistor string with equal resistance resistors and digital-analog converter using the same |
| US5680132A (en) * | 1994-12-15 | 1997-10-21 | Nec Corporation | Digital to analog converter having a string of resistors |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS553604A (en) * | 1978-06-21 | 1980-01-11 | Pioneer Electronic Corp | Packaging method of resistance element for integrated circuit |
| JPS58133029A (ja) * | 1982-02-02 | 1983-08-08 | Toshiba Corp | Ｄａ変換回路 |
| JPS58182918A (ja) * | 1982-04-21 | 1983-10-26 | Toshiba Corp | 電圧分圧回路 |
-
1983
- 1983-11-22 JP JP21987783A patent/JPS60112327A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS553604A (en) * | 1978-06-21 | 1980-01-11 | Pioneer Electronic Corp | Packaging method of resistance element for integrated circuit |
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| FR2642588A1 (fr) * | 1989-01-31 | 1990-08-03 | Jaeger | Dispositif de mise en forme de signaux analogiques frequentiels, a dynamique elevee |
| FR2642585A1 (fr) * | 1989-01-31 | 1990-08-03 | Jaeger | Dispositif de mise en forme de signaux analogiques frequentiels |
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| FR2642587A1 (fr) * | 1989-01-31 | 1990-08-03 | Jaeger | Perfectionnements aux dispositifs assurant une mise en forme de signaux analogiques frequentiels |
| EP0708532A1 (en) * | 1994-10-21 | 1996-04-24 | AT&T Corp. | Resistor string with equal resistance resistors and digital-analog converter using the same |
| US5680132A (en) * | 1994-12-15 | 1997-10-21 | Nec Corporation | Digital to analog converter having a string of resistors |
| DE19546953B4 (de) * | 1994-12-15 | 2005-12-22 | Nec Electronics Corp., Kawasaki | Halbleitervorrichtung beziehungsweise Digital-Analog-Wandler mit Widerstandsreihe |
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