JPS599304Y2 - 入出力装置診断装置 - Google Patents
入出力装置診断装置Info
- Publication number
- JPS599304Y2 JPS599304Y2 JP15444182U JP15444182U JPS599304Y2 JP S599304 Y2 JPS599304 Y2 JP S599304Y2 JP 15444182 U JP15444182 U JP 15444182U JP 15444182 U JP15444182 U JP 15444182U JP S599304 Y2 JPS599304 Y2 JP S599304Y2
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- JP
- Japan
- Prior art keywords
- section
- data bus
- diagnostic
- closing
- abnormality
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- Test And Diagnosis Of Digital Computers (AREA)
Description
【考案の詳細な説明】
本考案は入出力装置の診断装置に関する。
一般に入出力装置（以下Ｉ／Ｏ装置と称す）はＣＰＵ
（中央処理装置）の指令に従って動作するものであり、
そのＩ／Ｏ装置は該ＣＰＵとデータ交換を行なうコント
ロール部およびデバイス部から構或される。
（中央処理装置）の指令に従って動作するものであり、
そのＩ／Ｏ装置は該ＣＰＵとデータ交換を行なうコント
ロール部およびデバイス部から構或される。
このコントロール部はプロセッサ制御部として構威され
るのが普通であり、一方、前記デバイス部は、例えばＩ
／Ｏ装置がラインプリンタの場合、印字機構部に相当す
るものである。
るのが普通であり、一方、前記デバイス部は、例えばＩ
／Ｏ装置がラインプリンタの場合、印字機構部に相当す
るものである。
従来、上記のＩ／Ｏ装置が故障した場合、ＣＰＵからの
診断指令によりその故障の原因を自動的に発見すること
が困難であるばかりでなく、上記コントロール部および
デバイス部にのいずれに故障があるのかということすら
も容易には発見できなかった。
診断指令によりその故障の原因を自動的に発見すること
が困難であるばかりでなく、上記コントロール部および
デバイス部にのいずれに故障があるのかということすら
も容易には発見できなかった。
このため、従来、Ｉ／Ｏ装置に故障が発生した場合その
診断のために相当の時間を必要とするのが常であった。
診断のために相当の時間を必要とするのが常であった。
この様な故障が発生した場合、故障箇所そのものが即座
に判定できれば問題はないが、実際には故障箇所の判定
はかなり困難であり、少なくともＩ／Ｏ装置内のコント
ロール部およびテ゛バイス部のいずれに故障があるかを
判定できれば、Ｉ／Ｏ装置の故障回復時間はかなり短縮
でき、Ｉ／Ｏ装置の高効率な使用を維持する上で有利で
ある。
に判定できれば問題はないが、実際には故障箇所の判定
はかなり困難であり、少なくともＩ／Ｏ装置内のコント
ロール部およびテ゛バイス部のいずれに故障があるかを
判定できれば、Ｉ／Ｏ装置の故障回復時間はかなり短縮
でき、Ｉ／Ｏ装置の高効率な使用を維持する上で有利で
ある。
従って本考案の第一の目的は、Ｉ／Ｏ装置内におけるコ
ントロール部およびデバイス部のいずれに故障があるか
を判定し得る、Ｉ／Ｏ装置の診断装置を提案することで
あり、また第２の目的は、デバイス部が無くともコント
ロール部の試験を可能にすることである。
ントロール部およびデバイス部のいずれに故障があるか
を判定し得る、Ｉ／Ｏ装置の診断装置を提案することで
あり、また第２の目的は、デバイス部が無くともコント
ロール部の試験を可能にすることである。
上記目的に従い本考案は、コントロール部とデバイス部
とを結ぶデータ・バスを、該コントロール部内に新設し
たゲート手段により開閉自在とし、診断モード下におい
て、ライト・モードにあってはコントロール部自から発
生したデータが正常か否かを自内でチェックし、一方、
リード・モードにあってはコントロール部自から発生し
た診断データによって自内の処理が正常か否かをチェッ
クして、自内が正常でなければコントロール部が異常で
あることを判定し、一方自内が異常でなければデバイス
部が異常であることを判定するようにしたことを特徴と
するものである。
とを結ぶデータ・バスを、該コントロール部内に新設し
たゲート手段により開閉自在とし、診断モード下におい
て、ライト・モードにあってはコントロール部自から発
生したデータが正常か否かを自内でチェックし、一方、
リード・モードにあってはコントロール部自から発生し
た診断データによって自内の処理が正常か否かをチェッ
クして、自内が正常でなければコントロール部が異常で
あることを判定し、一方自内が異常でなければデバイス
部が異常であることを判定するようにしたことを特徴と
するものである。
以下図面を参照して本考案を説明する。
第１図は一般的なＩ／Ｏ装置を示すブロック図である。
本図において、１１はＩ／Ｏ装置であり、プロセッサ制
御を行なうコントロール部１２とデバイス部１３とに区
分される。
御を行なうコントロール部１２とデバイス部１３とに区
分される。
Ｉ／Ｏ装置１１が例えばラインプリンタであるとすると
、テ゛バイス部１３はハンマーマグネット等の印字機構
部である。
、テ゛バイス部１３はハンマーマグネット等の印字機構
部である。
コントロール部１２は外部のＣＰＵとデータの交換を行
ない、一方Ｉ／Ｏ装置１１内ではデバイス部１３とデー
タの交換を行なう。
ない、一方Ｉ／Ｏ装置１１内ではデバイス部１３とデー
タの交換を行なう。
後者のデータの交換はＩ／Ｏ装置１１内のライト・デー
タ・バス１４およびリード・テ゛一タ・バス１５を通し
て行なわれる。
タ・バス１４およびリード・テ゛一タ・バス１５を通し
て行なわれる。
上記のＩ／Ｏ装置１１内で故障が発生したとき、既述の
とおり、従来はその故障箇所の発見が相当困難であった
。
とおり、従来はその故障箇所の発見が相当困難であった
。
そこで本考案は、Ｉ／Ｏ装置１１内において故障が発生
したとき、少なくともコントロール部１２およびテ゛バ
イス部１３のいずれに故障があるかを迅速に判定可能な
、Ｉ／Ｏ装置診断装置を提供する。
したとき、少なくともコントロール部１２およびテ゛バ
イス部１３のいずれに故障があるかを迅速に判定可能な
、Ｉ／Ｏ装置診断装置を提供する。
この本考案の診断装置は、コントロール部１２とデバイ
ス部１３とを分離することにより故障箇所の判定を行な
うものであり、ライト・モードおよびリード・モード個
々に前記の分離を行なう。
ス部１３とを分離することにより故障箇所の判定を行な
うものであり、ライト・モードおよびリード・モード個
々に前記の分離を行なう。
先ずライト・モードにおける本考案装置の実施例を、第
２図を参照して述べる。
２図を参照して述べる。
ただし、第２図において第１図と同一の参照番号が付さ
れたものは相互に同一である。
れたものは相互に同一である。
今、Ｉ／Ｏ装置１１内において故障が発生したとすると
、ＣＰＵから診断モード指定Ｄを受信する。
、ＣＰＵから診断モード指定Ｄを受信する。
これにより、コントロール部１２内に新設されたゲート
手段２１が動作し、ライト・データ・バス１４を閉鎖す
る。
手段２１が動作し、ライト・データ・バス１４を閉鎖す
る。
これによりコントロール部１２はデバイス部１３と関係
なく動作することができる。
なく動作することができる。
そこで、Ｉ／Ｏ装置１１の故障を誘起したときの、若し
くはこれに相当するライト・データを既存のライト・デ
ータ発生部２２より出力する。
くはこれに相当するライト・データを既存のライト・デ
ータ発生部２２より出力する。
このライト・データは、閉となっているゲート手段２１
で折り返されてチェック部２３に印加される。
で折り返されてチェック部２３に印加される。
チェック部２３において、該ライト・データ自身に誤り
があれば、Ｉ／Ｏ装置１１内の故障はコントロール部１
２にあるものと判定しエラー信号ｂを発生する。
があれば、Ｉ／Ｏ装置１１内の故障はコントロール部１
２にあるものと判定しエラー信号ｂを発生する。
一方、該ライト・テ゛一夕自身に誤りがなければ、Ｉ／
Ｏ装置１１内の故障はデバイス部１３にあるものと判定
し、エラー信号Ｅ２を発生する。
Ｏ装置１１内の故障はデバイス部１３にあるものと判定
し、エラー信号Ｅ２を発生する。
かくして、診断モード時であって且つライト・モード下
での故障箇所の判定が完了する。
での故障箇所の判定が完了する。
なお、上述の診断パターンはＣＰＵから供給されてもよ
く、あるいはもしコントロール部１２自身に予め当該診
断パターンを備えてあれば、ＣＰＵからの指示なしに自
から診断を実行することもできる。
く、あるいはもしコントロール部１２自身に予め当該診
断パターンを備えてあれば、ＣＰＵからの指示なしに自
から診断を実行することもできる。
上記のライト・モード下での診断を実行するに際し注意
すべきことがある。
すべきことがある。
これは、ゲート手段２１を動作してライト・データ・バ
ス１４を閉にしたとき、テ゛バイス部１３が単独でどの
ような振舞をするか分らないことであり、最悪時にはデ
バイス部１３が暴走することも考えられる。
ス１４を閉にしたとき、テ゛バイス部１３が単独でどの
ような振舞をするか分らないことであり、最悪時にはデ
バイス部１３が暴走することも考えられる。
このような事態の発生を防止するため、ゲート手段２１
は単なるスイッチではなく、例えばＰ−ＲＯＭ（プログ
ラマブル・リードオンリーメモリ）からなる安全コード
のコード発生部とすることもできる。
は単なるスイッチではなく、例えばＰ−ＲＯＭ（プログ
ラマブル・リードオンリーメモリ）からなる安全コード
のコード発生部とすることもできる。
上述の動作は診断モード指定があった場合であり、通常
のモードではゲート手段２１は完全に開となっており、
またチェック部２３も非動作である。
のモードではゲート手段２１は完全に開となっており、
またチェック部２３も非動作である。
上述のライト・モードと同様、リード・モード下におい
ても同様の診断パターンを実行可能である。
ても同様の診断パターンを実行可能である。
このリード・モードにおける本考案装置の実施例を第３
図を参照して述べる。
図を参照して述べる。
ただし、第３図において第１図、第２図と同一の参照番
号（記号）が付されたものは相互に同一である。
号（記号）が付されたものは相互に同一である。
今、Ｉ／Ｏ装置１１内で故障が発生したとすると、ＣＰ
Ｕから診断モード指定Ｄを受信する。
Ｕから診断モード指定Ｄを受信する。
これにより、前記のゲート手段２１および新設のセレク
タ３１が動作し、ライト・テ゛一夕・バス１４をしゃ断
すると共に、リード・データ・バス１５を診断データ・
バス３２に切り換える。
タ３１が動作し、ライト・テ゛一夕・バス１４をしゃ断
すると共に、リード・データ・バス１５を診断データ・
バス３２に切り換える。
これにより、既存のリード・データ処理部３３は診断デ
ータ発生部３４からの正しい診断データを処理する。
ータ発生部３４からの正しい診断データを処理する。
この正しい診断データをリード・データ処理部３３で処
理して誤りがあればコントロール部１２に故障があるこ
とを示すエラー信号Ｅ１を、新設のチェック部３５より
出力する。
理して誤りがあればコントロール部１２に故障があるこ
とを示すエラー信号Ｅ１を、新設のチェック部３５より
出力する。
一方、リード・データ処理部３３での処理に誤りがなけ
ればテ゛バイス部１３に故障があることを示すエラー信
号Ｅ２をそのチェック部３５より出力する。
ればテ゛バイス部１３に故障があることを示すエラー信
号Ｅ２をそのチェック部３５より出力する。
かくして、診断モード時であって且つリード・モード下
での故障箇所の判定が完了する。
での故障箇所の判定が完了する。
なお、上述の診断パターンはＣＰＵから供給されてもよ
く、あるいはもしコントロール部１２自身に予め当該診
断パターンを備えてあれば、ＣＰＵがらの指示なしに自
から診断を実行することもできる。
く、あるいはもしコントロール部１２自身に予め当該診
断パターンを備えてあれば、ＣＰＵがらの指示なしに自
から診断を実行することもできる。
また、既に述べたように、ゲート手段２１を動作してラ
イト・データ・バス１４を閉にしたとき、テ゛バイス部
１３が単独でどのような振舞をするが分らないことがあ
り、最悪時にはデバイス部１３が暴走することも考えら
れるので、このような事態の発生を防止するため、ゲー
ト手段２１は単なるスイッチではなく、例えばＰ−ＲＯ
Ｍ（プログラマブル・リードオンリーメモリ）からなる
安全コードのコード？生部としても良い。
イト・データ・バス１４を閉にしたとき、テ゛バイス部
１３が単独でどのような振舞をするが分らないことがあ
り、最悪時にはデバイス部１３が暴走することも考えら
れるので、このような事態の発生を防止するため、ゲー
ト手段２１は単なるスイッチではなく、例えばＰ−ＲＯ
Ｍ（プログラマブル・リードオンリーメモリ）からなる
安全コードのコード？生部としても良い。
上述の動作は診断モード指定があった場合であり、通常
のモードではゲート手段２１は完全に開となっており、
セレクタ３１はリード・データ・バス１５に係合し、ま
たチェック部３５も非動作である。
のモードではゲート手段２１は完全に開となっており、
セレクタ３１はリード・データ・バス１５に係合し、ま
たチェック部３５も非動作である。
以上説明したように本考案によれば、Ｉ／Ｏ装置内をコ
ントロール部とテ゛バイス部とに区分して故障箇所を発
見でき、故障回復時間の早い診断装置が実現される。
ントロール部とテ゛バイス部とに区分して故障箇所を発
見でき、故障回復時間の早い診断装置が実現される。
なお、実際には第２図および第３図の構威を併用するの
が好ましい。
が好ましい。
第１図は一配般的なＩ／Ｏ装置を示すブロック図、第２
図はライト・モード下で本考案の診断装置を実施するた
めの回路例を示すブロック図、第３図はリート・モード
下で本考案の診断装置を実施するための回路例を示すブ
ロック図である。 図において、１１はＩ／Ｏ装置、１２はコントロール部
、１３はデバイス部、１４はライト・データ・バス、１
５はリード・データ・バス、２１はゲート手段、２２は
ライト・データ発生部、２３はチェック部、３１はセレ
クタ、３２は診断データ・バス、３３はリード・データ
処理部、３４は診断データ発生部、３５はチェック部、
Ｄは診断モード指定、Ｅ，Ｅ２はエラー信号である。
図はライト・モード下で本考案の診断装置を実施するた
めの回路例を示すブロック図、第３図はリート・モード
下で本考案の診断装置を実施するための回路例を示すブ
ロック図である。 図において、１１はＩ／Ｏ装置、１２はコントロール部
、１３はデバイス部、１４はライト・データ・バス、１
５はリード・データ・バス、２１はゲート手段、２２は
ライト・データ発生部、２３はチェック部、３１はセレ
クタ、３２は診断データ・バス、３３はリード・データ
処理部、３４は診断データ発生部、３５はチェック部、
Ｄは診断モード指定、Ｅ，Ｅ２はエラー信号である。
Claims (1)
- 【実用新案登録請求の範囲】 相互にライト・テ゛一タ・バスおよびリード・テ゛一夕
・バスで接続されるコントロール部およびテ゛バイス部
を有してなる入出力装置を診断する装置であって、診断
モードの指定があったとき前記ライト・データ・バスお
よびリード・テ゛一タ・バスの少なくとも一方を閉鎖す
る閉鎖手段と、前記コントロール部又は前記デバイス部
のいずれに異常があるかを判別する判別手段とを具備し
て診断を実行するようになし、ここにライト・モード時
においては前記閉鎖手段は前記ライト・テ゛一タ・バス
を閉鎖するゲート手段をなし、一方、リード・モード時
においては前記閉鎖手段は、該ライト・データ・バスを
閉鎖するゲート手段をなすと共に前記ノード・データ・
バスを閉鎖してこれを診断データ・バスに切換えるセレ
クタをなすようにした入出力装置診断装置において、 前記判別手段は、前記コントロール部から発生する正常
なデータを前記診断テ゛一タ・バスに供給することによ
って自白の異常を判定し、又は自内の異常を検出しない
ときは前記デバイス部に異常があるものと判定するチェ
ック手段によって構威し、さらに前記ゲート手段は前記
診断モードの指定時において前記テ゛バイス部を安全に
動作させるための安全コードを発生するコード発生部と
しても動作することを特徴とする入出力装置診断装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15444182U JPS599304Y2 (ja) | 1982-10-14 | 1982-10-14 | 入出力装置診断装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15444182U JPS599304Y2 (ja) | 1982-10-14 | 1982-10-14 | 入出力装置診断装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5890423U JPS5890423U (ja) | 1983-06-18 |
| JPS599304Y2 true JPS599304Y2 (ja) | 1984-03-23 |
Family
ID=29947040
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15444182U Expired JPS599304Y2 (ja) | 1982-10-14 | 1982-10-14 | 入出力装置診断装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS599304Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2710777B2 (ja) * | 1988-01-20 | 1998-02-10 | 富士通株式会社 | 中間制御装置のテスト回路 |
-
1982
- 1982-10-14 JP JP15444182U patent/JPS599304Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5890423U (ja) | 1983-06-18 |
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