JPS5963983A - 電力変換器の制御装置 - Google Patents
電力変換器の制御装置Info
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- JPS5963983A JPS5963983A JP57175134A JP17513482A JPS5963983A JP S5963983 A JPS5963983 A JP S5963983A JP 57175134 A JP57175134 A JP 57175134A JP 17513482 A JP17513482 A JP 17513482A JP S5963983 A JPS5963983 A JP S5963983A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明のｙＦｕ用分野〕
本発明は、電力変換器の制御装置の改良に関し、特にゲ
ートターンオフサイリスク（ＧＴＯ：Ｇａｔｅ Ｔｕｒ
ｎ ｏｆｆ ｔｈｙｒｉｓｔｏｒ ） 、ｆ６電Ｕ
Ｗｂ型プサイリスク Ｓ Ｉ Ｔ ： ５ｔａｔｉｃ
ＩｎｄｕｃｔｉｖｅＴｈｙｒｉｓｔｏｒ ）などの自
己消弧型半導体素子を用いた電力変換器により誘導性負
荷との電力の授受を行う場合の制御装置に係る。
ートターンオフサイリスク（ＧＴＯ：Ｇａｔｅ Ｔｕｒ
ｎ ｏｆｆ ｔｈｙｒｉｓｔｏｒ ） 、ｆ６電Ｕ
Ｗｂ型プサイリスク Ｓ Ｉ Ｔ ： ５ｔａｔｉｃ
ＩｎｄｕｃｔｉｖｅＴｈｙｒｉｓｔｏｒ ）などの自
己消弧型半導体素子を用いた電力変換器により誘導性負
荷との電力の授受を行う場合の制御装置に係る。
自己消弧型半導体素子（以下ＧＴＯと略記する）を利用
した電力変換器として、又−直変換器、直−変度換器（
インバータ）、チョッパあるいは周波数変換器などが知
られている。
した電力変換器として、又−直変換器、直−変度換器（
インバータ）、チョッパあるいは周波数変換器などが知
られている。
これらのＧＴＯ電力変換器は、誘導性負荷との間に電力
の授受を行うことが多く、この場合には、ＧＴＯのＯＮ
により通電した負荷１Ｌ流を、このＧＴＯがＯＦ ｌｉ
” しても流れ続けさせるための７リ一ホイール回路を
設ける必要がおる。
の授受を行うことが多く、この場合には、ＧＴＯのＯＮ
により通電した負荷１Ｌ流を、このＧＴＯがＯＦ ｌｉ
” しても流れ続けさせるための７リ一ホイール回路を
設ける必要がおる。
ところで、′電源電圧の変動などの要因で、負荷電流が
過大となった場合、負荷やＧＴＣＩ保諜するために速や
かにこの′電流路を断つ必要がある。
過大となった場合、負荷やＧＴＣＩ保諜するために速や
かにこの′電流路を断つ必要がある。
このため、負荷の過電流を検出すると、全ＧＴＯへの正
規のオンオフゲート信号を消滅させるとともに高速度し
ゃ断器で電源と変換器間をしゃ断する方法が知られてい
る。また、高速度しゃ断器が実際に回路ケしゃ断するま
での間の、特定のＧＴＯの過電流負担ｆ、＠減するため
に、全ＧＴＯにオフゲート信号を与えることも提案され
ている。
規のオンオフゲート信号を消滅させるとともに高速度し
ゃ断器で電源と変換器間をしゃ断する方法が知られてい
る。また、高速度しゃ断器が実際に回路ケしゃ断するま
での間の、特定のＧＴＯの過電流負担ｆ、＠減するため
に、全ＧＴＯにオフゲート信号を与えることも提案され
ている。
しかし、いずれの方法によっても、高速度しゃ断器の動
作までに電流からとる電流が過大にすぎ電源が過負葡と
なって電泳自体をトリップさせるなどの悪影響がある。
作までに電流からとる電流が過大にすぎ電源が過負葡と
なって電泳自体をトリップさせるなどの悪影響がある。
また、この間にＧＴＯ’を破壊することもしばしば発生
した。
した。
本発明の目的は、負荷の過電流を速かにしゃ断し、電源
への悪影響を軽減できるＧＴＯ電力変換器の制＃装置を
提供することである。
への悪影響を軽減できるＧＴＯ電力変換器の制＃装置を
提供することである。
本発明は、ＧＴＯを欧州した′電力変換器とｈル導性負
葡との間に′電力の授受を行い、負荷電流のフリーホイ
ール回路を備えたものに１いて、負荷電流が所定値を越
えたことを検出して少なくとも導通状態にあるＧＴＯに
オフゲート信号を与えることを主特徴とする。
葡との間に′電力の授受を行い、負荷電流のフリーホイ
ール回路を備えたものに１いて、負荷電流が所定値を越
えたことを検出して少なくとも導通状態にあるＧＴＯに
オフゲート信号を与えることを主特徴とする。
また、本発明の望ましい一実施態様においては、フリー
ホイール回路に対するリカバリー電流を流しているＧＴ
Ｏを除き、導通中のＧＴＯにオフゲート信号を与えるよ
うに構成する。
ホイール回路に対するリカバリー電流を流しているＧＴ
Ｏを除き、導通中のＧＴＯにオフゲート信号を与えるよ
うに構成する。
第１図に、本発明を適用するのに好適なインノく−タに
おける一実施例回路を示す。第１図回路では、自己消弧
型半導体素子としてゲートターンオフサイリスタＧＴＯ
’ｅ用いた例を示しであるが、このＧＴＯインバータ回
路の４Ｍ成及び動作の概略を次に説明する。
おける一実施例回路を示す。第１図回路では、自己消弧
型半導体素子としてゲートターンオフサイリスタＧＴＯ
’ｅ用いた例を示しであるが、このＧＴＯインバータ回
路の４Ｍ成及び動作の概略を次に説明する。
電源部Ｖ８は、直流電源ＥＤに図示のようにフィルタリ
アクトルＰＬとフィルタコンデンサＦＣから成るフィル
タを接続して構成され、該フィルタはＧＴＯインバータ
回路ＩＮＶのオンオフ制御に基づいて授受されるｖｊ［
続電流を平滑する役目を持つ。一方、ＧＴＯインバータ
回路ＩＮＶは誘導性負荷である誘導電動機ＩＭの゛亀流
金猿流させるためのフリーホイールダイオードＤＧＴＯ
Ｉ〜ＤＧＴＯ６を夫々並列接続したゲートターンオフサ
イリスタＧ’ｌ”Ｏ＋−ＧＴＯａを図示のように接続し
て構成される。そして、夫々が直列接続されたＧＴＯ＋
とＧＴＯ２、ＧＴＯａとＧ Ｔ ０４及びＧ Ｔ Ｏｓ
とＧＴＯ６の各接続点に、誘４電動機工Ｍが接続され
る。電源部ＶＢとＧＴＯインバータ回路ＩＮＶとの間に
は、ＧＴＯインバータ回路ＩＮＶの電泳短絡事故時（例
えばノイズ等によｐ （ｊ Ｔ ０１ とＧ Ｔ Ｏｚ
が共に導通状態となった場合）の過電流を抑制するため
のアノードリアクトルＡＬ（フリーホイールダイオード
ＤＡＬ が並列接続されている）が図示のように接続さ
れる。
アクトルＰＬとフィルタコンデンサＦＣから成るフィル
タを接続して構成され、該フィルタはＧＴＯインバータ
回路ＩＮＶのオンオフ制御に基づいて授受されるｖｊ［
続電流を平滑する役目を持つ。一方、ＧＴＯインバータ
回路ＩＮＶは誘導性負荷である誘導電動機ＩＭの゛亀流
金猿流させるためのフリーホイールダイオードＤＧＴＯ
Ｉ〜ＤＧＴＯ６を夫々並列接続したゲートターンオフサ
イリスタＧ’ｌ”Ｏ＋−ＧＴＯａを図示のように接続し
て構成される。そして、夫々が直列接続されたＧＴＯ＋
とＧＴＯ２、ＧＴＯａとＧ Ｔ ０４及びＧ Ｔ Ｏｓ
とＧＴＯ６の各接続点に、誘４電動機工Ｍが接続され
る。電源部ＶＢとＧＴＯインバータ回路ＩＮＶとの間に
は、ＧＴＯインバータ回路ＩＮＶの電泳短絡事故時（例
えばノイズ等によｐ （ｊ Ｔ ０１ とＧ Ｔ Ｏｚ
が共に導通状態となった場合）の過電流を抑制するため
のアノードリアクトルＡＬ（フリーホイールダイオード
ＤＡＬ が並列接続されている）が図示のように接続さ
れる。
一方、ＧＴＯインバータ回路ＩＮＶのゲート信号回路Ｓ
１は、移相器ＡＰ８、ロジック回路ＬＣ。
１は、移相器ＡＰ８、ロジック回路ＬＣ。
及び信号増幅部ＡＭＰから構成され、前記移相器。
ＡＰＳは電流指令Ｉｐに実際の誘導′ｒｌＪＨ戊電θ１
しＩＰ（例えは、各相の電流検出器ＣＴ ｌ−ＣＴ ３
の出力を３相全波醗流回路りにより歪流平滑された電流
）が追従制御されるように動作する。ＧＴＯインバータ
回路ＩＮＶは、第２図に示すようなグーＨ８号回路Ｓｇ
からの１ｄ号（過電流レベルＯＣＤからの出力が零で、
Ｎ０１回路の出力が１の場合。
しＩＰ（例えは、各相の電流検出器ＣＴ ｌ−ＣＴ ３
の出力を３相全波醗流回路りにより歪流平滑された電流
）が追従制御されるように動作する。ＧＴＯインバータ
回路ＩＮＶは、第２図に示すようなグーＨ８号回路Ｓｇ
からの１ｄ号（過電流レベルＯＣＤからの出力が零で、
Ｎ０１回路の出力が１の場合。
過電流検知器ＯＣＤは、第１図に示されるように、各相
の電流検出器Ｃ，Ｔ＋ 〜ＣＴ３の出力と設尾された過
電流レベルＯＣＬとの比軟をヤＳう。）を受けてオンオ
フ制御される。例えは、時刻ｔ１においてＧ Ｔ ０１
とＧ Ｔ ０４及びＧ Ｔ Ｏａが点弧していると の閉回路で、また時刻ｔ２においてＧＴＯ＋が消弧して
いると （ＡＬの電流はＤＡＬＫ猿流する） の閉回路で夫々訴導ｍ動機ＩＭに電流Ｉｎ、Ｉｖ及びＩ
ｗが流れることになる。この間のＧＴＯインバータ回路
ＩＮＶの動作図は、第３図に示すようになる。このよう
にして、各Ｇ Ｔ ０１〜ＧＴＯｓはゲート１４号回Ｉ
＃！１８ｇからの信号によって、ロジック回路ＬＣで決
められる所定の順序、所定の位相差をもってオンオフ制
御され、誘導電動機ＩＭに可変電圧、可変周波数の３相
交流電力を供給するものでおる。
の電流検出器Ｃ，Ｔ＋ 〜ＣＴ３の出力と設尾された過
電流レベルＯＣＬとの比軟をヤＳう。）を受けてオンオ
フ制御される。例えは、時刻ｔ１においてＧ Ｔ ０１
とＧ Ｔ ０４及びＧ Ｔ Ｏａが点弧していると の閉回路で、また時刻ｔ２においてＧＴＯ＋が消弧して
いると （ＡＬの電流はＤＡＬＫ猿流する） の閉回路で夫々訴導ｍ動機ＩＭに電流Ｉｎ、Ｉｖ及びＩ
ｗが流れることになる。この間のＧＴＯインバータ回路
ＩＮＶの動作図は、第３図に示すようになる。このよう
にして、各Ｇ Ｔ ０１〜ＧＴＯｓはゲート１４号回Ｉ
＃！１８ｇからの信号によって、ロジック回路ＬＣで決
められる所定の順序、所定の位相差をもってオンオフ制
御され、誘導電動機ＩＭに可変電圧、可変周波数の３相
交流電力を供給するものでおる。
ところで、第２図に示す時刻ｔ１〜ｔ２の間に、何尋か
の原因によシ寛源電圧ＥＤが急上昇することを考えると
、誘導電動機Ｕ相の電流工υは図示点Ｉｎ Ｉｖ１のよ
うに上昇して過電流レベルＯＣＬに達し、過電流検知器
ＯＣＤの出力が１とな９、ＮＯＴの出力が零つまり各Ａ
ＮＤ回路の出力カ五零となって、時刻ｔ３のところでオ
フノくルスを発生するように動作させる。従って、それ
までオン状態にあったＧＴＯはターンオフし、オフ状態
にあったものはこれを維持することになる。
の原因によシ寛源電圧ＥＤが急上昇することを考えると
、誘導電動機Ｕ相の電流工υは図示点Ｉｎ Ｉｖ１のよ
うに上昇して過電流レベルＯＣＬに達し、過電流検知器
ＯＣＤの出力が１とな９、ＮＯＴの出力が零つまり各Ａ
ＮＤ回路の出力カ五零となって、時刻ｔ３のところでオ
フノくルスを発生するように動作させる。従って、それ
までオン状態にあったＧＴＯはターンオフし、オフ状態
にあったものはこれを維持することになる。
ところで、ＧＴＣｈは時刻ｔ２のあとにターンオンした
後に、直ぐ時刻ｔ３でターンオフすることになる。一般
に、フリーホイールダイオードを並列接続した誘導性負
荷をオンオフ制御する。’ｒ。
後に、直ぐ時刻ｔ３でターンオフすることになる。一般
に、フリーホイールダイオードを並列接続した誘導性負
荷をオンオフ制御する。’ｒ。
においては、ターンオンした１自、後にＴｈ１Ｊ Ｎ己
フリーホイールダイオードをリカバリーするだめの大き
な電流が一流れるので、前記したＧＴＯのターンオン直
後にターンオフ信号が印加されることは、ｉ〕ｉＪ 記
した大きな電流（過電流レベルの約１．５〜２倍の電流
）をターンオフすることになシ、ターンオフパルス電流
が不足してＧＴ、０累子を破損する倶れが生ずる。この
間の動作波形を第３図に示しておく。つまｐ、ＧＴＯｓ
のターンオンにより図示の二点鎖線のような経路で、ｖ
ｌＩ−＋ＧＴＯ１→Ｄａｒｏｚ→ｖ８ と流れ、フリー
ホイールダイオードＤｏｔｏｇ に流れている負荷電流
を打ち消して、更に該ダイオードＤａ丁ｏｓ ’にリカ
バリーする電流が流れる。このため、第３図にＩＱＴＯ
Ｉ の電流波形で示すような大きな電流が流れ、この時
点（時刻ｊａ ）でターンオフパルスが与えられると通
常の過電流レベルまでの電流はターンオフできる能力を
もたせであるゲート回路では、ターンオフパルス電流が
不足してＧＴＯ素子を破損する惧れが生ずる。
フリーホイールダイオードをリカバリーするだめの大き
な電流が一流れるので、前記したＧＴＯのターンオン直
後にターンオフ信号が印加されることは、ｉ〕ｉＪ 記
した大きな電流（過電流レベルの約１．５〜２倍の電流
）をターンオフすることになシ、ターンオフパルス電流
が不足してＧＴ、０累子を破損する倶れが生ずる。この
間の動作波形を第３図に示しておく。つまｐ、ＧＴＯｓ
のターンオンにより図示の二点鎖線のような経路で、ｖ
ｌＩ−＋ＧＴＯ１→Ｄａｒｏｚ→ｖ８ と流れ、フリー
ホイールダイオードＤｏｔｏｇ に流れている負荷電流
を打ち消して、更に該ダイオードＤａ丁ｏｓ ’にリカ
バリーする電流が流れる。このため、第３図にＩＱＴＯ
Ｉ の電流波形で示すような大きな電流が流れ、この時
点（時刻ｊａ ）でターンオフパルスが与えられると通
常の過電流レベルまでの電流はターンオフできる能力を
もたせであるゲート回路では、ターンオフパルス電流が
不足してＧＴＯ素子を破損する惧れが生ずる。
次に、上記の点を改良した本発明の他の実施例ｆ：第４
図により説明する。第４図回路では、第２図回路におけ
るロジックＬＣの各ＡＮＤ出力をオア回路ＯＲ→ワンシ
ョットマルチバイブレータ回路ＭＭ→ナンド回路ＮＡＮ
Ｄ＝に介して夫々のかの入力に帰還する回路を設けると
共に、過電流検知器ＯＣＤの出力を直接各ＮＡＮＤの人
力とするようにＮＯＴ回路を省略しである。そして、こ
の実施例回路は、ＡＮＤ出力が０→１になるとＯＲ，回
路を介してワンショットマルチＭＭに入力されるが、該
ワンショットマルチＭＭ出力は一定時間零を保持し、該
一定時間後に１を出力するように動作する。一方、ＮＡ
ＮＤ回路は、過電流検知器ＯＣＤの出力が零のときはワ
ンショットマルチＭＭの出力に関係なくその出力は１と
なシ、各ＧＴＯに所定の順序、所定の位相差をもったオ
ンオフパルスを供給する。過電流検知器ＯＣＤの出力が
１になると、ワンショットマルチＭＭの出力が１のとき
のみＮＡＮＤＩｊｌ路出力が零となり、それまでオン期
間にあった各ＧＴＯにオフパルスを与えるように動作す
る。
図により説明する。第４図回路では、第２図回路におけ
るロジックＬＣの各ＡＮＤ出力をオア回路ＯＲ→ワンシ
ョットマルチバイブレータ回路ＭＭ→ナンド回路ＮＡＮ
Ｄ＝に介して夫々のかの入力に帰還する回路を設けると
共に、過電流検知器ＯＣＤの出力を直接各ＮＡＮＤの人
力とするようにＮＯＴ回路を省略しである。そして、こ
の実施例回路は、ＡＮＤ出力が０→１になるとＯＲ，回
路を介してワンショットマルチＭＭに入力されるが、該
ワンショットマルチＭＭ出力は一定時間零を保持し、該
一定時間後に１を出力するように動作する。一方、ＮＡ
ＮＤ回路は、過電流検知器ＯＣＤの出力が零のときはワ
ンショットマルチＭＭの出力に関係なくその出力は１と
なシ、各ＧＴＯに所定の順序、所定の位相差をもったオ
ンオフパルスを供給する。過電流検知器ＯＣＤの出力が
１になると、ワンショットマルチＭＭの出力が１のとき
のみＮＡＮＤＩｊｌ路出力が零となり、それまでオン期
間にあった各ＧＴＯにオフパルスを与えるように動作す
る。
従って、第４回動作波形の時刻ｔ３において過ｆｔＬ流
恢知器ＯＣＤの出力が１になった場合を考えると、それ
までずっとオン状５？Ｉ４を維持していたＧＴＯ４，０
ＴＯｓにオンパルスを供給している回路のワンショット
マルチＭＭの出力は既に１となっているので、これらは
直ちにオフパルスが与えられて図示のようにターンオフ
し、Ｕ相を流Ｉｕの過電流全抑制する。一方、時刻ｔ３
においてターンオン直後にあるＧ Ｔ Ｏｒにオンパル
スを供給している回路のワンショットマルチＭＭの出力
は、一定時間を第３図のｌ０ＴＯ１波形に示される時間
ｔｏ （ターンオン直後の大きな′電流が負６Ｊ電流ま
で減少するに要する時間）に設定すること □によりま
だ零の状態にあるので、ＮＡＮＤ出力は１、つまジオン
パルスを供給している。次に一定時間１ｏが経過すると
ワンショットマルチＭＭ出力が０→１、ＮＡＮＤ出力が
１→０となってＧ Ｔ Ｏ＋ にオフパルスを供給し、
該ＧＴ（Ｌ＋’！ｉ’ターンオフするものである。従っ
て、一本実施例によれば、過電流を検知してＧＴＯｅタ
ーンオフさせる保映方式において、ターンオン直後で大
きな電流が流れているＧＴＯにはオフノくルスを一定時
間遅らせて供給できるので、ＧＴＯ素子を破損すること
なく過電流から保譲できる効果がある。
恢知器ＯＣＤの出力が１になった場合を考えると、それ
までずっとオン状５？Ｉ４を維持していたＧＴＯ４，０
ＴＯｓにオンパルスを供給している回路のワンショット
マルチＭＭの出力は既に１となっているので、これらは
直ちにオフパルスが与えられて図示のようにターンオフ
し、Ｕ相を流Ｉｕの過電流全抑制する。一方、時刻ｔ３
においてターンオン直後にあるＧ Ｔ Ｏｒにオンパル
スを供給している回路のワンショットマルチＭＭの出力
は、一定時間を第３図のｌ０ＴＯ１波形に示される時間
ｔｏ （ターンオン直後の大きな′電流が負６Ｊ電流ま
で減少するに要する時間）に設定すること □によりま
だ零の状態にあるので、ＮＡＮＤ出力は１、つまジオン
パルスを供給している。次に一定時間１ｏが経過すると
ワンショットマルチＭＭ出力が０→１、ＮＡＮＤ出力が
１→０となってＧ Ｔ Ｏ＋ にオフパルスを供給し、
該ＧＴ（Ｌ＋’！ｉ’ターンオフするものである。従っ
て、一本実施例によれば、過電流を検知してＧＴＯｅタ
ーンオフさせる保映方式において、ターンオン直後で大
きな電流が流れているＧＴＯにはオフノくルスを一定時
間遅らせて供給できるので、ＧＴＯ素子を破損すること
なく過電流から保譲できる効果がある。
他の実施例を第５図によシ醗明する。
第５図の回路では第４図のロジック回路ＬＣにおける各
人ＮＤの前段にラッチ回路ＬＴを設けると共に、各ＡＮ
Ｄの帰還回路に挿入したワンショットマルチバイブレー
タＭＭの正論理出力Ｑ’（ｉｌ−１ＡＮＤ１→フリツプ
・７０ツブＦＦ′ｆ：介して夫々のＮＡＮＤの一方の入
力端子に接続し、該ＮＡＮＤの出力を前記各ＡＮＤに帰
還するように構成している。
人ＮＤの前段にラッチ回路ＬＴを設けると共に、各ＡＮ
Ｄの帰還回路に挿入したワンショットマルチバイブレー
タＭＭの正論理出力Ｑ’（ｉｌ−１ＡＮＤ１→フリツプ
・７０ツブＦＦ′ｆ：介して夫々のＮＡＮＤの一方の入
力端子に接続し、該ＮＡＮＤの出力を前記各ＡＮＤに帰
還するように構成している。
一方、過電流検知器ＯＣＤの出力はＡＮＤｌのもう一方
の入力に直接接続されると同時にＮ０Ｔ１、Ｎ０Ｔ２．
抵抗比、コンデンサＣから成る保映動作に影響ない程度
の短時間の遅れケ有する遅延回路を介して各ＮＡ、ＮＤ
のもう一つの入力に接続する。
の入力に直接接続されると同時にＮ０Ｔ１、Ｎ０Ｔ２．
抵抗比、コンデンサＣから成る保映動作に影響ない程度
の短時間の遅れケ有する遅延回路を介して各ＮＡ、ＮＤ
のもう一つの入力に接続する。
本実施例回路において、ＡＮＤの出力がＩＩ Ｏ＃→゛
１”になシ、この信号がＯＲを介してワンショットマル
チＭＭに入力されると、該ワンショットマルチＭ Ｍは
一定時間１″′となるパルス状の信号を出力する。しか
し、ＡＮＤｌは過ｌｉｔ流検知ＯＣＤの出力が′０″の
場合、ワンショットマルチＭＭの出力に関係なく’ ｏ
” ’ｉ維持する。このため、スリップ・７０ツブＦ
Ｆは動作せず、ランチ回路ＬＴのゲート端子Ｇは１”の
ままでめシ、データ端子ＤＫ♂力された信号はそのまま
出力Ｑに伝達される。 、 同様に、過電流検知器ＯＣＤの出力が０”の場合ＮＡＮ
Ｄの出力は１′１”を維持する。したがって、ＧＴＯの
ゲート信号はラッチ回路Ｌ Ｔ→ＡＮＤを介して信号増
幅部に伝線され、各Ｇ’Ｉ’０に所定の順序、所定の位
相差を持ったオン、オフパルスを供給する。
１”になシ、この信号がＯＲを介してワンショットマル
チＭＭに入力されると、該ワンショットマルチＭ Ｍは
一定時間１″′となるパルス状の信号を出力する。しか
し、ＡＮＤｌは過ｌｉｔ流検知ＯＣＤの出力が′０″の
場合、ワンショットマルチＭＭの出力に関係なく’ ｏ
” ’ｉ維持する。このため、スリップ・７０ツブＦ
Ｆは動作せず、ランチ回路ＬＴのゲート端子Ｇは１”の
ままでめシ、データ端子ＤＫ♂力された信号はそのまま
出力Ｑに伝達される。 、 同様に、過電流検知器ＯＣＤの出力が０”の場合ＮＡＮ
Ｄの出力は１′１”を維持する。したがって、ＧＴＯの
ゲート信号はラッチ回路Ｌ Ｔ→ＡＮＤを介して信号増
幅部に伝線され、各Ｇ’Ｉ’０に所定の順序、所定の位
相差を持ったオン、オフパルスを供給する。
第６図に他の実施例を示す。
第６図では第５図の実施例において、ラッチ回路ＬＴの
ゲート端子Ｇの前段にｏａｉｆ：挿入し、該ＯＲＩの一
方の入力端子にフリップ・フロップＦ Ｐの出力Ｑの信
号を、もう一つの入力端子にラッチ回１ｆｊＬＴの出力
Ｑの信号を入力する。
ゲート端子Ｇの前段にｏａｉｆ：挿入し、該ＯＲＩの一
方の入力端子にフリップ・フロップＦ Ｐの出力Ｑの信
号を、もう一つの入力端子にラッチ回１ｆｊＬＴの出力
Ｑの信号を入力する。
このため、過電流検知器ＯＣＤの出力が１”になった時
ワンショットマルチＭＭの出力Ｑが１”でありノリツブ
・７０ツブＦｌｉ’の出力Ｑがａ １ ｓ→″′０”と
なってもラッチ回路ＬＴはその出力Ｑがｔｕ １ ＃の
間は動作せず、ラッチ回路ＬＴの出力Ｑが”１”→″″
０”となった時点でゲート端子Ｇにｕ Ｏｊｊが人力さ
れたことによシランチ状態となり、出力Ｑは＠０”を保
持する。
ワンショットマルチＭＭの出力Ｑが１”でありノリツブ
・７０ツブＦｌｉ’の出力Ｑがａ １ ｓ→″′０”と
なってもラッチ回路ＬＴはその出力Ｑがｔｕ １ ＃の
間は動作せず、ラッチ回路ＬＴの出力Ｑが”１”→″″
０”となった時点でゲート端子Ｇにｕ Ｏｊｊが人力さ
れたことによシランチ状態となり、出力Ｑは＠０”を保
持する。
一方、過電流検知器ｂＣＤの出力が１′１”になった時
ワンショットマルチＭＭの出力Ｑが”Ｏ”の場合は第５
図の実施例と同様の動作を行う。
ワンショットマルチＭＭの出力Ｑが”Ｏ”の場合は第５
図の実施例と同様の動作を行う。
本実施例において第５図と同様、時間ｔ３に過電流検知
器ＯＣＤの出力が”１”になったとすると、ＧＴ０２〜
Ｇ Ｔ Ｏｓは前記第５図に示す実施例と同様にそれま
でオン状態にろったＧＴＯ４。
器ＯＣＤの出力が”１”になったとすると、ＧＴ０２〜
Ｇ Ｔ Ｏｓは前記第５図に示す実施例と同様にそれま
でオン状態にろったＧＴＯ４。
Ｇ Ｔ Ｏｓは直ちにオフし、オフ状態にあったＧＴＯ
２、ＧＴＯｓ 、ＧＴＯｓはオフ状態を保つ。
２、ＧＴＯｓ 、ＧＴＯｓはオフ状態を保つ。
しかし、ワンショットマルチＭＭの出力Ｑが′１″とな
る一足時間ｉｏ内に過電流検知器ＯＣＤの出力が１”と
なったＧＴｏｌについてはフリップ・フロップＦＦの出
力回が１゛１”→″０″″になり、続いてラッチ回路Ｌ
Ｔの出力Ｑが′″１”→゛′０”になった時点でオフ信
号が印加されＧ Ｔ Ｏ１はオンする。
る一足時間ｉｏ内に過電流検知器ＯＣＤの出力が１”と
なったＧＴｏｌについてはフリップ・フロップＦＦの出
力回が１゛１”→″０″″になり、続いてラッチ回路Ｌ
Ｔの出力Ｑが′″１”→゛′０”になった時点でオフ信
号が印加されＧ Ｔ Ｏ１はオンする。
すなわち、ＧＴＯがオンした後の一点時間内に過電流検
知器ＯＣＤが’ １ ” ’！ｉ？出力した場合、正規
のオフ信号が印加されるまでＧＴＯはオン状態を維持し
、正規のオフ信号でオフした後はオフ状態を保持する。
知器ＯＣＤが’ １ ” ’！ｉ？出力した場合、正規
のオフ信号が印加されるまでＧＴＯはオン状態を維持し
、正規のオフ信号でオフした後はオフ状態を保持する。
以上に述べた本実施例では、誘導策ｆＡＪＪ機をＧＴＯ
インバータで制御する場合を例にとシ説明したが、本発
明はこれに限定されるものではなく、例えば直流電動機
’ｅＧＴｏチョッパで制御する如く、フリーホイールダ
イオードが並列接続される誘導性負りｊｔ自己消弧型半
導体素子で制御するもの全てに適用できるものである。
インバータで制御する場合を例にとシ説明したが、本発
明はこれに限定されるものではなく、例えば直流電動機
’ｅＧＴｏチョッパで制御する如く、フリーホイールダ
イオードが並列接続される誘導性負りｊｔ自己消弧型半
導体素子で制御するもの全てに適用できるものである。
以上に詳述したように、本発明によれば、過電流を検知
して自己消弧型半導体素子をターンオフさせることによ
シ、速やかに過電流を抑制できる効果がらる。
して自己消弧型半導体素子をターンオフさせることによ
シ、速やかに過電流を抑制できる効果がらる。
第１図は本発明の一実施例によるＧＴＯインバータ装置
の回路図、第２図は同じく制御回路とその動作説明図、
第３図は同じく主回路電流路の説明図、第４図〜第６図
は夫々本発明の他の実施例による制御回路とその過電流
保護時の動作説明図である。
の回路図、第２図は同じく制御回路とその動作説明図、
第３図は同じく主回路電流路の説明図、第４図〜第６図
は夫々本発明の他の実施例による制御回路とその過電流
保護時の動作説明図である。
Claims (1)
- 【特許請求の範囲】 １、電源と、誘導性負荷と、上記電源と誘導性負荷との
間に接続され複数の自己消弧型半導体素子を備えた電力
変換器と、上記誘導性負荷に流れる電流が上記自己消弧
型半導体素子を介さずに環流する電路を形成するフリー
ホイール回路と、上記自己消弧型半導体素子を所屋れ順
序でオンオフ制御させるゲート信号を発生する手段を備
えたものにおいて、上記誘導性負荷に流れる電流が所定
値を越えたことを検出する手段と、この検知手段の出力
に応動して少なくとも導通状態にある上記自己消弧型半
導体素子にオフゲート信号を供給する手段を設けた電力
変換器の制御装置。 ２、上記ゲート信号発生手段は、上記半導体素子のオン
およびオフ制御に夫々対応して２値論理信号を発生する
手段を含み、上記オフゲート信号供給手段は、上記検知
手段の出力に応動してオン制御に対応した論理信号をオ
フ制御に対応した論理信号に切換える手段を備えた第１
項記載の′−電力変換器制御装置。 ３、電源と、誘導性負荷と、上記電源とムろ導性負荷と
の間に接続され複数の自己消弧型半導体素子′ｆｆ：ｖ
ｆＪえた電力変換器と、上記誘導性負荷に流れる電流が
上記自己消弧型半導体素子を介さずに環流する電路を形
成するフリーホイール回路と、上記自己消弧型半導体素
子を所定の順序でオンオフ制御させるグー１１４号會発
生する手段を備えたものにおいて、上記誘導性負荷に流
れるｌＬ流が予定値ｒ越えたことを検出する手段と、こ
の検知手段の出力に応動して、オンゲート信号が与えら
れたのち所定時間を経過していないものを除き、導通状
態におる上記自己消弧型半導体素子にオフゲート□信号
を供給する手段を設けた′−電力変換器制御装置。 ４、上記オフゲート信号供給手段は、上記オンゲート信
号が与えられたのち所定時１ｉｊＪ ’ｆ： Ａイ過し
ていない自己消弧型半導体素子に対して、上記所定時間
の社過後にオフゲート信号全供給するように（１４成し
た第３項記載の電力変換器の制御装置。 ５．上記オフゲート信号供給手段は、上記オンゲート信
号が与えられたのち所定時間を経過していない自己消弧
型半導体素子に対して、上記所定時間の経過後に上記ゲ
ート信号発生手段によって発生される正規のオフゲート
信号を供給するように構成した第３項にα載の電力変換
器の制御装置。 ６、電源と、誘導性負荷と、上記電源と誘導性負荷との
間に接続され複数の自己消弧型半導体素子を備え′ｆｃ
電力変換器と、上記誘導性負荷に流れる電流が上記自己
消弧型半導体素子を介さずに環流する電路を形成するフ
リーホイール回路と、上記自己消弧型半導体素子を所定
の順序でオンオフ制御させるゲート信号を発生する手段
を備えたものにおいて、上記＠導性負荷に流れる電流が
予定値を越えたことを検出する手段と、この検知手段の
出力に応動して、ターンオンしたのち上記フリーホイー
ル回路にリカバリー電流を流しているものを除き導通状
態にある上記自己消弧型半導体素子にオフゲート信号を
供給する手段を設けた電力変換器の制御装置。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57175134A JPS5963983A (ja) | 1982-10-04 | 1982-10-04 | 電力変換器の制御装置 |
| DE8383109858T DE3375441D1 (en) | 1982-10-04 | 1983-10-03 | Control system for power converter |
| EP83109858A EP0105510B1 (en) | 1982-10-04 | 1983-10-03 | Control system for power converter |
| US06/538,788 US4675799A (en) | 1982-10-04 | 1983-10-04 | Control system for power converter |
| KR1019830004690A KR940002919B1 (ko) | 1982-10-04 | 1983-10-04 | 전력변환기의 제어장치 |
| ZA837415A ZA837415B (en) | 1982-10-04 | 1983-10-04 | Control system for power converter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57175134A JPS5963983A (ja) | 1982-10-04 | 1982-10-04 | 電力変換器の制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5963983A true JPS5963983A (ja) | 1984-04-11 |
| JPH0410316B2 JPH0410316B2 (ja) | 1992-02-24 |
Family
ID=15990879
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57175134A Granted JPS5963983A (ja) | 1982-10-04 | 1982-10-04 | 電力変換器の制御装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4675799A (ja) |
| EP (1) | EP0105510B1 (ja) |
| JP (1) | JPS5963983A (ja) |
| KR (1) | KR940002919B1 (ja) |
| DE (1) | DE3375441D1 (ja) |
| ZA (1) | ZA837415B (ja) |
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| US9065367B2 (en) | 2010-04-16 | 2015-06-23 | Dyson Technology Limited | Control of a brushless motor |
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- 1982-10-04 JP JP57175134A patent/JPS5963983A/ja active Granted
-
1983
- 1983-10-03 DE DE8383109858T patent/DE3375441D1/de not_active Expired
- 1983-10-03 EP EP83109858A patent/EP0105510B1/en not_active Expired
- 1983-10-04 KR KR1019830004690A patent/KR940002919B1/ko not_active Expired - Fee Related
- 1983-10-04 US US06/538,788 patent/US4675799A/en not_active Expired - Lifetime
- 1983-10-04 ZA ZA837415A patent/ZA837415B/xx unknown
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| JPH0410316B2 (ja) | 1992-02-24 |
| EP0105510A2 (en) | 1984-04-18 |
| ZA837415B (en) | 1984-06-27 |
| KR840006886A (ko) | 1984-12-03 |
| EP0105510A3 (en) | 1985-11-21 |
| EP0105510B1 (en) | 1988-01-20 |
| US4675799A (en) | 1987-06-23 |
| KR940002919B1 (ko) | 1994-04-07 |
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