JPS5961429A - 突入電流防止回路 - Google Patents
突入電流防止回路Info
- Publication number
- JPS5961429A JPS5961429A JP57171993A JP17199382A JPS5961429A JP S5961429 A JPS5961429 A JP S5961429A JP 57171993 A JP57171993 A JP 57171993A JP 17199382 A JP17199382 A JP 17199382A JP S5961429 A JPS5961429 A JP S5961429A
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- inrush
- inrush current
- resistor
- current
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Emergency Protection Circuit Devices (AREA)
- Direct Current Feeding And Distribution (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）発明の技術分野
本発明は電Ｓ盤の突入電流防止回路に係り、特に瞬断及
び時間間隔の短い投入、切断時に発生する突入電流を防
止する機能に関するものである。
び時間間隔の短い投入、切断時に発生する突入電流を防
止する機能に関するものである。
ｔｂ＋従来技術と問題点
従来の突入電流防止回路は第１図の様な直列抵抗挿入方
式、第２図の様に直列抵抗挿入方式に継電器を併用する
方式、更に第３図の様に直列抵抗挿入方式にサイリスク
−ＴＨを併用する方式等がある。然し前者は常に抵抗Ｒ
２がラインに接続されているので、常時無駄に電力を消
費する欠点があり、後者は時間間隔の短い電源投入、切
断又は電源の瞬断に対して突入電流防止回路が時間的に
追従出来ない。第２図の例では継電器の動作時間だけ遅
れ、第３図ではサイリスターＴＨの動作時間だけ遅れる
ので、突入電流防止の機能を完全に果たすことが出来な
いと云う欠点がある。
式、第２図の様に直列抵抗挿入方式に継電器を併用する
方式、更に第３図の様に直列抵抗挿入方式にサイリスク
−ＴＨを併用する方式等がある。然し前者は常に抵抗Ｒ
２がラインに接続されているので、常時無駄に電力を消
費する欠点があり、後者は時間間隔の短い電源投入、切
断又は電源の瞬断に対して突入電流防止回路が時間的に
追従出来ない。第２図の例では継電器の動作時間だけ遅
れ、第３図ではサイリスターＴＨの動作時間だけ遅れる
ので、突入電流防止の機能を完全に果たすことが出来な
いと云う欠点がある。
［Ｃ）発明の目的
本発明の目的は上記の欠点を除去し、電源等の瞬断に際
し充分に装置全体を保護出来る様な高速の保護特性を持
つ突入電流防止回路を提供することである。
し充分に装置全体を保護出来る様な高速の保護特性を持
つ突入電流防止回路を提供することである。
（ｄ１発明の構成
」１記の目的は本発明によれば、直流電源から一定電流
を負荷に供給する回路に於ける突入電流を防止する突入
電流防止回路に於いて、該直流電源と負荷との間に直列
に接続された突入防止用抵抗と該突入防止用抵抗と並列
に接続されたトランジスターを設置し、該トランジスタ
ーを突入電流により制御することを特徴とする突入電流
防止回路を提供することにより達成される。
を負荷に供給する回路に於ける突入電流を防止する突入
電流防止回路に於いて、該直流電源と負荷との間に直列
に接続された突入防止用抵抗と該突入防止用抵抗と並列
に接続されたトランジスターを設置し、該トランジスタ
ーを突入電流により制御することを特徴とする突入電流
防止回路を提供することにより達成される。
ｆｅ）発明の実施例
以下本発明の実施例を図面によって詳述する。
第４図は本発明の一実施例を示す図で、図中Ｅは電源、
ＳＷはスイッチ、Ｒ１は抵抗、Ｒ４は過電流検出用抵抗
、Ｒ５は突入電流防止用抵抗、Ｑｌ、Ｑ２はトランジス
ター、更に抵抗Ｒ６とコンデンサーＣとの並列回路は負
荷を示す。
ＳＷはスイッチ、Ｒ１は抵抗、Ｒ４は過電流検出用抵抗
、Ｒ５は突入電流防止用抵抗、Ｑｌ、Ｑ２はトランジス
ター、更に抵抗Ｒ６とコンデンサーＣとの並列回路は負
荷を示す。
以下第４図により、本発明の突入電流防止回路を説明す
る。スイッチＳＷを閉し、電圧Ｅを負荷に印加すると、
コンデンサーＣは充電されていないので、負荷は短絡状
態になり、突入電流が流れようとする。此の時抵抗Ｒ１
を通して、トランジスターＱ１にベース電流を供給し、
トランジスターＱ１をＯＮにする。その結果過電流検出
用抵抗Ｒ４に電圧降下を生ずる。尚過電流検出用抵抗Ｒ
４は負荷抵抗Ｒ６に比し充分小さく設定されているので
、定常運転時に問題となる様な電力消費は無い。此の電
圧降下がトランジスターＱ２の飽和時のベース・エミッ
ター間の電圧より大きくなると、トランジスターＱ２は
トランジスターＱ１のベース電流を引き抜いて減少させ
、１−ランシスターＱ１の内部抵抗は大きくなり、突入
電流防止用抵抗Ｒ５と共に過大電流の流れるのを防止す
る。此の様にして突入電流が流れないようにする。この
様にしてコンデンサー〇が充電されて来ると過電流検出
用抵抗Ｒ４の電圧降下は漸次低下し、このためトランジ
スターＱ２の“コレクター電流は減少し、トランジスタ
ーＱ１のベース電流は増大し、定電状態に入ると、トラ
ンジスターＱ１のコレクター・エミッター間の電圧は略
０．５Ｖで大変小さくなる。前記の様に過電流検出用抵
抗Ｒ４は突入電流防止用抵抗Ｒ５、負荷抵抗Ｒ６に比し
、大変小さく設定しであるので、重力消費は少ない。
る。スイッチＳＷを閉し、電圧Ｅを負荷に印加すると、
コンデンサーＣは充電されていないので、負荷は短絡状
態になり、突入電流が流れようとする。此の時抵抗Ｒ１
を通して、トランジスターＱ１にベース電流を供給し、
トランジスターＱ１をＯＮにする。その結果過電流検出
用抵抗Ｒ４に電圧降下を生ずる。尚過電流検出用抵抗Ｒ
４は負荷抵抗Ｒ６に比し充分小さく設定されているので
、定常運転時に問題となる様な電力消費は無い。此の電
圧降下がトランジスターＱ２の飽和時のベース・エミッ
ター間の電圧より大きくなると、トランジスターＱ２は
トランジスターＱ１のベース電流を引き抜いて減少させ
、１−ランシスターＱ１の内部抵抗は大きくなり、突入
電流防止用抵抗Ｒ５と共に過大電流の流れるのを防止す
る。此の様にして突入電流が流れないようにする。この
様にしてコンデンサー〇が充電されて来ると過電流検出
用抵抗Ｒ４の電圧降下は漸次低下し、このためトランジ
スターＱ２の“コレクター電流は減少し、トランジスタ
ーＱ１のベース電流は増大し、定電状態に入ると、トラ
ンジスターＱ１のコレクター・エミッター間の電圧は略
０．５Ｖで大変小さくなる。前記の様に過電流検出用抵
抗Ｒ４は突入電流防止用抵抗Ｒ５、負荷抵抗Ｒ６に比し
、大変小さく設定しであるので、重力消費は少ない。
又入力瞬時変動に対しても有効に動作する。即ち電源電
圧が大きくなると、過電流検出用抵抗Ｒ４を流れる電流
が大きくなり、その電圧降下も大きくなり、トランジス
ターＱ２のコレクター電流が大きくなり、従ってトラン
ジスターＱ１のベース電流が減少し、トランジスターＱ
１のコレクター・エミッター間の電圧が大きくなり、負
荷電圧が減少する。此の様にトランジスターＱ１が定電
流を供給するので、突入電流は流れなくなる。
圧が大きくなると、過電流検出用抵抗Ｒ４を流れる電流
が大きくなり、その電圧降下も大きくなり、トランジス
ターＱ２のコレクター電流が大きくなり、従ってトラン
ジスターＱ１のベース電流が減少し、トランジスターＱ
１のコレクター・エミッター間の電圧が大きくなり、負
荷電圧が減少する。此の様にトランジスターＱ１が定電
流を供給するので、突入電流は流れなくなる。
而も本発明によれば、使用回路には時間的な遅延素子を
含まないので上記の制御は極めて高速に実施せられるの
で有効な突入電流防止機能を発揮する。
含まないので上記の制御は極めて高速に実施せられるの
で有効な突入電流防止機能を発揮する。
第５図は本発明の他の実施例で図中、Ｒ２、Ｒ３ば抵抗
で、其の他は第４図に同しである。此の実施例では、ト
ランジスターＱ１のコレクター・エミッター間の電圧を
検出し、これが規定以上の時はトランジスターＱ２をＯ
Ｎとし、トランジスターＱｌのベース電流を引き抜き、
トランジスターＱ１をＯＦＦとし、トランジスターＱｌ
に過大重力が印加しない様に保護する機能を発揮するも
のである。此の場合も第４図の時と同様にその動作は高
速であるので装置の保護は完全である。
で、其の他は第４図に同しである。此の実施例では、ト
ランジスターＱ１のコレクター・エミッター間の電圧を
検出し、これが規定以上の時はトランジスターＱ２をＯ
Ｎとし、トランジスターＱｌのベース電流を引き抜き、
トランジスターＱ１をＯＦＦとし、トランジスターＱｌ
に過大重力が印加しない様に保護する機能を発揮するも
のである。此の場合も第４図の時と同様にその動作は高
速であるので装置の保護は完全である。
面参考として、第６図に通寓のトランジスターのＡＳＯ
（安全動作領域）カーブと本発明を使用した時のトラン
ジスターに対する電圧、電流、電力のかかり具合を示す
。此の様にトランジスターにかかる負荷を軽減出来るの
で、安定な動作を保証することが可能である。
（安全動作領域）カーブと本発明を使用した時のトラン
ジスターに対する電圧、電流、電力のかかり具合を示す
。此の様にトランジスターにかかる負荷を軽減出来るの
で、安定な動作を保証することが可能である。
ｉｆ）発明の効果
以上詳細に説明したように、本発明によれば突入電流防
止回路にトランジスター利用の定電流回路を使っている
ので、電源の瞬間上昇や時間間隔の短い投入切断時に極
めて高速に機能し、設定値以上の突入電流が流れること
はないという効果がある。
止回路にトランジスター利用の定電流回路を使っている
ので、電源の瞬間上昇や時間間隔の短い投入切断時に極
めて高速に機能し、設定値以上の突入電流が流れること
はないという効果がある。
第１図、第２図、第３図は従来の突入電流防止回路の例
を示すもので、第１図面列抵抗挿入方式、第２図は継電
器の併用方式、第３図はサイリスターの併用方式を示す
図で、第１図、第２図、第３図において、Ｅは電源、ｓ
ｗはスイッチ、Ｒ１は負荷抵抗、Ｃは負荷のコンデンサ
ー、Ｒ２は突入電流防止用抵抗、ｒｌは継電器の接点、
ＴＨはすイリスターである。 第４図は本発明の一実施例を示す図で、図中Ｅは電源、
Ｓ Ｗはス・イソチ、Ｒ１は抵抗、Ｒ４は過電流検出用
抵抗、Ｒ５は突入電流防止用抵抗、Ｑｌ、Ｑ２はトラン
ジスター、更に抵抗Ｒ６とコンデンサーＣとの並列回路
は負荷を示す。 第５図は本発明の別の実施例で図中、Ｒ２、Ｒ３は抵抗
で、其の他は第４図に同じである。 第６図は本発明により、使用されるトランジスターの負
荷が軽減される状態を説明するグラフである。
を示すもので、第１図面列抵抗挿入方式、第２図は継電
器の併用方式、第３図はサイリスターの併用方式を示す
図で、第１図、第２図、第３図において、Ｅは電源、ｓ
ｗはスイッチ、Ｒ１は負荷抵抗、Ｃは負荷のコンデンサ
ー、Ｒ２は突入電流防止用抵抗、ｒｌは継電器の接点、
ＴＨはすイリスターである。 第４図は本発明の一実施例を示す図で、図中Ｅは電源、
Ｓ Ｗはス・イソチ、Ｒ１は抵抗、Ｒ４は過電流検出用
抵抗、Ｒ５は突入電流防止用抵抗、Ｑｌ、Ｑ２はトラン
ジスター、更に抵抗Ｒ６とコンデンサーＣとの並列回路
は負荷を示す。 第５図は本発明の別の実施例で図中、Ｒ２、Ｒ３は抵抗
で、其の他は第４図に同じである。 第６図は本発明により、使用されるトランジスターの負
荷が軽減される状態を説明するグラフである。
Claims (1)
- 直流電源から一定電流を負荷に供給する回路に於？−す
る突入電流を防止する突入電流防止回路に於いて、該直
流電源と負荷との間に直列に接続された突入防止用抵抗
と該突入防止用抵抗と並列に接続された［・ランジスク
ーを設置し、該トランジスターを突入電流により制御す
ることを特徴とする突入電流防止回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57171993A JPS5961429A (ja) | 1982-09-30 | 1982-09-30 | 突入電流防止回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57171993A JPS5961429A (ja) | 1982-09-30 | 1982-09-30 | 突入電流防止回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5961429A true JPS5961429A (ja) | 1984-04-07 |
Family
ID=15933532
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57171993A Pending JPS5961429A (ja) | 1982-09-30 | 1982-09-30 | 突入電流防止回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5961429A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6291531U (ja) * | 1985-11-27 | 1987-06-11 | ||
| JPS62163520A (ja) * | 1986-01-10 | 1987-07-20 | 東洋通信機株式会社 | 突入電流制限回路 |
| JPH01270727A (ja) * | 1988-04-20 | 1989-10-30 | Fuji Electric Co Ltd | 突入電流制限回路 |
| WO2012077195A1 (ja) * | 2010-12-08 | 2012-06-14 | 富士通株式会社 | 電子機器 |
-
1982
- 1982-09-30 JP JP57171993A patent/JPS5961429A/ja active Pending
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6291531U (ja) * | 1985-11-27 | 1987-06-11 | ||
| JPH0510520Y2 (ja) * | 1985-11-27 | 1993-03-15 | ||
| JPS62163520A (ja) * | 1986-01-10 | 1987-07-20 | 東洋通信機株式会社 | 突入電流制限回路 |
| JPH01270727A (ja) * | 1988-04-20 | 1989-10-30 | Fuji Electric Co Ltd | 突入電流制限回路 |
| WO2012077195A1 (ja) * | 2010-12-08 | 2012-06-14 | 富士通株式会社 | 電子機器 |
| JP5556900B2 (ja) * | 2010-12-08 | 2014-07-23 | 富士通株式会社 | 電子機器 |
| US9281679B2 (en) | 2010-12-08 | 2016-03-08 | Fujitsu Limited | Electronic device |
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