JPS5949093A - デジタルpb信号発生方式 - Google Patents
デジタルpb信号発生方式Info
- Publication number
- JPS5949093A JPS5949093A JP15877082A JP15877082A JPS5949093A JP S5949093 A JPS5949093 A JP S5949093A JP 15877082 A JP15877082 A JP 15877082A JP 15877082 A JP15877082 A JP 15877082A JP S5949093 A JPS5949093 A JP S5949093A
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- Japan
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- signal
- microprocessor
- rom
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- Pending
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q1/00—Details of selecting apparatus or arrangements
- H04Q1/18—Electrical details
- H04Q1/30—Signalling arrangements; Manipulation of signalling currents
- H04Q1/44—Signalling arrangements; Manipulation of signalling currents using alternate current
- H04Q1/444—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies
- H04Q1/45—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using multi-frequency signalling
- H04Q1/457—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using multi-frequency signalling with conversion of multifrequency signals into digital signals
- H04Q1/4575—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using multi-frequency signalling with conversion of multifrequency signals into digital signals which are transmitted in digital form
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明&i、、JR内y換((゛)等で使用さ才1ろ
P B信号発生方式に係わり、特にPB信号′f?:P
CM符号で発生するデジタルPB信号発生方式に191
11ろものである。
P B信号発生方式に係わり、特にPB信号′f?:P
CM符号で発生するデジタルPB信号発生方式に191
11ろものである。
従来から、父換装flitにおいては回線の接続、回線
の使用状況等のfti制御7行うため可聴音1δ号で形
成されるP B (Pu5h Button )イ3号
、呼出音2発信音9話中音等の信号を使用している(以
下こJしらの信号を含めてP B信号と総称する)。
の使用状況等のfti制御7行うため可聴音1δ号で形
成されるP B (Pu5h Button )イ3号
、呼出音2発信音9話中音等の信号を使用している(以
下こJしらの信号を含めてP B信号と総称する)。
か〜るl) B 4g号を利用して交換業務ケ行う交換
装置産は空間分割形交換装置と、■ゝCM II?i分
割形分割製交換装置が、これら又換装V171に(14
用さJt、る信号方式は、その適応性からAi1者では
アナログ方式が、後者ではデジタル方式が使用される。
装置産は空間分割形交換装置と、■ゝCM II?i分
割形分割製交換装置が、これら又換装V171に(14
用さJt、る信号方式は、その適応性からAi1者では
アナログ方式が、後者ではデジタル方式が使用される。
この発明は、後者の交換装植、にハし、特にP B9秒
をi’ e M符舛で送出するため、信号の基本周期分
のl) CM符号化標本値をkL OM (Il、e;
Id 0nlyへIemnry ) Ic fjき込ん
でおき、それらケ標本化周期でih’t I♀的に11
にみ出1ようにしたデジタル13 Tl (i号発生方
5(、に(“工・1づるものでk)ろ。
をi’ e M符舛で送出するため、信号の基本周期分
のl) CM符号化標本値をkL OM (Il、e;
Id 0nlyへIemnry ) Ic fjき込ん
でおき、それらケ標本化周期でih’t I♀的に11
にみ出1ようにしたデジタル13 Tl (i号発生方
5(、に(“工・1づるものでk)ろ。
又換業務に採用されているI’B信号火デジタル信号で
発生させろ際、PB(u号の殆んどは、その゛信号)1
″?1波数の公称値が標本化周波a CP CM方式む
ておいては8 KH2)の簡単な約数・倍数15′」係
にjIらブエい。そのため、信は発生に必黄な村木値の
数(格納1べきテークのワード数)が非”fKに多くな
る。
発生させろ際、PB(u号の殆んどは、その゛信号)1
″?1波数の公称値が標本化周波a CP CM方式む
ておいては8 KH2)の簡単な約数・倍数15′」係
にjIらブエい。そのため、信は発生に必黄な村木値の
数(格納1べきテークのワード数)が非”fKに多くな
る。
そこで、(i’i号周波l′シを許容誤差内で人為的に
変化させることによってnl記格納1べきワード数の減
少を泪かろことか行われろ。
変化させることによってnl記格納1べきワード数の減
少を泪かろことか行われろ。
2n 1表は、偏差11′[容筒を+05%としたとき
の各PI3(i¥号のワード数7示したもので、が又ろ
操第1表 作を行うと節IFな約数・倍数とならないPBI〜1)
B−Ifの信号も最畠178ワード斂に抑えることが
できる。
の各PI3(i¥号のワード数7示したもので、が又ろ
操第1表 作を行うと節IFな約数・倍数とならないPBI〜1)
B−Ifの信号も最畠178ワード斂に抑えることが
できる。
従って、第1図にみらftろよ5に第1表に示したワー
ド数のデータを格納している11. OA4 M、〜M
2.を、イ;p本化周波数のりpソクイS号をn1数し
ているアドレスカウンタC3〜C,3の計数値によって
循環的に読み出1−と、」二段がらIII’i次発振音
、 Tl1−出Cr“、i”nl、 PH1,・・・
・・・、PH1,r’n*、i’nO、I’ 13−1
1.に対応1ろPCMわ1骨化コードが読み出さね、イ
ンタフェース部1011?:入力さ」1ろ。したがって
、こオ]ら乞制御信号f応じて時分割で送信ハイウェイ
5I(Wl/こ出力することによって又挽業U5を・行
わせることができろ。
ド数のデータを格納している11. OA4 M、〜M
2.を、イ;p本化周波数のりpソクイS号をn1数し
ているアドレスカウンタC3〜C,3の計数値によって
循環的に読み出1−と、」二段がらIII’i次発振音
、 Tl1−出Cr“、i”nl、 PH1,・・・
・・・、PH1,r’n*、i’nO、I’ 13−1
1.に対応1ろPCMわ1骨化コードが読み出さね、イ
ンタフェース部1011?:入力さ」1ろ。したがって
、こオ]ら乞制御信号f応じて時分割で送信ハイウェイ
5I(Wl/こ出力することによって又挽業U5を・行
わせることができろ。
ブエお、第1図においてアドレスカウンタC1〜CI3
のCLK端子には標本化周期でクロック信号が供給され
ろものであり、ILOMM、〜M8.のA用J、アドレ
ス信号入力端子、01(9:M子は、インクフェース部
10からの同期信号によってP CM符号の送出を行5
出カイネーブルl’;l′、i子ン示1°。
のCLK端子には標本化周期でクロック信号が供給され
ろものであり、ILOMM、〜M8.のA用J、アドレ
ス信号入力端子、01(9:M子は、インクフェース部
10からの同期信号によってP CM符号の送出を行5
出カイネーブルl’;l′、i子ン示1°。
しかしながら、第1図のデジタルPB信号発生方式は、
発生すべきpn(=号の数だけ、アドレスカウンタC5
〜C73,及び1もOMM、〜〜113が必要でJ)り
装置〆Lが俵数化1°ろとともに大形となるという欠点
がある。
発生すべきpn(=号の数だけ、アドレスカウンタC5
〜C73,及び1もOMM、〜〜113が必要でJ)り
装置〆Lが俵数化1°ろとともに大形となるという欠点
がある。
しかも、IL OMの記憶容jl?は通常同一のもの、
例えば2にバイトのものが使用されるのでワード数の小
さいl)B信Hに対しては無駄になるという欠点もk)
ろ。
例えば2にバイトのものが使用されるのでワード数の小
さいl)B信Hに対しては無駄になるという欠点もk)
ろ。
この発明は、か匁ろ実状にかんがみてなされたもので、
I) B信号の発生にマイクロプロセッサを使用して、
l((、) Mの’h’Lみ出しを行うことf fle
徴とし、その目的とjるところはワード長の異なった多
A・i類の信号データな(,4;1本化周期で循環的に
読み出1時に簡明な回路構成とするとともに、70グラ
ムデークの追加によって新しいpn(:信号が必要とな
った時でも、速やかに対処できろようにしたデジタル)
) 13信号の発生方式を提供するものである。
I) B信号の発生にマイクロプロセッサを使用して、
l((、) Mの’h’Lみ出しを行うことf fle
徴とし、その目的とjるところはワード長の異なった多
A・i類の信号データな(,4;1本化周期で循環的に
読み出1時に簡明な回路構成とするとともに、70グラ
ムデークの追加によって新しいpn(:信号が必要とな
った時でも、速やかに対処できろようにしたデジタル)
) 13信号の発生方式を提供するものである。
以下、この発明の機能動作を、マイクロプロセッサ1L
PD8049(日′?i、製)夕月いた実施例で説明す
る。
PD8049(日′?i、製)夕月いた実施例で説明す
る。
2p 2図はこの発明の機能ブロック図を示したもので
、20は交4fA装置とのインターフェース部、21.
22.23はマイクロプロセッサ(itoム4内蔵)を
示′i。
、20は交4fA装置とのインターフェース部、21.
22.23はマイクロプロセッサ(itoム4内蔵)を
示′i。
マイクロブ謙セッサ21,22には第1表のPB1〜l
) B 44までの■)B信−F−+馨づれ生1ろブこ
めのデータが、内蔵されているメモリ(八1aslc
几OM)IcI)CM符−汀で格納さり、てい7)。マ
イクロブーセッサ21.22のl’ O端子にはイ1イ
織別IIIの16号が人力すJ1テいるが、こオ]はマ
イクロプロセッサ21゜22の処理速度の点からPBI
〜P B田の12周波を1つのマイクロブロセノ→ノー
21(22)で処理できないので、前記12周波’&
2 filに分け、6周波ずつ分担さ姓て発生させるよ
うにしたもので、処即連Iβ−が充分速い1易合は11
1・1のマイクロプロセッサ21のみを使用してもよい
。
) B 44までの■)B信−F−+馨づれ生1ろブこ
めのデータが、内蔵されているメモリ(八1aslc
几OM)IcI)CM符−汀で格納さり、てい7)。マ
イクロブーセッサ21.22のl’ O端子にはイ1イ
織別IIIの16号が人力すJ1テいるが、こオ]はマ
イクロプロセッサ21゜22の処理速度の点からPBI
〜P B田の12周波を1つのマイクロブロセノ→ノー
21(22)で処理できないので、前記12周波’&
2 filに分け、6周波ずつ分担さ姓て発生させるよ
うにしたもので、処即連Iβ−が充分速い1易合は11
1・1のマイクロプロセッサ21のみを使用してもよい
。
また、マイクロプロセッサ23には、第1表に示′1発
イ露音1話中員、 nf出音等に対1ろデータが11
CM ′6号で、内蔵され−Cいもメモリに格納されて
いる。
イ露音1話中員、 nf出音等に対1ろデータが11
CM ′6号で、内蔵され−Cいもメモリに格納されて
いる。
なお、D (Jは並列P CM符号化データの出力端子
、I N ’I’は割込指令を受領−5る端子ケ示′1
″。
、I N ’I’は割込指令を受領−5る端子ケ示′1
″。
第3図(a)、 (b)はが匁るメモリの内′8を示し
たもので、21≦31M1(a)はマイクロプロセッサ
21゜220メモリに格納さ少している内界で、斜線と
したDの部分は各PB信号をP CAt符号化して格納
している1」11域、Pの部分はプログラムが格納され
て(・る領域な示す。
たもので、21≦31M1(a)はマイクロプロセッサ
21゜220メモリに格納さ少している内界で、斜線と
したDの部分は各PB信号をP CAt符号化して格納
している1」11域、Pの部分はプログラムが格納され
て(・る領域な示す。
また、第3図(b)も同様にDの部分は話中社。
呼出音、および発イ客■が、Pの部分はブロクラムが格
納さlI]ていることを示1−0 以上の概要からなるこの発明のデジタルP 11信号発
生方式について、以下にさらに詳細に説明する。
納さlI]ていることを示1−0 以上の概要からなるこの発明のデジタルP 11信号発
生方式について、以下にさらに詳細に説明する。
一般K ’j’ シタル交換方式では朽声等のアナログ
信号を一定周期で勇ンノリンクし、デジタルの2進符号
化パルス列に変換し、通話路スイッチとしてはメモリヶ
用いてパルス列の時間的空間的位置を変えることにより
交換を行う。
信号を一定周期で勇ンノリンクし、デジタルの2進符号
化パルス列に変換し、通話路スイッチとしてはメモリヶ
用いてパルス列の時間的空間的位置を変えることにより
交換を行う。
この方式の入出力通話路は多数の回線に共通に使用され
るので一般圧ハイウェイ(HW )と吋はれ、送出fi
ll (S HW )、入力1ull (It HW
)とも2八411i t/secのスピードで32回線
を共用する。
るので一般圧ハイウェイ(HW )と吋はれ、送出fi
ll (S HW )、入力1ull (It HW
)とも2八411i t/secのスピードで32回線
を共用する。
したがって、1つの回線に割り当てられたタイムスロッ
トTSO−TS31と、ザンブリング周期。
トTSO−TS31と、ザンブリング周期。
クロックCLKの関係は第4し/1に示すようになり、
交換制御イd号川用PB信号等の可聴43号を発生1ろ
には、125μsのザンブリング周期で指定さねたタイ
ムスロットi” s o〜TS311C[水筒データを
(h′1環的に送出すればよい。
交換制御イd号川用PB信号等の可聴43号を発生1ろ
には、125μsのザンブリング周期で指定さねたタイ
ムスロットi” s o〜TS311C[水筒データを
(h′1環的に送出すればよい。
筆5図ばか〜ろタイミングで標本値データを1つのマイ
クプロセッサ21がら出力するための一′:J!:14
11例を示1もので、21はマイクロプロセッサ(It
OM内蔵)、21aはデータの書き込みJ6よぴfj
j’eみ出しを制御する信号を形成するデコーダ、30
〜35は並列−直列変換シフトレジスタ、40〜45は
アンドゲート、51〜55はタイムスロットの指定信号
端子、6はセンドハイウェイ、7は2 M1月+/se
cのクロックパルスCLKの15号端子である。
クプロセッサ21がら出力するための一′:J!:14
11例を示1もので、21はマイクロプロセッサ(It
OM内蔵)、21aはデータの書き込みJ6よぴfj
j’eみ出しを制御する信号を形成するデコーダ、30
〜35は並列−直列変換シフトレジスタ、40〜45は
アンドゲート、51〜55はタイムスロットの指定信号
端子、6はセンドハイウェイ、7は2 M1月+/se
cのクロックパルスCLKの15号端子である。
今、PBli号のタイムスロット總1 l)当てをP
B 1→’rsO,1)132→TSI、PB3→T
S 2. JIB4→i’s3.I’B5→’[’S4
.P136→T S 5と仮定すると、まず、マイクプ
ロセッサ 6図(a)のフロートチャートに示すように初期設定プ
ログラムによりマイクロプロセッサ21のプログラムレ
ジスタを初J+t1値に設定し、並列−1rZ 列変換
シフ 1−レジスタ30〜35の各々にl) B 1〜
11 B 6の第1吊目の1.゛3本値テデー(以下単
にデータとい5〕をliき込み、21す込み1ぎ号(I
NT端子の入力)待ちの状態となっている。第4図に示
したタイムスロット’r s oに対応した信号ケマイ
クプロセノザ210割込み13号として用いておけば、
この信号が受(fiされろと第6図(b)のフロートチ
ャートに示1″よ5 ic 1!U込み処理プログラム
か起動し、−11し列−1a列変換シフトレジスタ30
のデータ、すなわちP)(1がクロックパルスCLKK
よつ”’CF4cみ出さね1、以下順次にスロットタイ
ムS T 1〜S ’II’ 5 K同期して並列−直
列変換シフトレジスタ31〜35に書き込まれている1
)B2〜PR6のデータか読み出される。
B 1→’rsO,1)132→TSI、PB3→T
S 2. JIB4→i’s3.I’B5→’[’S4
.P136→T S 5と仮定すると、まず、マイクプ
ロセッサ 6図(a)のフロートチャートに示すように初期設定プ
ログラムによりマイクロプロセッサ21のプログラムレ
ジスタを初J+t1値に設定し、並列−1rZ 列変換
シフ 1−レジスタ30〜35の各々にl) B 1〜
11 B 6の第1吊目の1.゛3本値テデー(以下単
にデータとい5〕をliき込み、21す込み1ぎ号(I
NT端子の入力)待ちの状態となっている。第4図に示
したタイムスロット’r s oに対応した信号ケマイ
クプロセノザ210割込み13号として用いておけば、
この信号が受(fiされろと第6図(b)のフロートチ
ャートに示1″よ5 ic 1!U込み処理プログラム
か起動し、−11し列−1a列変換シフトレジスタ30
のデータ、すなわちP)(1がクロックパルスCLKK
よつ”’CF4cみ出さね1、以下順次にスロットタイ
ムS T 1〜S ’II’ 5 K同期して並列−直
列変換シフトレジスタ31〜35に書き込まれている1
)B2〜PR6のデータか読み出される。
各1’B(さ号PBI〜P B Gの第2番目の信号は
データが読;を出されたあと、マイクロプロセッサ21
のプログラムレジスタからtvAf<31:Jることに
よつ−(前記直列−並列変換シフトレジスタ30〜35
に書き込まれろ。
データが読;を出されたあと、マイクロプロセッサ21
のプログラムレジスタからtvAf<31:Jることに
よつ−(前記直列−並列変換シフトレジスタ30〜35
に書き込まれろ。
したかつて、以下125μs4げに前記割込み信号を受
イ3し、P B信号の第2査目、第3ネ19目、・・・
・・・のデータが各タイムスロットに同期してIl:f
i次並列−直列変拉8ンフトレジスク30〜35かも読
み出されセンドハイウェイS Hwに送り出される。
イ3し、P B信号の第2査目、第3ネ19目、・・・
・・・のデータが各タイムスロットに同期してIl:f
i次並列−直列変拉8ンフトレジスク30〜35かも読
み出されセンドハイウェイS Hwに送り出される。
以上、マイクロプロセッサ21について説明したが池の
マイクロプロセッサリ−22,23も125μsの周期
で割込み信号か受領されろ毎に同様(を起動さJ1上述
した各スロットタイムSTO〜S15と異なるスロット
タイムにP B信号か送出されることにブゑる。
マイクロプロセッサリ−22,23も125μsの周期
で割込み信号か受領されろ毎に同様(を起動さJ1上述
した各スロットタイムSTO〜S15と異なるスロット
タイムにP B信号か送出されることにブゑる。
な、お、It OM 内蔵のマイクロプロセッサ21に
ついて説明したが1′LOMt別1固に設けてもよいこ
とはいうまでもない。
ついて説明したが1′LOMt別1固に設けてもよいこ
とはいうまでもない。
この発明は以−ヒ説明したように、マイクメロセソーリ
゛内のレジスタ乞プリセンタプルなカウンタとし゛(用
い1iill i+lll +%からの周期的な読み出
し開始指令(割込み信@)ゲ受けてプログラムによりレ
ンスタの111+g1つずつtNQ −F): してI
L OMの7ドレスとし、几OMに格納さハているPB
B信号データをP CM杓号として読み出し制48シー
するようにしているので、カウンタとIt OMによっ
て構成するデジタルPB信号発生方式に比べて、ROM
、IC部分を大幅に少なく1ろことかでき、経済的にデ
ジタルPB信号を発生きせることかできるとともに、新
しいPB倍−号が要望された時もROMの内容を変更1
−ることおよびプログラムの追加によって速かに対処す
ることができろとい5利点を有する。
゛内のレジスタ乞プリセンタプルなカウンタとし゛(用
い1iill i+lll +%からの周期的な読み出
し開始指令(割込み信@)ゲ受けてプログラムによりレ
ンスタの111+g1つずつtNQ −F): してI
L OMの7ドレスとし、几OMに格納さハているPB
B信号データをP CM杓号として読み出し制48シー
するようにしているので、カウンタとIt OMによっ
て構成するデジタルPB信号発生方式に比べて、ROM
、IC部分を大幅に少なく1ろことかでき、経済的にデ
ジタルPB信号を発生きせることかできるとともに、新
しいPB倍−号が要望された時もROMの内容を変更1
−ることおよびプログラムの追加によって速かに対処す
ることができろとい5利点を有する。
第1図は従来のデジタルPB1μmDの発生方式Y示す
フロック図、8PJZ図はこの発明のデジタルl)B信
号発生方式の4iff安ケ示1゛ブロック図、第3図(
a)。 (I))はROMに格納されているデータ())B信号
の11更本値、およびプログラム)の内容乞示す説明図
、筆4図はデジタル父換方式におけるクロック信号、タ
イムスロット、i、;よびデータの門係を示−3波形図
、第5図はこの発明のデジタルl) B信号発生方式の
一実施例を示すフロック図、第6図はマイクロプロセッ
サのフローチャート図であ4)。 1菌中、20もまインタフェース’Btu、21,22
゜23はマイクロプロセツザタ示す。 第1図 一一] しぺ 一5′ 第2図 0 第3図 (a)
フロック図、8PJZ図はこの発明のデジタルl)B信
号発生方式の4iff安ケ示1゛ブロック図、第3図(
a)。 (I))はROMに格納されているデータ())B信号
の11更本値、およびプログラム)の内容乞示す説明図
、筆4図はデジタル父換方式におけるクロック信号、タ
イムスロット、i、;よびデータの門係を示−3波形図
、第5図はこの発明のデジタルl) B信号発生方式の
一実施例を示すフロック図、第6図はマイクロプロセッ
サのフローチャート図であ4)。 1菌中、20もまインタフェース’Btu、21,22
゜23はマイクロプロセツザタ示す。 第1図 一一] しぺ 一5′ 第2図 0 第3図 (a)
Claims (1)
- PB倍信号デジタルコードで発生するテンタル1)I3
信号発生方式において、前記PB倍信号相当するPCλ
1符号フードを予めマイクロプロセツサのIL OM
/l・負域、または別個0月1.04,1格納しておき
、所定の、違み出し制御11号があったとき前記格納さ
れているP CM符号コードを出力しでI)B(A号を
発生させろことン特C救と一′4るデジタルPI3信壮
発生方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15877082A JPS5949093A (ja) | 1982-09-14 | 1982-09-14 | デジタルpb信号発生方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15877082A JPS5949093A (ja) | 1982-09-14 | 1982-09-14 | デジタルpb信号発生方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5949093A true JPS5949093A (ja) | 1984-03-21 |
Family
ID=15678956
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP15877082A Pending JPS5949093A (ja) | 1982-09-14 | 1982-09-14 | デジタルpb信号発生方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5949093A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61145952A (ja) * | 1984-12-20 | 1986-07-03 | Oki Electric Ind Co Ltd | 信号音制御方式 |
JPS6292562A (ja) * | 1985-10-17 | 1987-04-28 | Fujitsu Ltd | アンサ−バツクト−ン発生方式 |
US6581429B1 (en) | 1999-03-31 | 2003-06-24 | Hitachi, Ltd. | Strip wiper device, strip wiping method, rolling mill and rolling method |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS54121606A (en) * | 1978-03-14 | 1979-09-20 | Nec Corp | Multi-frequency signal generating device |
-
1982
- 1982-09-14 JP JP15877082A patent/JPS5949093A/ja active Pending
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