JPS5947550B2 - トリガ回路 - Google Patents
トリガ回路Info
- Publication number
- JPS5947550B2 JPS5947550B2 JP3840577A JP3840577A JPS5947550B2 JP S5947550 B2 JPS5947550 B2 JP S5947550B2 JP 3840577 A JP3840577 A JP 3840577A JP 3840577 A JP3840577 A JP 3840577A JP S5947550 B2 JPS5947550 B2 JP S5947550B2
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- circuit
- signal
- supplied
- trigger
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Control Of Electrical Variables (AREA)
- Power Conversion In General (AREA)
- Electronic Switches (AREA)
Description
【発明の詳細な説明】
ＳＣＲとダイオードを用いて構成されたブリッジ整流回
路として第１図に示すようなものがある。
路として第１図に示すようなものがある。
図において、商用電源１からの第２図Ａに示す −よう
な交流電圧Ｅｃはブリッジ回路２の交流側接点に供給さ
れ、この回路２の整流側接点からの電圧が平滑用コンデ
ンサ３及び負荷４の並列回路に供給される。一方、電源
１からの交流電圧Ｅｃがゼロクロス検出回路５に供給さ
れて第２図Ｂに示 。すようなゼロクロス点の検出信号
Ｓ２が取り出される。そしてこの検出信号Ｓ２がトリガ
パルス発生回路６に供給され、第２図Ｃに示す制御信号
ｓｃが「１」の期間、第２図Ｄに示すトリガ信号Ｓｔが
ブリッジ回路２０）ＳＣＲ２ａ、２ｂのゲー 。卜に供
給されてブリッジ回路２から第２図Ｅに示す整流電圧Ｅ
ｒが取り出され、この電圧Ｅｒが第２図Ｆに示すように
平滑されてこの平滑電圧Ｅｓが負荷４に供給される。と
ころが、この回路において、第２図Ｇに示すように、制
御信号Ｓｃが「１」になつた後に、スイッチのチヤタリ
ング等により、電源電圧Ｅｃが瞬間的に立ち下がると、
検出回路５においてこの部分が誤検出され、第２図Ｈに
示すように誤まつたトリガ信号ＳｔがＳＣＲ２ａ、２ｂ
に供給される。
な交流電圧Ｅｃはブリッジ回路２の交流側接点に供給さ
れ、この回路２の整流側接点からの電圧が平滑用コンデ
ンサ３及び負荷４の並列回路に供給される。一方、電源
１からの交流電圧Ｅｃがゼロクロス検出回路５に供給さ
れて第２図Ｂに示 。すようなゼロクロス点の検出信号
Ｓ２が取り出される。そしてこの検出信号Ｓ２がトリガ
パルス発生回路６に供給され、第２図Ｃに示す制御信号
ｓｃが「１」の期間、第２図Ｄに示すトリガ信号Ｓｔが
ブリッジ回路２０）ＳＣＲ２ａ、２ｂのゲー 。卜に供
給されてブリッジ回路２から第２図Ｅに示す整流電圧Ｅ
ｒが取り出され、この電圧Ｅｒが第２図Ｆに示すように
平滑されてこの平滑電圧Ｅｓが負荷４に供給される。と
ころが、この回路において、第２図Ｇに示すように、制
御信号Ｓｃが「１」になつた後に、スイッチのチヤタリ
ング等により、電源電圧Ｅｃが瞬間的に立ち下がると、
検出回路５においてこの部分が誤検出され、第２図Ｈに
示すように誤まつたトリガ信号ＳｔがＳＣＲ２ａ、２ｂ
に供給される。
そうすると、整流電圧Ｅｃが第２図Ｉに示すように急激
に立ち上がることになり、コンデンサ３が破損したり、
負荷４に悪影響を与えるおそれがある。本考案はこのよ
うな点にかんがみ、上述のような誤まつたトリガ信号が
発生されないようにしたものであるｏ以下、図面を参照
しながら、本考案の一実施例について説明しよう。
に立ち上がることになり、コンデンサ３が破損したり、
負荷４に悪影響を与えるおそれがある。本考案はこのよ
うな点にかんがみ、上述のような誤まつたトリガ信号が
発生されないようにしたものであるｏ以下、図面を参照
しながら、本考案の一実施例について説明しよう。
第３図において、電源１からの交流電圧Ｅｃがウインド
コンパレータ１１に供給され、この出力信号が積分回路
１２、レベル検出回路１３を通じてトリガパルス発生回
路６に供給される。
コンパレータ１１に供給され、この出力信号が積分回路
１２、レベル検出回路１３を通じてトリガパルス発生回
路６に供給される。
他は第１図と同様にされる。この回路において、電源１
からの第４図Ａに示すような電圧Ｅｃは、ゼロクロス点
付近を拡大してみると第４図Ｂのようになつている。
からの第４図Ａに示すような電圧Ｅｃは、ゼロクロス点
付近を拡大してみると第４図Ｂのようになつている。
従つてこのゼロクロス付近で、ウインドコン′ゞレータ
１１の比較レベルを破線ａ、ｂのように定めれば、この
出力信号５ｗは第４図Ｃのようになり、この信号５ｗを
積分回路１２に供給した出力信号Ｓｉは第４図Ｄのよう
になる。そして、この信号Ｓｉの所定レベル（破線ｃ）
以上をレベル検出回路１３で検出（第４図Ｅ参照）し、
この出力信号５１を発生回路５に供給する。この回路に
よれば、電圧Ｅｃがゼロクロス付近で所定の傾きを持つ
ており、信号５ｗの持続時間が所定以上のときのみ信号
５１が検出される。
１１の比較レベルを破線ａ、ｂのように定めれば、この
出力信号５ｗは第４図Ｃのようになり、この信号５ｗを
積分回路１２に供給した出力信号Ｓｉは第４図Ｄのよう
になる。そして、この信号Ｓｉの所定レベル（破線ｃ）
以上をレベル検出回路１３で検出（第４図Ｅ参照）し、
この出力信号５１を発生回路５に供給する。この回路に
よれば、電圧Ｅｃがゼロクロス付近で所定の傾きを持つ
ており、信号５ｗの持続時間が所定以上のときのみ信号
５１が検出される。
これに対しチヤタリング等により瞬間的に立ち下がつた
場合には、第４図の後半に示すように電圧Ｅｃの傾きが
急峻であり、ウインドコンパレータ１１の出力信号Ｓｗ
のパルスの持続時間が短かく、この信号Ｓｗを積分して
も積分値がレベル検出回路１３の検出レベルＣに達しな
いので、信号Ｓｌは検出されない。こうして、この回路
においてゼロクロス点を検出し、ブリツジ回路２０）Ｓ
ＣＲ２ａ，２ｂをトリガすることができるわけであるが
、本発明によれば、電８Ｅｃが所定の傾きを持つていた
ときのみトリガが行われ、チヤタリング等により電！Ｔ
Ｅｃが瞬間的に立ち下がつた場合には、トリガ信号Ｓ，
が発生されないので、誤動作により電８Ｅｒが急激に立
ち上がつて、そのためコンデンサ３や負荷４が破損して
しまうおそれがない。
場合には、第４図の後半に示すように電圧Ｅｃの傾きが
急峻であり、ウインドコンパレータ１１の出力信号Ｓｗ
のパルスの持続時間が短かく、この信号Ｓｗを積分して
も積分値がレベル検出回路１３の検出レベルＣに達しな
いので、信号Ｓｌは検出されない。こうして、この回路
においてゼロクロス点を検出し、ブリツジ回路２０）Ｓ
ＣＲ２ａ，２ｂをトリガすることができるわけであるが
、本発明によれば、電８Ｅｃが所定の傾きを持つていた
ときのみトリガが行われ、チヤタリング等により電！Ｔ
Ｅｃが瞬間的に立ち下がつた場合には、トリガ信号Ｓ，
が発生されないので、誤動作により電８Ｅｒが急激に立
ち上がつて、そのためコンデンサ３や負荷４が破損して
しまうおそれがない。
なお、上述の回路では、トリガ信号が２つ発生されるが
、この内前の方のトリガ信号は、コンデンサ３及び負荷
４による立ち下がりの時定数を適当に定めておくことに
より、発生時点でＳＣＲが逆バイアスされているので無
効になる。
、この内前の方のトリガ信号は、コンデンサ３及び負荷
４による立ち下がりの時定数を適当に定めておくことに
より、発生時点でＳＣＲが逆バイアスされているので無
効になる。
従つて、ＳＣＲは後の方のトリガ信号のみによつてトリ
ガされる。そしてこの場合に、後の方のトリガ信号は、
ゼロクロス点より少し後になるが、この遅れ時間は、電
圧Ｅｃの傾きに比べて極めて短い時間なので影響はなく
、さらに、この有効なトリガパルスの前ぶちを、整流電
圧Ｅｒの電位がコンデンサ３の端子電圧より高くなる直
前の時点になるようにしておけば、平滑電圧Ｅｓの変動
をさらに押えることができ、有害なノイズの発生を防止
できる。また、上述の回路では、電圧Ｅｃの傾きが急峻
な場合のみを除去するようにしているが、電圧Ｅｃの傾
きが小さく、電圧がゆつくり立ち上がつている場合には
、例え誤動作であつても、コンデンサ３、負荷４の破損
するおそれはない。
ガされる。そしてこの場合に、後の方のトリガ信号は、
ゼロクロス点より少し後になるが、この遅れ時間は、電
圧Ｅｃの傾きに比べて極めて短い時間なので影響はなく
、さらに、この有効なトリガパルスの前ぶちを、整流電
圧Ｅｒの電位がコンデンサ３の端子電圧より高くなる直
前の時点になるようにしておけば、平滑電圧Ｅｓの変動
をさらに押えることができ、有害なノイズの発生を防止
できる。また、上述の回路では、電圧Ｅｃの傾きが急峻
な場合のみを除去するようにしているが、電圧Ｅｃの傾
きが小さく、電圧がゆつくり立ち上がつている場合には
、例え誤動作であつても、コンデンサ３、負荷４の破損
するおそれはない。
さらに、チヤタリング等の外来ノイズによる立ち上がり
は極めて急峻であり、正常波形との差が大きいので、信
号Ｓｗの持続時間の判別は余り厳密である必要はなく、
比較的傾きの急な６０Ｈｚの電源の検出に合せておけば
、５０Ｈｚの地域においても共通に使用することができ
る。
は極めて急峻であり、正常波形との差が大きいので、信
号Ｓｗの持続時間の判別は余り厳密である必要はなく、
比較的傾きの急な６０Ｈｚの電源の検出に合せておけば
、５０Ｈｚの地域においても共通に使用することができ
る。
第１図は従来の回路の系統図、第２図はその説明のため
の図、第３図は本発明の一例の系統図、第４図はその説
明のための図である。
の図、第３図は本発明の一例の系統図、第４図はその説
明のための図である。
Claims (1)
- １ 交流入力信号のゼロクロス付近の第１の所定のレベ
ルから第２の所定のレベルに達するまでの時間を測定し
、この時間が所定の長さ以上のとき上記ゼロクロス付近
で出力トリガ信号を得るようにしたトリガ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3840577A JPS5947550B2 (ja) | 1977-04-04 | 1977-04-04 | トリガ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3840577A JPS5947550B2 (ja) | 1977-04-04 | 1977-04-04 | トリガ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS53123653A JPS53123653A (en) | 1978-10-28 |
| JPS5947550B2 true JPS5947550B2 (ja) | 1984-11-20 |
Family
ID=12524378
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3840577A Expired JPS5947550B2 (ja) | 1977-04-04 | 1977-04-04 | トリガ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5947550B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001186771A (ja) * | 1999-10-15 | 2001-07-06 | Seiko Epson Corp | チョッパ回路、チョッパ回路の制御方法、チョッパ式充電回路、電子機器及び計時装置 |
-
1977
- 1977-04-04 JP JP3840577A patent/JPS5947550B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS53123653A (en) | 1978-10-28 |
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