JPS5923907A - 差電圧増幅回路 - Google Patents
差電圧増幅回路Info
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- JPS5923907A JPS5923907A JP57133560A JP13356082A JPS5923907A JP S5923907 A JPS5923907 A JP S5923907A JP 57133560 A JP57133560 A JP 57133560A JP 13356082 A JP13356082 A JP 13356082A JP S5923907 A JPS5923907 A JP S5923907A
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/06—Continuously compensating for, or preventing, undesired influence of physical parameters
- H03M1/08—Continuously compensating for, or preventing, undesired influence of physical parameters of noise
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/34—Analogue value compared with reference values
- H03M1/36—Analogue value compared with reference values simultaneously only, i.e. parallel type
- H03M1/361—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、入力信号電圧と基準電圧との差電圧を増幅す
る差電圧増幅回路に関する。
る差電圧増幅回路に関する。
たとえば並列比較型Ａ ／ Ｄコンバータでは月予信の
境界全識別する多数の比較回路により入力信号を同時に
比較判別し、名比較回路の出力に基ついて適宜な符号を
形成する。従来、この神のＡ／Ｄコンバータでは、上記
比較回路として演ｐ増幅器等の差動増幅回路を用いたも
のがｌ′−）る。しかしながらこのように酸ｎ増幅器を
用いたものではぢフセット箱、出、オフ七ット電流１１
Ｌよっ又誤差を生じ、１だ一般に高速性を寮求訟ノする
用途には不向きである。
境界全識別する多数の比較回路により入力信号を同時に
比較判別し、名比較回路の出力に基ついて適宜な符号を
形成する。従来、この神のＡ／Ｄコンバータでは、上記
比較回路として演ｐ増幅器等の差動増幅回路を用いたも
のがｌ′−）る。しかしながらこのように酸ｎ増幅器を
用いたものではぢフセット箱、出、オフ七ット電流１１
Ｌよっ又誤差を生じ、１だ一般に高速性を寮求訟ノする
用途には不向きである。
このために％ ／Ｉ′！ｆに高速Δ／ＩＪコン・ぐ−夕
では、−メことえｔｔ第１図に示すようなチョッパ型コ
ンパレータが広く用いらｈている。ずなわち、第１の人
カナ；・″−子ノにＡ＝準電圧ｖ１８．を与え、第２の
入力端子２に比軟ノーベぎ入カイｒｓ −Ｑ” ｉｎ
ｋ与える〇喧して８ｉ’Ｊ Ｉ ％第２の各入力端子１
．２をクロックｆｔ＋ ４−”ｉφおよびφの反転信号
７でメンオフ制御ずＺ〕、たとえはＦ’ＥＴアナログス
イッチからなる紀１、第２のイ〕ヌイッチ３，４を介し
て並列に４耕わＬし、コンデンサ５の一端に伝統する。
では、−メことえｔｔ第１図に示すようなチョッパ型コ
ンパレータが広く用いらｈている。ずなわち、第１の人
カナ；・″−子ノにＡ＝準電圧ｖ１８．を与え、第２の
入力端子２に比軟ノーベぎ入カイｒｓ −Ｑ” ｉｎ
ｋ与える〇喧して８ｉ’Ｊ Ｉ ％第２の各入力端子１
．２をクロックｆｔ＋ ４−”ｉφおよびφの反転信号
７でメンオフ制御ずＺ〕、たとえはＦ’ＥＴアナログス
イッチからなる紀１、第２のイ〕ヌイッチ３，４を介し
て並列に４耕わＬし、コンデンサ５の一端に伝統する。
そしてこのコンデンサ６の他１／ｊＡｆ ’ｌ：反転増
幅器６の入力に接続するとともに反転増幅器６の入・出
力間に上記クロック信号φでオンオフ制御さり、るたと
えはＦＥＴアナログスイッチからなる第３のスイッチ２
を設けている。そして反転増幅器６の出力を出力端子８
を介して出力するようにしている。
幅器６の入力に接続するとともに反転増幅器６の入・出
力間に上記クロック信号φでオンオフ制御さり、るたと
えはＦＥＴアナログスイッチからなる第３のスイッチ２
を設けている。そして反転増幅器６の出力を出力端子８
を介して出力するようにしている。
このようにすれば第２図に示す波形図のようにクロック
信号φ（第２図（ａ））の”Ｈ”の期間は第１、第３の
各スイッチ３．２をオンし、第２のスイッチ４をオフす
るので反転増幅器６０入・出力間を短絡してこの人・出
力端子の電圧を回路のしきい値電圧■ 、すなわち凱
）作のｈｒ 基準となる動作点電圧とする。一方、この場合コンデン
サ６の入力側の電極には基準電圧ｖｒｅｆを印加する。
信号φ（第２図（ａ））の”Ｈ”の期間は第１、第３の
各スイッチ３．２をオンし、第２のスイッチ４をオフす
るので反転増幅器６０入・出力間を短絡してこの人・出
力端子の電圧を回路のしきい値電圧■ 、すなわち凱
）作のｈｒ 基準となる動作点電圧とする。一方、この場合コンデン
サ６の入力側の電極には基準電圧ｖｒｅｆを印加する。
そしてクロック信号￥の６Ｈ”の期間は第１、第３の各
スイッチ３．７をオフし、第２のヌイシティｆ！：オン
するのでコンデンサ５０入力側の電極には入力信号ｖｉ
ｎ金印加し、反転増幅器６０入力′亀圧はしきい値電圧
ｖｔｈｒから基準電圧と入力信号との差１す、圧ｖ４．
！ｆ−Ｖｉｎへ変化する。ぞしてこのような反転バ・ｉ
幅器６の入力電圧の変化は反転増幅器６の増幅率を乗じ
て出力端子８から出力する。したがって、入力信号Ｖ、
（第２図（ｂ））に対してｆＪ意の基準石７圧ｎ ｖｒｅ（”ｉｆ：に定することにより出力端子８にクロ
ック信号に同期したパルス列からなる出力信号（第２図
（Ｃ））を得らｈる。すなわち、第１図にフ１てず回路
ｆｉｔ成ではクロックイ８号φにより反転増幅器６の入
・出力を知絡するメートゼロモードと、入カイを号Ｖ、
と基準電圧Ｖ、。１との差電圧をｎ ？４する→ノンブリングモードとを交互に繰ｐ返すこと
になる。
スイッチ３．７をオフし、第２のヌイシティｆ！：オン
するのでコンデンサ５０入力側の電極には入力信号ｖｉ
ｎ金印加し、反転増幅器６０入力′亀圧はしきい値電圧
ｖｔｈｒから基準電圧と入力信号との差１す、圧ｖ４．
！ｆ−Ｖｉｎへ変化する。ぞしてこのような反転バ・ｉ
幅器６の入力電圧の変化は反転増幅器６の増幅率を乗じ
て出力端子８から出力する。したがって、入力信号Ｖ、
（第２図（ｂ））に対してｆＪ意の基準石７圧ｎ ｖｒｅ（”ｉｆ：に定することにより出力端子８にクロ
ック信号に同期したパルス列からなる出力信号（第２図
（Ｃ））を得らｈる。すなわち、第１図にフ１てず回路
ｆｉｔ成ではクロックイ８号φにより反転増幅器６の入
・出力を知絡するメートゼロモードと、入カイを号Ｖ、
と基準電圧Ｖ、。１との差電圧をｎ ？４する→ノンブリングモードとを交互に繰ｐ返すこと
になる。
しか【７ながらこのようなテヨッノや型コンノやレータ
はＱｉ 印１ノンプリング系として動作するので入カイ
６−梠Ｖ、ｎ（１）約波数はクロックイ１号φの周波数
の怪よりも低くないと、止仰゛に入力信号ｖ１ｎの変化
を得ること祉できない。寸だ、特に高速”１ノンフ０リ
ングを杓なう場合は、スイッチのオン期曲がり一ノくな
るために寄生容Ｍ（１、スイッチのオン抵抗等が原因で
移々の問題を生じる。すなわちスイッチのオン抵抗およ
び寄生容量によって信号の伝達ふくれあるいはゲづンロ
ヌを生じる。
はＱｉ 印１ノンプリング系として動作するので入カイ
６−梠Ｖ、ｎ（１）約波数はクロックイ１号φの周波数
の怪よりも低くないと、止仰゛に入力信号ｖ１ｎの変化
を得ること祉できない。寸だ、特に高速”１ノンフ０リ
ングを杓なう場合は、スイッチのオン期曲がり一ノくな
るために寄生容Ｍ（１、スイッチのオン抵抗等が原因で
移々の問題を生じる。すなわちスイッチのオン抵抗およ
び寄生容量によって信号の伝達ふくれあるいはゲづンロ
ヌを生じる。
またこのようなスイッチの信号の入会出力端子とクロッ
ク信号φを入力する制御端子との間の寄生容量によって
、クロック成分が信号に重畳されてヒゲ状のパルス信号
を生じる。そしてこの現象は動的には系が定常状態に戻
るオでに時間がかかり、高速動作に支障を来たし、静的
には出力にオフセットを生じることになる。
ク信号φを入力する制御端子との間の寄生容量によって
、クロック成分が信号に重畳されてヒゲ状のパルス信号
を生じる。そしてこの現象は動的には系が定常状態に戻
るオでに時間がかかり、高速動作に支障を来たし、静的
には出力にオフセットを生じることになる。
本発明は上記の事情に鑑みてなされたもので、連続的な
動作を行なえ高い周波数の入力信号に刻しても高速サン
プリングを行なうことなく入力信号と基準電圧との差％
ｉ圧を得ることができる差電圧増幅回路を提供すること
を目的とするものである。
動作を行なえ高い周波数の入力信号に刻しても高速サン
プリングを行なうことなく入力信号と基準電圧との差％
ｉ圧を得ることができる差電圧増幅回路を提供すること
を目的とするものである。
すなわち本発明は２組のテロッパ型コンパレークを並列
に設けて交互に動作させることにより等測的に連ｌｈ、
的なＬＡ、較結果を１ｊ−、することを傷徴とするもの
である。
に設けて交互に動作させることにより等測的に連ｌｈ、
的なＬＡ、較結果を１ｊ−、することを傷徴とするもの
である。
〔発明の実加１例〕
以下本発明の一実施例を第３図に示すブロック図を参照
して詳細に説明する。第３図において、第１の入力端子
１ノに基準ηじ圧Ｖ、。、を与え第２の入力ψ；１１．
子１２に比較ずべき人力信号ｖｉ□’を力える。イしで
、第１の入力〜端子１１を第１．８１１、３のスイッチ
１３ｒ １５を介し７てそｉｌ、それコンデンサ／ ７
、．１．１１の一方の端子に接続している。また第２
の入力端子ノ２をε（Ａ２、第４のヌ・１ソチＪ ４
、．１６を介してそ１１）ＣｆＬ上記コンデンザ１７．
ＩＲの一方の端子に並列に接続している。さらに上記コ
ンデンサ１７ｅ１８の他方のｌ’１１．ｉ子をｊ”７
ＩＩす１．−Ｊ一段、すなわち第１、第２の反転Ｊ’＋
！ｆ ’ｌ’ｉｉｉ ７；ｉｒ Ｉ ９ Ｈ２０の各入
力に１ト続しテイル。そして第１、εｊ４２の反転増幅
器１９．２０の入・出力１ｔ）１に（７７そハ第５、第
６のスイッチ２１゜２２乞介押して動作点−圧発生手段
を構成するとともに出力を出力選択手段、−ｊなわち第
７゜第８のツイツチ２３，２４ｆ介して３１し列に出力
端子２５に接続している。そして上記第１乃至第８のス
イッチＩ Ｊ 、 １４ 、１５ 、１６ 、２１１２
２．２３．２４はたとえばＦ”ＥＴアナログスイッチで
第１、第５のスイッチ１３．２１はクロック信号４１
で制御し、第２のスイッチ１４はクロック信号φ葺め反
転信号ｉ＋によって制御する。そして第３、第６のスイ
ッチ１５．２２はクロック（，１−Ｆｆφ、で制御し、
第４のスイッチ１６はクロック信号φ２の反転信号（ｆ
ｉｔ（Ｌよって側位！ｌする。さらに第７のスイッチ２
３はクロック信号φ目で制御し、第８のスイッチ２４は
クロック信号φＩ２の反転イｂ号ｉ譜によって制御する
。
して詳細に説明する。第３図において、第１の入力端子
１ノに基準ηじ圧Ｖ、。、を与え第２の入力ψ；１１．
子１２に比較ずべき人力信号ｖｉ□’を力える。イしで
、第１の入力〜端子１１を第１．８１１、３のスイッチ
１３ｒ １５を介し７てそｉｌ、それコンデンサ／ ７
、．１．１１の一方の端子に接続している。また第２
の入力端子ノ２をε（Ａ２、第４のヌ・１ソチＪ ４
、．１６を介してそ１１）ＣｆＬ上記コンデンザ１７．
ＩＲの一方の端子に並列に接続している。さらに上記コ
ンデンサ１７ｅ１８の他方のｌ’１１．ｉ子をｊ”７
ＩＩす１．−Ｊ一段、すなわち第１、第２の反転Ｊ’＋
！ｆ ’ｌ’ｉｉｉ ７；ｉｒ Ｉ ９ Ｈ２０の各入
力に１ト続しテイル。そして第１、εｊ４２の反転増幅
器１９．２０の入・出力１ｔ）１に（７７そハ第５、第
６のスイッチ２１゜２２乞介押して動作点−圧発生手段
を構成するとともに出力を出力選択手段、−ｊなわち第
７゜第８のツイツチ２３，２４ｆ介して３１し列に出力
端子２５に接続している。そして上記第１乃至第８のス
イッチＩ Ｊ 、 １４ 、１５ 、１６ 、２１１２
２．２３．２４はたとえばＦ”ＥＴアナログスイッチで
第１、第５のスイッチ１３．２１はクロック信号４１
で制御し、第２のスイッチ１４はクロック信号φ葺め反
転信号ｉ＋によって制御する。そして第３、第６のスイ
ッチ１５．２２はクロック（，１−Ｆｆφ、で制御し、
第４のスイッチ１６はクロック信号φ２の反転信号（ｆ
ｉｔ（Ｌよって側位！ｌする。さらに第７のスイッチ２
３はクロック信号φ目で制御し、第８のスイッチ２４は
クロック信号φＩ２の反転イｂ号ｉ譜によって制御する
。
そして、＃！１、第２のスイッチ１３．１４およびコン
デンサ１７によって第１の印加電圧設定手段を栴成し、
同様に第３、第４のスイッチ１５１１６およびコンデン
サ１８によって第２の印加電圧設定手段を構成する。そ
して、各印加電圧設定手段によシ動作点電圧、あるいは
こ０５１ノ１作点′ＩＩＪＬＬｖＣ，Ｊ：記各人力幻：
子１１ ｒ １２ ヘ与えらｉする電圧の差電圧を重
畳１７た差情号箱、圧をＩＵるようにしている。
デンサ１７によって第１の印加電圧設定手段を栴成し、
同様に第３、第４のスイッチ１５１１６およびコンデン
サ１８によって第２の印加電圧設定手段を構成する。そ
して、各印加電圧設定手段によシ動作点電圧、あるいは
こ０５１ノ１作点′ＩＩＪＬＬｖＣ，Ｊ：記各人力幻：
子１１ ｒ １２ ヘ与えらｉする電圧の差電圧を重
畳１７た差情号箱、圧をＩＵるようにしている。
しかして、第１．第２、第５のスイッチ１３゜１４１２
１およびコンデン−１ｊ’ １７ 、反転増幅器Ｊ９に
よって各量糺合型増幅手段を有する第１のチｖ ７パ型
コンパレータ１０ノを構成シている。°まだ第３、第４
、第６のスイッチ１５゜１６．２２先・よひコンデンサ
１８、反転増幅器２０によって同様に容ｊｌ結合型バ・
７幅手段を有する紀２のブ“］ツバ型コンノやレータ１
０２を構成している。づして上記第１．第２のチ目ツバ
型：１７ ンノＰレ−り／ ０７ 、７ ｏ ２１ｒ、
Ｌ９互Ｖｃかツ１８０゜の位相差で１ノ転増１１’ｊ＋
ｉ器１９ 、２ （Ｉの人・出力を知絡うる訓−トゼロ
動作と入力（ｉ４号ｖｌｎをザンノ°リングするサンプ
リング動作とを繰り返す。
１およびコンデン−１ｊ’ １７ 、反転増幅器Ｊ９に
よって各量糺合型増幅手段を有する第１のチｖ ７パ型
コンパレータ１０ノを構成シている。°まだ第３、第４
、第６のスイッチ１５゜１６．２２先・よひコンデンサ
１８、反転増幅器２０によって同様に容ｊｌ結合型バ・
７幅手段を有する紀２のブ“］ツバ型コンノやレータ１
０２を構成している。づして上記第１．第２のチ目ツバ
型：１７ ンノＰレ−り／ ０７ 、７ ｏ ２１ｒ、
Ｌ９互Ｖｃかツ１８０゜の位相差で１ノ転増１１’ｊ＋
ｉ器１９ 、２ （Ｉの人・出力を知絡うる訓−トゼロ
動作と入力（ｉ４号ｖｌｎをザンノ°リングするサンプ
リング動作とを繰り返す。
Ｑ Ｌ’ ４’３スイツチシまクロック４６号φが”Ｈ
”のときメンし、Ｉ ｌ、 ｌ“のときメンするものと
して１１イＬｊｉｌ ｊ−る。
”のときメンし、Ｉ ｌ、 ｌ“のときメンするものと
して１１イＬｊｉｌ ｊ−る。
乙のような４ｈ成であ、＋ｒＪＪ１、／ことえｅＪ：ク
ロック信号φ１ （第４図（ａ））が’ ＴＩ”のＴ１
〜Ｔ、のとき第１のテゴッパ型コンパレータ１０１０１
ｔｄ、第５のスイッチ１３．２１がオンし、第２のスイ
ッチ１４をオフして反転ノ・１３幅器１９の入・出力の
電位￥： ｆｆ１ｉ；作点１Ｆに圧とするオートゼロ動
作を行なう。一方、この期間およびその前後でクロック
信号φ、（第４図（ｂ））は”Ｌ”であり、第２のチョ
ッパ型コンノｆレータ１θ２は第３、第６のスイッチ１
５．２２をオフし、第４のスイッチ１６をオンして入力
信号Ｖ、ｎ（ｆｆ１図（Ｃ））のサンプリング動作を行
ない上記入力信号Ｖいと基準電圧ｖｒｅｆの差電圧を反
転増幅器２０へ入力する。したがってこの肋間中相１の
チミッパ型コンパレ〜り１０ノの出力（第４図（ｅ））
は反転増幅器１９のしきい値電圧Ｖｔｈｒとなり、また
第２のチロツバ型コンツヤレータ１０２の出力（第４図
（ｆ））は入力信号Ｖ、のサンプリング値ｎ となる。そしてこの期間中はクロック信号φ目はＬ”で
第７の諌イッチ２３はオフ、第８のスイッチ２４／ｄオ
ンし、第２のチョッパ型コンノＣ１，＝ 夕１ ｎ ２
の４ノンプリング（ｔｒｉを出力鈴□子２５から出力′
する。
ロック信号φ１ （第４図（ａ））が’ ＴＩ”のＴ１
〜Ｔ、のとき第１のテゴッパ型コンパレータ１０１０１
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ッチ１４をオフして反転ノ・１３幅器１９の入・出力の
電位￥： ｆｆ１ｉ；作点１Ｆに圧とするオートゼロ動
作を行なう。一方、この期間およびその前後でクロック
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ッパ型コンノｆレータ１θ２は第３、第６のスイッチ１
５．２２をオフし、第４のスイッチ１６をオンして入力
信号Ｖ、ｎ（ｆｆ１図（Ｃ））のサンプリング動作を行
ない上記入力信号Ｖいと基準電圧ｖｒｅｆの差電圧を反
転増幅器２０へ入力する。したがってこの肋間中相１の
チミッパ型コンパレ〜り１０ノの出力（第４図（ｅ））
は反転増幅器１９のしきい値電圧Ｖｔｈｒとなり、また
第２のチロツバ型コンツヤレータ１０２の出力（第４図
（ｆ））は入力信号Ｖ、のサンプリング値ｎ となる。そしてこの期間中はクロック信号φ目はＬ”で
第７の諌イッチ２３はオフ、第８のスイッチ２４／ｄオ
ンし、第２のチョッパ型コンノＣ１，＝ 夕１ ｎ ２
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する。
−そして■＝を刻Ｔ２でクロック信月φが”Ｌ”になる
と、第１のチョッパ型コンパレータ１０１のＰｌ！１、
筆５のスイッチ１３．２１Ｔｔ′ｉオフし、第２のスイ
ッチ１４はオンして入力信号Ｖ１ｎのリンプリング１助
作を行なう。しかしながらこのＪ４：ｒ ＠、カンブリ
ング動作のｕトｉ始的後、すなわち〜１，２のスイッチ
１４のオン１１１林からしσらくの［１１目まスイッチ
等の寄生容１１によるクロック漏れ、ツイツチのメン抵
抗による入カイ１１号の伝達遅れ宿の過沢覗象の／でめ
に第１のチぢツ／臂型コンノ臂し一タ１０）の出力は第
４図（ｄ）図π破糾１で示ずように止常飴に〃らないこ
とがある。したがって、」−記ｊ１，４渡現象がｚト定
する期間１１ を設け、このＪｉｉｊ間ｔｌ を粁鍋後
時刻ｔ３でクロック信号φ目五反！ｒ、いせ、第７のス
イッチ２３をオン、）（８のスイッチ２４をオフし第１
のチョッパ型コンパレータ１０１のサンプリング（？＋
を出力端子２５から出力する。
と、第１のチョッパ型コンパレータ１０１のＰｌ！１、
筆５のスイッチ１３．２１Ｔｔ′ｉオフし、第２のスイ
ッチ１４はオンして入力信号Ｖ１ｎのリンプリング１助
作を行なう。しかしながらこのＪ４：ｒ ＠、カンブリ
ング動作のｕトｉ始的後、すなわち〜１，２のスイッチ
１４のオン１１１林からしσらくの［１１目まスイッチ
等の寄生容１１によるクロック漏れ、ツイツチのメン抵
抗による入カイ１１号の伝達遅れ宿の過沢覗象の／でめ
に第１のチぢツ／臂型コンノ臂し一タ１０）の出力は第
４図（ｄ）図π破糾１で示ずように止常飴に〃らないこ
とがある。したがって、」−記ｊ１，４渡現象がｚト定
する期間１１ を設け、このＪｉｉｊ間ｔｌ を粁鍋後
時刻ｔ３でクロック信号φ目五反！ｒ、いせ、第７のス
イッチ２３をオン、）（８のスイッチ２４をオフし第１
のチョッパ型コンパレータ１０１のサンプリング（？＋
を出力端子２５から出力する。
さらにこの後、時刻Ｔ４でクロック信号φ！を反転し第
２のチョッパ型コンパレータ１０２の第３、第６のスイ
ッチ１５．２２をオンし、第４のスイッチ１６をオフし
て、オートゼロ動作を行なう。なおこの場合、第１のチ
ョッパ型コンパレータ１０１の状態は不変でサンプリン
グ動作を継続し、そのサンプリング値を出力する。そし
て以後時刻’ｒ、、’ｒ、・・・で上述の時刻’ｒ＋−
Ｔｔ・・・の動作を第２のテヨッノ等型コンノやレータ
１０２で行ない、オートゼロ動作およびカンブリング動
作を第１、第２のチョッパ型コンパレータ１０１，１０
２で交互に繰り返すことになる。
２のチョッパ型コンパレータ１０２の第３、第６のスイ
ッチ１５．２２をオンし、第４のスイッチ１６をオフし
て、オートゼロ動作を行なう。なおこの場合、第１のチ
ョッパ型コンパレータ１０１の状態は不変でサンプリン
グ動作を継続し、そのサンプリング値を出力する。そし
て以後時刻’ｒ、、’ｒ、・・・で上述の時刻’ｒ＋−
Ｔｔ・・・の動作を第２のテヨッノ等型コンノやレータ
１０２で行ない、オートゼロ動作およびカンブリング動
作を第１、第２のチョッパ型コンパレータ１０１，１０
２で交互に繰り返すことになる。
したがって基準電圧Ｖ と入力信号ｖ１ｎとのｅｆ
比較結果を連続的に得ることができる。
なお、本発明は上記実施例に限定されるものではなく、
たとえばサンプリング動作の開始時に過渡現象による異
常出力を生じないとき、あるいはこれを無視できる場合
には、第１、第２のテＭｙパ型コンパレータ１０１，１
０’２のサンプリングＪｌｌｌ １ｆ−ｎ ｉ 爪なる
ようにしなくてもよい。
たとえばサンプリング動作の開始時に過渡現象による異
常出力を生じないとき、あるいはこれを無視できる場合
には、第１、第２のテＭｙパ型コンパレータ１０１，１
０’２のサンプリングＪｌｌｌ １ｆ−ｎ ｉ 爪なる
ようにしなくてもよい。
したがって、このような場合にｖ；１、出力側の第７、
第８のスイッチ２ 、？ 、 ２４ ”、［制御するク
ロック信号φ１．赫いはこの反転細分Ｔｉをクロック（
ＦＡ月＄ｔ 、φ重 として用いｉｌはよい。
第８のスイッチ２ 、？ 、 ２４ ”、［制御するク
ロック信号φ１．赫いはこの反転細分Ｔｉをクロック（
ＦＡ月＄ｔ 、φ重 として用いｉｌはよい。
１だ、メートゼロ動作のために反転増幅器１９．２０へ
しきい値電圧を力える場合、たとえは第５図に示すよう
にしてもよい。すなわちｅ４５ 図１ｄ ｍ １のテヨ
ッノや型コン７ぞレータ１０１だけを示すブロック図で
反転増幅器１９と四−楢°性の反転増幅器２６０入・出
力間を知絡してクロック４Ｍ号φ！によって制御するス
イッチ２７を介して反転増幅器〕９の入力へ与えればよ
い。このようにすれはスイッチ２７のオンと同時に反転
増幅器１９の入力へしきい値電圧を与えることができる
ので所印オートゼロ動作を知時間で行なえ、ＪＣノア、
によって全体のザンゾリング周期を知縮でき反転増幅器
１９にかえて同一特性の非反転州幅器を用いてもよい。
しきい値電圧を力える場合、たとえは第５図に示すよう
にしてもよい。すなわちｅ４５ 図１ｄ ｍ １のテヨ
ッノや型コン７ぞレータ１０１だけを示すブロック図で
反転増幅器１９と四−楢°性の反転増幅器２６０入・出
力間を知絡してクロック４Ｍ号φ！によって制御するス
イッチ２７を介して反転増幅器〕９の入力へ与えればよ
い。このようにすれはスイッチ２７のオンと同時に反転
増幅器１９の入力へしきい値電圧を与えることができる
ので所印オートゼロ動作を知時間で行なえ、ＪＣノア、
によって全体のザンゾリング周期を知縮でき反転増幅器
１９にかえて同一特性の非反転州幅器を用いてもよい。
さらにチョッパ型コンノやレータは、たとえは第６図に
示すようにコンデンサＣ１ｙＣ１・・・Ｃｎおよび反転
増幅器Ｉ 、Ｉ ・・・Ｉ を交互に複ｖｔ
ｖｚ ｖｌ’１数組縦続し、かつ各反転増
幅器１ 、Ｉ ・・・ｖｌ １ｒ２ ’Ｖｎの入・出力間にオートゼロ動作時にオンするスイ
ッチＳＩ＋８１ ・・・Ｓ を介挿するようにしてもよ
い。
示すようにコンデンサＣ１ｙＣ１・・・Ｃｎおよび反転
増幅器Ｉ 、Ｉ ・・・Ｉ を交互に複ｖｔ
ｖｚ ｖｌ’１数組縦続し、かつ各反転増
幅器１ 、Ｉ ・・・ｖｌ １ｒ２ ’Ｖｎの入・出力間にオートゼロ動作時にオンするスイ
ッチＳＩ＋８１ ・・・Ｓ を介挿するようにしてもよ
い。
また第７図に示すブロック図のように反転増’ｆｌｌｒ
Ｄ Ｉ ｖｌを用いたチョッパ型コンノやレータノ後
段に動作点電圧のほぼ等しい抜数の反転増幅器！ｖ２．
・・・、■ を縦続に接続してもよい。
Ｄ Ｉ ｖｌを用いたチョッパ型コンノやレータノ後
段に動作点電圧のほぼ等しい抜数の反転増幅器！ｖ２．
・・・、■ を縦続に接続してもよい。
ｎ
なお上記反転増幅器の具体例としては第８図（、）に示
すようにＰチャンネルＦＥＴとＮチャンネルＦＥＴを組
み合せたＣ−ＭＯＳ型のもの、同図（ｂ）に示すように
負荷ＭＯ８ＦＥＴを飽和領域で動作させるもの、同図（
Ｃ）に示すようにディグレッションモードのＦＥＴ ｉ
用いるもの同図（ｄ）に示すように線形抵抗ｒとＦｇＴ
とを組み合せたもの等を適宜に用いることができる。
すようにＰチャンネルＦＥＴとＮチャンネルＦＥＴを組
み合せたＣ−ＭＯＳ型のもの、同図（ｂ）に示すように
負荷ＭＯ８ＦＥＴを飽和領域で動作させるもの、同図（
Ｃ）に示すようにディグレッションモードのＦＥＴ ｉ
用いるもの同図（ｄ）に示すように線形抵抗ｒとＦｇＴ
とを組み合せたもの等を適宜に用いることができる。
さらにスイッチの具体的な回路としては第９図（、）（
ｂ）に示すように単一のＮチキンネルあるいはＰチャン
ネルのＦＥＴ ｉ用いるもの、同図（、）に示すように
一対のＮチャンネルおよびＰチャンネルＯＦＦ；Ｔ Ｉ
組み合ぜたＦ９ｒｒｊｌ’ｌ ｌ・ランスミッションケ
゛−ト、同図（ｄ）に示すようにＮチャンネルＦａＴｏ
２＋を板Ｋ ｉｌｊ、ｉｉ、圧ｖ 、Ｖ ノ中間
ノｉＨ，圧ＤＤ １１８ ｖｌ、を印加し、ＰブヤンネルＦ’ＥＴの基板に゛屯源
亀Ｈ：ＶＤＸ、を印加したトランスミッションゲートの
グ（形蛤を用いることができる。
ｂ）に示すように単一のＮチキンネルあるいはＰチャン
ネルのＦＥＴ ｉ用いるもの、同図（、）に示すように
一対のＮチャンネルおよびＰチャンネルＯＦＦ；Ｔ Ｉ
組み合ぜたＦ９ｒｒｊｌ’ｌ ｌ・ランスミッションケ
゛−ト、同図（ｄ）に示すようにＮチャンネルＦａＴｏ
２＋を板Ｋ ｉｌｊ、ｉｉ、圧ｖ 、Ｖ ノ中間
ノｉＨ，圧ＤＤ １１８ ｖｌ、を印加し、ＰブヤンネルＦ’ＥＴの基板に゛屯源
亀Ｈ：ＶＤＸ、を印加したトランスミッションゲートの
グ（形蛤を用いることができる。
〔そＦ、、（す」のうンノｌ−！Ｉ’］」−ノ、土のよ
うに２１６発明によｊ’１． ｔ；Ｊ：入力信号と淋準
１：１．圧の比１ＩＩＸ結果をシｉｓ ！’ｊ；的に出
力することができるので入力信号の周波４食＆、ｊ Ｊ
ｔ Ｒ？’＜ ［ｉ」回路のクロック周波数のＡ以下に
制限式）１ず、入力信号の周波袈弓うよりυ１い場合に
も比較結味を得ることができる。？ｉな寄生容ルによる
々ロック漏れ、スイッチのオン■（抗による入カイ目号
の伝達遅れ等の：ｉΔ゛・）獲現象に幻してこの過渡現
ｆｂｊによる異常出力が消勢し７た後に比較結果を出力
し、影響を受けないようにできる。
うに２１６発明によｊ’１． ｔ；Ｊ：入力信号と淋準
１：１．圧の比１ＩＩＸ結果をシｉｓ ！’ｊ；的に出
力することができるので入力信号の周波４食＆、ｊ Ｊ
ｔ Ｒ？’＜ ［ｉ」回路のクロック周波数のＡ以下に
制限式）１ず、入力信号の周波袈弓うよりυ１い場合に
も比較結味を得ることができる。？ｉな寄生容ルによる
々ロック漏れ、スイッチのオン■（抗による入カイ目号
の伝達遅れ等の：ｉΔ゛・）獲現象に幻してこの過渡現
ｆｂｊによる異常出力が消勢し７た後に比較結果を出力
し、影響を受けないようにできる。
第１図は従来のチョッパ型コンパレータの一例を示すブ
ロック図、第２Ｍ１Ｊ第１Ｍに示すテコツバ型コンパレ
ータの動作を鰭；明する波形図、第３図は本発明の一実
施例を示すブロック図、第４図は釦、３図に示す実施例
の動作を示す波形図、第５図乃至第７図は本発明のチョ
ッパ型コンパレータの各別の他の実施例を示す図、第８
図（、）〜（ｄ）は反転増幅器の各別の一例を九す図、
第９図（ａ）〜（ｄ）はスイッチの各別の一例を示す図
である。 １ノ・・・第１の入力端子（ｖｒｅｆ）、ノ２・・・第
２の入力端子（ｖｌｎ）、１３ 、１４ 、 Ｊ ５
、１６１２１．２２．２３．２４・・・スイッチ、１７
．１１３・・・コンデンサ、２５・・・出力端子、１θ
ｌ 、 １０２・・・チョッパ型コンパレータ。 出願人代理人 弁理士 鈴 江 武 彦第２ｒＶ７＋ 第３図 第４図 第５図 昭和 年 月 日 特許庁長官 若 杉 和 夫 殿 １、事件の表示 ％軸間５７−１３３５６０号 ２ 発明の名称 差電圧増幅回路 ：（−）＋Ｉｉ ＋Ｅをする名 事件との関係 特許出頼人 （３０７） 東京芝浦電気株式会社 １１、代理人 ７、補正の内容 （１） 特許請求の範囲を別紙の通り訂正する。 （２） 明細書第１０頁第１７行目（二「のサンプリ
ング値」とあるを「と基準電圧Ｖｒｅｆ との比較結
果」と訂正する。 （３） 同書第１１頁第１行目ににングリング値」と
あるを「出力信号」と訂正する。 （４） 同書第１１員第１９行目Ｃ二「サンシリング
値」とあるを「比較結果信号」と訂正する。 （５） 同書第１２頁第７行目に「サンプリング値」
とあるな「比較結果信号」と訂正する。 ２、特許請求の範囲 （１） 入力電圧信号を容量で受けて増幅出力する第
１．第２の容量結合形増幅手段と基準電圧信号と入力電
圧信号を交互に選択して上記第１、第２の容量結合形増
幅手段（＝それぞれ伝達印加する第１、第２の人力選択
手段と上記第１、第２の容箱結合形増幅手段の一方の増
幅出力信号を選択する出力選択手段とを具備し、上記第
１と第２の容量結合形増幅手段はそれぞれ時間的（＝区
別される動作点′電圧を自己設定するオートゼロ期間と
入力電圧を増幅する信号増幅期間とを有し上記第１と第
２の容１結合形増幅手０段のそれぞれのオートゼロ期間
は時間的Ｃ二重なることはなく、上記第１と第２の入力
選択手段は伝達印加される第１と第２の容量結合形増幅
手段のそれぞれの１−ドゼロ期間（二対窓して基準電圧
信号を選択し、信号増幅期間Ｃ二対窓して入力電圧信号
を選択し、上記出力選択手段は上記第１．第２の容凱結
合形増幅手段がそれぞれ信号増幅期間である時のそれぞ
れの増幅出力信号を選択し出力することによって上記基
準電圧信号と入力電圧信号の差電圧信号を時間的に連続
して増幅出力する差電圧増幅回路。 （２） 特許請求の範囲第１項記載のもの（＝おいて
、増幅手段にＭＯ８型素子を用いたことを特徴とする差
電圧増幅回路。 （３） 特許請求の範囲第２項記載のものｉ二おいて
、増幅手段は反転増幅器からなり人・出力間（二相３番
目のスイッチを介挿して動作点電圧発生手段を構成した
ことを特徴とする差電圧増幅回路。
ロック図、第２Ｍ１Ｊ第１Ｍに示すテコツバ型コンパレ
ータの動作を鰭；明する波形図、第３図は本発明の一実
施例を示すブロック図、第４図は釦、３図に示す実施例
の動作を示す波形図、第５図乃至第７図は本発明のチョ
ッパ型コンパレータの各別の他の実施例を示す図、第８
図（、）〜（ｄ）は反転増幅器の各別の一例を九す図、
第９図（ａ）〜（ｄ）はスイッチの各別の一例を示す図
である。 １ノ・・・第１の入力端子（ｖｒｅｆ）、ノ２・・・第
２の入力端子（ｖｌｎ）、１３ 、１４ 、 Ｊ ５
、１６１２１．２２．２３．２４・・・スイッチ、１７
．１１３・・・コンデンサ、２５・・・出力端子、１θ
ｌ 、 １０２・・・チョッパ型コンパレータ。 出願人代理人 弁理士 鈴 江 武 彦第２ｒＶ７＋ 第３図 第４図 第５図 昭和 年 月 日 特許庁長官 若 杉 和 夫 殿 １、事件の表示 ％軸間５７−１３３５６０号 ２ 発明の名称 差電圧増幅回路 ：（−）＋Ｉｉ ＋Ｅをする名 事件との関係 特許出頼人 （３０７） 東京芝浦電気株式会社 １１、代理人 ７、補正の内容 （１） 特許請求の範囲を別紙の通り訂正する。 （２） 明細書第１０頁第１７行目（二「のサンプリ
ング値」とあるを「と基準電圧Ｖｒｅｆ との比較結
果」と訂正する。 （３） 同書第１１頁第１行目ににングリング値」と
あるを「出力信号」と訂正する。 （４） 同書第１１員第１９行目Ｃ二「サンシリング
値」とあるを「比較結果信号」と訂正する。 （５） 同書第１２頁第７行目に「サンプリング値」
とあるな「比較結果信号」と訂正する。 ２、特許請求の範囲 （１） 入力電圧信号を容量で受けて増幅出力する第
１．第２の容量結合形増幅手段と基準電圧信号と入力電
圧信号を交互に選択して上記第１、第２の容量結合形増
幅手段（＝それぞれ伝達印加する第１、第２の人力選択
手段と上記第１、第２の容箱結合形増幅手段の一方の増
幅出力信号を選択する出力選択手段とを具備し、上記第
１と第２の容量結合形増幅手段はそれぞれ時間的（＝区
別される動作点′電圧を自己設定するオートゼロ期間と
入力電圧を増幅する信号増幅期間とを有し上記第１と第
２の容１結合形増幅手０段のそれぞれのオートゼロ期間
は時間的Ｃ二重なることはなく、上記第１と第２の入力
選択手段は伝達印加される第１と第２の容量結合形増幅
手段のそれぞれの１−ドゼロ期間（二対窓して基準電圧
信号を選択し、信号増幅期間Ｃ二対窓して入力電圧信号
を選択し、上記出力選択手段は上記第１．第２の容凱結
合形増幅手段がそれぞれ信号増幅期間である時のそれぞ
れの増幅出力信号を選択し出力することによって上記基
準電圧信号と入力電圧信号の差電圧信号を時間的に連続
して増幅出力する差電圧増幅回路。 （２） 特許請求の範囲第１項記載のもの（＝おいて
、増幅手段にＭＯ８型素子を用いたことを特徴とする差
電圧増幅回路。 （３） 特許請求の範囲第２項記載のものｉ二おいて
、増幅手段は反転増幅器からなり人・出力間（二相３番
目のスイッチを介挿して動作点電圧発生手段を構成した
ことを特徴とする差電圧増幅回路。
Claims (1)
- 【特許請求の範囲】 （１） 入カ′ル５圧信号を容量で受りて増幅出力す
る第１１εＢ２の容が一結合形増幅手段と基準電圧イ、
１号と入力′市圧個号を交互に選択して上記第１、第２
の容量結合形増幅手段にぞｈ（１′九伝達印加するｙＡ
ｌ、第２の入力選択手段と上記第１１第２の芥知結合形
増幅手段の一方の増幅出力信号を選択する出力選択手段
とを具ψｔｔｔ Ｌ 、上記第１と第２の容１１結合形
増幅手段はそ）１．ぞｈ時間的に区別さｉする動作点電
圧を自己設定するメートゼロ期間と入力′１１．圧を増
幅する信号増幅期間とを崩し上記第１と第２の容鰯結合
形増幅手段のそれぞノアのバイアス設定期間Ｊｄ時間的
に重なるこ゛とはなく、上記第１と第２の人力選択手段
は伝達印加ざｉする第１と第２の客月結合型層幅手段の
そＩｒそれのバイアス設定期間に対応して基準電圧信号
を選択し、信号増幅期間に対応して入力電圧信号を選択
し、上記出力選択手段は上記第１、第２の容邦結合形増
幅手段がそれぞれ（ｇ号増幅期間である時のそれぞれの
増幅出力信号を選択し出力することによって上記基準電
圧信号と入力電圧信号の差電圧信号を時間的に連続して
増幅出力する差電圧増幅回路。 （２、特許請求の範囲第１項記載のものにおいて、増幅
手段にＭＯ８型素子を用いたことを特徴とする差電圧増
幅回路。 （３）％許請求の範囲第２項記載のものにおいて、増幅
手段は反転増幅器からなり人・出力間に第３番目のスイ
ッチを介挿して動作点電圧発生手段を構成したことを特
徴とする差電圧増幅回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57133560A JPS5923907A (ja) | 1982-07-30 | 1982-07-30 | 差電圧増幅回路 |
| EP83107285A EP0101571B1 (en) | 1982-07-30 | 1983-07-25 | Differential voltage amplifier |
| DE8383107285T DE3369615D1 (en) | 1982-07-30 | 1983-07-25 | Differential voltage amplifier |
| US06/518,443 US4539551A (en) | 1982-07-30 | 1983-07-29 | Differential voltage amplifier |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57133560A JPS5923907A (ja) | 1982-07-30 | 1982-07-30 | 差電圧増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5923907A true JPS5923907A (ja) | 1984-02-07 |
| JPH0116052B2 JPH0116052B2 (ja) | 1989-03-22 |
Family
ID=15107654
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57133560A Granted JPS5923907A (ja) | 1982-07-30 | 1982-07-30 | 差電圧増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5923907A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5487152A (en) * | 1977-12-19 | 1979-07-11 | Intersil Inc | Active analog processing system |
| JPS55135418A (en) * | 1979-04-10 | 1980-10-22 | Sharp Corp | Comparator circuit |
| JPS56141617A (en) * | 1980-04-08 | 1981-11-05 | Mitsubishi Electric Corp | Comparator circuit |
-
1982
- 1982-07-30 JP JP57133560A patent/JPS5923907A/ja active Granted
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5487152A (en) * | 1977-12-19 | 1979-07-11 | Intersil Inc | Active analog processing system |
| JPS55135418A (en) * | 1979-04-10 | 1980-10-22 | Sharp Corp | Comparator circuit |
| JPS56141617A (en) * | 1980-04-08 | 1981-11-05 | Mitsubishi Electric Corp | Comparator circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0116052B2 (ja) | 1989-03-22 |
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