JPS59176920A - 通信装置用の電子同調装置 - Google Patents

通信装置用の電子同調装置

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JPS59176920A
JPS59176920A JP59017256A JP1725684A JPS59176920A JP S59176920 A JPS59176920 A JP S59176920A JP 59017256 A JP59017256 A JP 59017256A JP 1725684 A JP1725684 A JP 1725684A JP S59176920 A JPS59176920 A JP S59176920A
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tuning
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voltage
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ゲルハルト・マイアー
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Deutsche Thomson Brandt GmbH
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    • H03—ELECTRONIC CIRCUITRY
    • H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
    • H03J3/00—Continuous tuning
    • H03J3/28—Continuous tuning of more than one resonant circuit simultaneously, the tuning frequencies of the circuits having a substantially constant difference throughout the tuning range
    • H03J3/32—Arrangements for ensuring tracking with variable capacitors
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
    • H03J1/00—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general
    • H03J1/0008—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general using a central processing unit, e.g. a microprocessor
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    • H03J2200/28—Automatic self-alignment of a receiver

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 発明の関連する技術分野 本発明は、通信装置用の同調装置、例えばＰＬＩ・系を
用いたテレビ及びラジオ受信装置に関する。このＰＬＬ
系は、受信装置の同調の際、個々の同調回路をｌＰＬＬ
から発生された周波数に順に同調し、かつ個々のフィル
タ回路のこのようにして得られた同調電圧を固定保持す
る。
この種の同調装置は、例えばドイツ連邦共和国時Ｈ／１
出願公開第２８５４８５２号公報に記載さりＬＣいる。
この公知の同調装置は、三つの補助発振器と、これらの
補助発振器に所属のアナログメモリ、及びＰＬＬ回路を
用いて、高周波回路を所望の受信周波数に同調している
。調整すべき高周波回路の数に相当する数の補助発振器
が必要である。必要な補助発振器の数と利料費は、例え
ばテレビ受信装置をバンド１．Ｉｎ、ＩＶ・Ｖにおいて
受信調整しようとする場合には特ｆ増大する。その際チ
ューナー発振器及び補助発振器の周波数と受信周波数と
の識別が難しくなる。公知の同調装置を実用的に実現す
る際に不利な点は、個々のコイルを有する各補助発振器
の励振巻線が、高周波回路において受信の際に回路の不
所望な共振及び減衰を生じさせることである。また前記
励振巻線は、補助発振器を調整の後１ｃ　ＩＪＪ離さな
ければならない場合、回路の制御不可能な離調を生じさ
せる。
雑誌Ｊ　Ｎａｃｈｒｉｃｈｔｅｎ　ｅｌｅｋｔｒｏｎｉ
ｋ　Ｊ第１１／７９号、第３６５頁乃至第３６８頁にお
いて、う・ジオ受信装置の同調の方法が記載されている
。この方法においては、同様に付加的な補助回路が高周
波フィルタに用いられている。この方法においても、回
路の不利な影響が、調整された受信装置を作動する際に
生じる。上述雑誌の第３６７頁左及び中段に記載されて
いるように、特殊構成による同調の精度は、正確に対を
なす容量ダイオードの形においてのみ達成される。この
場合も相当に費用がかがる。なぜなら容量ダイオードは
同じチップ上に実現しなければ々らないからである。
本発明の課題 本発明の課題は、選り抜かれた構成素子を用いることな
く、通信用受信装置の自動調整を行ない、かつこの目的
により、調整すべき受信装置の出力側における最大信号
振幅、及びすべての受信チャンネルと領域における最適
な、即ち対称的なフィルター選択性を、高周波受信装置
に１渉ぜずに調整することである。
本発明においては、すべての調整すべきフィルタ回路の
同調電圧に対して唯一のＤ　／　Ａ変換器が使用される
。このＤ／Ａ変換器は、安価なアナログバッファメモリ
と接続され、自動調整同調装置の構成を著しく簡易化す
る。
実施例の説明 次に本発明の実施例を図面を用いて詳細に説明する。
図においてｌは、高周波受信装置、例えばテレビ受信装
置を示す。この受信装置は、受信周波数を濾波して取出
すために、フィルり回路２．１乃至２＋ｎを有している
。この受信装置は、ＵＨＦ及びＶＨＦ周波数領域におけ
るチャンネル用の同調装置を有している。同調は、周波
数シンセサイーリ３によって行われる。その際、装置を
同調するための発振器周波数は、Ｐ　ＬＬ回路３によっ
て発生される。受信装置を同調するためのこの回路は、
公知である。ＰＬＬ回路内に接続されているプログラマ
ブル分周器の分周比を変えることにより、ＰＬＬ回路は
、所望の発振器周波数に調整される。この分周比は、コ
ード化されてチャンネルセレクタに供給され、ｉｆｌ算
装置牛からデータ語として取出され、データ線５を介し
てＰＬＬ回路３に供給される。本発明の１」的は、受信
装置がどの受信チャンネルにおいても自動的に調整され
ることである。そのために、ＰＬＬ回路３によって受信
チャンネルを設定する際、割当周波数発振器６又は７か
ら発生される割当周波数ｋが、受信装置の入力側に供給
される。これは、計算装置牛からの制御線１７へ供給さ
れる制御信号により切換段１６を切換えるととにより行
われる。この切換段１６は、受信発振器の周波数から割
当周波数ｋ［切換える。
受信すべきチャンネルの中心周波数に相応するこの割当
周波数は、段Ｂにおいて増幅された後、フィルタ回路２
，１乃至２　＋　ｎ及び接続点９に達する。この接続点
９は、例えば、受信装置の混合段１８の入力側である。
この接続点に現われる、周波数ｋを有する電圧は、整流
器１９により整流さ１１る。この直流電圧は、Δ／Ｄ変
換藩］−〇により、接続点９における測定電圧に相応す
るディジタル値へ変換されしる。
個々のフィルタ回路の調整は、次のようにして行われる
。
１〕／Ａ変換器１１は、語算装置牛からのディジタル、
１ｊ１によって、例えば下方の同調電圧が現われるよう
に制御される。この下方の同調電圧は、上方の同調電圧
からＤ　／　Ａ変換器］、１の最大歩進数での分周によ
って生じる。６ビツトを有するＩ）　／　Ａ変換器にお
いては、歩進数は６４である。この下方の同調電圧は、
アナログ形で、スイッチ１２の接点１２．１を介してま
ずバッファメモリ１３．１に印加され、従って、調整す
べき第１のフィルタ回路２，１に印加される。ｉｉ′ｌ
ｌＩ定点９に現われる測定電圧は、整流器１９によって
整流された後、Ａ　／　Ｄ変換器１０によってディジク
ル値に変換され、計算装置生において保持される。それ
に基づき、計算装置中Ｖこより、ディジクル同調値は、
■ステップだけ高められる。このディジタル同調値は、
Ｄ／Ａ変換器１１及びスイッチ１２の接点１２，１を介
して再び第１のフィルタ回路２．１に供給される。こう
した同調過程は、測定点９における測定値を変化させる
。この測定値がプラス方向に高まると、計算装置中は、
ディジタル同調値をさらに１ステツゾ高める。その結果
、アナログ同調電圧は、Ｄ／Ａ変換器１１を介して、接
続点９において最大電圧値が得られるまで同様に高めら
れる。この最大電圧値は、第１のフィルタ２．１が最適
に調整されるための基準である。
この所属の同調電圧値は、メモリ１４のメモリアドレス
にてファイルされる。計算装置中の制御を介して、制御
線２０を介して、スイッチ１２はさらに接点１２，２へ
切換ゎる。次に、フィルタ回路２，２に対する同様の１
ステツプごとの調整が、フィルタ２，２が最、適に調整
されるまで行われる。求められた同調値は、メモリ１４
の次のアドレスにてファイルされる。こうした方法は、
最後のフィルタ２　＋　ｎが調整される寸で続けられる
。制御線１５を介して、各アナログバッファメモリ１３
は、印加されたデータを受入れるために伺勢される。ア
ナログバッファメモリ１３は、短時間のメモリであるの
で、これらのアナログバッファメモリ１３は、１；１算
装置の制御の後周期的にリフレッシュされる。従って受
信装置の調整は、第１の調整の際に用いられた割当周波
数を新たに付勢し々くても、受信装置が作動中維持され
る。アナログバッファメモリとしては、コンデンサ又は
サンプ゛ル・アンド・ホール１２回路が適しており、こ
れらは今１］の技術では非常に安価である。コンデンサ
又はサンプル・アンド・ホールド回路は、同調値をリフ
レッシュされるまで十分に保持する。なぜなら、同調回
路の容量ダイオードは、比較的高抵抗であるからである
。完全に調整された状態においては、割当周波数発振器
聞Ｆｋ乃至ＶＨＦ’ｋ　　は遮断される。受信装置ｌの
入力側は、その際アンテナ２１に接続される。発振器周
波ａｔｙｎｐ　　又はＶＨＦ　　は、さらに処理すべき
中０　　　　　　　　　　　０ 間層波数を発生するために混合段１８に印加される。こ
の中間周波数は、発振器周波数と入力周波数の差によっ
て形成される。
【図面の簡単な説明】
図は、本発明による実施例の回路略図を示す１・・・高
周波受信装置、２，１〜２νｎ・・・フィルタ回路、３
・・・ＰＬＬ回路、牛・・・ｄｌ算装置、６゜７・・・
割当周波数発振器、８・・・段、１０・・・Ａ　／　Ｄ
変換器、１１・・・Ｄ　／　ｐ、変換器、１２・・・ス
イッチ、１３．１〜１３ｔｎ・・・バッファメモリ、■
牛・・・メモリ、１６・・・ＩＪＪ換段、１８・・・混
合段、２１・・・アンテナ

Claims (1)

  1. 【特許請求の範囲】 ｌ　受信チャンネルの選定の際にその都度、割当周波数
    がアンテナ入力側に接続され、該割当周波数が高周波フ
    ィルタ回路の出力側の測定点において整流された電圧と
    して取出され、Ａ／Ｄ変換器を介して用算装置に供給さ
    れ、該計算装置が、測定点において測定電圧の最大値が
    得られるまで１ステツプずつ同調値を高め、またアナロ
    グバッファメモリが設けられており、該アナログバッフ
    ァメモリが、フィルタ回路内に接続された容量ダイオー
    ドに同調電圧を供給する、通信装置用の電子同調装置に
    おいて、個々の同調値を、唯一のＤ／Ａ変換器（１１）
    、計算装置（４）および被制御スイッチ（１２）を介し
    て順に１つの・々゛ンフアメモリ１３．Ｘ）に印刀口し
    、その際、１つのフィルタ回路（２，Ｘ）が最適に同調
    された後、計算装置（４）によってＤ　／Ａ変換器（１
    １）の出力側をスイッチ（１２〕ヲ介して次のバッファ
    メモ’Ｊ　（１３、Ｘ　＋　１）に接続するように制御
    したことを特徴とする通信装置用の電子同調装置。 ２、　計算装置（４〕にメモＩＪ　（１４）を設け、該
    メモリ（１４）内に、個々のフィルタ回路（２，ｌ乃至
    ２．ｎ）の同調値に対するディジタル語がファイルされ
    る、特許請求の範囲第１項記載の電子同調装置。 ３、バッファメモリ（１３，ｌ乃至１３．ｎ）が周期的
    にリフレッシュされる、特許請求の範囲第１項記載の電
    子同調装置。
JP59017256A 1983-02-04 1984-02-03 通信装置用の電子同調装置 Granted JPS59176920A (ja)

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DE3303711A DE3303711C2 (de) 1983-02-04 1983-02-04 Abstimmeinheit für Geräte der Nachrichtentechnik
DE3303711.6 1983-02-04

Publications (2)

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JPS59176920A true JPS59176920A (ja) 1984-10-06
JPH0210604B2 JPH0210604B2 (ja) 1990-03-08

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JP59017256A Granted JPS59176920A (ja) 1983-02-04 1984-02-03 通信装置用の電子同調装置

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EP (1) EP0116350B1 (ja)
JP (1) JPS59176920A (ja)
AT (1) ATE29632T1 (ja)
DE (2) DE3303711C2 (ja)
DK (1) DK157278C (ja)
FI (1) FI82793C (ja)
WO (1) WO1984003184A1 (ja)

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