JPS59103118A - 定電圧装置 - Google Patents
定電圧装置Info
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- JPS59103118A JPS59103118A JP57212912A JP21291282A JPS59103118A JP S59103118 A JPS59103118 A JP S59103118A JP 57212912 A JP57212912 A JP 57212912A JP 21291282 A JP21291282 A JP 21291282A JP S59103118 A JPS59103118 A JP S59103118A
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- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/56—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices
- G05F1/575—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices characterised by the feedback circuit
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- Automation & Control Theory (AREA)
- Control Of Electrical Variables (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、あらゆるアナログモノリシックＩＣに使用す
ることのできる定電圧装置に関するものである。
ることのできる定電圧装置に関するものである。
従来例の構成とその問題点
従来、比較的低い出力電圧（５Ｖ以下）を発生し、しか
も出力電流容量の大きい定電圧装置として第１図に示す
ような装置が提案され、一部で実用化されている。同図
において、１は非安定化直流電圧が供給されるプラス側
給電端子であり、２がプラス側出力端子で、マイナス側
給電端子とマイナス側出力端子は共通になっている。
も出力電流容量の大きい定電圧装置として第１図に示す
ような装置が提案され、一部で実用化されている。同図
において、１は非安定化直流電圧が供給されるプラス側
給電端子であり、２がプラス側出力端子で、マイナス側
給電端子とマイナス側出力端子は共通になっている。
また、プラス側出力線路すとマイナス側出力線路Ｃの間
には分圧抵抗３，４が接続され、その分圧点にはトラン
ジスタ６と、その１０倍のエミッタ面積を有するトラン
ジスタ６のベースが接続され、前記トランジスタ６のエ
ミッタとマイナス側給電線路Ｃの間には抵抗７，８の直
列回路が接続され、前記抵抗７と前記抵抗８の接続点に
は前記トランジスタ６のエミッタが接続されている。
には分圧抵抗３，４が接続され、その分圧点にはトラン
ジスタ６と、その１０倍のエミッタ面積を有するトラン
ジスタ６のベースが接続され、前記トランジスタ６のエ
ミッタとマイナス側給電線路Ｃの間には抵抗７，８の直
列回路が接続され、前記抵抗７と前記抵抗８の接続点に
は前記トランジスタ６のエミッタが接続されている。
また、前記トランジスタ５，６のコレクタはそれぞれ同
じ抵抗値を有する抵抗９，１ｏを介してグラス側出力線
路すに接続され、前記（・ランジスタロ、６のコレクタ
には、それぞれコンパレータ１００の非反転入力端子１
００ａ、反転入力端子１００ｂが接続され、前記コンパ
レータ１００の出力端子１００Ｃは制御トランジスタ１
１のベースに接続され、前記制御トランジスタ１１のコ
レクタはプラス側給電線路ａＶｃ接続され、同エミッタ
はプラス側出力線路すに接続されるとともに同ベースと
コレクタ間には定電流源２００が接続されている。
じ抵抗値を有する抵抗９，１ｏを介してグラス側出力線
路すに接続され、前記（・ランジスタロ、６のコレクタ
には、それぞれコンパレータ１００の非反転入力端子１
００ａ、反転入力端子１００ｂが接続され、前記コンパ
レータ１００の出力端子１００Ｃは制御トランジスタ１
１のベースに接続され、前記制御トランジスタ１１のコ
レクタはプラス側給電線路ａＶｃ接続され、同エミッタ
はプラス側出力線路すに接続されるとともに同ベースと
コレクタ間には定電流源２００が接続されている。
第１図の装置ではコンパレータ１００の出力に基づいて
制御トランジスタ１１が出力線路間の電圧を制御し、最
終的には、抵抗４０両端が）くンドギャップ電圧（約１
．２Ｖ）に等しくなるような出力電圧が発生される。
制御トランジスタ１１が出力線路間の電圧を制御し、最
終的には、抵抗４０両端が）くンドギャップ電圧（約１
．２Ｖ）に等しくなるような出力電圧が発生される。
すなわち、抵抗７，８の抵抗値をそれぞれＲ７１Ｒ８、
トランジスタ５，６のコレクタ電流をそれぞれＩ５，１
６、抵抗４の両端の電圧をＶｏとし、前記トランジスタ
６．６０ベース・エミッタ間順方向電圧をそれぞれｖＢ
５＋”Ｒ６とし、抵抗９゜１０の抵抗値は等しく、各ト
ランジスタの直流電流増幅率とコンパレータ１００の入
力抵抗は十分に大きいものとすると、次式が得られる。
トランジスタ５，６のコレクタ電流をそれぞれＩ５，１
６、抵抗４の両端の電圧をＶｏとし、前記トランジスタ
６．６０ベース・エミッタ間順方向電圧をそれぞれｖＢ
５＋”Ｒ６とし、抵抗９゜１０の抵抗値は等しく、各ト
ランジスタの直流電流増幅率とコンパレータ１００の入
力抵抗は十分に大きいものとすると、次式が得られる。
Ｖｏ＝（Ｉ６＋Ｉ、）−Ｒ８＋ＶＢ５−−−−・・−・
−（１）■。、Ｒ７：■Ｂ５−■Ｂ６ ・・
・・・・・・・（２）コンパレータ１０ｏとトランジス
タ１１ｉＣよって前記コンパレータ１００の入力端子間
の電圧が零になるように制御されるから、 Ｉ５−■。 ・・・・・・・・・
（３）前記（１）〜（３）式を整理すると 一方、半導体の接合部の温度をＴ（’Ｋ）とし、トラン
ジスタ６はトランジスタ５のエミッタ面積ＡｅのＮ倍の
エミッタ面積を有しているものとすると、ｖＢ６１ ｖ
Ｂ６はそれぞれ次式で表わされる。
−（１）■。、Ｒ７：■Ｂ５−■Ｂ６ ・・
・・・・・・・（２）コンパレータ１０ｏとトランジス
タ１１ｉＣよって前記コンパレータ１００の入力端子間
の電圧が零になるように制御されるから、 Ｉ５−■。 ・・・・・・・・・
（３）前記（１）〜（３）式を整理すると 一方、半導体の接合部の温度をＴ（’Ｋ）とし、トラン
ジスタ６はトランジスタ５のエミッタ面積ＡｅのＮ倍の
エミッタ面積を有しているものとすると、ｖＢ６１ ｖ
Ｂ６はそれぞれ次式で表わされる。
ただし、ｋはボルツマン定数、ｑは電子の電荷で、それ
ぞれ、 ｋ ＝ １．３８ ｘ １０ ）ｏｕｌｅ／ ’
Ｋｑ ＝ １．６０２ ｘ １０ ” ｃｏｕｌｃｍ
ｂである。また、ＩＯは接合部の単位面積あたりの逆方
向飽オ日電流で、半導体の製造プロセスによって定まる
定数をγとすると、 Ｉｏ ＝ ｒ ・Ｔ３ｅｘｐ （−） ・−−・１７
）となる。（４）〜（６）式を整理すると、（８）式の
右辺第１項はトランジスタ５のベース・エミッタ間順方
向電圧であるから、はぼ、−２ｍＶ／℃（−３０００ｐ
ｐｍ程度）の温度係数を有しているので、抵抗Ｒ７，Ｒ
８，Ｎを適当に設定して（８）式の右辺第２項の温度係
数を＋２ｍＶ／℃にすることＫよって、抵抗４の両端の
電圧は温度変化に対してきわめて安定となる。
ぞれ、 ｋ ＝ １．３８ ｘ １０ ）ｏｕｌｅ／ ’
Ｋｑ ＝ １．６０２ ｘ １０ ” ｃｏｕｌｃｍ
ｂである。また、ＩＯは接合部の単位面積あたりの逆方
向飽オ日電流で、半導体の製造プロセスによって定まる
定数をγとすると、 Ｉｏ ＝ ｒ ・Ｔ３ｅｘｐ （−） ・−−・１７
）となる。（４）〜（６）式を整理すると、（８）式の
右辺第１項はトランジスタ５のベース・エミッタ間順方
向電圧であるから、はぼ、−２ｍＶ／℃（−３０００ｐ
ｐｍ程度）の温度係数を有しているので、抵抗Ｒ７，Ｒ
８，Ｎを適当に設定して（８）式の右辺第２項の温度係
数を＋２ｍＶ／℃にすることＫよって、抵抗４の両端の
電圧は温度変化に対してきわめて安定となる。
具体的にはＮの値を１０としてＲ８／Ｒ７の値をほぼ５
にすることによって、出力電圧の温度係数は零となる。
にすることによって、出力電圧の温度係数は零となる。
ところで、第１図に示した定電圧装置は（８）式からも
明らかなように抵抗４の両端の電圧がトランジスタのベ
ース・エミッタ間順方向電圧のほぼ２倍の電圧（約１・
２Ｖ）であるとき、つまり、エネルギーバンドギャップ
電圧に等しくなったときに零温度係数となるが、このこ
とは第１図の装置が１・２■以下の電源電圧や出力電圧
のものとでは調定な特性を示さないことを怠味する。
明らかなように抵抗４の両端の電圧がトランジスタのベ
ース・エミッタ間順方向電圧のほぼ２倍の電圧（約１・
２Ｖ）であるとき、つまり、エネルギーバンドギャップ
電圧に等しくなったときに零温度係数となるが、このこ
とは第１図の装置が１・２■以下の電源電圧や出力電圧
のものとでは調定な特性を示さないことを怠味する。
また、第１図の主要ブロック３００け回路構成は簡単で
あるが、トランジスタ５０１０倍のエミッタ面積を仔す
るトランジスタ６を必要とし、前記トランジスタ６と前
記トランジスタ６のマツチングも重要であることから、
この回路をモノリシックＩＣ化する際にはレイアウト上
の問題が多かった０ 発明の目的 本発明は、より低い電源電圧や出力電圧に１で使用でき
、しかもＩＣのレイアウトが容易な定電圧装置を実現す
ることを目的とする。
あるが、トランジスタ５０１０倍のエミッタ面積を仔す
るトランジスタ６を必要とし、前記トランジスタ６と前
記トランジスタ６のマツチングも重要であることから、
この回路をモノリシックＩＣ化する際にはレイアウト上
の問題が多かった０ 発明の目的 本発明は、より低い電源電圧や出力電圧に１で使用でき
、しかもＩＣのレイアウトが容易な定電圧装置を実現す
ることを目的とする。
発明の構成
本発明の定電圧装置は、ベースとコレクタ間およびベー
スとエミッタ間にそれぞれ第１．第２の抵抗が接続され
た第１のトランジスタと、前記第１のトランジスタに電
流を供給する第１の電流供給手段と、前記第１のトラン
ジスタのコレクタ電位がベースに供給され、エミッタが
第３の抵抗を介して前記第１のトランジスタのエミッタ
に接続された第２のトランジスタと、前記第２のトラン
ジスタに電流を供給する第２の電流供給手段と、前記第
２のトランジスタのエミッタ電流もしくはコレクタ電流
によって抵抗の両端に生じる基準電圧と出力線路の電圧
を比較するコンパレータと、前記コンパレータの出力に
基づいて出力線路間の電圧を制御する制御トランジスタ
を備えたことを特徴とするもので、これによって低電圧
のもとて使用でき、またレイアウト設計の容易な装置を
実現しうるものである。
スとエミッタ間にそれぞれ第１．第２の抵抗が接続され
た第１のトランジスタと、前記第１のトランジスタに電
流を供給する第１の電流供給手段と、前記第１のトラン
ジスタのコレクタ電位がベースに供給され、エミッタが
第３の抵抗を介して前記第１のトランジスタのエミッタ
に接続された第２のトランジスタと、前記第２のトラン
ジスタに電流を供給する第２の電流供給手段と、前記第
２のトランジスタのエミッタ電流もしくはコレクタ電流
によって抵抗の両端に生じる基準電圧と出力線路の電圧
を比較するコンパレータと、前記コンパレータの出力に
基づいて出力線路間の電圧を制御する制御トランジスタ
を備えたことを特徴とするもので、これによって低電圧
のもとて使用でき、またレイアウト設計の容易な装置を
実現しうるものである。
実施例の説明
以下、本発明の実施例について図面を参照しながら説明
する。
する。
第２図は本発明の一実施例に係る定電圧装置の回路図で
あり、第１図と同一部分については同一符号を付してい
る。
あり、第１図と同一部分については同一符号を付してい
る。
謁２図において、トランジスタ１２のコレクタ・ベース
間、ベース・エミッタ間にそれぞれの抵抗１３．１４が
接続され、前記トランジスタ１２のエミッタはマイナス
側出力線路Ｃに接続され、同コレクタは抵抗１６を介し
てプラス側出力線路すに１妾絖されているとともに、１
司コレクタにはトランジスタ１６のベースが接続され、
前記トランジスタ１６のエミッタは抵抗１７を介してマ
イナス側出力線路Ｃに接続され、同コレクタは直接プラ
ス側出力線路Ｊ）Ｋ接続されている。
間、ベース・エミッタ間にそれぞれの抵抗１３．１４が
接続され、前記トランジスタ１２のエミッタはマイナス
側出力線路Ｃに接続され、同コレクタは抵抗１６を介し
てプラス側出力線路すに１妾絖されているとともに、１
司コレクタにはトランジスタ１６のベースが接続され、
前記トランジスタ１６のエミッタは抵抗１７を介してマ
イナス側出力線路Ｃに接続され、同コレクタは直接プラ
ス側出力線路Ｊ）Ｋ接続されている。
また、前記トランジスタ１６のエミッタにはコンパレ〜
り１００の非反転入力端子１００ ａが接続され、前記
コンパレータ１００の反転入力端子１００ｂは抵抗３と
抵抗４の接続点（分圧点）に接続され、同出力端子１０
０ ｃはトランジスタ１１のベースに接続され、前記ト
ランジスタ１１のエミッタはプラス側出力線路すに接続
され、同コレクタはプラス側給電線路ａに接続されてい
る。
り１００の非反転入力端子１００ ａが接続され、前記
コンパレータ１００の反転入力端子１００ｂは抵抗３と
抵抗４の接続点（分圧点）に接続され、同出力端子１０
０ ｃはトランジスタ１１のベースに接続され、前記ト
ランジスタ１１のエミッタはプラス側出力線路すに接続
され、同コレクタはプラス側給電線路ａに接続されてい
る。
一方、ｔｆ’Ｈａトランジスタ１２のコレクタにはトラ
ンジスタ１８のベースが接続され、前記トランジスタ１
８のエミッタは抵抗１９を介してマイナス側出力線路Ｃ
に接続され、同コレクタはトランジスタ２０のベースお
よびコレクタ、さらＫはトランジスタ２１のベースに接
続され、前記トランジスタ２０．２１のエミッタはとも
にプラス側給電線路ａに接続され、前記トランジスタ２
１のコレクタは前記トランジスタ１１のベースに接続さ
れている。
ンジスタ１８のベースが接続され、前記トランジスタ１
８のエミッタは抵抗１９を介してマイナス側出力線路Ｃ
に接続され、同コレクタはトランジスタ２０のベースお
よびコレクタ、さらＫはトランジスタ２１のベースに接
続され、前記トランジスタ２０．２１のエミッタはとも
にプラス側給電線路ａに接続され、前記トランジスタ２
１のコレクタは前記トランジスタ１１のベースに接続さ
れている。
なお、前記トランジスタ１Ｂ、２０．２１および抵抗１
９によって定電流源２００か構成されている。
９によって定電流源２００か構成されている。
さて、第２図に示された回路について、その動作を説明
すると、コンパレータ１００とトランジスタ１１は第１
図の装置と同様に前記コンパレータ１００の入力端子間
の電圧が零になるように動作し、最終的に抵抗４の両端
の電圧■０と抵抗１７の両端の電圧が等しくなるように
働く。
すると、コンパレータ１００とトランジスタ１１は第１
図の装置と同様に前記コンパレータ１００の入力端子間
の電圧が零になるように動作し、最終的に抵抗４の両端
の電圧■０と抵抗１７の両端の電圧が等しくなるように
働く。
第２図において、抵抗１３，１４，１５．１７の抵抗値
をそれぞれＲ３、Ｒ４，Ｒ５、Ｒ７とし、トランジスタ
１２．１６のコレクタ電流をそれぞれＩ、、Ｉ。、ベー
ス・エミッタ間順方向電圧をそれぞれ■Ｂ２．ｖＢ６
とすると、 ただし、Ｎはトランジスタ１２に対するトランジスタ１
６のエミッタ面積の倍率である。
をそれぞれＲ３、Ｒ４，Ｒ５、Ｒ７とし、トランジスタ
１２．１６のコレクタ電流をそれぞれＩ、、Ｉ。、ベー
ス・エミッタ間順方向電圧をそれぞれ■Ｂ２．ｖＢ６
とすると、 ただし、Ｎはトランジスタ１２に対するトランジスタ１
６のエミッタ面積の倍率である。
また、Ｖｏ＝Ｉ。・Ｒ７であるから、
さらに、抵抗３，４の抵抗値をそれぞれＲＡ。
とすると、
（９）〜（１２）式を整理すると、
（１ｏ） 、 （１４）式を整理すると、（１５） 、
（１６）式は超越方程式を形成しているので、これを
解くには計算機を用いて■０および工、をステップ的に
変化させてバランス点を求める必要がある。
（１６）式は超越方程式を形成しているので、これを
解くには計算機を用いて■０および工、をステップ的に
変化させてバランス点を求める必要がある。
ここでは、定性的にその動作を説明するために（１６）
式を次のように近似する。
式を次のように近似する。
（１７）式を（１５）式に代入すると、（１８）式にお
いて右辺第１項の■Ｂ２ の項はほぼ−２ｍＶ ／ ℃
の温度係数を有しているので、Ｒ６゜Ｒ７，Ｎの値を適
当に設定することにより、■の温度係数を零にすること
ができる。
いて右辺第１項の■Ｂ２ の項はほぼ−２ｍＶ ／ ℃
の温度係数を有しているので、Ｒ６゜Ｒ７，Ｎの値を適
当に設定することにより、■の温度係数を零にすること
ができる。
また、第１図の回路と違って、例えばＲ３をＲ４の１０
分の１にすることもできるから、■ｏそのものもかなり
小さくすることが可能になり、その場合、（１８）酸第
２項の対数項も小さくてすむので、Ｎの値は２または３
で期待する特性が得られる。
分の１にすることもできるから、■ｏそのものもかなり
小さくすることが可能になり、その場合、（１８）酸第
２項の対数項も小さくてすむので、Ｎの値は２または３
で期待する特性が得られる。
したがって第２図の主要ブロック３００のトランジスタ
１６のトランジスタサイズをトランジスタ１２に比べて
大幅に大きくする必要はなくなり、ＩＣチップ上の占有
面積も小さくなるし、トランジスタ１２とトランジスタ
１６のマツチングをとるためのレイアウト設計もかなり
簡単になる。
１６のトランジスタサイズをトランジスタ１２に比べて
大幅に大きくする必要はなくなり、ＩＣチップ上の占有
面積も小さくなるし、トランジスタ１２とトランジスタ
１６のマツチングをとるためのレイアウト設計もかなり
簡単になる。
なお、本発明の効果を大ざっばな近似を用いて説明した
が、出力電圧α■０ の小さい場合には（１７）式は成
立せず、この近似は妥当ではないし、その他の場合にお
いても実際には（１５）式および（１６）式から各抵抗
の抵抗値を求める必要がある。
が、出力電圧α■０ の小さい場合には（１７）式は成
立せず、この近似は妥当ではないし、その他の場合にお
いても実際には（１５）式および（１６）式から各抵抗
の抵抗値を求める必要がある。
ところで、本発明の実施態様は（１５）式あるいは（１
８）式に示された考え方、すなわち、零温度係数となる
出力電圧をＲ３とＲ４の比率によって自由に変え得る点
を基本として種々に展開することが可能である。
８）式に示された考え方、すなわち、零温度係数となる
出力電圧をＲ３とＲ４の比率によって自由に変え得る点
を基本として種々に展開することが可能である。
例えば第す図に示すようにトランジスタ１６のコレクタ
側に抵抗２２を挿入し、前記抵抗２２の両端の電圧（抵
抗１７の両端の電圧に依存した電圧が現われる。）と抵
抗３の両端の電圧をコンノくレータ１００によって比較
することもできるし、制御トランジスタにｆ′ＮＰトラ
ンジスタ２３を用いて定電流源２００を省くこともでき
る。（なお、図には示されていないが、第２図、第３図
に示された装置はいずれも自己起動しないので別途起動
回路が必要であり、第１図に示した装置においても定電
流源２００の基準をブロック３００から得る場合には起
動回路が必要である。） また、第４図に示すようにトランジスタ１６のコレクタ
電流をトランジスタ２４ 、２５ 、２６ 。
側に抵抗２２を挿入し、前記抵抗２２の両端の電圧（抵
抗１７の両端の電圧に依存した電圧が現われる。）と抵
抗３の両端の電圧をコンノくレータ１００によって比較
することもできるし、制御トランジスタにｆ′ＮＰトラ
ンジスタ２３を用いて定電流源２００を省くこともでき
る。（なお、図には示されていないが、第２図、第３図
に示された装置はいずれも自己起動しないので別途起動
回路が必要であり、第１図に示した装置においても定電
流源２００の基準をブロック３００から得る場合には起
動回路が必要である。） また、第４図に示すようにトランジスタ１６のコレクタ
電流をトランジスタ２４ 、２５ 、２６ 。
２７、抵抗２８，２９．３０によって構成されたカレン
トミラー回路に供給し、前記トランジスタ２６のコレク
タ電流をトランジスタ１２および抵抗１３．１４に供給
するとともに前記トランジスタ２７のコレクタ電流を抵
抗３１に供給して、その両端に基準の電圧を発生させる
こともできる。
トミラー回路に供給し、前記トランジスタ２６のコレク
タ電流をトランジスタ１２および抵抗１３．１４に供給
するとともに前記トランジスタ２７のコレクタ電流を抵
抗３１に供給して、その両端に基準の電圧を発生させる
こともできる。
発明の効果
以上の説明から明らかになるように、本発明のとエミッ
タ間にそれぞれ第１の抵抗（前記１３に相当）、第２の
抵抗（１４に相当）が接続された第１のトランジスタ第
１のトランジスタ（１２に相当）と、前記第１のトラン
ジスタに電流を供給する第１の電流供給手段（抵抗１５
あるいは抵抗２９とトランジスタ２６に相当）と前記第
１のトランジスタのコレクタ電位がベースに供給され、
エミッタが第３の抵抗（１７に相当）を介して前記第１
のトランジスタのエミッタ接続された第２のトランジス
タ（１６に相当）と、前記第２のトランジスタに電流を
供給する第２の電流供給手段（第２図においてはプラス
側出力線路すからトランジスタ１６のコレクタに至る配
線が第２の電流供給手段であり、第３図においては抵抗
１６に相当）と、前記第２のトランジスタのエミッタ電
流もしくはコレクタ電流によって第３の抵抗（第３図に
おいては抵抗２２、第４図においては抵抗３１に相当）
の両端に生じる基準電圧と出力線路の電圧を比較するコ
ンパレータ（１００に相当）と、前記コンパレータの出
力に基づいて出力線路間の電圧を制御する制御トランジ
スタを備えているので、より低い電源電圧や出力電圧の
もとで満足すべき特性が得られるだけでなく、第１のト
ランジスタと第２のトランジスタのトランジスタサイズ
を極端に異ならせる必要がなく、ＩＣのレイアウトがき
わめて容易であるという効果を呈する。
タ間にそれぞれ第１の抵抗（前記１３に相当）、第２の
抵抗（１４に相当）が接続された第１のトランジスタ第
１のトランジスタ（１２に相当）と、前記第１のトラン
ジスタに電流を供給する第１の電流供給手段（抵抗１５
あるいは抵抗２９とトランジスタ２６に相当）と前記第
１のトランジスタのコレクタ電位がベースに供給され、
エミッタが第３の抵抗（１７に相当）を介して前記第１
のトランジスタのエミッタ接続された第２のトランジス
タ（１６に相当）と、前記第２のトランジスタに電流を
供給する第２の電流供給手段（第２図においてはプラス
側出力線路すからトランジスタ１６のコレクタに至る配
線が第２の電流供給手段であり、第３図においては抵抗
１６に相当）と、前記第２のトランジスタのエミッタ電
流もしくはコレクタ電流によって第３の抵抗（第３図に
おいては抵抗２２、第４図においては抵抗３１に相当）
の両端に生じる基準電圧と出力線路の電圧を比較するコ
ンパレータ（１００に相当）と、前記コンパレータの出
力に基づいて出力線路間の電圧を制御する制御トランジ
スタを備えているので、より低い電源電圧や出力電圧の
もとで満足すべき特性が得られるだけでなく、第１のト
ランジスタと第２のトランジスタのトランジスタサイズ
を極端に異ならせる必要がなく、ＩＣのレイアウトがき
わめて容易であるという効果を呈する。
また、第２図に示した実施例においては、コンパレータ
１００の一方の入力端子を第２のトランジスタ１６のエ
ミッタ側に接続し、他方の入力端子を出力線路間の抵抗
分圧点に接続しており、第３図に示した実施例において
は、一方の出力線路と第２のトランジスタ１６のコレク
タの間に接続された第４の抵抗２２によって第２の電流
供給手段を構成し、コンパレータ１００の一方の入力端
子を前記第２のトランジスタのコレクタ側に接続し、他
方の入力端子を出力線路間の抵抗分圧点に接続している
ので、いずれも、その構成がきわめて簡単になるなど大
なる効果を奏する。
１００の一方の入力端子を第２のトランジスタ１６のエ
ミッタ側に接続し、他方の入力端子を出力線路間の抵抗
分圧点に接続しており、第３図に示した実施例において
は、一方の出力線路と第２のトランジスタ１６のコレク
タの間に接続された第４の抵抗２２によって第２の電流
供給手段を構成し、コンパレータ１００の一方の入力端
子を前記第２のトランジスタのコレクタ側に接続し、他
方の入力端子を出力線路間の抵抗分圧点に接続している
ので、いずれも、その構成がきわめて簡単になるなど大
なる効果を奏する。
第１図は従来例を示す回路図、第２図、第３図および第
４図はいずれも本発明の各実施例を示す回路図である。 ２・・・・・・出力端子、１２・・・・・・トランジス
タ、１６・・・・・・トランジスタ、１ｏＯ・・・・・
・コンパレータ。
４図はいずれも本発明の各実施例を示す回路図である。 ２・・・・・・出力端子、１２・・・・・・トランジス
タ、１６・・・・・・トランジスタ、１ｏＯ・・・・・
・コンパレータ。
Claims (3)
- （１）ベースとコレクタ間およびベースとエミッタ間に
それぞれ第１．第２の抵抗が接続された第１のトランジ
スタと、前記第１のトランジスタに電流を供給する第１
の電流供給手段と、前記第１のトランジスタのコレクタ
電位がベースに供給され、エミッタが第３の抵抗を介し
て前記第１のトランジスタのエミッタに接続された第２
のトランジスタと、前記第２のトランジスタに電流を供
給する第２の電流供給手段と、前記第２のトランジスタ
のエミッタ電流もしくはコレクタ電流によって抵抗の両
端に生じる基準電圧と出力線路の電圧を比較するコンパ
レータと、前記コンパレータの出力に基づいて出力線路
間の電圧を制御する制御トランジスタを備えてなる定電
圧装置。 - （２） コンパレータの一方の入力端子を第２のトラ
ンジスタのエミッタ側に接続し、他方の入力端子を出力
線路間の抵抗分圧点に接続したことを特徴とする特許請
求の範囲第（１）項記載の定電圧装置。 - （３）一方の出力線路と第２のトランジスタのコレクタ
の間に接続された第４の抵抗によって第２の電流供給手
段を構成し、コンパレータの一方の入力端子を前記第２
のトランジスタのコレクタ側に接続し、他方の入力端子
を出力線路間の抵抗分圧点に接続したことを特徴とする
特許請求の範囲第一（１）項記載の定電圧装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57212912A JPS59103118A (ja) | 1982-12-03 | 1982-12-03 | 定電圧装置 |
| US06/555,678 US4559488A (en) | 1982-12-03 | 1983-11-28 | Integrated precision reference source |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57212912A JPS59103118A (ja) | 1982-12-03 | 1982-12-03 | 定電圧装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59103118A true JPS59103118A (ja) | 1984-06-14 |
Family
ID=16630334
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57212912A Pending JPS59103118A (ja) | 1982-12-03 | 1982-12-03 | 定電圧装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4559488A (ja) |
| JP (1) | JPS59103118A (ja) |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0690656B2 (ja) * | 1985-01-24 | 1994-11-14 | ソニー株式会社 | 基準電圧の形成回路 |
| US4912393A (en) * | 1986-03-12 | 1990-03-27 | Beltone Electronics Corporation | Voltage regulator with variable reference outputs for a hearing aid |
| JP3195256B2 (ja) * | 1996-10-24 | 2001-08-06 | 株式会社東芝 | 半導体集積回路 |
| EP1184769A3 (en) * | 2000-08-09 | 2004-09-22 | Mitsubishi Denki Kabushiki Kaisha | Voltage generator, output circuit for error detector, and current generator |
| US6597619B2 (en) * | 2001-01-12 | 2003-07-22 | Micron Technology, Inc. | Actively driven VREF for input buffer noise immunity |
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Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5320554A (en) * | 1976-08-11 | 1978-02-24 | Hitachi Ltd | Constant current circuit |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3617859A (en) * | 1970-03-23 | 1971-11-02 | Nat Semiconductor Corp | Electrical regulator apparatus including a zero temperature coefficient voltage reference circuit |
| US3887863A (en) * | 1973-11-28 | 1975-06-03 | Analog Devices Inc | Solid-state regulated voltage supply |
| US4260946A (en) * | 1979-03-22 | 1981-04-07 | Rca Corporation | Reference voltage circuit using nested diode means |
| JPS564818A (en) * | 1979-06-27 | 1981-01-19 | Toshiba Corp | Reference voltage circuit |
| US4399399A (en) * | 1981-12-21 | 1983-08-16 | Motorola, Inc. | Precision current source |
-
1982
- 1982-12-03 JP JP57212912A patent/JPS59103118A/ja active Pending
-
1983
- 1983-11-28 US US06/555,678 patent/US4559488A/en not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5320554A (en) * | 1976-08-11 | 1978-02-24 | Hitachi Ltd | Constant current circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| US4559488A (en) | 1985-12-17 |
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