JPH0326435B2 - - Google Patents
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- JPH0326435B2 JPH0326435B2 JP57092028A JP9202882A JPH0326435B2 JP H0326435 B2 JPH0326435 B2 JP H0326435B2 JP 57092028 A JP57092028 A JP 57092028A JP 9202882 A JP9202882 A JP 9202882A JP H0326435 B2 JPH0326435 B2 JP H0326435B2
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- transistor
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- circuit
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- 238000006243 chemical reaction Methods 0.000 claims description 33
- 238000010586 diagram Methods 0.000 description 6
- 230000007423 decrease Effects 0.000 description 2
- 230000003247 decreasing effect Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01D—MEASURING NOT SPECIALLY ADAPTED FOR A SPECIFIC VARIABLE; ARRANGEMENTS FOR MEASURING TWO OR MORE VARIABLES NOT COVERED IN A SINGLE OTHER SUBCLASS; TARIFF METERING APPARATUS; MEASURING OR TESTING NOT OTHERWISE PROVIDED FOR
- G01D3/00—Indicating or recording apparatus with provision for the special purposes referred to in the subgroups
- G01D3/028—Indicating or recording apparatus with provision for the special purposes referred to in the subgroups mitigating undesired influences, e.g. temperature, pressure
Description
【発明の詳細な説明】
この発明は電圧電流変換回路に係り、特に電圧
電流変換特性の温度特性の改善に関する。
電流変換特性の温度特性の改善に関する。
第１図は電圧電流変換回路の基本回路を示して
いる。この回路はトランジスタ２のエミツタを抵
抗４を介して基準電位点（GND）６に接続し、
端子８は駆動電源に接続されている。トランジス
タ２のベースに形成された入力端子１０と、前記
基準電位点６に形成した端子１２との間には、電
圧Vinが印加されるものとする。この場合、抵抗
４の抵抗値をRe、トランジスタ２のベース・エ
ミツタ間電圧をVbeとすると、トランジスタ２を
流れる電流Ｉは、Ｉ≒（Vin−Vbe）／Reで与え
られる。この電流Ｉにおいて、トランジスタ２の
ベース・エミツタ間電圧Vbeにはトランジスタ２
の温度特性による変化分２ｍＶ／℃が加わるた
め、その値は温度特性を含んだものと成る。即
ち、電流Ｉの値は温度上昇で減少する。この減少
分を補正するためには、補正用の電流源１４より
補正電流を流すことが必要となるが、この補正電
流は温度特性を加味して調整しなければならない
ため、その設定は非常に面倒なものと成る。
いる。この回路はトランジスタ２のエミツタを抵
抗４を介して基準電位点（GND）６に接続し、
端子８は駆動電源に接続されている。トランジス
タ２のベースに形成された入力端子１０と、前記
基準電位点６に形成した端子１２との間には、電
圧Vinが印加されるものとする。この場合、抵抗
４の抵抗値をRe、トランジスタ２のベース・エ
ミツタ間電圧をVbeとすると、トランジスタ２を
流れる電流Ｉは、Ｉ≒（Vin−Vbe）／Reで与え
られる。この電流Ｉにおいて、トランジスタ２の
ベース・エミツタ間電圧Vbeにはトランジスタ２
の温度特性による変化分２ｍＶ／℃が加わるた
め、その値は温度特性を含んだものと成る。即
ち、電流Ｉの値は温度上昇で減少する。この減少
分を補正するためには、補正用の電流源１４より
補正電流を流すことが必要となるが、この補正電
流は温度特性を加味して調整しなければならない
ため、その設定は非常に面倒なものと成る。
そこで、この発明は、温度特性の影響を受けな
い電圧電流変換特性を実現した電圧電流変換回路
の提供を目的とする。
い電圧電流変換特性を実現した電圧電流変換回路
の提供を目的とする。
即ち、この発明の電圧電流変換回路は、電流に
変換すべき入力電圧を増幅器２４の正相入力端子
に加え、その出力を電流変換トランジスタ（トラ
ンジスタ２６）のベースに加えて電流に変換する
とともに、その電流を前記電流変換トランジスタ
のエミツタ側に接続された抵抗３０に流して電圧
に変換し、この電圧を前記増幅器の逆相入力端子
に帰還することにより、前記入力電圧を電流に変
換する電圧電流変換回路であつて、エミツタを共
通にして定電流源４８から動作電流が供給される
第１のトランジスタ３８及び第２のトランジスタ
４０からなる差動対を設置するとともに、この差
動対に対して能動負荷を成す第３のトランジスタ
４４及び第４のトランジスタ４６からなるカレン
トミラー回路を設置して前記増幅器を構成し、 前記差動対の前記第１のトランジスタ及び前記
第２のトランジスタの電流容量、又は前記カレン
トミラー回路の前記第３のトランジスタ及び前記
第４のトランジスタの通流電流の比率を以て前記
増幅器に任意のオフセツト電圧を設定したもので
ある。
変換すべき入力電圧を増幅器２４の正相入力端子
に加え、その出力を電流変換トランジスタ（トラ
ンジスタ２６）のベースに加えて電流に変換する
とともに、その電流を前記電流変換トランジスタ
のエミツタ側に接続された抵抗３０に流して電圧
に変換し、この電圧を前記増幅器の逆相入力端子
に帰還することにより、前記入力電圧を電流に変
換する電圧電流変換回路であつて、エミツタを共
通にして定電流源４８から動作電流が供給される
第１のトランジスタ３８及び第２のトランジスタ
４０からなる差動対を設置するとともに、この差
動対に対して能動負荷を成す第３のトランジスタ
４４及び第４のトランジスタ４６からなるカレン
トミラー回路を設置して前記増幅器を構成し、 前記差動対の前記第１のトランジスタ及び前記
第２のトランジスタの電流容量、又は前記カレン
トミラー回路の前記第３のトランジスタ及び前記
第４のトランジスタの通流電流の比率を以て前記
増幅器に任意のオフセツト電圧を設定したもので
ある。
以下、この発明を図面に示した実施例を参照し
て詳細に説明する。第２図はこの発明の電圧電流
変換回路の実施例を示している。図において、電
流変換すべき入力電圧Vinは入力端子２０，２２
に印加され、この入力電圧Vinは正相入力端子
（＋）に加えられて増幅器２４で増幅される。こ
の増幅器２４は差動増幅器等で構成され、一定の
オフセツト電圧を持つているものとする。
て詳細に説明する。第２図はこの発明の電圧電流
変換回路の実施例を示している。図において、電
流変換すべき入力電圧Vinは入力端子２０，２２
に印加され、この入力電圧Vinは正相入力端子
（＋）に加えられて増幅器２４で増幅される。こ
の増幅器２４は差動増幅器等で構成され、一定の
オフセツト電圧を持つているものとする。
この増幅器２４の出力端子にはその増幅出力を
電流に変換する電流変換トランジスタとしてトラ
ンジスタ２６のベースが接続され、このトランジ
スタ２６のコレクタには電流出力端子２８が形成
されている。トランジスタ２６のエミツタは電流
変換用の抵抗３０を介して基準電位点３２に接続
され、増幅器２４の逆相入力端子（−）には抵抗
３０とトランジスタ２６のエミツタとの接続点を
帰還点として帰還回路３４が形成されている。
電流に変換する電流変換トランジスタとしてトラ
ンジスタ２６のベースが接続され、このトランジ
スタ２６のコレクタには電流出力端子２８が形成
されている。トランジスタ２６のエミツタは電流
変換用の抵抗３０を介して基準電位点３２に接続
され、増幅器２４の逆相入力端子（−）には抵抗
３０とトランジスタ２６のエミツタとの接続点を
帰還点として帰還回路３４が形成されている。
以上の構成において、入力端子２０，２２に電
流Vinが印加されると、増幅器２４は増幅出力を
発生し、トランジスタ２６には電流Ｉが電流出力
端子２８より回路内部に取り込むようにして流れ
る。この結果、抵抗３０には電圧降下Vin′が発生
する。この電圧降下Vin′は差動増幅器等で構成さ
れる増幅器２４に帰還される。従つて、入力電圧
Vinと電圧降下Vin′とに差があると、その差は増
幅器２４でさらに増幅され、結局、両者はVin＝
Vin′となる。この結果、抵抗３０の値をＲとする
と、電流ＩはＩ＝Vin′（＝Vin）／Ｒで与えられ
る。即ち、この電圧電流変換回路では、入力電圧
Vinは帰還点電圧Vin′と考えられ、直接に電流変
換用の抵抗３０を駆動しているため、電圧電流変
換が極めて簡略化される。第３図はこの場合の電
圧電流変換特性を示し、ΔVOは増幅器２４が持つ
オフセツト電圧である。即ち、このオフセツト電
圧ΔVOの値を入力電圧Vinが越えない場合、出力
電流IOは発生しない。
流Vinが印加されると、増幅器２４は増幅出力を
発生し、トランジスタ２６には電流Ｉが電流出力
端子２８より回路内部に取り込むようにして流れ
る。この結果、抵抗３０には電圧降下Vin′が発生
する。この電圧降下Vin′は差動増幅器等で構成さ
れる増幅器２４に帰還される。従つて、入力電圧
Vinと電圧降下Vin′とに差があると、その差は増
幅器２４でさらに増幅され、結局、両者はVin＝
Vin′となる。この結果、抵抗３０の値をＲとする
と、電流ＩはＩ＝Vin′（＝Vin）／Ｒで与えられ
る。即ち、この電圧電流変換回路では、入力電圧
Vinは帰還点電圧Vin′と考えられ、直接に電流変
換用の抵抗３０を駆動しているため、電圧電流変
換が極めて簡略化される。第３図はこの場合の電
圧電流変換特性を示し、ΔVOは増幅器２４が持つ
オフセツト電圧である。即ち、このオフセツト電
圧ΔVOの値を入力電圧Vinが越えない場合、出力
電流IOは発生しない。
このような回路によれば、電圧電流変換部を簡
略化できるとともに、増幅器２４の帰還回路３４
に能動素子が含まれていないため、温度特性の影
響を回避することができる。しかも、印加電圧
Vinは基準電位点レベルより制御可能であり、外
部からの電流補正用の電流源等の回路を必要とし
ない。
略化できるとともに、増幅器２４の帰還回路３４
に能動素子が含まれていないため、温度特性の影
響を回避することができる。しかも、印加電圧
Vinは基準電位点レベルより制御可能であり、外
部からの電流補正用の電流源等の回路を必要とし
ない。
第４図はこの発明の電圧電流変換回路の具体的
実施例を示している。第４図において、第２図の
回路と同一部分には同一符号が付してある。増幅
器２４は第１のトランジスタ３８、第２のトラン
ジスタ４０、第３のトランジスタ４４、第４のト
ランジスタ４６、第５のトランジスタ３６及び第
６のトランジスタ４２及び定電流源４８で構成さ
れている。即ち、この実施例の増幅器２４は差動
増幅器で構成され、トランジスタ４４，４６はカ
レントミラー回路を構成している。
実施例を示している。第４図において、第２図の
回路と同一部分には同一符号が付してある。増幅
器２４は第１のトランジスタ３８、第２のトラン
ジスタ４０、第３のトランジスタ４４、第４のト
ランジスタ４６、第５のトランジスタ３６及び第
６のトランジスタ４２及び定電流源４８で構成さ
れている。即ち、この実施例の増幅器２４は差動
増幅器で構成され、トランジスタ４４，４６はカ
レントミラー回路を構成している。
このような構成において、電圧印加端子５０に
は電圧VCCが印加されると、定電流源４８が定電
流を発生し、この電流でトランジスタ３８，４０
が駆動される。ここで、入力端子２０，２２の間
に電圧Vinが印加されると、この電圧増幅器２４
で増幅され、その増幅出力はトランジスタ４０の
コレクタから取り出され、トランジスタ２６のベ
ースに印加される。この結果、トランジスタ２６
にはこの増幅出力に応じた変換出力電流IOが電流
出力端子２８に流れる。
は電圧VCCが印加されると、定電流源４８が定電
流を発生し、この電流でトランジスタ３８，４０
が駆動される。ここで、入力端子２０，２２の間
に電圧Vinが印加されると、この電圧増幅器２４
で増幅され、その増幅出力はトランジスタ４０の
コレクタから取り出され、トランジスタ２６のベ
ースに印加される。この結果、トランジスタ２６
にはこの増幅出力に応じた変換出力電流IOが電流
出力端子２８に流れる。
第５図はこの発明の電圧電流変換回路の他の実
施例を示している。この実施例は増幅器２４のオ
フセツト電圧ΔVOの値を変更したものである。即
ち、増幅器２４のオフセツト電圧ΔVOはトランジ
スタ３８，４０の電流容量又はトランジスタ４
４，４６の通流電流の比率により変更することが
可能である。この実施例では、トランジスタ３８
のエミツタ面積をトランジスタ４０のそれより大
きく設定したものである。この結果、トランジス
タ４２のベースに電源５２が挿入されたのと等価
になり、変換入力電圧の最低レベルが決定され
る。
施例を示している。この実施例は増幅器２４のオ
フセツト電圧ΔVOの値を変更したものである。即
ち、増幅器２４のオフセツト電圧ΔVOはトランジ
スタ３８，４０の電流容量又はトランジスタ４
４，４６の通流電流の比率により変更することが
可能である。この実施例では、トランジスタ３８
のエミツタ面積をトランジスタ４０のそれより大
きく設定したものである。この結果、トランジス
タ４２のベースに電源５２が挿入されたのと等価
になり、変換入力電圧の最低レベルが決定され
る。
第６図はこの場合のオフセツト電圧ΔVOの変更
に対する入力出力関係の変化を示している。オフ
セツト電圧ΔVOをV1に減少又はV2に増加するこ
とに応じて特性Ａは、特性A1又はA2に変更され
る。即ち、変化電流を得ることのできる印加電圧
点が変動し、例えばオフセツト電圧ΔVOをΔVO＝
０に設定すれば、極めて小さい電圧の印加でも電
流変換をすることができる。
に対する入力出力関係の変化を示している。オフ
セツト電圧ΔVOをV1に減少又はV2に増加するこ
とに応じて特性Ａは、特性A1又はA2に変更され
る。即ち、変化電流を得ることのできる印加電圧
点が変動し、例えばオフセツト電圧ΔVOをΔVO＝
０に設定すれば、極めて小さい電圧の印加でも電
流変換をすることができる。
以上説明したように、この発明によれば、増幅
器の出力を電流変換トランジスタのベースに加え
て電流変換トランジスタで電流変換するととも
に、電流変換トランジスタのエミツタに接続した
抵抗によつて得られた電圧を増幅器の逆相入力端
子に加え、第１及び第２のトランジスタの電流容
量、又は第３及び第４のトランジスタの電流比率
の設定で増幅器に任意のオフセツト電圧の設定と
ともに、そのオフセツト電圧を零に設定できるの
で、温度特性の影響を受けない電圧電流変換出力
を得ることができる上、極めて小さい値の入力電
圧の電流変換を行うことができる。
器の出力を電流変換トランジスタのベースに加え
て電流変換トランジスタで電流変換するととも
に、電流変換トランジスタのエミツタに接続した
抵抗によつて得られた電圧を増幅器の逆相入力端
子に加え、第１及び第２のトランジスタの電流容
量、又は第３及び第４のトランジスタの電流比率
の設定で増幅器に任意のオフセツト電圧の設定と
ともに、そのオフセツト電圧を零に設定できるの
で、温度特性の影響を受けない電圧電流変換出力
を得ることができる上、極めて小さい値の入力電
圧の電流変換を行うことができる。
第１図は電圧電流変換回路の基本回路を示す回
路図、第２図はこの発明の電圧電流変換回路の実
施例を示す回路図、第３図はその入出力特性を示
す説明図、第４図はこの発明の電圧電流変換回路
の実施例を示す回路図、第５図はこの発明の他の
実施例を示す回路図、第６図はその入出力特性を
示す説明図である。 ２４……増幅器、２６……トランジスタ（電流
変換トランジスタ）、３０……抵抗、３４……帰
還回路、３８……第１のトランジスタ、４０……
第２のトランジスタ、４４……第３のトランジス
タ、４６……第４のトランジスタ、４８……定電
流源。
路図、第２図はこの発明の電圧電流変換回路の実
施例を示す回路図、第３図はその入出力特性を示
す説明図、第４図はこの発明の電圧電流変換回路
の実施例を示す回路図、第５図はこの発明の他の
実施例を示す回路図、第６図はその入出力特性を
示す説明図である。 ２４……増幅器、２６……トランジスタ（電流
変換トランジスタ）、３０……抵抗、３４……帰
還回路、３８……第１のトランジスタ、４０……
第２のトランジスタ、４４……第３のトランジス
タ、４６……第４のトランジスタ、４８……定電
流源。
Claims (1)
- 【特許請求の範囲】 １ 電流に変換すべき入力電圧を増幅器の正相入
力端子に加え、その出力を電流変換トランジスタ
のベースに加えて電流に変換するとともに、その
電流を前記電流変換トランジスタのエミツタ側に
接続された抵抗に流して電圧に変換し、この電圧
を前記増幅器の逆相入力端子に帰還することによ
り、前記入力電圧を電流に変換する電圧電流変換
回路であつて、 エミツタを共通にして定電流源から動作電流が
供給される第１のトランジスタ及び第２のトラン
ジスタからなる差動対を設置するとともに、この
差動対に対して能動負荷を成す第３のトランジス
タ及び第４のトランジスタからなるカレントミラ
ー回路を設置して前記増幅器を構成し、 前記差動対の前記第１のトランジスタ及び第２
のトランジスタの電流容量、又は前記カレントミ
ラー回路の前記第３のトランジスタ及び前記第４
のトランジスタの通流電流の比率を以て前記増幅
器に任意のオフセツト電圧を設定したことを特徴
とする電圧電流変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57092028A JPS58208621A (ja) | 1982-05-30 | 1982-05-30 | 電圧電流変換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57092028A JPS58208621A (ja) | 1982-05-30 | 1982-05-30 | 電圧電流変換回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58208621A JPS58208621A (ja) | 1983-12-05 |
| JPH0326435B2 true JPH0326435B2 (ja) | 1991-04-10 |
Family
ID=14043074
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57092028A Granted JPS58208621A (ja) | 1982-05-30 | 1982-05-30 | 電圧電流変換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58208621A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH079615B2 (ja) * | 1984-08-09 | 1995-02-01 | 日本電気株式会社 | 絶対値電圧電流変換回路 |
| JPS6442903A (en) * | 1987-08-10 | 1989-02-15 | Nippon Telegraph & Telephone | Voltage drive type current amplifier |
| US6144374A (en) * | 1997-05-15 | 2000-11-07 | Orion Electric Co., Ltd. | Apparatus for driving a flat panel display |
| AUPQ285899A0 (en) * | 1999-09-16 | 1999-10-07 | Britax Rainsfords Pty Ltd | Sensor memory electronic circuit |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54106255A (en) * | 1978-02-08 | 1979-08-21 | Hitachi Ltd | Voltage-current converting circuit |
-
1982
- 1982-05-30 JP JP57092028A patent/JPS58208621A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54106255A (en) * | 1978-02-08 | 1979-08-21 | Hitachi Ltd | Voltage-current converting circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58208621A (ja) | 1983-12-05 |
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