JPS5831546B2 - コシヨウテンヒヨウテイソウチ - Google Patents
コシヨウテンヒヨウテイソウチInfo
- Publication number
- JPS5831546B2 JPS5831546B2 JP50142545A JP14254575A JPS5831546B2 JP S5831546 B2 JPS5831546 B2 JP S5831546B2 JP 50142545 A JP50142545 A JP 50142545A JP 14254575 A JP14254575 A JP 14254575A JP S5831546 B2 JPS5831546 B2 JP S5831546B2
- Authority
- JP
- Japan
- Prior art keywords
- surge
- circuit
- output
- locating device
- point locating
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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Description
【発明の詳細な説明】
本発明は故障点標定精度の向上を図るようにしたサージ
受信方式の故障点標定装置に関するものである。
受信方式の故障点標定装置に関するものである。
従来、サージ受信方式の送電線故障点標定装置は、送電
線路の故障時に発生するサージを線路の両端の電気所で
捕え、そのサージの到着時間差から故障点までの距離を
標定できるようにしである。
線路の故障時に発生するサージを線路の両端の電気所で
捕え、そのサージの到着時間差から故障点までの距離を
標定できるようにしである。
したがって、この種の故障点標定装置においては故障（
せん絡）時点の同一サージを両端電気所で捕えることが
必要条件となる。
せん絡）時点の同一サージを両端電気所で捕えることが
必要条件となる。
しかし線路のせん絡時のサージ波形は複雑な場合が多く
、特に雷によるせん絡時のサージ波形としては第１図に
示す如く高周波振動をともなって上昇した後、せん絡に
整向すると思われる波形が多数実測されている。
、特に雷によるせん絡時のサージ波形としては第１図に
示す如く高周波振動をともなって上昇した後、せん絡に
整向すると思われる波形が多数実測されている。
したがって、このようなサージが送電線路を伝播すると
その過程でサージが減衰して電気所に到達するため、線
路の故障地点（せん終点）が異なれば、当然両電気所に
到達するサージのレベルも異なってくる。
その過程でサージが減衰して電気所に到達するため、線
路の故障地点（せん終点）が異なれば、当然両電気所に
到達するサージのレベルも異なってくる。
このため、第２図に示す如く、例えばＡ電気所では前駆
サージを、またＢ電気所ではせん絡サージを検出するこ
とになり、標定値としては図示ｔｆ２の誤差を生じて故
障点標定精度が低いのが欠点とされている。
サージを、またＢ電気所ではせん絡サージを検出するこ
とになり、標定値としては図示ｔｆ２の誤差を生じて故
障点標定精度が低いのが欠点とされている。
本発明の上記の欠点を除去するためになされたもので、
送電線路のせん絡時の前駆サージのレベルを低減させて
せん絡時点のサージを検出し、さらにこの検出したサー
ジについて立上り原点を検出することにより、故障点標
定精度の向上を図ることができる故障点標定装置を提供
することを目的とする。
送電線路のせん絡時の前駆サージのレベルを低減させて
せん絡時点のサージを検出し、さらにこの検出したサー
ジについて立上り原点を検出することにより、故障点標
定精度の向上を図ることができる故障点標定装置を提供
することを目的とする。
以下図面を参照して本発明の一実施例を説明する。
第３図はＢ形故障点標定装置の受信装置（親局）に本発
明を適用した回路例を示すものである。
明を適用した回路例を示すものである。
即ち、第３図において、５ＵＲＡＤＪはサージ入力が加
えられるレベル設定器で、このレベル設定器５ＵＲＡＤ
Ｊの出力を差動回路ＤＥＦの一方の入力端子に加えると
共に図示極性のダイオードＲｆ１を並列接続した積分回
路ＩＮに加え、その出力を差動回路ＤＥＦの他方の入力
端子に加える。
えられるレベル設定器で、このレベル設定器５ＵＲＡＤ
Ｊの出力を差動回路ＤＥＦの一方の入力端子に加えると
共に図示極性のダイオードＲｆ１を並列接続した積分回
路ＩＮに加え、その出力を差動回路ＤＥＦの他方の入力
端子に加える。
上記積分回路ＩＮはサージを積分して急使な波形を緩や
かな波形に修正するものであり、また差動回路ＤＥＦは
レベル設定器５ＵＲＡＤＪの出力と積分回路ＩＮの出力
との差電圧を得るものである。
かな波形に修正するものであり、また差動回路ＤＥＦは
レベル設定器５ＵＲＡＤＪの出力と積分回路ＩＮの出力
との差電圧を得るものである。
この差動回路ＤＥＦの出力を２段のレベル比較器ＣＯＭ
Ｐ−Ｌ、ＣＯＭＰ−Ｈに加え、それぞれレベル比較設定
電圧ＶＬ、ＶＨとそれぞれ比較検出する。
Ｐ−Ｌ、ＣＯＭＰ−Ｈに加え、それぞれレベル比較設定
電圧ＶＬ、ＶＨとそれぞれ比較検出する。
レベル比較器ＣＯＭＰ−Ｌ、ＣＯＭＰ−Ｈの出力をメモ
リ回路Ｍｌ、Ｍ２に加え、その出力をアンド回路ＡＮＤ
１ 、ＡＮＤ２に加える。
リ回路Ｍｌ、Ｍ２に加え、その出力をアンド回路ＡＮＤ
１ 、ＡＮＤ２に加える。
また一方ノアンド回路ＡＮＤＩにはクロックパルス発生
器ＣＰ１の出力と、ノット回路Ｎ０ＴＩを介して得た前
記メモリー回路Ｍ２の出力をそれぞれ加える。
器ＣＰ１の出力と、ノット回路Ｎ０ＴＩを介して得た前
記メモリー回路Ｍ２の出力をそれぞれ加える。
他方のアンド回路ＡＮＤ２にはクロックパルス発振器Ｃ
Ｐ２の出力と、返送信号を信号波増巾器ＳＩＧＡＭＰに
より増幅して加えられたメモリー回路Ｍ３よりノット・
回路Ｎ０Ｔ２を介して得られた出力をそれぞれ加える。
Ｐ２の出力と、返送信号を信号波増巾器ＳＩＧＡＭＰに
より増幅して加えられたメモリー回路Ｍ３よりノット・
回路Ｎ０Ｔ２を介して得られた出力をそれぞれ加える。
これらアンド回路ＡＮＤＩ 、ＡＮＤ２の出力をオア回
路ＯＲＩを介してカウンタ←Ｃ０ＵＮに加える。
路ＯＲＩを介してカウンタ←Ｃ０ＵＮに加える。
次に上記のように構成された受信装置の作用を第４図に
示す各部の動作タイミングチャートを参照しながら述べ
る。
示す各部の動作タイミングチャートを参照しながら述べ
る。
先ず、サージ人力■がレベル設定器５ＵＲＡＤＪに加わ
ると、このサージ人力■はレベル設定器５ＵＲＡＤＪに
よりレベルが設定された後、その出力■は差動回路ＤＥ
Ｆ、積分回路ＩＮ１ダイオードＲｆ１に与えられる。
ると、このサージ人力■はレベル設定器５ＵＲＡＤＪに
よりレベルが設定された後、その出力■は差動回路ＤＥ
Ｆ、積分回路ＩＮ１ダイオードＲｆ１に与えられる。
すると積分回路ＩＮでは第４図ａに示すようにサージを
積分して急使た波形や緩やかた波形に修正し、その出力
■が差動回路ＤＥＦに加わる。
積分して急使た波形や緩やかた波形に修正し、その出力
■が差動回路ＤＥＦに加わる。
この差動回路ＤＥＦではレベル設定器５ＵＲＡＤＪの出
力■と積分回路ＩＮの出力■とにより、出力■として第
４図すに示すような差電圧を得る。
力■と積分回路ＩＮの出力■とにより、出力■として第
４図すに示すような差電圧を得る。
したがって、この差動出力■で得られるサージ成分とし
てはサージ人力■−積分回路出力■ 一差動回路出力■ となり、第４図すからも明らかな如く前駆サージの直流
重畳外のうち、直流上昇分が相殺される。
てはサージ人力■−積分回路出力■ 一差動回路出力■ となり、第４図すからも明らかな如く前駆サージの直流
重畳外のうち、直流上昇分が相殺される。
コノことにより、実質的には前駆サージのレベルを低減
させたことと等価になり、次段のレベル比ン 較器ＣＯ
ＭＰ−Ｌ 、ＣＯＭＰ−Ｈにおいて、せん終点のサージ
検出が可能となる。
させたことと等価になり、次段のレベル比ン 較器ＣＯ
ＭＰ−Ｌ 、ＣＯＭＰ−Ｈにおいて、せん終点のサージ
検出が可能となる。
今、レベル比較器ＣＯＭＰ−Ｌ、ＣＯＭＰ−Ｈのレベル
比較設定電圧ＶＬ■、ＶＨ■の関係が第４図Ｃに示す如
くＨ −ＶＬ＝−に設定しであるものとする。
比較設定電圧ＶＬ■、ＶＨ■の関係が第４図Ｃに示す如
くＨ −ＶＬ＝−に設定しであるものとする。
従って差動回路ＤＥＦの出力＠が前駆サージ期間ｔｆの
ものであれば、この時の差動出力はレベル比較器ＣＯＭ
Ｐ−Ｌのレベル設定電圧ＶＬよりも小さいので、このレ
ベル比較器ＣＯＭＰ−Ｌからは出力が送出されない。
ものであれば、この時の差動出力はレベル比較器ＣＯＭ
Ｐ−Ｌのレベル設定電圧ＶＬよりも小さいので、このレ
ベル比較器ＣＯＭＰ−Ｌからは出力が送出されない。
また差動回路ＤＥＦよりせん絡サージに対応する出力が
時点ｔ。
時点ｔ。
より現われ上昇して行くが、その上昇期間ｔ１はパル比
較器ＣＯＭＰ−Ｌのレベル設定電圧ＶＬよりも小さいの
で、この上昇期間ｔ１に対してもレベル比較器ＣＯＭＰ
−Ｌからは出力が送出されない。
較器ＣＯＭＰ−Ｌのレベル設定電圧ＶＬよりも小さいの
で、この上昇期間ｔ１に対してもレベル比較器ＣＯＭＰ
−Ｌからは出力が送出されない。
差動回路ＤＥＦの出力が上昇期間ｔ１を過ぎてレベル設
定電圧ＶＬより大きくなると、レベル検出器ＣＯＭＰ−
Ｌが検出動作し、その出力■（第４図ｄ参照）によりメ
モリ回路Ｍ１を動作させる。
定電圧ＶＬより大きくなると、レベル検出器ＣＯＭＰ−
Ｌが検出動作し、その出力■（第４図ｄ参照）によりメ
モリ回路Ｍ１を動作させる。
そしてこのメモリー回路Ｍ１の出力■はアンド回路ＡＮ
ＤＩにクロックパルス発生器ＣＰＩの出力とメモリー回
路Ｍ２の出力［相］をノット回路Ｎ０Ｔ１により反転し
て得られた出力０と共に加えられる。
ＤＩにクロックパルス発生器ＣＰＩの出力とメモリー回
路Ｍ２の出力［相］をノット回路Ｎ０Ｔ１により反転し
て得られた出力０と共に加えられる。
したがって、このアンド回路ＡＮＤ１はアンド条件が成
立するのでその出力＠はオア回路ＯＲＩを介してカウン
ターＣ０ＵＮに送り込まれる。
立するのでその出力＠はオア回路ＯＲＩを介してカウン
ターＣ０ＵＮに送り込まれる。
やがて差動回路ＤＥＦの出力がレベル設定電圧ＶＬを越
えて次段のレベル設定電圧ＶＨに至る期間ｔ２を経過す
ると、レベル比較器ＣＯＭＰ−Ｈがその時の差動回路Ｄ
ＥＦの出力により動作し、その出力■がメモリー回路Ｍ
２に与えられる。
えて次段のレベル設定電圧ＶＨに至る期間ｔ２を経過す
ると、レベル比較器ＣＯＭＰ−Ｈがその時の差動回路Ｄ
ＥＦの出力により動作し、その出力■がメモリー回路Ｍ
２に与えられる。
するとこのメモリー回路Ｍ２は動作し、その動作出力［
相］がノット回路Ｎ０Ｔ１により反転されてアンド回路
ＡＮＤ１に加わるので、このアンド回路ＡＮＤ１のアン
ド条件は不成立になり、カウンターＣ０ＵＮは計数動作
を停止する。
相］がノット回路Ｎ０Ｔ１により反転されてアンド回路
ＡＮＤ１に加わるので、このアンド回路ＡＮＤ１のアン
ド条件は不成立になり、カウンターＣ０ＵＮは計数動作
を停止する。
これと同時にメモリー回路Ｍ２の出力［相］がアンド回
路ＡＮＤ２にノット回路Ｎ０Ｔ２の出力＠及びクロック
パルス発生器ＣＰ２の出力と共に加わるので、アンド回
路ＡＮＤ２のアンド条件が成立し、その出力０がオア回
路ＯＲ１を介してカウンターＣ０ＵＮに送り込まれる。
路ＡＮＤ２にノット回路Ｎ０Ｔ２の出力＠及びクロック
パルス発生器ＣＰ２の出力と共に加わるので、アンド回
路ＡＮＤ２のアンド条件が成立し、その出力０がオア回
路ＯＲ１を介してカウンターＣ０ＵＮに送り込まれる。
ここで、カウンターＣ０ＵＮの計数動作としては前記ク
ロックパルス発振器ＣＰ１とＣＦ２のパルス周波数の関
係をｆ１＝２ｆ２としであるので、レベル比較器ＣＯＭ
Ｐ−Ｌが動作してから次段のレベル比較器ＣＯＭＰ−Ｈ
が動作するまでの期間ｔ２は、レベル比較器ＣＯＭＰ−
Ｈの動作後の計数動作に比べ２倍の速度となる。
ロックパルス発振器ＣＰ１とＣＦ２のパルス周波数の関
係をｆ１＝２ｆ２としであるので、レベル比較器ＣＯＭ
Ｐ−Ｌが動作してから次段のレベル比較器ＣＯＭＰ−Ｈ
が動作するまでの期間ｔ２は、レベル比較器ＣＯＭＰ−
Ｈの動作後の計数動作に比べ２倍の速度となる。
したがって、レベル比較器ＣＯＭＰ−ＬとＣＯＭＰ−Ｈ
のレベル設Ｈ 定電圧ＶＬ 、ＶＨの関係がＶＬ＝−としであることか
ら、上記期間ｔ１とｔ２は等しくなり、また期間ｔ２に
おけるカウンターＣ０ＵＮの計数動作はレベル比較器Ｃ
ＯＭＰ−Ｈの動作後の計数動作に比べ２倍の速度にしで
あるので、結果的には差動回路ＤＥＦよりせん絡サージ
に対応する出力が現われる時点ｔ。
のレベル設Ｈ 定電圧ＶＬ 、ＶＨの関係がＶＬ＝−としであることか
ら、上記期間ｔ１とｔ２は等しくなり、また期間ｔ２に
おけるカウンターＣ０ＵＮの計数動作はレベル比較器Ｃ
ＯＭＰ−Ｈの動作後の計数動作に比べ２倍の速度にしで
あるので、結果的には差動回路ＤＥＦよりせん絡サージ
に対応する出力が現われる時点ｔ。
力ろ期間１＝１１＋１２をクロックパルス発生器ＣＰ２
のパルス周波数ｆ２で計数したのと等価になる。
のパルス周波数ｆ２で計数したのと等価になる。
したがって、レベル比較器ＣＯＭＰ−Ｌが動作してから
レベル比較器ＣＯＭＰ−Ｈが動作するまでの期間ｔ２、
すなわち２点レベルの検出時間差からせん絡サージの立
上り時点ｔ。
レベル比較器ＣＯＭＰ−Ｈが動作するまでの期間ｔ２、
すなわち２点レベルの検出時間差からせん絡サージの立
上り時点ｔ。
を検出することができる。一方相手端送信装置から返信
信号［相］が送られてくると、この信号［相］（第４図
ｅ参照）は信号波増幅器Ｓ Ｉ ＧＡＭＰにより必要に
応じた大きさに増幅し、その出力［相］によりメモリー
回路Ｍ３を動作させる。
信号［相］が送られてくると、この信号［相］（第４図
ｅ参照）は信号波増幅器Ｓ Ｉ ＧＡＭＰにより必要に
応じた大きさに増幅し、その出力［相］によりメモリー
回路Ｍ３を動作させる。
したがって、このメモリー回路Ｍ３の動作出力■はノッ
ト回路Ｎ０Ｔ２により反転された出力［相］となってア
ンド回路ＡＮＤ２に加わるので、このアンド回路ＡＮＤ
２のアンド条件が不成立となり、カウンターＣ０ＵＮの
計数動作が停止する。
ト回路Ｎ０Ｔ２により反転された出力［相］となってア
ンド回路ＡＮＤ２に加わるので、このアンド回路ＡＮＤ
２のアンド条件が不成立となり、カウンターＣ０ＵＮの
計数動作が停止する。
なお、上記実施例で述べたＢ形故障点標定装置のシステ
ムとしては当然のことたがら相手端に送信装置が設置さ
れているが、ここでは相手端送信装置の説明を省略する
。
ムとしては当然のことたがら相手端に送信装置が設置さ
れているが、ここでは相手端送信装置の説明を省略する
。
以上述べたように本発明によれば、サージ入力を積分器
により積分し、この積分器の出力とサージ入力との差を
小さくして送電線路のせん絡時の前駆サージのレベル低
下を図るようにしたので、それだけせん絡サージの検出
精度が向上し、さらにせん絡サージを２点レベル検出し
てその２点の検出時間差からサージの立上り原点を検出
するようにしたので、さらにその精度の向上を図ること
ができる故障点標定装置が提供できる。
により積分し、この積分器の出力とサージ入力との差を
小さくして送電線路のせん絡時の前駆サージのレベル低
下を図るようにしたので、それだけせん絡サージの検出
精度が向上し、さらにせん絡サージを２点レベル検出し
てその２点の検出時間差からサージの立上り原点を検出
するようにしたので、さらにその精度の向上を図ること
ができる故障点標定装置が提供できる。
第１図はせん緒言サージの実測波形図、第２図は送電線
の両端電気所でのサージ検出例の説明図、第３図は本発
明による送電線故障点標定装置の一実施例を示すブロッ
ク図、第４図ａ −ｅは同実施例の各部の動作タイミン
グチャートを示すものである。 ＩＮ・・・・・・積分回路、ＤＥＦ・・・・・・差動回
路、ＣＯＭＰ−Ｌ、ＣＯＭＰ−Ｈ・・・・・・レベル比
較器、Ｍ１〜Ｍ３・・・・・・メモリー回路、ＡＮＤｌ
、ＡＮＤ２・・・・・・アンド回路、ＮＯＴ １ 、
ＮＯＴ ２・・・・・ラット回路、ＣＰＩ 、ＣＦ２・
・・・・・クロックパルス発生器、Ｃ０ＵＮ・・・・・
・カウンター。
の両端電気所でのサージ検出例の説明図、第３図は本発
明による送電線故障点標定装置の一実施例を示すブロッ
ク図、第４図ａ −ｅは同実施例の各部の動作タイミン
グチャートを示すものである。 ＩＮ・・・・・・積分回路、ＤＥＦ・・・・・・差動回
路、ＣＯＭＰ−Ｌ、ＣＯＭＰ−Ｈ・・・・・・レベル比
較器、Ｍ１〜Ｍ３・・・・・・メモリー回路、ＡＮＤｌ
、ＡＮＤ２・・・・・・アンド回路、ＮＯＴ １ 、
ＮＯＴ ２・・・・・ラット回路、ＣＰＩ 、ＣＦ２・
・・・・・クロックパルス発生器、Ｃ０ＵＮ・・・・・
・カウンター。
Claims (1)
- 【特許請求の範囲】 １ 送電線路の故障時に発生するサージを線路端の電気
所で捕え、そのサージの到着時間差から故障点までの距
離を標定するようにしたサージ受信方式の故障点標定装
置において、サージ受信入力部に、前駆サージ及び閃絡
サージを積分する積分回路と、この積分回路より得られ
るサージ入力に対する積分出力と直接受信波形との差を
取出して標定器に起動入力として与える差動回路とを設
けるようにしたことを特徴とする故障点標定装置。 ２ 送電線路の故障時に発生するサージを線路端の電気
所で捕え、そのサージの到着時間差から故障点までの距
離を標定するようにした故障点標定装置において、サー
ジ受信入力部に、前駆サージ及び閃絡サージを積分する
積分回路と、この積分回路より得られるサージ人力／１
ζ対する積分出力と直接受信波形との差を取出す差動回
路と、この差動回路の差動出力を２点レベル検出してそ
の２点の検出時間差からサージの立上り原点を検出する
回路とを設けるようにしたことを特徴とする故障点標定
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP50142545A JPS5831546B2 (ja) | 1975-11-29 | 1975-11-29 | コシヨウテンヒヨウテイソウチ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP50142545A JPS5831546B2 (ja) | 1975-11-29 | 1975-11-29 | コシヨウテンヒヨウテイソウチ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5266307A JPS5266307A (en) | 1977-06-01 |
| JPS5831546B2 true JPS5831546B2 (ja) | 1983-07-06 |
Family
ID=15317832
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP50142545A Expired JPS5831546B2 (ja) | 1975-11-29 | 1975-11-29 | コシヨウテンヒヨウテイソウチ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5831546B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53121141A (en) * | 1977-03-30 | 1978-10-23 | Fujitsu Ltd | Transmission line fault point locating method |
-
1975
- 1975-11-29 JP JP50142545A patent/JPS5831546B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5266307A (en) | 1977-06-01 |
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