JPS58224413A - 磁気記録回路 - Google Patents
磁気記録回路Info
- Publication number
- JPS58224413A JPS58224413A JP10814182A JP10814182A JPS58224413A JP S58224413 A JPS58224413 A JP S58224413A JP 10814182 A JP10814182 A JP 10814182A JP 10814182 A JP10814182 A JP 10814182A JP S58224413 A JPS58224413 A JP S58224413A
- Authority
- JP
- Japan
- Prior art keywords
- data
- current source
- recording
- pulse train
- current
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/02—Recording, reproducing, or erasing methods; Read, write or erase circuits therefor
- G11B5/09—Digital recording
Landscapes
- Digital Magnetic Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は磁気記録媒体のマルチトラックにパルストレイ
ン記録により記録を行うようにした磁気記録回路に関す
る。
ン記録により記録を行うようにした磁気記録回路に関す
る。
ディジタル磁気記録を行う場合、通常は第１図Ａに示す
ような矩形波の交番電流をヘッドに流すことにより、磁
気テープ上に同図Ｂに示すような残留磁化を残すように
している。これに対して上記矩形波電流に代えて第１図
Ｃに示すように点線で示す包絡線が上記矩形波と等しく
なるような正負のパルス列′亀流をヘッドに流すこさに
よっても、同図Ｂと略等しい形の残留磁化が得ら’４す
ることが ゛知られている。この方法はパルストレ
イン記録と呼ばれ、クロストークの軽減、消費電力の低
減等の利点を有している。
ような矩形波の交番電流をヘッドに流すことにより、磁
気テープ上に同図Ｂに示すような残留磁化を残すように
している。これに対して上記矩形波電流に代えて第１図
Ｃに示すように点線で示す包絡線が上記矩形波と等しく
なるような正負のパルス列′亀流をヘッドに流すこさに
よっても、同図Ｂと略等しい形の残留磁化が得ら’４す
ることが ゛知られている。この方法はパルストレ
イン記録と呼ばれ、クロストークの軽減、消費電力の低
減等の利点を有している。
磁気テープ上のマルチトラックにディジタル記録を行う
場合、第１図Ａの通常の矩形波記録を行つと、各チャン
ネルに流れる’［ｆｉは連続的となるので、駆動回路が
複雑となり、また消費電力も増大する。パルストレイン
記録を行う場合でも谷チャンネル毎にディジタルデータ
で制御される電流源と駆動回路とが必要になり、やはり
複雑な回路構成となる。特にディジタルオーディオ信号
を記録する場合は、例えば１６ビツトのデータを１６ト
ラツクに記録するため、回路規模が非常に太きくなり実
現が極めて困難である。
場合、第１図Ａの通常の矩形波記録を行つと、各チャン
ネルに流れる’［ｆｉは連続的となるので、駆動回路が
複雑となり、また消費電力も増大する。パルストレイン
記録を行う場合でも谷チャンネル毎にディジタルデータ
で制御される電流源と駆動回路とが必要になり、やはり
複雑な回路構成となる。特にディジタルオーディオ信号
を記録する場合は、例えば１６ビツトのデータを１６ト
ラツクに記録するため、回路規模が非常に太きくなり実
現が極めて困難である。
本発明は一つの電流源を用いてマルチトラックのパルス
トレイン記録を行うよう壷こした磁気記録面Ｍを提供す
るもので、以下本発明の夾施例を図面と共に説明する。
トレイン記録を行うよう壷こした磁気記録面Ｍを提供す
るもので、以下本発明の夾施例を図面と共に説明する。
第２図はパルストレイン記録によりテープ上の４本のト
ラックを記録ヘッドｍ ｆ２＋ （３）（４）ｌこより
記録する場合の駆動回路を示す。
ラックを記録ヘッドｍ ｆ２＋ （３）（４）ｌこより
記録する場合の駆動回路を示す。
この回路は、Ｄ型フリップフロップ（以下ＭＩＬ ニＦ
Ｆと言う）（５）から得られるシリアルデータ８Ｄ１に
よりヘッド電流源（６）を制御すること（こよって、％
記録ヘッド（１）〜（４）に順次に矢印ａ又はｂて示す
方向に′に流を流すようにしたものである。各記録ヘッ
ド（１１〜（４）はトランジスタＴ１〜Ｔ４が順次に所
定期間づつ導通すること（こよってｔ流が流される。
Ｆと言う）（５）から得られるシリアルデータ８Ｄ１に
よりヘッド電流源（６）を制御すること（こよって、％
記録ヘッド（１）〜（４）に順次に矢印ａ又はｂて示す
方向に′に流を流すようにしたものである。各記録ヘッ
ド（１１〜（４）はトランジスタＴ１〜Ｔ４が順次に所
定期間づつ導通すること（こよってｔ流が流される。
以下第３図のタイミングチャートを参照して第２図の回
路の構成及び動作を説明する。
路の構成及び動作を説明する。
基準発振器（７）は第３図Ａ＃こ示すクロックパルスＰ
＋ｆ発振している。このタロツクパルスＰ１は％分周器
（８）により同図Ｂに示すシフトクロックパルスＰ２と
なって、ｐｐｇｏ）に加えられる。このＦＦ’ＱＯ，）
はクロックＰ１でトリガされ１、そのＱ６出力として第
６図Ｃに示すような、上記クロッ（Ｐ２の位相をクロッ
クＰ１の一周期遅らせて成るパルス列Ｐ４が得られる。
＋ｆ発振している。このタロツクパルスＰ１は％分周器
（８）により同図Ｂに示すシフトクロックパルスＰ２と
なって、ｐｐｇｏ）に加えられる。このＦＦ’ＱＯ，）
はクロックＰ１でトリガされ１、そのＱ６出力として第
６図Ｃに示すような、上記クロッ（Ｐ２の位相をクロッ
クＰ１の一周期遅らせて成るパルス列Ｐ４が得られる。
このパルス列Ｐ４はインバータα場で反転され、Ｌとな
ってトランジスタＴ５のゲートに加えられる。
ってトランジスタＴ５のゲートに加えられる。
上記クロックＰ２はさらに前記Ｆ Ｆ ｆ５）をトリガ
すると共にワードクロック発生回路（９）とシフトレジ
スタ（１１）とに加えられる。ワードクロック発生回路
（９）からは上記クロックＰ２の４個に１個の割合で第
３図Ｆに示すワードクロックパルスＰ３が得られ、この
クロックＰ５はシフトレジスタ０１）（こ加えうｆｔ、
ル。
すると共にワードクロック発生回路（９）とシフトレジ
スタ（１１）とに加えられる。ワードクロック発生回路
（９）からは上記クロックＰ２の４個に１個の割合で第
３図Ｆに示すワードクロックパルスＰ３が得られ、この
クロックＰ５はシフトレジスタ０１）（こ加えうｆｔ、
ル。
シフトレジスタＱｌ）は夫々前記クロックＰ２でトリガ
される４個のＦＦ（１２１〜（１５）で構成きれている
。そして谷ＦＦ（ｌり〜ａ句のＱ１〜Ｑ４出力として第
３図Ｇ、 ＨｌＩ、Ｊに示すようなタロツクＰ３の位桓
を順次にクロックＰ２の一周期ずつ遅らせて成るクロッ
クパルスＰ５１〜Ｐ５４が得られる。これらのクロック
ＰＡ１〜Ｐ５４はトランジスタＴ１〜Ｔ４のゲートに加
えられて、これらのトランジスタＴ１〜Ｔ４を順次に導
通させる。
される４個のＦＦ（１２１〜（１５）で構成きれている
。そして谷ＦＦ（ｌり〜ａ句のＱ１〜Ｑ４出力として第
３図Ｇ、 ＨｌＩ、Ｊに示すようなタロツクＰ３の位桓
を順次にクロックＰ２の一周期ずつ遅らせて成るクロッ
クパルスＰ５１〜Ｐ５４が得られる。これらのクロック
ＰＡ１〜Ｐ５４はトランジスタＴ１〜Ｔ４のゲートに加
えられて、これらのトランジスタＴ１〜Ｔ４を順次に導
通させる。
一方、前記Ｆ’ Ｆ （５１のＤ端子にはＡ／Ｄ変換器
等のデータ源＋２ＱよりシリアルデータＳＤＯか加えら
れている。このデー’ｉｌ ８ｎｏかＦ Ｆ （５１で
クロックＰ２の一周期分ずらされることにより、このＦ
Ｆ’（５１のｑ出力として第６図りに示すシリアルデー
タＳＤ１が得られる。このデータＳＤＩはクロックＰ２
の一周期毎に１〜４ｃｈのデータが順次に宍現されてい
るもので、図示のデータ例をテープに記録すると第４図
に示すように記録されることになる。第４図のテープＣ
Ｄにおいては、ｒＨＪ （高レベル）、ｒＬＪ（低レベ
ル）のデータ８Ｄ１が第６図りのレベル変化に応じて４
本のトラックに記録されている。この場合、パルストレ
イン記録においては各トラックの長手方向の１個のデー
タｒＨＪ又はｒＬＪか！１１００パルス列のパルス１個
と対応してよい。従って、第４図の場合は１個以上のデ
ータでデータＳＤＩの１ビツトが構成される。
等のデータ源＋２ＱよりシリアルデータＳＤＯか加えら
れている。このデー’ｉｌ ８ｎｏかＦ Ｆ （５１で
クロックＰ２の一周期分ずらされることにより、このＦ
Ｆ’（５１のｑ出力として第６図りに示すシリアルデー
タＳＤ１が得られる。このデータＳＤＩはクロックＰ２
の一周期毎に１〜４ｃｈのデータが順次に宍現されてい
るもので、図示のデータ例をテープに記録すると第４図
に示すように記録されることになる。第４図のテープＣ
Ｄにおいては、ｒＨＪ （高レベル）、ｒＬＪ（低レベ
ル）のデータ８Ｄ１が第６図りのレベル変化に応じて４
本のトラックに記録されている。この場合、パルストレ
イン記録においては各トラックの長手方向の１個のデー
タｒＨＪ又はｒＬＪか！１１００パルス列のパルス１個
と対応してよい。従って、第４図の場合は１個以上のデ
ータでデータＳＤＩの１ビツトが構成される。
上記データ８Ｄ１（まヘッド電流源（６）を制御して、
その出力端子（２’４（Ａｉこ得られる出力電流ＩＯの
方向をデータの内容に応じて制御する。この結果、上記
出力′＃を流Ｉｏとして第３図Ｅに示すようなデータ８
ｎｉに応じたものが得られ、この出力電流ＩＯかヘッド
（１１〜（４）に供給される。
その出力端子（２’４（Ａｉこ得られる出力電流ＩＯの
方向をデータの内容に応じて制御する。この結果、上記
出力′＃を流Ｉｏとして第３図Ｅに示すようなデータ８
ｎｉに応じたものが得られ、この出力電流ＩＯかヘッド
（１１〜（４）に供給される。
先ず、ヘッド（１）〜（４）と並列に接続されているト
ランジスタＴ５が省略されているものとして説明する。
ランジスタＴ５が省略されているものとして説明する。
ヘッド（１）〜（４）は夫々トランジスタＴ１〜Ｔ４が
導通されることによって通電され、トランジスタＴ１〜
Ｔ４はクロックＰ５１〜Ｐ３４ ＃こよってクロックＰ
２の一周期だけ順次に導通ずる。従って、各ヘッド（１
）〜（４）には第６図に、Ｌ％Ｍ、Ｎに示すようなヘッ
ド電流が流れる。これらの各ヘッド電流は上記出力電流
■ｏから対応するチャンネルの分を抜き取った形となっ
ており、これ（こよって第４内（こ示す記録が成される
。
導通されることによって通電され、トランジスタＴ１〜
Ｔ４はクロックＰ５１〜Ｐ３４ ＃こよってクロックＰ
２の一周期だけ順次に導通ずる。従って、各ヘッド（１
）〜（４）には第６図に、Ｌ％Ｍ、Ｎに示すようなヘッ
ド電流が流れる。これらの各ヘッド電流は上記出力電流
■ｏから対応するチャンネルの分を抜き取った形となっ
ており、これ（こよって第４内（こ示す記録が成される
。
次（こトランジスタＴ５を接続した場合について説明す
る。
る。
ヘッド電流源（６）の反転速度が速い場合、その出力電
流■ｏは第５図Ａに示すものとなる。このとき例えば第
ｉｃｈについて考えると、トランジスタＴ１を導通させ
るクロックＰ３１ のタイミングが第５図Ｂのようにず
れた場合は、ヘッド（１）には第５図Ｃのように隣接ナ
ヤン不ルからの不必要なヒゲ状パルスｐがクロストーク
として流れてしまう。このようなパルスｐは磁気記録上
好ましくない。上記トランジスタＴ５はこの問題を解決
するために設けられたものである。
流■ｏは第５図Ａに示すものとなる。このとき例えば第
ｉｃｈについて考えると、トランジスタＴ１を導通させ
るクロックＰ３１ のタイミングが第５図Ｂのようにず
れた場合は、ヘッド（１）には第５図Ｃのように隣接ナ
ヤン不ルからの不必要なヒゲ状パルスｐがクロストーク
として流れてしまう。このようなパルスｐは磁気記録上
好ましくない。上記トランジスタＴ５はこの問題を解決
するために設けられたものである。
前記インバータ四からは前記パルス列Ｐ４を反転した第
６図Ａに示すパルス列Ｐ４が得られる。尚、第６図Ｂ、
Ｃ％Ｄ、 Ｅは第３図に、Ｌ、Ｍ、Ｎと対応する各ヘッ
ド電流を示す。上記パルス列Ｐ４はトランジスタＴｂｆ
スイッチングする。ここでトランジスタＴ５のインピー
ダンスを、谷ヘッド（１）〜（４）とトランジスタＴ１
〜Ｔ４との各組のインピーダンスよりも充分小さくして
おけば、トランジスタＴ５が導通する期間、即ち、パル
ス列Ｐ４の「Ｈ」期間はヘッド（１）〜（４）には１ｔ
ｔＮ、か流れない。図示のようにパルス列Ｐ４のｒＨＪ
期間は同図Ｂ、Ｅの電流波形の両側部分とこのＰ４のｈ
周期で重なるタイミングで形成されている。このためＴ
１〜Ｔ４は実際にはＰ４のｒＬＪ期間で導通する。これ
によってヘッド（１）〜（４）に実際に流れる＊流は同
図Ｆ、Ｇ、Ｉ（、Ｉに示す波形となる。従って、トラン
ジスタＴ１〜Ｔ４を導通させるクロックＰ５１〜Ｐ５４
が若干ずれても、ずれた区間の電流はトランジスタＴ５
に流れるので、第５図Ｃのようなヒゲ状パルスｐを除去
することができる。
６図Ａに示すパルス列Ｐ４が得られる。尚、第６図Ｂ、
Ｃ％Ｄ、 Ｅは第３図に、Ｌ、Ｍ、Ｎと対応する各ヘッ
ド電流を示す。上記パルス列Ｐ４はトランジスタＴｂｆ
スイッチングする。ここでトランジスタＴ５のインピー
ダンスを、谷ヘッド（１）〜（４）とトランジスタＴ１
〜Ｔ４との各組のインピーダンスよりも充分小さくして
おけば、トランジスタＴ５が導通する期間、即ち、パル
ス列Ｐ４の「Ｈ」期間はヘッド（１）〜（４）には１ｔ
ｔＮ、か流れない。図示のようにパルス列Ｐ４のｒＨＪ
期間は同図Ｂ、Ｅの電流波形の両側部分とこのＰ４のｈ
周期で重なるタイミングで形成されている。このためＴ
１〜Ｔ４は実際にはＰ４のｒＬＪ期間で導通する。これ
によってヘッド（１）〜（４）に実際に流れる＊流は同
図Ｆ、Ｇ、Ｉ（、Ｉに示す波形となる。従って、トラン
ジスタＴ１〜Ｔ４を導通させるクロックＰ５１〜Ｐ５４
が若干ずれても、ずれた区間の電流はトランジスタＴ５
に流れるので、第５図Ｃのようなヒゲ状パルスｐを除去
することができる。
第７図は上記パルスｐを除去するための第２の実施例の
原理を説明するためのタイミングチャートである。
原理を説明するためのタイミングチャートである。
第７図Ａは第６図Ａと同じパルス列Ｐ４を示し、第７図
Ｂは第３図Ｆと同じデータＳＤ１を示す。本ＳＤ１′を
得、このデータＳＤ１′でヘッド電流＃（６）を制御す
るようにしたものである。この結果、ヘッド電流源（６
）からは第７図りに示すような上記レベル変化部分の電
流がゼロとなるような出力電流Ｉｏ′を得ることかでき
る。
Ｂは第３図Ｆと同じデータＳＤ１を示す。本ＳＤ１′を
得、このデータＳＤ１′でヘッド電流＃（６）を制御す
るようにしたものである。この結果、ヘッド電流源（６
）からは第７図りに示すような上記レベル変化部分の電
流がゼロとなるような出力電流Ｉｏ′を得ることかでき
る。
次にヘッド電流源（６）の回路の実施例を第８〜１１図
について説明する。
について説明する。
第８図の回路はトランジスタＴ６〜Ｔ９、インバー
′夕（２４１及び定ＩＩ渾源（２１により構成されて
いる。入力端子０Ｉｉ）にデータＳＤ１か入力されると
、トランジスタＴ６、Ｔ９と’ｌ”、、Ｔ６とか交互に
オン・オフされて定電流源（２５）から′電流が流れ、
出力端子（２２） （２３）に出力室Ｎ、Ｉｏか得られ
る。記録電流（Ｉｏ）の大きさは定電流源（２５１の１
１流値をＷＦ４整することにより決められる。
′夕（２４１及び定ＩＩ渾源（２１により構成されて
いる。入力端子０Ｉｉ）にデータＳＤ１か入力されると
、トランジスタＴ６、Ｔ９と’ｌ”、、Ｔ６とか交互に
オン・オフされて定電流源（２５）から′電流が流れ、
出力端子（２２） （２３）に出力室Ｎ、Ｉｏか得られ
る。記録電流（Ｉｏ）の大きさは定電流源（２５１の１
１流値をＷＦ４整することにより決められる。
第９図の回路はトランジスタＴ１ｏ、’ｌ’１１の５Ｂ
ＰＰ接続を用いたもので、入力端子（２ηに加えられる
データＳＤ１はコンデンサＣ１で直流分が除去された慨
トランジスタＴｔｏ、ＴＨｆ交互にスイッチする。記録
電流の大きさは抵抗Ｒ１を調整して決められる。
ＰＰ接続を用いたもので、入力端子（２ηに加えられる
データＳＤ１はコンデンサＣ１で直流分が除去された慨
トランジスタＴｔｏ、ＴＨｆ交互にスイッチする。記録
電流の大きさは抵抗Ｒ１を調整して決められる。
第１０図の回路は上記第９図の回路の前段にコンパレー
タ（２ａｌを接続したものである。データ８Ｄ１はコン
パレータ（財）で基準電圧Ｖｓと比較され、この比較出
力でトランジスタＴ１ｏ％Ｔ１１かスイッチされる。尚
、基準電圧ＶｓはデータＳＤ１の略中心レベルに選ばれ
る。
タ（２ａｌを接続したものである。データ８Ｄ１はコン
パレータ（財）で基準電圧Ｖｓと比較され、この比較出
力でトランジスタＴ１ｏ％Ｔ１１かスイッチされる。尚
、基準電圧ＶｓはデータＳＤ１の略中心レベルに選ばれ
る。
第１１図の回路は前述した第７図の実施例に用いられる
もので、上記第１０図の回路にトランジスタＴ１２を接
続したものである。このトランジスタＴ１２のゲートに
前記パルス列′Ｐ２を加えることによって、コンパレー
タ（２印の出力データからレベル変化部分をミューティ
ングして第７図ＣのデータＳＤ１′を得る。このデータ
８Ｄ１′でトランジスタ’Ｉ’１ｏ。
もので、上記第１０図の回路にトランジスタＴ１２を接
続したものである。このトランジスタＴ１２のゲートに
前記パルス列′Ｐ２を加えることによって、コンパレー
タ（２印の出力データからレベル変化部分をミューティ
ングして第７図ＣのデータＳＤ１′を得る。このデータ
８Ｄ１′でトランジスタ’Ｉ’１ｏ。
Ｔ１１をスイッチすることによって出力端子（２３（ハ
）に第７図りの出力電流Ｉｏ′を得る。
）に第７図りの出力電流Ｉｏ′を得る。
以上述べたように本発明は、データの内容に応じてその
出力電流■ｏの方向が制御される電流源（６）を設ける
と共に、記録ヘッド（１１〜（４）とスイッチ手段（’
１’１〜Ｔ４）との直列回路の複数個を並列に接続して
成る回路を、上記電流源の出力端子（２り（ハ）に接続
して成り、上記複数個のスイッチ手段を順次に所定期間
づつ導通させるようにした磁気記録回路に係るものであ
る。
出力電流■ｏの方向が制御される電流源（６）を設ける
と共に、記録ヘッド（１１〜（４）とスイッチ手段（’
１’１〜Ｔ４）との直列回路の複数個を並列に接続して
成る回路を、上記電流源の出力端子（２り（ハ）に接続
して成り、上記複数個のスイッチ手段を順次に所定期間
づつ導通させるようにした磁気記録回路に係るものであ
る。
従って本発明によれば、ヘッド電流源が１個で済むので
回路を単純化することができる。また同時に複数チャン
ネルに電流か流れることがないので、電気系でのクロス
トークがない。さらにヘッド記録電流の設定を全チャン
ネル同時に且つ同じ値に設定することができる。
回路を単純化することができる。また同時に複数チャン
ネルに電流か流れることがないので、電気系でのクロス
トークがない。さらにヘッド記録電流の設定を全チャン
ネル同時に且つ同じ値に設定することができる。
第１図はパルストレイン記録の原理を示す波形図、ＷＦ
２図は本発明の実施例を示す回路ブロック図、第６図は
第２図の動作を説明するためのタイミングチャート、第
４図はテープの記録状態の−例を示す図、第５図は第２
図の回路の問題を説明するための波形図、第６図は上記
問題を解決する原理を説明するためのタイミングチャー
ト、第７図は上記問題を解決する他の実施例の原理を説
明するためのタイミングチャート、第８〜１０図は第２
図のヘッド電流源の実施例を示す回路図、第１１図は上
記仙の実施例に適用し得るヘッド電流源の実施例を示す
回路図である。 なお図面１こ用いられた符号（こおいて、（１）、（４
１・・・・・・・・・記録ヘッド（６）・・・・・・・
・・・・・・・・ヘッド電流源（２（沙 ・・・・・・
・・・・・・ヤ・・データ源ψυ ・・・・・・・・・
・・・・・・磁気テープＣ２２） Ｃ１！３）・・・・
・・・・・・・・出力端子Ｔ１〜Ｔ４・・・・・凹 ト
ランジスタである。 代理人 土、、屋 勝 〃 常包芳男 Ｉ 杉浦俊責 ０υ 第１図 第４図 ＜ ｍｕ １５ ｅ嬬 黄 ＜ｍｃ、） ρ 第１０図 −Ｂ 第１１図
２図は本発明の実施例を示す回路ブロック図、第６図は
第２図の動作を説明するためのタイミングチャート、第
４図はテープの記録状態の−例を示す図、第５図は第２
図の回路の問題を説明するための波形図、第６図は上記
問題を解決する原理を説明するためのタイミングチャー
ト、第７図は上記問題を解決する他の実施例の原理を説
明するためのタイミングチャート、第８〜１０図は第２
図のヘッド電流源の実施例を示す回路図、第１１図は上
記仙の実施例に適用し得るヘッド電流源の実施例を示す
回路図である。 なお図面１こ用いられた符号（こおいて、（１）、（４
１・・・・・・・・・記録ヘッド（６）・・・・・・・
・・・・・・・・ヘッド電流源（２（沙 ・・・・・・
・・・・・・ヤ・・データ源ψυ ・・・・・・・・・
・・・・・・磁気テープＣ２２） Ｃ１！３）・・・・
・・・・・・・・出力端子Ｔ１〜Ｔ４・・・・・凹 ト
ランジスタである。 代理人 土、、屋 勝 〃 常包芳男 Ｉ 杉浦俊責 ０υ 第１図 第４図 ＜ ｍｕ １５ ｅ嬬 黄 ＜ｍｃ、） ρ 第１０図 −Ｂ 第１１図
Claims (1)
- データの内容に応じてその出力電流の方向が制ツチ手段
を順次に所定期間づつ導通させるようにした磁気記録回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10814182A JPS58224413A (ja) | 1982-06-23 | 1982-06-23 | 磁気記録回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10814182A JPS58224413A (ja) | 1982-06-23 | 1982-06-23 | 磁気記録回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58224413A true JPS58224413A (ja) | 1983-12-26 |
Family
ID=14476973
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10814182A Pending JPS58224413A (ja) | 1982-06-23 | 1982-06-23 | 磁気記録回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58224413A (ja) |
-
1982
- 1982-06-23 JP JP10814182A patent/JPS58224413A/ja active Pending
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