JPS58175031A - 定電圧電源装置 - Google Patents
定電圧電源装置Info
- Publication number
- JPS58175031A JPS58175031A JP5771082A JP5771082A JPS58175031A JP S58175031 A JPS58175031 A JP S58175031A JP 5771082 A JP5771082 A JP 5771082A JP 5771082 A JP5771082 A JP 5771082A JP S58175031 A JPS58175031 A JP S58175031A
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- JP
- Japan
- Prior art keywords
- power supply
- phase
- control device
- voltage
- comparator
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/70—Regulating power factor; Regulating reactive current or power
Landscapes
- Engineering & Computer Science (AREA)
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- Automation & Control Theory (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は位相制御による定電圧電源装置に関する。
従来、この種装置としては、位相制御装置を交流電源の
半サイクルの後位相期間オンさせているものであった。
半サイクルの後位相期間オンさせているものであった。
したがって、このような定電圧電Ｉｓ装置を複数個用い
ることによって、電飾の入力力率が低Ｆするという問題
があった。
ることによって、電飾の入力力率が低Ｆするという問題
があった。
本発明は上記間融を解決するためになされたもので、交
流電源の半サイクルの前位相期間に位相制御装置をオン
させることによって入力力率の低下−を防止するととも
に、精度の高い定電圧１１１＃装置を提供することを目
的とするものである。
流電源の半サイクルの前位相期間に位相制御装置をオン
させることによって入力力率の低下−を防止するととも
に、精度の高い定電圧１１１＃装置を提供することを目
的とするものである。
本発明は位相制御装置を交流電源の半サイクルの前位期
間オンし、交流電源電圧を整流した電圧を積分して予め
設定された基準電圧と比較して両者が一致した時点で上
記位相制御装置をオフすることを特徴とするものである
。
間オンし、交流電源電圧を整流した電圧を積分して予め
設定された基準電圧と比較して両者が一致した時点で上
記位相制御装置をオフすることを特徴とするものである
。
以下、本発明の概略構成を第１図を参照して説明する。
（１）は交流電源であり、（２）はこの電源（１）から
付勢される負荷たとえば電球である。第１図において前
記電源（１）と前記負荷（２）との間に全波整流器（３
）が介在している。（４）は位相制御装置で、前記交流
電源（１）の半サイクルの萌位相期間オンするものであ
る、このような位相制御装置（４）としてはたとえばト
ランジスタ、ＧＴＯあるいはその他の半導体スイッチン
グ素子によって構成することができる。（５）は制御装
置であって、上記交流電源（１）の電圧を整流して積分
し予め設定された基準電圧と比較して上記位相制御装置
（４）をオフするものである。′＠１図において、制御
装置（５）は、前記整流器（３）の出力端子間に接続さ
れた積分回路（６）、この積分回路（６）の出力を一万
の入力端子に入力され他方の入力端子に入力される基準
電圧発生回路（力の電圧（■「）と比較し両者が一致し
たとき前記位相制御装置（４）をオフする信号を出力す
る比較器（８）とを有してなるものである。そして、＠
１図の制御装置ｆ ｆ５１は、前記比較器（８）におい
て両人力信号が一致するまでは連続した（ｆｉ号を出力
するものである。
付勢される負荷たとえば電球である。第１図において前
記電源（１）と前記負荷（２）との間に全波整流器（３
）が介在している。（４）は位相制御装置で、前記交流
電源（１）の半サイクルの萌位相期間オンするものであ
る、このような位相制御装置（４）としてはたとえばト
ランジスタ、ＧＴＯあるいはその他の半導体スイッチン
グ素子によって構成することができる。（５）は制御装
置であって、上記交流電源（１）の電圧を整流して積分
し予め設定された基準電圧と比較して上記位相制御装置
（４）をオフするものである。′＠１図において、制御
装置（５）は、前記整流器（３）の出力端子間に接続さ
れた積分回路（６）、この積分回路（６）の出力を一万
の入力端子に入力され他方の入力端子に入力される基準
電圧発生回路（力の電圧（■「）と比較し両者が一致し
たとき前記位相制御装置（４）をオフする信号を出力す
る比較器（８）とを有してなるものである。そして、＠
１図の制御装置ｆ ｆ５１は、前記比較器（８）におい
て両人力信号が一致するまでは連続した（ｆｉ号を出力
するものである。
つぎに、作用を述べる。交流電源（１）の半サイクルに
おいて、位相制御装Ｗ（４）は前位相期間オンするので
、すなわち制御装置（５）により前記半サイクルの零位
相からオンしている。一方、電源電圧を整流した電圧は
積分回路（６）によって積分される。
おいて、位相制御装Ｗ（４）は前位相期間オンするので
、すなわち制御装置（５）により前記半サイクルの零位
相からオンしている。一方、電源電圧を整流した電圧は
積分回路（６）によって積分される。
そして、この積分回路（６）の出力は比較器（８）の一
方の入力端子に入力されて基準電圧と比較される。
方の入力端子に入力されて基準電圧と比較される。
比較器（８）は、両入力電圧が一致した時点で信号を出
力するから、位相制御装置（４）はオフする。以後この
動作を交流電＃ｒｌ）の半サイクル毎に繰返して、負荷
（２）に対する供給電圧を設定値に保つことかで舞るも
のである。
力するから、位相制御装置（４）はオフする。以後この
動作を交流電＃ｒｌ）の半サイクル毎に繰返して、負荷
（２）に対する供給電圧を設定値に保つことかで舞るも
のである。
＠２図は本発明の具体的実施例を示すものである。第１
図と同じ部分には同じ符号を付して説明を省略する。本
実施例において積分回路（６）はコンデンサおよび抵抗
からなるものである。また、本実施例において、トラン
ジスタ（Ｔｒ、） Ｉ （Ｔｒ、）などからなる同期回
路（９）、トラン、ジスタ（Ｔｒ、）を主として構成さ
れる増幅器Ｈが設けられている２、これらの回路構成は
周知のものである。この実施例において、積分回路（６
）の電圧は比較器１８）にて基準電圧（Ｖｒ） と比
較され、基準電圧（Ｖｒ） と一致したとき比較器（
８）は信号を出力する。したがって、増幅器αｌにおい
て、トランジスタ（Ｔｒ、）がオンし、出力信号がなく
なるから、位相制御装置（４）はオフする。一方、同期
回路（９）は交流電源（１）の零点近傍でトランジスタ
（Ｔｒ、）がオフしてトランジスタ（Ｔｒ、）がオンす
る。トランジスタ（Ｔｒ、）がオンすることにより積分
回路（６１の電圧は放電されっぎの半サイクルに備える
ものである。
図と同じ部分には同じ符号を付して説明を省略する。本
実施例において積分回路（６）はコンデンサおよび抵抗
からなるものである。また、本実施例において、トラン
ジスタ（Ｔｒ、） Ｉ （Ｔｒ、）などからなる同期回
路（９）、トラン、ジスタ（Ｔｒ、）を主として構成さ
れる増幅器Ｈが設けられている２、これらの回路構成は
周知のものである。この実施例において、積分回路（６
）の電圧は比較器１８）にて基準電圧（Ｖｒ） と比
較され、基準電圧（Ｖｒ） と一致したとき比較器（
８）は信号を出力する。したがって、増幅器αｌにおい
て、トランジスタ（Ｔｒ、）がオンし、出力信号がなく
なるから、位相制御装置（４）はオフする。一方、同期
回路（９）は交流電源（１）の零点近傍でトランジスタ
（Ｔｒ、）がオフしてトランジスタ（Ｔｒ、）がオンす
る。トランジスタ（Ｔｒ、）がオンすることにより積分
回路（６１の電圧は放電されっぎの半サイクルに備える
ものである。
なお、本発明は上記実施例に限られるものではない。た
とえば負荷は電球でなくともよい。また、交流電源と負
荷との間には整流器を介在させなくともよい。さらに、
制御装置は位相制御装置にオン信号を与えるものでなく
ともよく、要は位相制御装着をオフするものであればよ
い。たとえば位相制御装置に対して他の手段からオン信
号を供給するようにし、制御装置によって前記オン信号
をしゃ断するようにしてもよいものである。
とえば負荷は電球でなくともよい。また、交流電源と負
荷との間には整流器を介在させなくともよい。さらに、
制御装置は位相制御装置にオン信号を与えるものでなく
ともよく、要は位相制御装着をオフするものであればよ
い。たとえば位相制御装置に対して他の手段からオン信
号を供給するようにし、制御装置によって前記オン信号
をしゃ断するようにしてもよいものである。
以上詳述したように本発明は、位相制御装置を交流電源
の半サイクルの前位相期間オンするとともに、交流電源
電圧の整流電圧を積分し基準電圧と比較して前記位相制
御装置をオフするものであるから、精度の高い定電圧特
性を得られるものである。しかも、負荷電圧検出装置を
必要としないから小形かつ安価に提供できる。また、従
来の位相制御装置を交流電源の半サイクルの後位相期間
オンするものと併用した場合電源の入力力率を向上でき
るものである。
の半サイクルの前位相期間オンするとともに、交流電源
電圧の整流電圧を積分し基準電圧と比較して前記位相制
御装置をオフするものであるから、精度の高い定電圧特
性を得られるものである。しかも、負荷電圧検出装置を
必要としないから小形かつ安価に提供できる。また、従
来の位相制御装置を交流電源の半サイクルの後位相期間
オンするものと併用した場合電源の入力力率を向上でき
るものである。
第１図は本発明の概略構成を示すブロック図、！Ｊ２図
は本発明の具体的な一実施例を示す回路図である。 （１）・・・交流電源 （２）・・・負荷（４
）・・・位相制御装置 １５）・・・制御装置。 特許出願人 東芝電材株式会社 代理人 弁理士 小野１）芳 弘
は本発明の具体的な一実施例を示す回路図である。 （１）・・・交流電源 （２）・・・負荷（４
）・・・位相制御装置 １５）・・・制御装置。 特許出願人 東芝電材株式会社 代理人 弁理士 小野１）芳 弘
Claims (2)
- （１）交流電源と； この交流電源から付勢される負荷と； 上記交流電源および上記負荷の間に介挿され上記交流電
源の半サイクルの前位相期間オンする位相制御装置と； 上記交流電源に並列に設けられた整流装置と；この整流
装置の出力を積分し予め設定された基準電圧と比較して
上記位相制御装置をオフする制御Ｖｌ醒と； を具備したことを特徴とする定電圧電源装置。 - （２） 前記位相制御装置はトランジスタを有してな
るものであることを特徴とする特許請求の範囲（１）記
載の定電圧電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5771082A JPS58175031A (ja) | 1982-04-07 | 1982-04-07 | 定電圧電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5771082A JPS58175031A (ja) | 1982-04-07 | 1982-04-07 | 定電圧電源装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58175031A true JPS58175031A (ja) | 1983-10-14 |
Family
ID=13063497
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5771082A Pending JPS58175031A (ja) | 1982-04-07 | 1982-04-07 | 定電圧電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58175031A (ja) |
-
1982
- 1982-04-07 JP JP5771082A patent/JPS58175031A/ja active Pending
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